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100350PC

产品描述Low Power Hex D-Type Latch
产品类别逻辑    逻辑   
文件大小74KB,共7页
制造商Fairchild
官网地址http://www.fairchildsemi.com/
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100350PC概述

Low Power Hex D-Type Latch

100350PC规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称Fairchild
零件包装代码DIP
包装说明DIP, DIP24,.4
针数24
Reach Compliance Codeunknown
Is SamacsysN
其他特性WITH DUAL LATCH ENABLE
系列100K
JESD-30 代码R-PDIP-T24
JESD-609代码e0
长度30.585 mm
逻辑集成电路类型D LATCH
位数6
功能数量1
端子数量24
最高工作温度85 °C
最低工作温度
输出特性OPEN-EMITTER
输出极性COMPLEMENTARY
封装主体材料PLASTIC/EPOXY
封装代码DIP
封装等效代码DIP24,.4
封装形状RECTANGULAR
封装形式IN-LINE
峰值回流温度(摄氏度)NOT SPECIFIED
电源-4.5 V
最大电源电流(ICC)93 mA
Prop。Delay @ Nom-Sup1.5 ns
传播延迟(tpd)1.4 ns
认证状态Not Qualified
座面最大高度5.08 mm
表面贴装NO
技术ECL
温度等级OTHER
端子面层Tin/Lead (Sn/Pb)
端子形式THROUGH-HOLE
端子节距2.54 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
触发器类型LOW LEVEL
宽度10.16 mm
Base Number Matches1

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100350 Low Power Hex D-Type Latch
July 1988
Revised August 2000
100350
Low Power Hex D-Type Latch
General Description
The 100350 contains six D-type latches with true and com-
plement outputs, a pair of common Enables (E
a
and E
b
),
and a common Master Reset (MR). A Q output follows its D
input when both E
a
and E
b
are LOW. When either E
a
or E
b
(or both) are HIGH, a latch stores the last valid data
present on its D input before E
a
or E
b
went HIGH. The MR
input overrides all other inputs and makes the Q outputs
LOW. All inputs have 50 k
pull-down resistors.
Features
s
20% power reduction of the 100150
s
2000V ESD protection
s
Pin/function compatible with 100150
s
Voltage compensated operating range
= −
4.2V to
5.7V
Ordering Code:
Order Number
100350PC
100350QC
Package Number
N24E
V28A
Package Description
24-Lead Plastic Dual-In-Line Package (PDIP), JEDEC MS-010, 0.400 Wide
28-Lead Plastic Lead Chip Carrier (PLCC), JEDEC MO-047, 0.450 Square
Devises also available in Tape and Reel. Specify by appending the suffix letter “X” to the ordering code.
Logic Symbol
Connection Diagrams
24-Pin DIP
Pin Descriptions
28-Pin PLCC
Pin Names
D
0
–D
5
E
a
, E
b
MR
Q
0
–Q
5
Q
0
–Q
5
Data Inputs
Common Enable Inputs (Active LOW)
Asynchronous Master Reset Input
Data Outputs
Complementary Data Outputs
Description
© 2000 Fairchild Semiconductor Corporation
DS009884
www.fairchildsemi.com

100350PC相似产品对比

100350PC 100350 100350QC
描述 Low Power Hex D-Type Latch Low Power Hex D-Type Latch Low Power Hex D-Type Latch
是否Rohs认证 不符合 - 不符合
厂商名称 Fairchild - Fairchild
零件包装代码 DIP - LCC
包装说明 DIP, DIP24,.4 - QCCJ, LDCC28,.5SQ
针数 24 - 28
Reach Compliance Code unknown - unknown
Is Samacsys N - N
其他特性 WITH DUAL LATCH ENABLE - WITH DUAL LATCH ENABLE
系列 100K - 100K
JESD-30 代码 R-PDIP-T24 - S-PQCC-J28
JESD-609代码 e0 - e0
长度 30.585 mm - 11.43 mm
逻辑集成电路类型 D LATCH - D LATCH
位数 6 - 6
功能数量 1 - 1
端子数量 24 - 28
最高工作温度 85 °C - 85 °C
输出特性 OPEN-EMITTER - OPEN-EMITTER
输出极性 COMPLEMENTARY - COMPLEMENTARY
封装主体材料 PLASTIC/EPOXY - PLASTIC/EPOXY
封装代码 DIP - QCCJ
封装等效代码 DIP24,.4 - LDCC28,.5SQ
封装形状 RECTANGULAR - SQUARE
封装形式 IN-LINE - CHIP CARRIER
峰值回流温度(摄氏度) NOT SPECIFIED - NOT SPECIFIED
电源 -4.5 V - -4.5 V
最大电源电流(ICC) 93 mA - 93 mA
Prop。Delay @ Nom-Sup 1.5 ns - 1.3 ns
传播延迟(tpd) 1.4 ns - 1.2 ns
认证状态 Not Qualified - Not Qualified
座面最大高度 5.08 mm - 4.57 mm
表面贴装 NO - YES
技术 ECL - ECL
温度等级 OTHER - OTHER
端子面层 Tin/Lead (Sn/Pb) - Tin/Lead (Sn/Pb)
端子形式 THROUGH-HOLE - J BEND
端子节距 2.54 mm - 1.27 mm
端子位置 DUAL - QUAD
处于峰值回流温度下的最长时间 NOT SPECIFIED - NOT SPECIFIED
触发器类型 LOW LEVEL - LOW LEVEL
宽度 10.16 mm - 11.43 mm
Base Number Matches 1 - 1
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