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LTC2143CUP-14#PBF

产品描述IC ADC DUAL 14BIT 80 MSPS 64-QFN
产品类别模拟混合信号IC    转换器   
文件大小657KB,共38页
制造商Linear ( ADI )
官网地址http://www.analog.com/cn/index.html
标准
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LTC2143CUP-14#PBF概述

IC ADC DUAL 14BIT 80 MSPS 64-QFN

LTC2143CUP-14#PBF规格参数

参数名称属性值
Brand NameLinear Technology
是否Rohs认证符合
厂商名称Linear ( ADI )
零件包装代码QFN
包装说明HVQCCN, LCC64,.35SQ,20
针数64
制造商包装代码UP
Reach Compliance Codecompliant
ECCN代码3A991.C.3
最大模拟输入电压2 V
最小模拟输入电压-2 V
转换器类型ADC, PROPRIETARY METHOD
JESD-30 代码S-PQCC-N64
JESD-609代码e3
长度9 mm
最大线性误差 (EL)0.0159%
湿度敏感等级1
模拟输入通道数量2
位数14
功能数量1
端子数量64
最高工作温度70 °C
最低工作温度
输出位码OFFSET BINARY, 2\'S COMPLEMENT BINARY
输出格式PARALLEL, WORD
封装主体材料PLASTIC/EPOXY
封装代码HVQCCN
封装等效代码LCC64,.35SQ,20
封装形状SQUARE
封装形式CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度(摄氏度)NOT SPECIFIED
电源1.8 V
认证状态Not Qualified
采样速率80 MHz
采样并保持/跟踪并保持SAMPLE
座面最大高度0.8 mm
标称供电电压1.8 V
表面贴装YES
技术CMOS
温度等级COMMERCIAL
端子面层Matte Tin (Sn)
端子形式NO LEAD
端子节距0.5 mm
端子位置QUAD
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度9 mm

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LTC2145-14/
LTC2144-14/LTC2143-14
14-Bit, 125Msps/105Msps/
80Msps Low Power Dual ADCs
FEATURES
n
n
n
n
n
n
n
n
n
n
n
n
n
DESCRIPTION
The LTC
®
2145-14/LTC2144-14/LTC2143-14 are 2-channel
simultaneous sampling 14-bit A/D converters designed
for digitizing high frequency, wide dynamic range signals.
They are perfect for demanding communications applica-
tions with AC performance that includes 73.1dB SNR and
90dB spurious free dynamic range (SFDR). Ultralow jitter
of 0.08ps
RMS
allows undersampling of IF frequencies with
excellent noise performance.
DC specs include ±1LSB INL (typ), ±0.3LSB DNL (typ)
and no missing codes over temperature. The transition
noise is 1.2LSB
RMS
.
The digital outputs can be either full rate CMOS, double
data rate CMOS, or double data rate LVDS. A separate
output power supply allows the CMOS output swing to
range from 1.2V to 1.8V.
The ENC
+
and ENC
inputs may be driven differentially
or single-ended with a sine wave, PECL, LVDS, TTL, or
CMOS inputs. An optional clock duty cycle stabilizer al-
lows high performance at full speed for a wide range of
clock duty cycles.
L,
LT, LTC, LTM, Linear Technology and the Linear logo are registered trademarks of Linear
Technology Corporation. All other trademarks are the property of their respective owners.
Two-Channel Simultaneously Sampling ADC
73.1dB SNR
90dB SFDR
Low Power: 189mW/149mW/113mW Total
95mW/75mW/57mW per Channel
Single 1.8V Supply
CMOS, DDR CMOS, or DDR LVDS Outputs
Selectable Input Ranges: 1V
P-P
to 2V
P-P
750MHz Full Power Bandwidth S/H
Optional Data Output Randomizer
Optional Clock Duty Cycle Stabilizer
Shutdown and Nap Modes
Serial SPI Port for Configuration
64-Pin (9mm × 9mm) QFN Package
APPLICATIONS
n
n
n
n
n
n
Communications
Cellular Base Stations
Software Defined Radios
Portable Medical Imaging
Multi-Channel Data Acquisition
Nondestructive Testing
TYPICAL APPLICATION
1.8V
V
DD
1.8V
OV
DD
64k Point 2-Tone FFT, f
IN
= 69MHz,
70MHz, –1dBFS, 125Msps
0
–10
AMPLITUDE (dBFS)
CH 1
ANALOG
INPUT
S/H
14-BIT
ADC CORE
D1_13
CMOS,
DDR CMOS
OR DDR LVDS
OUTPUTS
–20
–30
–40
–50
–60
–70
–80
D1_0
D2_13
CH 2
ANALOG
INPUT
S/H
14-BIT
ADC CORE
OUTPUT
DRIVERS
D2_0
–90
–100
–110
–120
0
10
20
30
40
FREQUENCY (MHz)
50
60
21454314 TA03b
125MHz
CLOCK
GND
CLOCK
CONTROL
21454314 TA01a
OGND
21454314fa
1
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