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74LVC1G74DP-Q100H

产品描述IC FF D-TYPE SNGL 1BIT 8TSSOP
产品类别逻辑    逻辑   
文件大小798KB,共18页
制造商Nexperia
官网地址https://www.nexperia.com
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74LVC1G74DP-Q100H在线购买

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74LVC1G74DP-Q100H概述

IC FF D-TYPE SNGL 1BIT 8TSSOP

74LVC1G74DP-Q100H规格参数

参数名称属性值
Brand NameNexperia
零件包装代码TSSOP
包装说明TSSOP,
针数8
制造商包装代码SOT505-2
Reach Compliance Codecompliant
系列LVC/LCX/Z
JESD-30 代码S-PDSO-G8
长度3 mm
逻辑集成电路类型D FLIP-FLOP
位数1
功能数量1
端子数量8
最高工作温度125 °C
最低工作温度-40 °C
输出极性COMPLEMENTARY
封装主体材料PLASTIC/EPOXY
封装代码TSSOP
封装形状SQUARE
封装形式SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
传播延迟(tpd)13.4 ns
筛选级别AEC-Q100
座面最大高度1.1 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)1.65 V
标称供电电压 (Vsup)1.8 V
表面贴装YES
技术CMOS
温度等级AUTOMOTIVE
端子形式GULL WING
端子节距0.65 mm
端子位置DUAL
触发器类型POSITIVE EDGE
宽度3 mm
最小 fmax200 MHz
Base Number Matches1

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74LVC1G74-Q100
Single D-type flip-flop with set and reset; positive edge trigger
Rev. 3 — 9 December 2016
Product data sheet
1. General description
The 74LVC1G74-Q100 is a single positive edge triggered D-type flip-flop. It has individual
data (D) inputs, clock (CP) inputs, set (SD) and reset (RD) inputs, and complementary
Q and Q outputs.
This device is fully specified for partial power-down applications using I
OFF
. The I
OFF
circuitry disables the output, preventing damaging backflow current through the device
when it is powered down.
The set and reset are asynchronous active LOW inputs and operate independently of the
clock input. Information on the data input is transferred to the Q output on the
LOW-to-HIGH transition of the clock pulse. The D inputs must be stable one set-up time
prior to the LOW-to-HIGH clock transition for predictable operation. Schmitt trigger action
at all inputs makes the circuit highly tolerant of slower input rise and fall times.
This product has been qualified to the Automotive Electronics Council (AEC) standard
Q100 (Grade 1) and is suitable for use in automotive applications.
2. Features and benefits
Automotive product qualification in accordance with AEC-Q100 (Grade 1)
Specified from
40 C
to +85
C
and from
40 C
to +125
C
Wide supply voltage range from 1.65 V to 5.5 V
5 V tolerant inputs for interfacing with 5 V logic
High noise immunity
Complies with JEDEC standard:
JESD8-7 (1.65 V to 1.95 V)
JESD8-5 (2.3 V to 2.7 V)
JESD8-B/JESD36 (2.7 V to 3.6 V)
ESD protection:
MIL-STD-883, method 3015 exceeds 2000 V
HBM JESD22-A114F exceeds 2000 V
MM JESD22-A115-A exceeds 200 V (C = 200 pF, R = 0
)
24
mA output drive (V
CC
= 3.0 V)
CMOS low power consumption
Latch-up performance exceeds 250 mA
Direct interface with TTL levels
Inputs accept voltages up to 5 V

74LVC1G74DP-Q100H相似产品对比

74LVC1G74DP-Q100H 74LVC1G74DC-Q100H 74LVC1G74GD-Q100H
描述 IC FF D-TYPE SNGL 1BIT 8TSSOP IC FF D-TYPE SNGL 1BIT 8VSSOP IC FF D-TYPE SNGL 1BIT 8XSON
Brand Name Nexperia Nexperia Nexperia
零件包装代码 TSSOP SSOP SON
包装说明 TSSOP, VSSOP, 3 X 2 MM, 0.50 MM PITCH, 0.50 MM HEIGHT, PLASTIC, SOT996-2, XSON-8
针数 8 8 8
制造商包装代码 SOT505-2 SOT765-1 SOT996-2
Reach Compliance Code compliant compliant compliant
系列 LVC/LCX/Z LVC/LCX/Z -
JESD-30 代码 S-PDSO-G8 R-PDSO-G8 -
长度 3 mm 2.3 mm -
逻辑集成电路类型 D FLIP-FLOP D FLIP-FLOP -
位数 1 1 -
功能数量 1 1 -
端子数量 8 8 -
最高工作温度 125 °C 125 °C -
最低工作温度 -40 °C -40 °C -
输出极性 COMPLEMENTARY COMPLEMENTARY -
封装主体材料 PLASTIC/EPOXY PLASTIC/EPOXY -
封装代码 TSSOP VSSOP -
封装形状 SQUARE RECTANGULAR -
封装形式 SMALL OUTLINE, THIN PROFILE, SHRINK PITCH SMALL OUTLINE, VERY THIN PROFILE, SHRINK PITCH -
传播延迟(tpd) 13.4 ns 13.4 ns -
筛选级别 AEC-Q100 AEC-Q100 -
座面最大高度 1.1 mm 1 mm -
最大供电电压 (Vsup) 5.5 V 5.5 V -
最小供电电压 (Vsup) 1.65 V 1.65 V -
标称供电电压 (Vsup) 1.8 V 1.8 V -
表面贴装 YES YES -
技术 CMOS CMOS -
温度等级 AUTOMOTIVE AUTOMOTIVE -
端子形式 GULL WING GULL WING -
端子节距 0.65 mm 0.5 mm -
端子位置 DUAL DUAL -
触发器类型 POSITIVE EDGE POSITIVE EDGE -
宽度 3 mm 2 mm -
最小 fmax 200 MHz 200 MHz -
厂商名称 - Nexperia Nexperia

 
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