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LTC2232IUK#TRPBF

产品描述IC ADC 10BIT 105MSPS SAMPL 48QFN
产品类别模拟混合信号IC    转换器   
文件大小812KB,共28页
制造商Linear ( ADI )
官网地址http://www.analog.com/cn/index.html
标准
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LTC2232IUK#TRPBF概述

IC ADC 10BIT 105MSPS SAMPL 48QFN

LTC2232IUK#TRPBF规格参数

参数名称属性值
Brand NameLinear Technology
是否Rohs认证符合
厂商名称Linear ( ADI )
零件包装代码QFN
包装说明HVQCCN, LCC48,.27SQ,20
针数48
制造商包装代码UK
Reach Compliance Codecompliant
ECCN代码3A991.C.1
最大模拟输入电压1 V
最小模拟输入电压-1 V
转换器类型ADC, PROPRIETARY METHOD
JESD-30 代码S-PQCC-N48
JESD-609代码e3
长度7 mm
最大线性误差 (EL)0.0781%
湿度敏感等级1
模拟输入通道数量1
位数10
功能数量1
端子数量48
最高工作温度85 °C
最低工作温度-40 °C
输出位码OFFSET BINARY, 2\'S COMPLEMENT BINARY
输出格式PARALLEL, WORD
封装主体材料PLASTIC/EPOXY
封装代码HVQCCN
封装等效代码LCC48,.27SQ,20
封装形状SQUARE
封装形式CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度(摄氏度)260
电源3.3 V
认证状态Not Qualified
采样速率105 MHz
采样并保持/跟踪并保持SAMPLE
座面最大高度0.8 mm
标称供电电压3.3 V
表面贴装YES
技术CMOS
温度等级INDUSTRIAL
端子面层Matte Tin (Sn)
端子形式NO LEAD
端子节距0.5 mm
端子位置QUAD
处于峰值回流温度下的最长时间30
宽度7 mm

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LTC2232/LTC2233
10-Bit,105Msps/
80Msps ADCs
FEATURES
DESCRIPTIO
Sample Rate: 105Msps/80Msps
61dB SNR up to 140MHz Input
75dB SFDR up to 200MHz Input
775MHz Full Power Bandwidth S/H
Single 3.3V Supply
Low Power Dissipation: 475mW/366mW
Selectable Input Ranges:
±0.5V
or
±1V
No Missing Codes
Optional Clock Duty Cycle Stabilizer
Shutdown and Nap Modes
Data Ready Output Clock
Pin Compatible Family
135Msps: LTC2224 (12-Bit), LTC2234 (10-Bit)
105Msps: LTC2222 (12-Bit), LTC2232 (10-Bit)
80Msps: LTC2223 (12-Bit), LTC2233 (10-Bit)
48-Pin 7mm x 7mm QFN Package
The LTC
®
2232 and LTC2233 are 105Msps/80Msps, sam-
pling 10-bit A/D converters designed for digitizing high
frequency, wide dynamic range signals. The LTC2232/
LTC2233 are perfect for demanding communications
applications with AC performance that includes 61dB SNR
and 75dB spurious free dynamic range for signals
up to 200MHz. Ultralow jitter of 0.15ps
RMS
allows
undersampling of IF frequencies with excellent noise
performance.
DC specs include
±0.15LSB
INL (typ),
±0.1LSB
DNL (typ)
and
±0.8LSB
INL,
±0.6LSB
DNL over temperature. The
transition noise is a low 0.12LSB
RMS
.
A separate output power supply allows the outputs to drive
0.5V to 3.6V logic.
The ENC
+
and ENC
inputs may be driven differentially or
single ended with a sine wave, PECL, LVDS, TTL, or CMOS
inputs. An optional clock duty cycle stabilizer allows high
performance at full speed for a wide range of clock duty
cycles.
, LTC and LT are registered trademarks of Linear Technology Corporation.
All other trademarks are the property of their respective owners.
APPLICATIO S
Wireless and Wired Broadband Communication
Cable Head-End Systems
Power Amplifier Linearization
Communications Test Equipment
TYPICAL APPLICATIO
REFH
REFL
3.3V
V
DD
FLEXIBLE
REFERENCE
0.5V
TO 3.6V
OV
DD
ANALOG
INPUT
INPUT
S/H
10-BIT
PIPELINED
ADC CORE
CORRECTION
LOGIC
OUTPUT
DRIVERS
SFDR (dBFS)
+
D9
D0
OGND
CLOCK/DUTY
CYCLE
CONTROL
22323 TA01
ENCODE INPUT
U
SFDR vs Input Frequency
90
85
4th OR HIGHER
80
75
70
2nd OR 3rd
65
60
55
50
0
100
200
300
400
500
600
22323 TA01b
INPUT FREQUENCY (MHz)
22323fa
U
U
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