Datasheet> 器件分类 > 逻辑> 逻辑> 74ALVT16260DL,518

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74ALVT16260DL,518: 产品描述IC 12-24BIT MUX D LATCH 56SSOP; 产品类别逻辑逻辑; 文件大小102KB，共18页; 制造商NXP(恩智浦); 官网地址https://www.nxp.com; 标准

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74ALVT16260DL,518概述

IC 12-24BIT MUX D LATCH 56SSOP

74ALVT16260DL,518规格参数

参数名称	属性值
Brand Name	NXP Semiconductor
是否Rohs认证	符合
零件包装代码	SSOP
包装说明	SSOP,
针数	56
制造商包装代码	SOT371-1
Reach Compliance Code	compliant
其他特性	USER SELECTABLE 3.3V VCC
系列	ALVT
JESD-30 代码	R-PDSO-G56
长度	18.425 mm
逻辑集成电路类型	MULTIPLEXER AND DEMUX/DECODER
湿度敏感等级	2
功能数量	12
端子数量	56
最高工作温度	85 °C
最低工作温度	-40 °C
输出特性	3-STATE
封装主体材料	PLASTIC/EPOXY
封装代码	SSOP
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE, SHRINK PITCH
峰值回流温度（摄氏度）	260
认证状态	Not Qualified
座面最大高度	2.8 mm
最大供电电压 (Vsup)	2.7 V
最小供电电压 (Vsup)	2.3 V
标称供电电压 (Vsup)	2.5 V
表面贴装	YES
技术	BICMOS
温度等级	INDUSTRIAL
端子形式	GULL WING
端子节距	0.635 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	40
宽度	7.5 mm
Base Number Matches	1

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74ALVT16260

12-bit to 24-bit multiplexed D-type latches; 3-state

Rev. 03 — 20 March 2006

Product data sheet

1. General description

The 74ALVT16260 is a 12-bit to 24-bit multiplexed D-type latch used in applications where

two separate data paths must be multiplexed onto, or demultiplexed from, a single data

path. Typical applications include multiplexing or demultiplexing of address and data

information in microprocessor or bus-interface applications. This device is also useful in

memory-interleaving applications.

Three 12-bit I/O ports (A1 to A12, 1B1 to 1B12 and 2B1 to 2B12) are available for address

or data transfer. The output enable inputs (OE1B, OE2B, and OEA) control the bus

transceiver functions. OE1B and OE2B also allow bank control in the A to B direction.

Address or data information can be stored using the internal storage latches. The latch

enable inputs (LE1B, LE2B, LEA1B and LEA2B) are used to control data storage. When

the latch enable input is HIGH, the latch is transparent. When the latch enable input goes

LOW, the data present at the inputs is latched and remains latched until the latch enable

input is returned HIGH.

To ensure the high-impedance state during power-up or power-down, all output enable

inputs should be tied to V

through a pull-up resistor. The minimum value of the resistor

is determined by the current sinking capability of the driver.

The 74ALVT16260 is available in a SSOP56 and a TSSOP56 package.

2. Features

5 V I/O compatible

Bus hold inputs eliminate the need for external pull-up resistors

Live insertion and extraction permitted

Power-up 3-state

Power-up reset

Output capability: +64 mA and

−32

Distributed V

and GND pin conﬁguration minimizes high-speed switching noise

Latch-up protection:

JESD78: exceeds 500 mA

ESD protection:

MIL STD 883C, method 3015: exceeds 2000 V

Machine model: exceeds 200 V

74ALVT16260DL,518相似产品对比

	74ALVT16260DL,518	74ALVT16260DG-T	935260345518	74ALVT16260DL,512	935260344512	935260344518
描述	IC 12-24BIT MUX D LATCH 56SSOP	闭锁 12-bit TO 24-bit mulitplexed D	ALVT SERIES, 12-BIT EXCHANGER, TRUE OUTPUT, PDSO56, 7.50 MM, PLASTIC, MO-118AB, SOT-371-1, SSOP3-56	IC 12-24BIT MUX D LATCH 56-SSOP	ALVT SERIES, 12-BIT EXCHANGER, TRUE OUTPUT, PDSO56, 6.10 MM, PLASTIC, SOT-364-1, TSSOP2-56	ALVT SERIES, 12-BIT EXCHANGER, TRUE OUTPUT, PDSO56, 6.10 MM, PLASTIC, SOT-364-1, TSSOP2-56
包装说明	SSOP,	6.10 MM, PLASTIC, SOT-364-1, TSSOP2-56	SSOP,	7.50 MM, PLASTIC, MO-118AB, SOT-371-1, SSOP3-56	TSSOP,	TSSOP,
Reach Compliance Code	compliant	unknow	unknown	compliant	unknow	unknow
其他特性	USER SELECTABLE 3.3V VCC	USER SELECTABLE 3.3V VCC	USER SELECTABLE 3.3V VCC	USER SELECTABLE 3.3V VCC	USER SELECTABLE 3.3V VCC	USER SELECTABLE 3.3V VCC
系列	ALVT	ALVT	ALVT	ALVT	ALVT	ALVT
JESD-30 代码	R-PDSO-G56	R-PDSO-G56	R-PDSO-G56	R-PDSO-G56	R-PDSO-G56	R-PDSO-G56
长度	18.425 mm	14.15 mm	18.425 mm	18.425 mm	14.15 mm	14.15 mm
逻辑集成电路类型	MULTIPLEXER AND DEMUX/DECODER	BUS EXCHANGER	BUS EXCHANGER	BUS EXCHANGER	BUS EXCHANGER	BUS EXCHANGER
功能数量	12	1	1	1	1	1
端子数量	56	56	56	56	56	56
最高工作温度	85 °C	85 °C	85 °C	85 °C	85 °C	85 °C
最低工作温度	-40 °C	-40 °C	-40 °C	-40 °C	-40 °C	-40 °C
输出特性	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE	3-STATE
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	SSOP	TSSOP	SSOP	SSOP	TSSOP	TSSOP
封装形状	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR
封装形式	SMALL OUTLINE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, SHRINK PITCH	SMALL OUTLINE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
座面最大高度	2.8 mm	1.2 mm	2.8 mm	2.8 mm	1.2 mm	1.2 mm
最大供电电压 (Vsup)	2.7 V	2.7 V	2.7 V	2.7 V	2.7 V	2.7 V
最小供电电压 (Vsup)	2.3 V	2.3 V	2.3 V	2.3 V	2.3 V	2.3 V
标称供电电压 (Vsup)	2.5 V	2.5 V	2.5 V	2.5 V	2.5 V	2.5 V
表面贴装	YES	YES	YES	YES	YES	YES
技术	BICMOS	BICMOS	BICMOS	BICMOS	BICMOS	BICMOS
温度等级	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL	INDUSTRIAL
端子形式	GULL WING	GULL WING	GULL WING	GULL WING	GULL WING	GULL WING
端子节距	0.635 mm	0.5 mm	0.635 mm	0.635 mm	0.5 mm	0.5 mm
端子位置	DUAL	DUAL	DUAL	DUAL	DUAL	DUAL
宽度	7.5 mm	6.25 mm	7.5 mm	7.5 mm	6.25 mm	6.25 mm
厂商名称	-	NXP(恩智浦)	-	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)
JESD-609代码	-	e0	e4	e4	e4	e4
位数	-	12	12	12	12	12
端口数量	-	3	3	3	3	3
输出极性	-	TRUE	TRUE	TRUE	TRUE	TRUE
传播延迟（tpd）	-	6.2 ns	6.2 ns	6.2 ns	6.2 ns	6.2 ns
端子面层	-	TIN LEAD	NICKEL PALLADIUM GOLD	Nickel/Palladium/Gold (Ni/Pd/Au)	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD

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