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74ACT280TTR

产品描述ACT SERIES, 9-BIT PARITY GENERATOR/CHECKER, COMPLEMENTARY OUTPUT, PDSO14, TSSOP-14
产品类别逻辑   
文件大小67KB,共9页
制造商ST(意法半导体)
官网地址http://www.st.com/
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74ACT280TTR概述

ACT SERIES, 9-BIT PARITY GENERATOR/CHECKER, COMPLEMENTARY OUTPUT, PDSO14, TSSOP-14

74ACT280TTR规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称ST(意法半导体)
零件包装代码TSSOP
包装说明TSSOP-14
针数14
Reach Compliance Codenot_compliant
系列ACT
JESD-30 代码R-PDSO-G14
JESD-609代码e0
长度5 mm
逻辑集成电路类型PARITY GENERATOR/CHECKER
位数9
功能数量1
端子数量14
最高工作温度125 °C
最低工作温度-55 °C
输出极性COMPLEMENTARY
封装主体材料PLASTIC/EPOXY
封装代码TSSOP
封装等效代码TSSOP14,.25
封装形状RECTANGULAR
封装形式SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
峰值回流温度(摄氏度)NOT SPECIFIED
电源5 V
传播延迟(tpd)14.5 ns
认证状态Not Qualified
座面最大高度1.2 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级MILITARY
端子面层Tin/Lead (Sn/Pb)
端子形式GULL WING
端子节距0.65 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度4.4 mm
Base Number Matches1

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74ACT280
9 BIT PARITY GENERATOR/CHECKER
s
s
s
s
s
s
s
s
s
HIGH SPEED: t
PD
= 7ns (TYP.) at V
CC
= 5V
LOW POWER DISSIPATION:
I
CC
= 4µA(MAX.) at T
A
=25°C
COMPATIBLE WITH TTL OUTPUTS
V
IH
= 2V (MIN.), V
IL
= 0.8V (MAX.)
50Ω TRANSMISSION LINE DRIVING
CAPABILITY
SYMMETRICAL OUTPUT IMPEDANCE:
|I
OH
| = I
OL
= 24mA (MIN)
BALANCED PROPAGATION DELAYS:
t
PLH
t
PHL
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 4.5V to 5.5V
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 280
IMPROVED LATCH-UP IMMUNITY
DIP
SOP
TSSOP
ORDER CODES
PACKAGE
DIP
SOP
TSSOP
TUBE
74ACT280B
74ACT280M
T&R
74ACT280MTR
74ACT280TTR
DESCRIPTION
The 74ACT280 is an advanced high-speed CMOS
9 BIT PARITY GENERATOR CHECKER
fabricated with sub-micron silicon gate and
double-layer metal wiring C
2
MOS tecnology.
It is composed of nine data inputs (A to I) and odd/
even parity outputs (ΣODD and
ΣEVEN).
The nine
data inputs control the output conditions. When
the number of high level input is odd,
ΣODD
output is kept high and
ΣEVEN
output low.
PIN CONNECTION AND IEC LOGIC SYMBOLS
Conservely, when the output is even,
ΣEVEN
output is kept high and
ΣODD
low.
The IC generates either odd or even parity making
it flexible application. The word-length capability is
easly expanded by cascading.
The device is designed to interface directly High
Speed CMOS systems with TTL, NMOS and
CMOS output voltage levels.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
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1/9
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