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SY10H641AJC

产品描述SINGLE SUPPLY 1:9 PECL-TO-TTL
产品类别逻辑    逻辑   
文件大小179KB,共5页
制造商Microchip(微芯科技)
官网地址https://www.microchip.com
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SY10H641AJC概述

SINGLE SUPPLY 1:9 PECL-TO-TTL

SY10H641AJC规格参数

参数名称属性值
是否Rohs认证不符合
包装说明QCCJ,
Reach Compliance Codecompli
系列S
输入调节DIFFERENTIAL LATCHED
JESD-30 代码S-PQCC-J28
长度11.48 mm
逻辑集成电路类型LOW SKEW CLOCK DRIVER
功能数量1
反相输出次数
端子数量28
实输出次数9
最高工作温度85 °C
最低工作温度
封装主体材料PLASTIC/EPOXY
封装代码QCCJ
封装形状SQUARE
封装形式CHIP CARRIER
传播延迟(tpd)6.9 ns
认证状态Not Qualified
Same Edge Skew-Max(tskwd)0.3 ns
座面最大高度4.57 mm
最大供电电压 (Vsup)5.25 V
最小供电电压 (Vsup)4.75 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术BIPOLAR
温度等级OTHER
端子形式J BEND
端子节距1.27 mm
端子位置QUAD
宽度11.48 mm
最小 fmax80 MHz
Base Number Matches1

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SEMICONDUCTOR
SYNERGY
SINGLE SUPPLY 1:9
PECL-TO-TTL
ClockWorks™
SY10H641A
ClockWorks™
SY100H641A
SY10H641A
SY100H641A
FEATURES
s
s
s
s
s
s
Input frequencies up to 80MHz
PECL-to-TTL version of popular ECLinPS E111
Guaranteed low skew specification
Latched input
Differential ECL internal design
V
BB
output for single-ended operation
DESCRIPTION
The SY10/100H641A are single supply, low skew
translating 1:9 clock drivers. Devices in the Synergy H600
translator series utilize the 28-lead PLCC for optimal
power pinning, signal flow-through and electrical
performance.
The devices feature a 24mA TTL output stage with
AC performance specified into a 50pF load capacitance.
A latch is provided on-chip. When LEN is LOW (or left
open, in which case it is pulled LOW by the internal pull-
downs), the latch is transparent. A HIGH on the enable
pin (EN) forces all outputs LOW.
The 10H version is compatible with MECL 10KH ECL
logic levels. The 100H version is compatible with 100K
levels.
s
Single +5V supply
s
Reset/enable
s
Extra TTL and ECL power/ground pins
s
Choice of ECL compatibility: MECL 10KH (10Hxxx)
or 100K (100Hxxx)
s
ESD protection of 2000V
s
Fully compatible with Motorola MC10H641/100H641
s
Available in 28-pin PLCC package
BLOCK DIAGRAM
TTL Outputs
Q
0
PIN CONFIGURATION
Q
6
V
T
Q
7
V
T
Q
8
G
T
18
17
16
25 24 23 22 21 20 19
Q
1
Q
2
G
T
Q
5
V
T
Q
4
V
T
Q
3
G
T
26
27
28
1
2
3
4
5
6
7
8
9
10 11
G
T
V
BB
D
D
V
E
LEN
G
E
EN
TOP VIEW
PLCC
15
14
13
12
Q
3
G
T
Q
2
V
T
Q
1
V
T
Q
0
G
T
PECL Input
D
D
V
BB
Q
5
LEN
EN
Q
6
D
Q
Q
4
PIN NAMES
Pin
G
T
V
T
V
E
G
E
D, D
Function
TTL Ground (0V)
TTL V
CC
(+5.0V)
ECL V
CC
(+5.0V)
ECL Ground (0V)
Signal Input (PECL)
V
BB
Reference Output (PECL)
Signal Outputs (TTL)
Enable Input (PECL)
Latch Enable Input (PECL)
Rev.: D
Amendment: /0
Issue Date: February, 1999
Q
7
V
BB
Q
0
- Q
8
EN
Q
8
© 1999 Micrel-Synergy
LEN
5-356

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