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CY7B992-7JXCT: 产品描述Phase Locked Loops - PLL Programmable Skew Clk Buffer 80MHz 5V; 产品类别逻辑逻辑; 文件大小464KB，共22页; 制造商Cypress(赛普拉斯); 标准

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Phase Locked Loops - PLL Programmable Skew Clk Buffer 80MHz 5V

	CY7B992-7JXCT	CY7B992-7JXC
描述	Phase Locked Loops - PLL Programmable Skew Clk Buffer 80MHz 5V	Phase Locked Loops - PLL Programmable Skew Clk Buffer 80MHz 5V
是否Rohs认证	符合	符合
零件包装代码	QFJ	QFJ
包装说明	QCCJ, LDCC32,.5X.6	QCCJ, LDCC32,.5X.6
针数	32	32
Reach Compliance Code	unknown	unknown
ECCN代码	EAR99	EAR99
系列	7B	7B
输入调节	STANDARD	STANDARD
JESD-30 代码	R-PQCC-J32	R-PQCC-J32
长度	13.97 mm	13.97 mm
逻辑集成电路类型	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER
最大I（ol）	0.046 A	0.046 A
功能数量	4	4
端子数量	32	32
实输出次数	4	4
最高工作温度	85 °C	85 °C
最低工作温度	-40 °C	-40 °C
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	QCCJ	QCCJ
封装等效代码	LDCC32,.5X.6	LDCC32,.5X.6
封装形状	RECTANGULAR	RECTANGULAR
封装形式	CHIP CARRIER	CHIP CARRIER
电源	5 V	5 V
Prop。Delay @ Nom-Sup	0.7 ns	0.7 ns
传播延迟（tpd）	0.7 ns	0.7 ns
认证状态	Not Qualified	Not Qualified
Same Edge Skew-Max（tskwd）	1.5 ns	1.5 ns
座面最大高度	3.556 mm	3.556 mm
最大供电电压 (Vsup)	5.5 V	5.5 V
最小供电电压 (Vsup)	4.5 V	4.5 V
标称供电电压 (Vsup)	5 V	5 V
表面贴装	YES	YES
温度等级	INDUSTRIAL	INDUSTRIAL
端子形式	J BEND	J BEND
端子节距	1.27 mm	1.27 mm
端子位置	QUAD	QUAD
宽度	11.43 mm	11.43 mm
最小 fmax	80 MHz	80 MHz

器件捷径: L0 L1 L2 L3 L4 L5 L6 L7 L8 L9 LA LB LC LD LE LF LG LH LI LJ LK LL LM LN LO LP LQ LR LS LT LU LV LW LX LY LZ M0 M1 M2 M3 M4 M5 M6 M7 M8 M9 MA MB MC MD ME MF MG MH MI MJ MK ML MM MN MO MP MQ MR MS MT MU MV MW MX MY MZ N0 N1 N2 N3 N4 N5 N6 N7 N8 NA NB NC ND NE NF NG NH NI NJ NK NL NM NN NO NP NQ NR NS NT NU NV NX NZ O0 O1 O2 O3 OA OB OC OD OE OF OG OH OI OJ OK OL OM ON OP OQ OR OS OT OV OX OY OZ P0 P1 P2 P3 P4 P5 P6 P7 P8 P9 PA PB PC PD PE PF PG PH PI PJ PK PL PM PN PO PP PQ PR PS PT PU PV PW PX PY PZ Q1 Q2 Q3 Q4 Q5 Q6 Q8 Q9 QA QB QC QE QF QG QH QK QL QM QP QR QS QT QV QW QX QY R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 RA RB RC RD RE RF RG RH RI RJ RK RL RM RN RO RP RQ RR RS RT RU RV RW RX RY RZ

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