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PSD854F2V-12MI: 产品描述CPLD - Complex Programmable Logic Devices 3.0V 2M 120ns; 产品类别嵌入式处理器和控制器微控制器和处理器; 文件大小741KB，共109页; 制造商ST(意法半导体); 官网地址http://www.st.com/; 标准

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CPLD - Complex Programmable Logic Devices 3.0V 2M 120ns

参数名称	属性值
是否Rohs认证	符合
厂商名称	ST(意法半导体)
零件包装代码	QFP
包装说明	PLASTIC, QFP-52
针数	52
Reach Compliance Code	compliant
ECCN代码	EAR99
最长访问时间	1.2e-7 ns
JESD-30 代码	S-PQFP-G52
JESD-609代码	e4
长度	10 mm
I/O 线路数量	27
端口数量	4
端子数量	52
最高工作温度	85 °C
最低工作温度	-40 °C
封装主体材料	PLASTIC/EPOXY
封装代码	QFP
封装等效代码	QFP52,.52SQ
封装形状	SQUARE
封装形式	FLATPACK
峰值回流温度（摄氏度）	NOT SPECIFIED
电源	3.3 V
认证状态	Not Qualified
ROM大小（位）	2097152 Bits
座面最大高度	2.35 mm
最大待机电流	0.0001 A
最大供电电压	3.6 V
最小供电电压	3 V
标称供电电压	3.3 V
表面贴装	YES
技术	CMOS
温度等级	INDUSTRIAL
端子面层	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式	GULL WING
端子节距	0.65 mm
端子位置	QUAD
处于峰值回流温度下的最长时间	NOT SPECIFIED
紫外线可擦	N
宽度	10 mm
uPs/uCs/外围集成电路类型	PARALLEL IO PORT, GENERAL PURPOSE

器件捷径: E0 E1 E2 E3 E4 E5 E6 E7 E8 E9 EA EB EC ED EE EF EG EH EI EJ EK EL EM EN EO EP EQ ER ES ET EU EV EW EX EY EZ F0 F1 F2 F3 F4 F5 F6 F7 F8 F9 FA FB FC FD FE FF FG FH FI FJ FK FL FM FN FO FP FQ FR FS FT FU FV FW FX FY FZ G0 G1 G2 G3 G4 G5 G6 G7 G8 G9 GA GB GC GD GE GF GG GH GI GJ GK GL GM GN GO GP GQ GR GS GT GU GV GW GX GZ H0 H1 H2 H3 H4 H5 H6 H7 H8 HA HB HC HD HE HF HG HH HI HJ HK HL HM HN HO HP HQ HR HS HT HU HV HW HX HY HZ I1 I2 I3 I4 I5 I6 I7 IA IB IC ID IE IF IG IH II IK IL IM IN IO IP IQ IR IS IT IU IV IW IX J0 J1 J2 J6 J7 JA JB JC JD JE JF JG JH JJ JK JL JM JN JP JQ JR JS JT JV JW JX JZ K0 K1 K2 K3 K4 K5 K6 K7 K8 K9 KA KB KC KD KE KF KG KH KI KJ KK KL KM KN KO KP KQ KR KS KT KU KV KW KX KY KZ

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