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SI4122-D-GM

产品描述Phase Locked Loops - PLL SINGLE BAND RF MLP-28
产品类别热门应用    无线/射频/通信   
文件大小947KB,共36页
制造商Silicon Laboratories
标准
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SI4122-D-GM概述

Phase Locked Loops - PLL SINGLE BAND RF MLP-28

SI4122-D-GM规格参数

参数名称属性值
Product AttributeAttribute Value
制造商
Manufacturer
Silicon Laboratories
产品种类
Product Category
Phase Locked Loops - PLL
RoHSDetails
类型
Type
RF Synthesizer
Number of Circuits3
Maximum Input Frequency26 MHz
Minimum Input Frequency2 MHz
电源电压-最大
Supply Voltage - Max
3.6 V
电源电压-最小
Supply Voltage - Min
2.7 V
最小工作温度
Minimum Operating Temperature
- 40 C
最大工作温度
Maximum Operating Temperature
+ 85 C
安装风格
Mounting Style
SMD/SMT
封装 / 箱体
Package / Case
MLP-28
系列
Packaging
Tray
高度
Height
0.84 mm
长度
Length
5 mm
宽度
Width
5 mm
Moisture SensitiveYes
工作电源电压
Operating Supply Voltage
2.7 V to 3.6 V
工厂包装数量
Factory Pack Quantity
490
单位重量
Unit Weight
0.002243 oz

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Si4133
Si4123/22/13/12
D
U A L
- B
A N D
R F S
Y N T H E S I Z E R
W
I T H
I
N TE G R A T E D
V C O
S
F
OR
W
I R E L E S S
C
O M M U N I C A T I O N S
F
EATURES
Dual-band RF synthesizers
900 MHz to 1.8 GHz

RF2: 750 MHz to 1.5 GHz

RF1:
IF synthesizer

IF:
62.5 to 1000 MHz
Integrated VCOs, loop filters,
varactors, and resonators
Minimal (2) number of external
components required
Low phase noise
Programmable powerdown modes
1 µA standby current
18 mA typical supply current
2.7 to 3.6 V operation
Packages: 24-pin TSSOP,
28-lead QFN

Lead-free
Ordering Information:
See page 31.
and RoHS compliant
Applications
Pin Assignments
Dual-band communications
Digital cellular telephones GSM 850, E-GSM 900, DCS 1800,
PCS 1900
Digital cordless phones
Analog cordless phones
Wireless local loop
Si4133-GT
SCLK
SDATA
GNDR
RFLD
1
2
3
4
5
6
7
8
9
10
11
12
24
23
22
21
20
19
18
17
16
15
14
13
SEN
VDDI
IFOUT
GNDI
IFLB
IFLA
GNDD
VDDD
GNDD
XIN
PWDN
AUXOUT
Description
The Si4133 is a monolithic integrated circuit that performs both IF and dual-
band RF synthesis for wireless communications applications. The Si4133
includes three VCOs, loop filters, reference and VCO dividers, and phase
detectors. Divider and powerdown settings are programmable with a three-
wire serial interface.
RFLC
GNDR
RFLB
RFLA
GNDR
GNDR
RFOUT
Functional Block Diagram
VDDR
XIN
SDATA
IFOUT
GNDR
Reference
Amplifier
Powerdown
Control
R
Si4133-GM
SCLK
RF1
PWDN
N
R
Phase
Detector
RF2
RFOUT
GNDR
28 27 26 25 24 23 22
1
2
3
4
5
6
7
8
GNDR
SEN
VDDI
RFLB
GNDI
Phase
Detector
RFLA
21
20
19
GNDI
IFLB
IFLA
GNDD
VDDD
GNDD
XIN
SDATA
SCLK
SEN
Serial
Interface
22-bit
Data
Register
RFLC
RFLD
RFLD
RFLC
GNDR
RFLB
N
R
Phase
Detector
IF
GND
Pad
18
17
16
15
AUXOUT
Test
Mux
IFDIV
IFOUT
RFLA
GNDR
PWDN
GNDR
Patents pending
Rev. 1.61 1/10
Copyright © 2010 by Silicon Laboratories
Si4133
RFOUT
GNDD
VDDR
IFLB
AUXOUT
N
IFLA
9
10 11 12 13 14
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