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70V3569S4DR

产品描述SRAM 16K X 36 SYNCH DPRAM
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文件大小193KB,共18页
制造商IDT (Integrated Device Technology)
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70V3569S4DR在线购买

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70V3569S4DR概述

SRAM 16K X 36 SYNCH DPRAM

70V3569S4DR规格参数

参数名称属性值
Brand NameIntegrated Device Technology
是否无铅含铅
是否Rohs认证不符合
厂商名称IDT (Integrated Device Technology)
零件包装代码PQFP
包装说明QFP, QFP208,1.2SQ,20
针数208
制造商包装代码DR208
Reach Compliance Codenot_compliant
ECCN代码3A991.B.2.B
最长访问时间4.2 ns
其他特性PIPELINED OUTPUT MODE, SELF TIMED WRITE CYCLE
最大时钟频率 (fCLK)133 MHz
I/O 类型COMMON
JESD-30 代码S-PQFP-G208
JESD-609代码e0
内存密度589824 bit
内存集成电路类型DUAL-PORT SRAM
内存宽度36
湿度敏感等级3
功能数量1
端口数量2
端子数量208
字数16384 words
字数代码16000
工作模式SYNCHRONOUS
最高工作温度70 °C
最低工作温度
组织16KX36
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码QFP
封装等效代码QFP208,1.2SQ,20
封装形状SQUARE
封装形式FLATPACK
并行/串行PARALLEL
峰值回流温度(摄氏度)225
电源2.5/3.3,3.3 V
认证状态Not Qualified
最大待机电流0.015 A
最小待机电流3.15 V
最大压摆率0.46 mA
最大供电电压 (Vsup)3.45 V
最小供电电压 (Vsup)3.15 V
标称供电电压 (Vsup)3.3 V
表面贴装YES
技术CMOS
温度等级COMMERCIAL
端子面层Tin/Lead (Sn/Pb)
端子形式GULL WING
端子节距0.5 mm
端子位置QUAD
处于峰值回流温度下的最长时间NOT SPECIFIED

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IDT70V3569S
HIGH-SPEED 3.3V 16K x 36
SYNCHRONOUS PIPELINED
DUAL-PORT STATIC RAM
WITH 3.3V OR 2.5V INTERFACE
LEAD FINISH (SnPb) ARE IN EOL PROCESS - LAST TIME BUY EXPIRES JUNE 15, 2018
Features:
True Dual-Port memory cells which allow simultaneous
access of the same memory location
High-speed clock to data access
– Commercial: 4.2/5/6ns (max.)
– Industrial: 5ns (max)
Pipelined output mode
Counter enable and reset features
Dual chip enables allow for depth expansion without
additional logic
Full synchronous operation on both ports
– 7.5ns cycle time, 133MHz operation (9.6 Gbps bandwidth)
– Fast 4.2ns clock to data out
– 1.8ns setup to clock and 0.7ns hold on all control, data, and
address inputs @ 133MHz
– Data input, address, byte enable and control registers
– Self-timed write allows fast cycle time
Separate byte controls for multiplexed bus and bus
matching compatibility
LVTTL- compatible, single 3.3V (±150mV) power supply for
core
LVTTL- compatible, selectable 3.3V (±150mV)/2.5V (±125mV)
power supply for I/Os and control signals on each port
Industrial temperature range (-40°C to +85°C) is
available for selected speeds
Available in a 208-pin Plastic Quad Flatpack (PQFP),
208-ball fine-pitch Ball Grid Array, and 256-pin Ball
Grid Array
Green parts availble, see ordering instructions
Functional Block Diagram
BE
3L
BE
3R
BE
2L
BE
1L
BE
0L
BE
2R
BE
1R
BE
0R
R/W
L
B B
WW
0 1
L L
B B
WW
2 3
L L
B BB B
W WW W
3 2 1 0
R RR R
R/W
R
CE
0L
CE
1L
CE
0R
CE
1R
OE
L
Dout0-8_L
Dout9-17_L
Dout18-26_L
Dout27-35_L
Dout0-8_R
Dout9-17_R
Dout18-26_R
Dout27-35_R
OE
R
16K x 36
MEMORY
ARRAY
I/O
0L
- I/O
35L
Din_L
Din_R
I/O
0R
- I/O
35R
CLK
L
A
13L
A
0L
CNTRST
L
ADS
L
CNTEN
L
CLK
R
,
Counter/
Address
Reg.
A
13R
ADDR_L
ADDR_R
Counter/
Address
Reg.
A
0R
CNTRST
R
ADS
R
CNTEN
R
4831 tbl 01
FEBRUARY 2018
1
©2018 Integrated Device Technology, Inc.
DSC 4831/14
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