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80HCPS1432CRM: 产品描述Switch ICs - Various S-RIO GEN 2; 产品类别无线/射频/通信电信电路; 文件大小924KB，共79页; 制造商IDT (Integrated Device Technology); 标准

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80HCPS1432CRM概述

Switch ICs - Various S-RIO GEN 2

80HCPS1432CRM规格参数

参数名称	属性值
Brand Name	Integrated Device Technology
是否无铅	含铅
是否Rohs认证	符合
厂商名称	IDT (Integrated Device Technology)
零件包装代码	FCBGA
包装说明	HBGA,
针数	576
制造商包装代码	RM576
Reach Compliance Code	not_compliant
ECCN代码	EAR99
JESD-30 代码	S-PBGA-B576
JESD-609代码	e1
长度	25 mm
湿度敏感等级	4
功能数量	1
端子数量	576
最高工作温度	70 °C
最低工作温度
封装主体材料	PLASTIC/EPOXY
封装代码	HBGA
封装形状	SQUARE
封装形式	GRID ARRAY, HEAT SINK/SLUG
峰值回流温度（摄氏度）	245
座面最大高度	2.83 mm
标称供电电压	1 V
表面贴装	YES
电信集成电路类型	TELECOM CIRCUIT
温度等级	COMMERCIAL
端子面层	Tin/Silver/Copper (Sn/Ag/Cu)
端子形式	BALL
端子节距	1 mm
端子位置	BOTTOM
处于峰值回流温度下的最长时间	NOT SPECIFIED
宽度	25 mm

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14-Port, 32-Lane, 160Gbps,

Gen2 RapidIO Switch

CPS-1432

Datasheet

Description

The CPS-1432 (80HCPS1432) is a

RapidIO Specification (Rev. 2.1)

compliant Central Packet Switch whose functionality is central to

routing packets for distribution among DSPs, processors, FPGAs,

other switches, or any other RapidIO-based devices. It can also be

used in RapidIO backplane switching. The CPS-1432 supports Serial

RapidIO (S-RIO) packet switching (unicast, multicast, and an optional

broadcast) from any of its 14input ports to any of its 14 output ports.

Features

• RapidIO ports

—

bidirectional S-RIO lanes

— Port widths of 1x, 2x, and 4x allow up to 20 Gbps per port

— Port speeds selectable: 6.25, 5, 3.125, 2.5, or 1.25 Gbaud

— Support Level I defined short or long haul reach, and Level II

defined short-, medium-, or long-run reach for each PHY speed

— Error Management Extensions support

— Software-assisted error recovery, supporting hot swap

• I

C Interfaces

— Provides I

C port for maintenance and error reporting

— Master or Slave operation

— Master allows power-on configuration from external ROM

— Master mode configuration with external image compressing and

checksum

• Switch

—

160

Gbps peak throughput

— Non-blocking data flow architecture

— Configurable for Cut-Through or Store-and-Forward data flow

— Very low latency for all packet lengths and load conditions

— Internal queuing buffer and retransmit buffer

— Standard transmitter- or receiver-controlled flow control

— Global routing or Local Port routing capability

— Supports up to 40 simultaneous multicast masks, with broadcast

— Performance monitoring counters for performance and

diagnostics analysis. Per input port and output port counters

• SerDes

— Transmitter pre-emphasis and drive strength + receiver

equalization provides best possible signal integrity

— Embedded PRBS generation and detection with programmable

polynomials support Bit Error Rate testing

• Additional Information

— Packet Trace/Mirror. Each input port can copy all incoming

packets matching user-defined criteria to a “trace” output port.

— Packet Filter. Each input port can filter (drop) all incoming packets

matching user-defined criteria.

— Device configurable through any of S-RIO ports, I

C, or JTAG

— Full JTAG Boundary Scan Support (IEEE1149.1 and 1149.6)

— Lidless 784-FCBGA Package:

25 X 25 mm,1.0

mm ball pitch

Block Diagram

Quadrant 0

Lanes 0-3, 16-19

Ports 0, 4, 12

Quadrant 3

Lanes 12-15, 28-31

Ports 3, 7, 11, 15

CPS-1432

RapidIO Gen2

Switch Fabric

Event Management and Maintenance

Registers

C Controller

Ports 1, 5, 13

Lanes 4-7, 20-23

Quadrant 1

JTAG Controller

Ports 2, 6, 10, 14

Lanes 8-11, 24-27

Quadrant 2

Typical Applications

•

High-performance computing

Wireless

Defense and aerospace

Video and imaging

June 26, 2017

CPS-1432 Datasheet

Table of Contents

About This Document.................................................................................................................... 4

Introduction............................................................................................................................................................................................................ 4

Additional Resources............................................................................................................................................................................................. 4

Document Conventions and Definitions................................................................................................................................................................. 4

Revision History..................................................................................................................................................................................................... 4

Device Description ........................................................................................................................ 6

Specification Compliancy....................................................................................................................................................................................... 7

Functional Overview ..................................................................................................................... 7

Interface Overview........................................................................................................................ 8

S-RIO Ports ........................................................................................................................................................................................................... 8

I2C Bus .................................................................................................................................................................................................................. 8

JTAG TAP Port...................................................................................................................................................................................................... 8

Interrupt (IRQ_N) ................................................................................................................................................................................................... 8

Reset (RST_N) ...................................................................................................................................................................................................... 8

Clock (REF_CLK_P/N) .......................................................................................................................................................................................... 8

Rext (REXT_N/P) .................................................................................................................................................................................................. 9

Speed Select (SPD[2:0])........................................................................................................................................................................................ 9

Quadrant Config (QCFG[7:0])................................................................................................................................................................................ 9

Frequency Select (FSEL[1:0]) ............................................................................................................................................................................... 9

Multicast (MCAST)................................................................................................................................................................................................. 9

Configuration Pins ....................................................................................................................... 10

Speed Select Pins SPD[2:0]................................................................................................................................................................................ 10

Quadrant Configuration Pins QCFG[7:0]............................................................................................................................................................. 10

Absolute Maximum Ratings ........................................................................................................ 13

Recommended Operating Conditions ......................................................................................... 14

AC Test Conditions...................................................................................................................... 15

Power Consumption .................................................................................................................... 17

10. I

C Bus ......................................................................................................................................... 18

C Master Mode and Slave Mode....................................................................................................................................................................... 18

C Device Address ............................................................................................................................................................................................. 18

Signaling.............................................................................................................................................................................................................. 19

Read/Write Figures.............................................................................................................................................................................................. 20

C DC Electrical Specifications........................................................................................................................................................................... 22

C AC Electrical Specifications........................................................................................................................................................................... 23

C Timing Waveforms......................................................................................................................................................................................... 24

11. Interrupt (IRQ_N) Electrical Specifications ................................................................................ 25

12. Configuration (Static) Pin Specification ..................................................................................... 26

13. S-RIO Ports .................................................................................................................................. 27

Overview.............................................................................................................................................................................................................. 27

Definition of Amplitude and Swing....................................................................................................................................................................... 28

1.25, 2.5, and 3.125 Gbaud LP-Serial Links........................................................................................................................................................ 29

Level I Electrical Specification ............................................................................................................................................................................. 29

5 and 6.25 Gbaud LP-Serial Links....................................................................................................................................................................... 36

Level II Electrical Specifications .......................................................................................................................................................................... 36

June 26, 2017

CPS-1432 Datasheet

14. Reference Clock .......................................................................................................................... 46

Reference Clock Electrical Specifications ........................................................................................................................................................... 46

15. Reset (RST_N) Specification ....................................................................................................... 48

16. JTAG Interface ............................................................................................................................ 49

Description........................................................................................................................................................................................................... 49

IEEE 1149.1 (JTAG) and IEEE 1149.6 (AC Extest) Compliance ........................................................................................................................ 49

System Logic TAP Controller Overview............................................................................................................................................................... 49

Signal Definitions ................................................................................................................................................................................................. 50

Test Data Register (DR) ...................................................................................................................................................................................... 51

Boundary Scan Registers.................................................................................................................................................................................... 51

Instruction Register (IR)....................................................................................................................................................................................... 54

EXTEST............................................................................................................................................................................................................... 55

Configuration Register Access (Revision A/B) .................................................................................................................................................... 57

Configuration Register Access (Revision C)........................................................................................................................................................ 59

JTAG DC Electrical Specifications....................................................................................................................................................................... 62

JTAG AC Electrical Specifications....................................................................................................................................................................... 63

JTAG Timing Waveforms..................................................................................................................................................................................... 64

17. Pinout and Pin Listing ................................................................................................................. 65

Pinout — Top View .............................................................................................................................................................................................. 65

Pin Listing ............................................................................................................................................................................................................ 66

18. Package Specifications .............................................................................................................. 73

Package Physical Specifications ......................................................................................................................................................................... 73

Package Outline Drawings .................................................................................................................................................................................. 73

Thermal Characteristics....................................................................................................................................................................................... 76

19. Ordering Information ................................................................................................................... 78

June 26, 2017

80HCPS1432CRM相似产品对比

	80HCPS1432CRM	80HCPS1432CHM	80HCPS1432RMI	80HCPS1432CRMI	80HCPS1432CHMI
描述	Switch ICs - Various S-RIO GEN 2	Switch ICs - Various S-RIO GEN 2	Switch ICs - Various RapidIO Switch	Switch ICs - Various S-RIO GEN 2	Switch ICs - Various Rapid I/O Switch 32 Lanes
Brand Name	Integrated Device Technology	Integrated Device Technology	-	Integrated Device Technology	Integrated Device Technology
是否无铅	含铅	含铅	-	含铅	含铅
是否Rohs认证	符合	不符合	-	符合	不符合
厂商名称	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)	-	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)
零件包装代码	FCBGA	FCBGA	-	FCBGA	FCBGA
包装说明	HBGA,	BGA,	-	HBGA,	BGA,
针数	576	576	-	576	576
制造商包装代码	RM576	HM576	-	RM576	HM576
Reach Compliance Code	not_compliant	not_compliant	-	not_compliant	not_compliant
ECCN代码	EAR99	EAR99	-	EAR99	EAR99
JESD-30 代码	S-PBGA-B576	S-PBGA-B576	-	S-PBGA-B576	S-PBGA-B576
JESD-609代码	e1	e0	-	e1	e0
长度	25 mm	25 mm	-	25 mm	25 mm
湿度敏感等级	4	4	-	4	4
功能数量	1	1	-	1	1
端子数量	576	576	-	576	576
最高工作温度	70 °C	70 °C	-	85 °C	-
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	-	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	HBGA	BGA	-	HBGA	BGA
封装形状	SQUARE	SQUARE	-	SQUARE	SQUARE
封装形式	GRID ARRAY, HEAT SINK/SLUG	GRID ARRAY	-	GRID ARRAY, HEAT SINK/SLUG	GRID ARRAY
峰值回流温度（摄氏度）	245	225	-	245	225
座面最大高度	2.83 mm	2.83 mm	-	2.83 mm	2.83 mm
标称供电电压	1 V	1 V	-	1 V	-
表面贴装	YES	YES	-	YES	YES
电信集成电路类型	TELECOM CIRCUIT	TELECOM CIRCUIT	-	TELECOM CIRCUIT	TELECOM CIRCUIT
温度等级	COMMERCIAL	COMMERCIAL	-	INDUSTRIAL	-
端子面层	Tin/Silver/Copper (Sn/Ag/Cu)	Tin/Lead (Sn/Pb)	-	Tin/Silver/Copper (Sn/Ag/Cu)	Tin/Lead (Sn63Pb37)
端子形式	BALL	BALL	-	BALL	BALL
端子节距	1 mm	1 mm	-	1 mm	1 mm
端子位置	BOTTOM	BOTTOM	-	BOTTOM	BOTTOM
处于峰值回流温度下的最长时间	NOT SPECIFIED	NOT SPECIFIED	-	NOT SPECIFIED	NOT SPECIFIED
宽度	25 mm	25 mm	-	25 mm	25 mm

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