Datasheet> 器件分类 > 半导体> 模拟混合信号IC> STA559BWSTR

STA559BWSTR: 产品描述Audio Amplifiers 5V 2A 2.1ch hi-eff digital audio system; 产品类别半导体模拟混合信号IC; 文件大小1MB，共67页; 制造商ST(意法半导体); 官网地址http://www.st.com/; 标准

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STA559BWSTR概述

Audio Amplifiers 5V 2A 2.1ch hi-eff digital audio system

STA559BWSTR规格参数

参数名称	属性值
Product Attribute	Attribute Value
制造商 Manufacturer	ST(意法半导体)
产品种类 Product Category	Audio Amplifiers
RoHS	Details
产品 Product	Audio Subsystems
Output Power	6 W
安装风格 Mounting Style	SMD/SMT
类型 Type	2.1 Channel Stereo
封装 / 箱体 Package / Case	PowerSSO-36
THD plus Noise	0.2 %
电源电压-最大 Supply Voltage - Max	16 V
电源电压-最小 Supply Voltage - Min	4.5 V
最小工作温度 Minimum Operating Temperature	- 20 C
最大工作温度 Maximum Operating Temperature	+ 70 C
系列 Packaging	Cut Tape
系列 Packaging	MouseReel
系列 Packaging	Reel
Moisture Sensitive	Yes
工作电源电流 Operating Supply Current	15 mA
工作电源电压 Operating Supply Voltage	4.5 V to 16 V
工厂包装数量 Factory Pack Quantity	1000

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STA559BW

5 V, 2 A, 2.1 channel high-efficiency digital audio system

Sound Terminal®

Datasheet

production data



Audio presets:

– 15 preset crossover filters

– 5 preset anti-clipping modes

– Preset night-time listening mode



Individual channel soft/hard mute



Independent channel volume and DSP bypass

PowerSSO-36

with exposed pad down (EPD)



2-channel I²S input data interface



Input and output channel mapping



Automatic invalid-input detect Mute



Automatic zero-detect mute

Features



Wide-range supply voltage, 4.5 V to 16 V



Three power output configurations:

– 2 channels of ternary PWM (2 x 3 W into



at 5 V) + PWM output

– 2 channels of ternary PWM (2 x 3 W into



at 5 V) + ternary stereo line-out

– 2.1 channels of binary PWM (left, right,

LFE) (2 x 0.7 W + 1 x 3 W into 4



at 5 V)

(2 x 1.4 W + 1 x 6 W into 2



at 5 V)



FFX with 100-dB SNR and dynamic range



Selectable 32- to 192-kHz input sample rates



I²C control with selectable device address



Digital gain/attenuation +48 dB to -80 dB with

0.5-dB/step resolution



Soft volume update



Individual channel and master gain/attenuation



Two independent limiters/compressors



Dynamic range compression or anti-clipping

modes



Up to 4 user-programmable biquads/channel



Three coefficients banks for EQ presets storing

with fast recall via I²C interface



Bass/treble tones and de-emphasis control



Selectable high-pass filter for DC blocking



Advanced AM interference frequency

switching and noise suppression modes



Selectable high- or low-bandwidth

noise-shaping topologies



Selectable clock input ratio



Thermal overload and short-circuit protection

embedded



Video apps: 576 x f

input mode supported

Table 1. Device summary

Order code

STA559BWTR

Package

Packaging

PowerSSO-36 EPD Tape and reel

February 2014

This is information on a product in full production.

DocID18190 Rev 2

1/67

www.st.com

Contents

STA559BW

Contents

Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8

Pin connections . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

2.1

2.2

Connection diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Pin description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Electrical specifications . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11

3.1

3.2

3.3

3.4

3.5

3.6

Absolute maximum ratings . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .11

Thermal data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .11

Recommended operating conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . 12

Electrical specifications for the digital section . . . . . . . . . . . . . . . . . . . . . 12

Electrical specifications for the power section . . . . . . . . . . . . . . . . . . . . . 13

Power on/off sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Processing data paths . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16

I²C bus specification . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

5.1

Communication protocol . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

5.1.1

5.1.2

5.1.3

5.1.4

Data transition or change . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Start condition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Stop condition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Data input . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

5.2

5.3

Device addressing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

Write operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

5.3.1

5.3.2

Byte write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Multi-byte write . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

5.4

Read operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

5.4.1

5.4.2

5.4.3

5.4.4

Current address byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Current address multi-byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Random address byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Random address multi-byte read . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

2/67

DocID18190 Rev 2

STA559BW

Contents

6.1

Configuration registers (addr 0x00 to 0x05) . . . . . . . . . . . . . . . . . . . . . . . 22

6.1.1

6.1.2

6.1.3

6.1.4

6.1.5

6.1.6

Configuration register A (addr 0x00) . . . . . . . . . . . . . . . . . . . . . . . . . . . 22

Configuration register B (addr 0x01) . . . . . . . . . . . . . . . . . . . . . . . . . . . 24

Configuration register C (addr 0x02) . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Configuration register D (addr 0x03) . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Configuration register E (addr 0x04) . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Configuration register F (addr 0x05) . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

6.2

Volume control registers (addr 0x06 - 0x0A) . . . . . . . . . . . . . . . . . . . . . . 40

6.2.1

6.2.2

6.2.3

6.2.4

6.2.5

Mute/line output configuration register (addr 0x06) . . . . . . . . . . . . . . . . 41

Master volume register (addr 0x07) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

Channel 1 volume (addr 0x08) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

Channel 2 volume (addr 0x09) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 41

Channel 3 / line output volume (addr 0x0A) . . . . . . . . . . . . . . . . . . . . . 42

6.3

Audio preset registers (addr 0x0B and 0x0C) . . . . . . . . . . . . . . . . . . . . . 43

6.3.1

6.3.2

Audio preset register 1 (addr 0x0B) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43

Audio preset register 2 (addr 0x0C) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 43

6.4

6.5

6.6

Channel configuration registers (addr 0x0E - 0x10) . . . . . . . . . . . . . . . . . 45

Tone control register (addr 0x11) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 47

Dynamic control registers (addr 0x12 - 0x15) . . . . . . . . . . . . . . . . . . . . . 47

6.6.1

6.6.2

6.6.3

6.6.4

6.6.5

Limiter 1 attack/release rate (addr 0x12) . . . . . . . . . . . . . . . . . . . . . . . . 47

Limiter 1 attack/release threshold (addr 0x13) . . . . . . . . . . . . . . . . . . . 47

Limiter 2 attack/release rate (addr 0x14) . . . . . . . . . . . . . . . . . . . . . . . . 48

Limiter 2 attack/release threshold (addr 0x15) . . . . . . . . . . . . . . . . . . . 48

Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

6.7

User-defined coefficient control registers (addr 0x16 - 0x26) . . . . . . . . . . 52

6.7.1

6.7.2

6.7.3

6.7.4

6.7.5

6.7.6

6.7.7

6.7.8

Coefficient address register (addr 0x16) . . . . . . . . . . . . . . . . . . . . . . . . 52

Coefficient b1 data register bits (addr 0x17 - 0x19) . . . . . . . . . . . . . . . . 53

Coefficient b2 data register bits (addr 0x1A - 0x1C) . . . . . . . . . . . . . . . 53

Coefficient a1 data register bits (addr 0x1D - 0x1F) . . . . . . . . . . . . . . . 53

Coefficient a2 data register bits (addr 0x20 - 0x22) . . . . . . . . . . . . . . . . 53

Coefficient b0 data register bits (addr 0x23 - 0x25) . . . . . . . . . . . . . . . . 54

Coefficient read/write control register (addr 0x26) . . . . . . . . . . . . . . . . . 54

Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

6.8

6.9

6.10

Variable max power correction registers (addr 0x27 - 0x28) . . . . . . . . . . 59

Distortion compensation registers (addr 0x29 - 0x2A) . . . . . . . . . . . . . . . 59

Fault detect recovery constant registers (addr 0x2B - 0x2C) . . . . . . . . . . 59

DocID18190 Rev 2

3/67

STA559BW

List of figures

Figure 1.

Figure 2.

Figure 3.

Figure 4.

Figure 5.

Figure 6.

Figure 7.

Figure 8.

Figure 9.

Figure 10.

Figure 11.

Figure 12.

Figure 13.

Figure 14.

Figure 15.

Figure 16.

Figure 17.

Figure 18.

Figure 19.

Figure 20.

Figure 21.

Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8

Pin connection PowerSSO-36 (top view) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Test circuit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

Power-on sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Power-off sequence for pop-free turn-off . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Left and right processing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

Write mode sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Read mode sequence. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

OCFG = 00 (default value) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

OCFG = 01 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

OCFG = 10 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

OCFG = 11 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 34

Output mapping scheme . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

2.0 channels (OCFG = 00) PWM slots . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

2.1 channels (OCFG = 01) PWM slots . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 37

2.1 channels (OCFG = 10) PWM slots . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

Basic limiter and volume flow diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 48

Output configuration for stereo BTL mode (R

= 8



. . . . . . . . . . . . . . . . . . . . . . . . . . . . 61

Applications circuit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

PowerSSO-36 power derating curve . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 63

PowerSSO-36 EPD outline drawing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

DocID18190 Rev 2

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STA559BWSTR相似产品对比

	STA559BWSTR	STA559BW13TR
描述	Audio Amplifiers 5V 2A 2.1ch hi-eff digital audio system	Audio Amplifiers 5-Volt 2-Amp 2.1 CH FFX 100 dB Audio
Product Attribute	Attribute Value	Attribute Value
制造商 Manufacturer	ST(意法半导体)	ST(意法半导体)
产品种类 Product Category	Audio Amplifiers	Audio Amplifiers
RoHS	Details	Details
产品 Product	Audio Subsystems	Audio Subsystems
安装风格 Mounting Style	SMD/SMT	SMD/SMT
类型 Type	2.1 Channel Stereo	2.1 Channel Stereo
封装 / 箱体 Package / Case	PowerSSO-36	PowerSSO EP
THD plus Noise	0.2 %	0.2 %
最大工作温度 Maximum Operating Temperature	+ 70 C	+ 70 C
Moisture Sensitive	Yes	Yes
工作电源电流 Operating Supply Current	15 mA	15 mA
工厂包装数量 Factory Pack Quantity	1000	1000
系列 Packaging	Reel	Reel

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消息称三星正为 2nm 尖端制程导入 Hyper Cell 技术

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基于多线程扫描的网络拓扑边界监测系统设计

　　随着国家电子政务网络规模和业务应用的不断深化，通过网络传输的数据和业务变得越来越敏感和重要。为了保障业务数据在网络传输交换过程中不被非法获取与篡改，相应的网络信息安全防护措施已在不同层面进行了部署。然而，大多数的业务专网对于网络的访问控制几乎都集中在网络的出入关口，而对网络内部结构和接入边界却没有施行必要的监测与管理。这种只注重网关出入防护的安全策略虽然配置了大量的防火墙、多重安全网关和网闸...[详细]
导航可不可以辅助自动驾驶

通常，我们通过观察和简单的GPS工具根据周围事物的对比来确定我们的位置及想要去的地方，但是对于无人驾驶的汽车来说，这种推理是非常困难的，汽车要先绘制和分析所在的新道路，后进行动态等复杂项目的处理，这是非常困难耗时间的。麻省理工学院的研究人员在机器人与自动化国际会议上发表研究成果，他们创建了卷积神经网络（CNN）的机器学习系统，该系统仅使用简单的地图和摄影机的影像数据，使无人驾驶汽车能够在新...[详细]
为什么焊接工匠都爱助焊剂？揭开回流焊接的秘密

在电子制造过程中，回流焊接是最常用的方法之一，它允许在相对短的时间内焊接大量的元件。然而，任何经验丰富的电子工程师都会告诉你，没有助焊剂，高质量的回流焊接是无法完成的。那么，为什么回流焊接时需要使用助焊剂呢？以下几个方面可以解释这一点。首先，助焊剂的主要功能是帮助焊接材料在被焊接表面上均匀分布。焊接是一个涉及熔化金属并使其重新固化的过程。如果金属在固化之前不能均匀分布在被焊接表面上，焊接质...[详细]
Power Integrations推出太阳能赛车专用参考设计，采用高效率氮化镓芯片

PowiGaN在轻载和满载时均实现95%高效率，满足关键的运行和安全功能需求澳大利亚达尔文及美国加州圣何塞， 2025年8月22日讯 –Power Integrations推出一款专为太阳能赛车量身定制的参考设计套件。与此同时，37支学生队伍已整装待发，将参加于8月24日开始的普利司通世界太阳能挑战赛，穿越澳洲内陆地区。该套件型号为RDK-85SLR，采用了PI™公司一款集成Po...[详细]

器件捷径: A0 A1 A2 A3 A4 A5 A6 A7 A8 A9 AA AB AC AD AE AF AG AH AI AJ AK AL AM AN AO AP AQ AR AS AT AU AV AW AX AY AZ B0 B1 B2 B3 B4 B5 B6 B7 B8 B9 BA BB BC BD BE BF BG BH BI BJ BK BL BM BN BO BP BQ BR BS BT BU BV BW BX BY BZ C0 C1 C2 C3 C4 C5 C6 C7 C8 C9 CA CB CC CD CE CF CG CH CI CJ CK CL CM CN CO CP CQ CR CS CT CU CV CW CX CY CZ D0 D1 D2 D3 D4 D5 D6 D7 D8 D9 DA DB DC DD DE DF DG DH DI DJ DK DL DM DN DO DP DQ DR DS DT DU DV DW DX DZ

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