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AS7C256B

产品描述5V 32K X 8 CMOS SRAM (Common I/O)
文件大小132KB,共8页
制造商ALSC [Alliance Semiconductor Corporation]
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AS7C256B概述

5V 32K X 8 CMOS SRAM (Common I/O)

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September 2006
Advance Information
®
AS7C256B
5V 32K X 8 CMOS SRAM (Common I/O)
Features
• Industrial (-40
o
to 85
o
C) temperature
• Organization: 32,768 words × 8 bits
• High speed
- 12 ns address access time
- 6 ns output enable access time
• 28-pin JEDEC standard packages
- 300 mil SOJ
- 8
×
13.4 mm TSOP
- 300 mil PDIP
• ESD protection
2000 volts
• Low power consumption via chip deselect
• One chip select plus one Output Enable pin
• Bidirectional data inputs and outputs
• TTL-compatible
Logic block diagram
Pin arrangement
28-pin DIP, SOJ (300 mil)
A14
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O0
I/O1
I/O2
GND
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
V
CC
WE
A13
A8
A9
A11
OE
A10
CE
I/O7
I/O6
I/O5
I/O4
I/O3
V
CC
GND
Input buffer
A0
A1
A2
A3
A4
A5
A6
A7
Address decoder
I/O7
Sense amp
32,768 X 8
Array
(262,144)
I/O0
28-pin TSOP 1 (8×13.4mm)
OE
A11
A9
A8
A13
WE
V
CC
A14
A12
A7
A6
A5
A4
A3
1
2
3
4
5
6
7
8
9
10
11
12
13
14
(21) 28
(22)
(20) 27
(23)
(19) 26
(24)
(18) 25
(25)
(17) 24
(26)
(16) 23
(27)
(28)
AS7C256B
(15) 22
(14) 21
(1)
(13) 20
(2)
(12) 19
(3)
(11) 18
(4)
(10) 17
(5)
(9) 16
(6)
(8) 15
(7)
A10
CE
I/O7
I/O6
I/O5
I/O4
I/O3
GND
I/O2
I/O1
I/O0
A0
A1
A2
Address decoder
WE
Control
circuit
OE
CE
A A A A A A A
8 9 10 11 12 13 14
Note: This part is compatible with both pin numbering
conventions used by various manufacturers.
12/5/06; V.1.0
Alliance Memory
AS7C256B
P. 1 of 8
Copyright © Alliance Memory. All rights reserved.
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