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28C64AT-15I/L

产品描述3.3V Transceiver with Two EIA TIA 562 Receivers Active in Shutdown
产品类别存储    存储   
文件大小125KB,共10页
制造商Microchip(微芯科技)
官网地址https://www.microchip.com
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28C64AT-15I/L概述

3.3V Transceiver with Two EIA TIA 562 Receivers Active in Shutdown

28C64AT-15I/L规格参数

参数名称属性值
是否Rohs认证不符合
零件包装代码QFJ
包装说明QCCJ, LDCC32,.5X.6
针数32
Reach Compliance Code_compli
ECCN代码EAR99
最长访问时间150 ns
其他特性AUTOMATIC WRITE; BULK ERASE; DATA RETENTION > 10 YEARS
命令用户界面NO
数据轮询YES
数据保留时间-最小值10
JESD-30 代码R-PQCC-J32
JESD-609代码e0
长度13.97 mm
内存密度65536 bi
内存集成电路类型EEPROM
内存宽度8
功能数量1
端子数量32
字数8192 words
字数代码8000
工作模式ASYNCHRONOUS
最高工作温度85 °C
最低工作温度-40 °C
组织8KX8
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码QCCJ
封装等效代码LDCC32,.5X.6
封装形状RECTANGULAR
封装形式CHIP CARRIER
并行/串行PARALLEL
峰值回流温度(摄氏度)NOT SPECIFIED
电源5 V
编程电压5 V
认证状态Not Qualified
就绪/忙碌YES
座面最大高度3.56 mm
最大待机电流0.0001 A
最大压摆率0.03 mA
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级INDUSTRIAL
端子面层Tin/Lead (Sn/Pb)
端子形式J BEND
端子节距1.27 mm
端子位置QUAD
处于峰值回流温度下的最长时间NOT SPECIFIED
切换位NO
宽度11.43 mm
最长写入周期时间 (tWC)1 ms
Base Number Matches1

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Obsolete Device
28C64A
64K (8K x 8) CMOS EEPROM
FEATURES
• Fast Read Access Time—150 ns
• CMOS Technology for Low Power Dissipation
- 30 mA Active
- 100
µA
Standby
• Fast Byte Write Time—200
µs
or 1 ms
• Data Retention >200 years
• High Endurance - Minimum 100,000 Erase/Write
Cycles
• Automatic Write Operation
- Internal Control Timer
- Auto-Clear Before Write Operation
- On-Chip Address and Data Latches
• Data Polling
• Ready/Busy
• Chip Clear Operation
• Enhanced Data Protection
- V
CC
Detector
- Pulse Filter
- Write Inhibit
• Electronic Signature for Device Identification
• 5-Volt-Only Operation
• Organized 8Kx8 JEDEC Standard Pinout
- 28-pin Dual-In-Line Package
- 32-pin PLCC Package
- 28-pin SOIC Package
• Available for Extended Temperature Ranges:
- Commercial: 0°C to +70°C
- Industrial:
-40°C to +85°C
PACKAGE TYPES
RDY/BSY
A12
A7
A6
A5
A4
A3
A2
A1
A0
I/O0
I/O1
I/O2
V
SS
•1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
16
15
Vcc
WE
NC
A8
A6
5
A9
A5
6
A11 A4
7
A3
8
OE
A10 A2
9
A1
10
CE
A0
11
I/O7
NC
12
I/O6
I/O0
13
I/O5
I/O4
I/O3
2
RDY/BSY
1
NU
4
A7
3
A12
32
Vcc
31
WE
18
19
30
NC
29
A8
28
A9
27
A11
26
NC
25
OE
24
A10
23
CE
22
I/O7
21
I/O6
14
15
16
17
• Pin 1 indicator on PLCC on top of package
BLOCK DIAGRAM
I/O0
I/O7
V
SS
V
CC
CE
OE
WE
Rdy/
Busy
Data Protection
Circuitry
Chip Enable/
Output Enable
Control Logic
Auto Erase/Write
Timing
Data
Poll
Program Voltage
Generation
A0
L
a
t
c
h
e
s
A12
Y
Decoder
X
Decoder
DESCRIPTION
The Microchip Technology Inc. 28C64A is a CMOS 64K non-
volatile electrically Erasable PROM. The 28C64A is
accessed like a static RAM for the read or write cycles with-
out the need of external components. During a “byte write”,
the address and data are latched internally, freeing the micro-
processor address and data bus for other operations. Fol-
lowing the initiation of write cycle, the device will go to a busy
state and automatically clear and write the latched data using
an internal control timer. To determine when the write cycle
is complete, the user has a choice of monitoring the Ready/
Busy output or using Data polling. The Ready/Busy pin is an
open drain output, which allows easy configuration in wired-
or systems. Alternatively, Data polling allows the user to read
the location last written to when the write operation is com-
plete. CMOS design and processing enables this part to be
used in systems where reduced power consumption and reli-
ability are required. A complete family of packages is offered
to provide the utmost flexibility in applications.
2004 Microchip Technology Inc.
I/O1
I/O2
Vss
NU
I/O3
I/O4
I/O5
Input/Output
Buffers
Y Gating
16K bit
Cell Matrix
DS11109K-page 1
20
DIP/SOIC
PLCC

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