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IDT7006S35PFI

产品描述Dual-Port SRAM, 16KX8, 35ns, CMOS, PQFP64, 14 X 14 MM, 1.40 MM HEIGHT, TQFP-64
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文件大小237KB,共20页
制造商IDT (Integrated Device Technology)
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IDT7006S35PFI概述

Dual-Port SRAM, 16KX8, 35ns, CMOS, PQFP64, 14 X 14 MM, 1.40 MM HEIGHT, TQFP-64

IDT7006S35PFI规格参数

参数名称属性值
是否无铅含铅
是否Rohs认证不符合
厂商名称IDT (Integrated Device Technology)
零件包装代码QFP
包装说明LQFP,
针数64
Reach Compliance Codecompliant
ECCN代码EAR99
最长访问时间35 ns
JESD-30 代码S-PQFP-G64
JESD-609代码e0
长度14 mm
内存密度131072 bit
内存集成电路类型DUAL-PORT SRAM
内存宽度8
湿度敏感等级3
功能数量1
端子数量64
字数16384 words
字数代码16000
工作模式ASYNCHRONOUS
最高工作温度85 °C
最低工作温度-40 °C
组织16KX8
封装主体材料PLASTIC/EPOXY
封装代码LQFP
封装形状SQUARE
封装形式FLATPACK, LOW PROFILE
并行/串行PARALLEL
峰值回流温度(摄氏度)240
认证状态Not Qualified
座面最大高度1.6 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级INDUSTRIAL
端子面层Tin/Lead (Sn/Pb)
端子形式GULL WING
端子节距0.8 mm
端子位置QUAD
处于峰值回流温度下的最长时间20
宽度14 mm
Base Number Matches1

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HIGH-SPEED
16K x 8 DUAL-PORT
STATIC RAM
Features
x
x
IDT7006S/L
x
x
True Dual-Ported memory cells which allow simultaneous
reads of the same memory location
High-speed access
– Military: 20/25/35/55/70ns (max.)
– Industrial: 55ns (max.)
– Commercial: 15/17/20/25/35/55ns (max.)
Low-power operation
– IDT7006S
Active: 750mW (typ.)
Standby: 5mW (typ.)
– IDT7006L
Active: 700mW (typ.)
Standby: 1mW (typ.)
IDT7006 easily expands data bus width to 16 bits or more
using the Master/Slave select when cascading more than
x
x
x
x
x
x
x
x
x
x
one device
M/S = H for
BUSY
output flag on Master,
M/S = L for
BUSY
input on Slave
Busy and Interrupt Flags
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
Devices are capable of withstanding greater than 2001V
electrostatic discharge
Battery backup operation—2V data retention
TTL-compatible, single 5V (±10%) power supply
Available in 68-pin PGA, quad flatpack, PLCC, and a 64-pin
TQFP
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Functional Block Diagram
OE
L
CE
L
R/W
L
OE
R
CE
R
R/W
R
I/O
0L
- I/O
7L
I/O
Control
BUSY
L
A
13L
A
0L
(1,2)
I/O
0R
-I/O
7R
I/O
Control
BUSY
R
(1,2)
Address
Decoder
14
MEMORY
ARRAY
14
Address
Decoder
A
13R
A
0R
CE
L
OE
L
R/W
L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
CE
R
OE
R
R/W
R
SEM
L
(2)
INT
L
NOTES:
1. (MASTER):
BUSY
is output; (SLAVE):
BUSY
is input.
2.
BUSY
outputs and
INT
outputs are non-tri-stated push-pull.
M/S
SEM
R
INT
R
(2)
2739 drw 01
SEPTEMBER 1999
1
DSC-2739/11
听人说这里高手入云?能出来帮下忙吗?
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