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74LVQ273_01

产品描述Low Voltage Octal D-Type Flip-Flop
文件大小63KB,共6页
制造商Fairchild
官网地址http://www.fairchildsemi.com/
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74LVQ273_01概述

Low Voltage Octal D-Type Flip-Flop

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74LVQ273 Low Voltage Octal D-Type Flip-Flop
February 1992
Revised June 2001
74LVQ273
Low Voltage Octal D-Type Flip-Flop
General Description
The LVQ273 has eight edge-triggered D-type flip-flops with
individual D inputs and Q outputs. The common buffered
Clock (CP) and Master Reset (MR) input load and reset
(clear) all flip-flops simultaneously.
The register is fully edge-triggered. The state of each D
input, one setup time before the LOW-to-HIGH clock transi-
tion, is transferred to the corresponding flip-flop’s Q output.
All outputs will be forced LOW independently of Clock or
Data inputs by a LOW voltage level on the MR input. The
device is useful for applications where the true output only
is required and the Clock and Master Reset are common to
all storage elements.
Features
s
Ideal for low power/low noise 3.3V applications
s
Implements patented EMI reduction circuitry
s
Available in SOIC JEDEC, SOIC EIAJ and QSOP
packages
s
Guaranteed simultaneous switching noise level and
dynamic threshold performance
s
Improved latch-up immunity
s
Guaranteed incident wave switching into 75
s
4 kV minimum ESD immunity
Ordering Code:
Order Number
74LVQ273SC
74LVQ273SJ
74LVQ273QSC
Package Number
M20B
M20D
MQA20
Package Description
20-Lead Small Outline Integrated Circuit (SOIC), JEDEC MS-013, 0.300" Wide
20-Lead Small Outline Package (SOP), EIAJ TYPE II, 5.3mm Wide
20-Lead Quarter Size Outline Package (QSOP), JEDEC MO-137, 0.150" Wide
Devices also available in Tape and Reel. Specify by appending suffix letter “X” to the ordering code.
Logic Symbols
Connection Diagram
IEEE/IEC
Pin Descriptions
Pin Names
D
0
–D
7
MR
CP
Q
0
–Q
7
Description
Data Inputs
Master Reset
Clock Pulse Input
Data Outputs
© 2001 Fairchild Semiconductor Corporation
DS011358
www.fairchildsemi.com

74LVQ273_01相似产品对比

74LVQ273_01 74LVQ273 74LVQ273SC 74LVQ273SJ 74LVQ273QSC
描述 Low Voltage Octal D-Type Flip-Flop Low Voltage Octal D-Type Flip-Flop Low Voltage Octal D-Type Flip-Flop Low Voltage Octal D-Type Flip-Flop Low Voltage Octal D-Type Flip-Flop
是否Rohs认证 - - 符合 符合 符合
厂商名称 - - Fairchild Fairchild Fairchild
零件包装代码 - - SOIC SOIC SSOP
包装说明 - - SOP, SOP20,.4 5.30 MM, EIAJ TYPE2, SOP-20 0.150 INCH, MO-137, QSOP-20
针数 - - 20 20 20
Reach Compliance Code - - unknow compli unknow
系列 - - LVQ LVQ LVQ
JESD-30 代码 - - R-PDSO-G20 R-PDSO-G20 R-PDSO-G20
JESD-609代码 - - e3 e3 e3
长度 - - 12.8 mm 12.6 mm 8.65 mm
负载电容(CL) - - 50 pF 50 pF 50 pF
逻辑集成电路类型 - - D FLIP-FLOP D FLIP-FLOP D FLIP-FLOP
最大频率@ Nom-Su - - 75000000 Hz 75000000 Hz 75000000 Hz
最大I(ol) - - 0.012 A 0.012 A 0.012 A
湿度敏感等级 - - 1 1 1
位数 - - 8 8 8
功能数量 - - 1 1 1
端子数量 - - 20 20 20
最高工作温度 - - 85 °C 85 °C 85 °C
最低工作温度 - - -40 °C -40 °C -40 °C
输出极性 - - TRUE TRUE TRUE
封装主体材料 - - PLASTIC/EPOXY PLASTIC/EPOXY PLASTIC/EPOXY
封装代码 - - SOP SOP SSOP
封装等效代码 - - SOP20,.4 SOP20,.3 SSOP20,.25
封装形状 - - RECTANGULAR RECTANGULAR RECTANGULAR
封装形式 - - SMALL OUTLINE SMALL OUTLINE SMALL OUTLINE, SHRINK PITCH
包装方法 - - TUBE TUBE TUBE
峰值回流温度(摄氏度) - - 260 260 260
电源 - - 3.3 V 3.3 V 3.3 V
Prop。Delay @ Nom-Su - - 14.5 ns 14.5 ns 14.5 ns
传播延迟(tpd) - - 20.5 ns 20.5 ns 20.5 ns
认证状态 - - Not Qualified Not Qualified Not Qualified
座面最大高度 - - 2.65 mm 2.1 mm 1.75 mm
最大供电电压 (Vsup) - - 3.6 V 3.6 V 3.6 V
最小供电电压 (Vsup) - - 2 V 2 V 2 V
标称供电电压 (Vsup) - - 2.7 V 2.7 V 2.7 V
表面贴装 - - YES YES YES
技术 - - CMOS CMOS CMOS
温度等级 - - INDUSTRIAL INDUSTRIAL INDUSTRIAL
端子面层 - - Matte Tin (Sn) Matte Tin (Sn) Matte Tin (Sn)
端子形式 - - GULL WING GULL WING GULL WING
端子节距 - - 1.27 mm 1.27 mm 0.635 mm
端子位置 - - DUAL DUAL DUAL
处于峰值回流温度下的最长时间 - - NOT SPECIFIED NOT SPECIFIED NOT SPECIFIED
触发器类型 - - POSITIVE EDGE POSITIVE EDGE POSITIVE EDGE
宽度 - - 7.5 mm 5.3 mm 3.9116 mm
最小 fmax - - 75 MHz 75 MHz 75 MHz
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