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PSD813F1VA-15M

产品描述CPLD - Complex Programmable Logic Devices 3.0V 1M 150ns
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文件大小812KB,共110页
制造商ST(意法半导体)
官网地址http://www.st.com/
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PSD813F1VA-15M概述

CPLD - Complex Programmable Logic Devices 3.0V 1M 150ns

PSD813F1VA-15M规格参数

参数名称属性值
是否Rohs认证符合
零件包装代码QFP
包装说明PLASTIC, QFP-52
针数52
Reach Compliance Codecompliant
ECCN代码EAR99
最长访问时间15 ns
JESD-30 代码S-PQFP-G52
长度14 mm
内存密度1048576 bit
内存集成电路类型FLASH
内存宽度8
功能数量1
端子数量52
字数131072 words
字数代码128000
工作模式SYNCHRONOUS
最高工作温度70 °C
最低工作温度
组织128KX8
封装主体材料PLASTIC/EPOXY
封装代码LQFP
封装形状SQUARE
封装形式FLATPACK, LOW PROFILE
并行/串行PARALLEL
编程电压3.3 V
认证状态Not Qualified
座面最大高度1.54 mm
最大供电电压 (Vsup)3.6 V
最小供电电压 (Vsup)3 V
标称供电电压 (Vsup)3.3 V
表面贴装YES
技术CMOS
温度等级COMMERCIAL
端子形式GULL WING
端子节距0.8 mm
端子位置QUAD
类型NOR TYPE
宽度14 mm
最长写入周期时间 (tWC)10 ms
Base Number Matches1

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PSD813F1V
Flash in-system programmable (ISP) peripherals
for 8-bit MCUs, 3.3 V
NOT FOR NEW DESIGN
FEATURES SUMMARY
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le
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DUAL BANK FLASH MEMORIES
– 1 Mbit of Primary Flash Memory (8
Uniform Sectors)
– 256 Kbit Secondary EEPROM (4 Uniform
Sectors)
– Concurrent operation: read from one
memory while erasing and writing the
other
16 Kbit SRAM
PLD WITH MACROCELLS
– Over 3,000 Gates Of PLD: DPLD and
CPLD
– DPLD - User-defined Internal chip-select
decoding
– CPLD with 16 Output Macrocells (OMCs)
and 24 Input Macrocells (IMCs)
27 RECONFIGURABLE I/Os
– 27 individually configurable I/O port pins
that can be used for the following
functions:
MCU I/Os;
PLD I/Os;
Latched MCU address output; and
Special function I/Os.
Note:
16 of the I/O ports may be
configured as open-drain outputs.
ENHANCED JTAG SERIAL PORT
– Built-in JTAG-compliant serial port allows
full-chip In-System Programmability (ISP)
– Efficient manufacturing allows for easy
product testing and programming
PAGE REGISTER
– Internal page register that can be used to
expand the microcontroller address space
by a factor of 256.
PROGRAMMABLE POWER MANAGEMENT
Figure 1. Packages
PQFP52 (M)
b
O
so
te
le
ro
P
uc
d
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P
e
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s)
t(
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PLCC52 (J)
TQFQ64 (U)
HIGH ENDURANCE:
– 100,000 Erase/WRITE Cycles of Flash
Memory
– 10,000 Erase/WRITE Cycles of EEPROM
– 1,000 Erase/WRITE Cycles of PLD
– Data Retention: 15-year minimum at 90°C
(for Main Flash, Boot, PLD and
Configuration bits).
SINGLE SUPPLY VOLTAGE:
– 3.3V±10% for PSD813F1V
STANDBY CURRENT AS LOW AS 50µA
Packages are ECOPACK
®
October 2008
Rev 4
1/110
This is information on a product still in production but not recommended for new designs.

PSD813F1VA-15M相似产品对比

PSD813F1VA-15M PSD813F1VA-15U PSD813F1VA-20JI PSD813F1VA-15J
描述 CPLD - Complex Programmable Logic Devices 3.0V 1M 150ns CPLD - Complex Programmable Logic Devices 3.0V 1M 150ns CPLD - Complex Programmable Logic Devices 3.0V 1M 200ns CPLD - Complex Programmable Logic Devices 3.0V 1M 150ns
是否Rohs认证 符合 - 符合 符合
零件包装代码 QFP - LCC LCC
包装说明 PLASTIC, QFP-52 - PLASTIC, LCC-52 PLASTIC, LCC-52
针数 52 - 52 52
Reach Compliance Code compliant - compliant compliant
ECCN代码 EAR99 - EAR99 EAR99
最长访问时间 15 ns - 20 ns 15 ns
JESD-30 代码 S-PQFP-G52 - S-PQCC-J52 S-PQCC-J52
长度 14 mm - 19.1 mm 19.1 mm
内存密度 1048576 bit - 1048576 bit 1048576 bit
内存集成电路类型 FLASH - FLASH FLASH
内存宽度 8 - 8 8
功能数量 1 - 1 1
端子数量 52 - 52 52
字数 131072 words - 131072 words 131072 words
字数代码 128000 - 128000 128000
工作模式 SYNCHRONOUS - SYNCHRONOUS SYNCHRONOUS
最高工作温度 70 °C - 85 °C 70 °C
组织 128KX8 - 128KX8 128KX8
封装主体材料 PLASTIC/EPOXY - PLASTIC/EPOXY PLASTIC/EPOXY
封装代码 LQFP - QCCJ QCCJ
封装形状 SQUARE - SQUARE SQUARE
封装形式 FLATPACK, LOW PROFILE - CHIP CARRIER CHIP CARRIER
并行/串行 PARALLEL - PARALLEL PARALLEL
编程电压 3.3 V - 3.3 V 3.3 V
认证状态 Not Qualified - Not Qualified Not Qualified
座面最大高度 1.54 mm - 4.57 mm 4.57 mm
最大供电电压 (Vsup) 3.6 V - 3.6 V 3.6 V
最小供电电压 (Vsup) 3 V - 3 V 3 V
标称供电电压 (Vsup) 3.3 V - 3.3 V 3.3 V
表面贴装 YES - YES YES
技术 CMOS - CMOS CMOS
温度等级 COMMERCIAL - INDUSTRIAL COMMERCIAL
端子形式 GULL WING - J BEND J BEND
端子节距 0.8 mm - 1.27 mm 1.27 mm
端子位置 QUAD - QUAD QUAD
类型 NOR TYPE - NOR TYPE NOR TYPE
宽度 14 mm - 19 mm 19 mm
最长写入周期时间 (tWC) 10 ms - 10 ms 10 ms
Base Number Matches 1 - 1 1
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