VE-JNK-CW-S,VE-JNK-CW-S pdf中文资料,VE-JNK-CW-S引脚图,VE-JNK-CW-S电路-Datasheet-电子工程世界

VE-JNK-CW-S: 产品描述Isolated DC/DC Converters VI J00/200 - 48 Vin, 40 Vout, 100 W, C Product Grade; 产品类别电源/电源管理电源电路; 文件大小656KB，共8页; 制造商VICOR; 官网地址http://www.vicorpower.com/; 标准

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Isolated DC/DC Converters VI J00/200 - 48 Vin, 40 Vout, 100 W, C Product Grade

参数名称	属性值
是否无铅	不含铅
是否Rohs认证	符合
包装说明	,
Reach Compliance Code	compliant
ECCN代码	EAR99
模拟集成电路 - 其他类型	DC-DC REGULATED POWER SUPPLY MODULE
最大输入电压	76 V
最小输入电压	36 V
标称输入电压	48 V
JESD-30 代码	R-XDMA-P9
JESD-609代码	e3
最大负载调整率	0.2%
功能数量	1
输出次数	1
端子数量	9
最高工作温度	100 °C
最低工作温度	-25 °C
最大输出电压	44 V
最小输出电压	20 V
标称输出电压	40 V
封装主体材料	UNSPECIFIED
封装形状	RECTANGULAR
封装形式	MICROELECTRONIC ASSEMBLY
峰值回流温度（摄氏度）	NOT SPECIFIED
认证状态	Not Qualified
表面贴装	NO
技术	HYBRID
温度等级	OTHER
端子面层	MATTE TIN OVER NICKEL
端子形式	PIN/PEG
端子位置	DUAL
处于峰值回流温度下的最长时间	NOT SPECIFIED
最大总功率输出	100 W
微调/可调输出	YES
Base Number Matches	1

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求助，关于SRAM设计中出现latch: 我设计了一个SRAM，可是结果出现了8个12bit的latch，不知道怎么消去，还望高手帮忙，在此先谢过了！代码如下：module SRAM(CLK, CS, AWE, A, D, AOE);input CLK;input CS;input AWE;input [2:0] A;inout [11:0] D;input AOE;reg [11:0] MEM [7:0];//Only CS is lo...; goodsaint FPGA/CPLD

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器件捷径: L0 L1 L2 L3 L4 L5 L6 L7 L8 L9 LA LB LC LD LE LF LG LH LI LJ LK LL LM LN LO LP LQ LR LS LT LU LV LW LX LY LZ M0 M1 M2 M3 M4 M5 M6 M7 M8 M9 MA MB MC MD ME MF MG MH MI MJ MK ML MM MN MO MP MQ MR MS MT MU MV MW MX MY MZ N0 N1 N2 N3 N4 N5 N6 N7 N8 NA NB NC ND NE NF NG NH NI NJ NK NL NM NN NO NP NQ NR NS NT NU NV NX NZ O0 O1 O2 O3 OA OB OC OD OE OF OG OH OI OJ OK OL OM ON OP OQ OR OS OT OV OX OY OZ P0 P1 P2 P3 P4 P5 P6 P7 P8 P9 PA PB PC PD PE PF PG PH PI PJ PK PL PM PN PO PP PQ PR PS PT PU PV PW PX PY PZ Q1 Q2 Q3 Q4 Q5 Q6 Q8 Q9 QA QB QC QE QF QG QH QK QL QM QP QR QS QT QV QW QX QY R0 R1 R2 R3 R4 R5 R6 R7 R8 R9 RA RB RC RD RE RF RG RH RI RJ RK RL RM RN RO RP RQ RR RS RT RU RV RW RX RY RZ

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