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74LVC841AD118: 产品描述Latches 10BIT BUS INTERFC; 产品类别半导体逻辑; 文件大小141KB，共20页; 制造商NXP(恩智浦); 官网地址https://www.nxp.com

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74LVC841AD118概述

Latches 10BIT BUS INTERFC

74LVC841AD118规格参数

参数名称	属性值
Product Attribute	Attribute Value
制造商 Manufacturer	NXP(恩智浦)
产品种类 Product Category	Latches
RoHS	Details
Number of Circuits	1 Circuit
Logic Type	TTL
Logic Family	LVC
Polarity	Non-Inverting
Quiescent Current	40 uA
Number of Output Lines	10 Line
High Level Output Current	- 24 mA
传播延迟时间 Propagation Delay Time	4.5 ns at 3.3 V
电源电压-最大 Supply Voltage - Max	3.6 V
电源电压-最小 Supply Voltage - Min	1.2 V
最小工作温度 Minimum Operating Temperature	- 40 C
最大工作温度 Maximum Operating Temperature	+ 125 C
封装 / 箱体 Package / Case	SO-24
系列 Packaging	Cut Tape
系列 Packaging	MouseReel
系列 Packaging	Reel
Function	Transparent
高度 Height	2.45 mm
长度 Length	15.6 mm
输出类型 Output Type	3-State
类型 Type	D-Type
宽度 Width	7.6 mm
安装风格 Mounting Style	SMD/SMT
Number of Channels	10 Channels
Number of Input Lines	10 Line
Supply Current - Max	100 nA
工作电源电压 Operating Supply Voltage	1.8 V, 2.5 V, 3.3 V
Reset Type	No Reset
工厂包装数量 Factory Pack Quantity	1000
单位重量 Unit Weight	0.010857 oz

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74LVC841A

10-bit transparent latch with 5 V tolerant inputs/outputs;

3-state

Rev. 4 — 2 April 2013

Product data sheet

1. General description

The 74LVC841A is a 10-bit transparent latch featuring separate D-type inputs for each

latch and 3-state outputs for bus applications. A latch enable (pin LE) input and an output

enable (pin OE) input are common to all internal latches. The device consists of ten

transparent latches with 3-state true outputs. When pin LE is HIGH, data at the Dn inputs

enters the latches. In this condition, the latches are transparent, that is, a latch output

changes each time its corresponding D-input changes. When pin LE is LOW, the latches

store the information that was present at the D-inputs a set-up time preceding the HIGH to

LOW transition of pin LE.

When pin OE is LOW, the contents of the ten latches are available at the outputs. When

pin OE is HIGH, the outputs go to the high-impedance OFF-state. Operation of the pin OE

input does not affect the state of the latches.

Inputs can be driven from either 3.3 V or 5 V devices. When disabled, up to 5.5 V can be

applied to the outputs. These features allow the use of these devices as translators in

mixed 3.3 V and 5 V applications.

2. Features and benefits



5 V tolerant inputs/outputs; for interfacing with 5 V logic

Wide supply voltage range from 1.2 V to 3.6 V

CMOS low power consumption

Direct interface with TTL levels

Flow-through pinout architecture

Complies with JEDEC standard:



JESD8-7A (1.65 V to 1.95 V)



JESD8-5A (2.3 V to 2.7 V)



JESD8-C/JESD36 (2.7 V to 3.6 V)



ESD protection:



HBM JESD22-A114F exceeds 2000 V



MM JESD22-A115-B exceeds 200 V



CDM JESD22-C101E exceeds 1000 V



Specified from

40 C

to +85

C

and

40 C

to +125

C.

74LVC841AD118相似产品对比

	74LVC841AD118	74LVC841ADB118	74LVC841APW-T	74LVC841ADB	74LVC841AD,112	74LVC841ABQ,118
描述	Latches 10BIT BUS INTERFC	Latches 10BIT BUS INTERFC	Latches 10BIT BUS INTERFC LATCH 3ST	Latches 10BIT BUS INTERFC LATCH 3ST	闭锁 10BIT BUS INTERFC	闭锁 Latch Transpar 3-ST 10-CH D-Type 24-Pin
是否Rohs认证	-	-	符合	符合	符合	符合
厂商名称	-	-	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)	NXP(恩智浦)
零件包装代码	-	-	TSSOP	SSOP	SOP	QFN
包装说明	-	-	TSSOP,	SSOP, SSOP24,.3	7.50 MM, PLASTIC, MS-013, SOT-137-1, SO-24	3.50 X 5.50 MM, 0.85 MM HEIGHT, PLASTIC, SOT-815-1, DHVQFN-24
针数	-	-	24	24	24	24
Reach Compliance Code	-	-	unknown	compliant	compliant	compliant
系列	-	-	LVC/LCX/Z	LVC/LCX/Z	LVC/LCX/Z	LVC/LCX/Z
JESD-30 代码	-	-	R-PDSO-G24	R-PDSO-G24	R-PDSO-G24	R-PQCC-N24
JESD-609代码	-	-	e4	e4	e4	e4
长度	-	-	7.8 mm	8.2 mm	15.4 mm	5.5 mm
负载电容（CL）	-	-	50 pF	50 pF	50 pF	50 pF
逻辑集成电路类型	-	-	BUS DRIVER	BUS DRIVER	BUS DRIVER	BUS DRIVER
湿度敏感等级	-	-	1	1	1	1
位数	-	-	10	10	10	10
功能数量	-	-	1	1	1	1
端口数量	-	-	2	2	2	2
端子数量	-	-	24	24	24	24
最高工作温度	-	-	125 °C	125 °C	125 °C	125 °C
最低工作温度	-	-	-40 °C	-40 °C	-40 °C	-40 °C
输出特性	-	-	3-STATE	3-STATE	3-STATE	3-STATE
输出极性	-	-	TRUE	TRUE	TRUE	TRUE
封装主体材料	-	-	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	-	-	TSSOP	SSOP	SOP	HVQCCN
封装形状	-	-	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR
封装形式	-	-	SMALL OUTLINE, THIN PROFILE, SHRINK PITCH	SMALL OUTLINE, SHRINK PITCH	SMALL OUTLINE	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）	-	-	260	260	260	260
传播延迟（tpd）	-	-	11 ns	11 ns	11 ns	11 ns
认证状态	-	-	Not Qualified	Not Qualified	Not Qualified	Not Qualified
座面最大高度	-	-	1.1 mm	2 mm	2.65 mm	1 mm
最大供电电压 (Vsup)	-	-	3.6 V	3.6 V	3.6 V	3.6 V
最小供电电压 (Vsup)	-	-	1.2 V	1.2 V	1.2 V	1.2 V
标称供电电压 (Vsup)	-	-	2.7 V	2.7 V	2.7 V	2.7 V
表面贴装	-	-	YES	YES	YES	YES
技术	-	-	CMOS	CMOS	CMOS	CMOS
温度等级	-	-	AUTOMOTIVE	AUTOMOTIVE	AUTOMOTIVE	AUTOMOTIVE
端子面层	-	-	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD	NICKEL PALLADIUM GOLD	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式	-	-	GULL WING	GULL WING	GULL WING	NO LEAD
端子节距	-	-	0.65 mm	0.65 mm	1.27 mm	0.5 mm
端子位置	-	-	DUAL	DUAL	DUAL	QUAD
处于峰值回流温度下的最长时间	-	-	30	30	30	30
宽度	-	-	4.4 mm	5.3 mm	7.5 mm	3.5 mm
Base Number Matches	-	-	1	1	1	1

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