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7007S25PFI

产品描述Dual-Port SRAM, 32KX8, 25ns, CMOS, PQFP80, 14 X 14 MM, 1.40 MM HEIGHT, TQFP-80
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文件大小368KB,共22页
制造商IDT (Integrated Device Technology)
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7007S25PFI概述

Dual-Port SRAM, 32KX8, 25ns, CMOS, PQFP80, 14 X 14 MM, 1.40 MM HEIGHT, TQFP-80

7007S25PFI规格参数

参数名称属性值
是否无铅含铅
是否Rohs认证不符合
厂商名称IDT (Integrated Device Technology)
零件包装代码QFP
包装说明14 X 14 MM, 1.40 MM HEIGHT, TQFP-80
针数80
Reach Compliance Codenot_compliant
ECCN代码EAR99
最长访问时间25 ns
I/O 类型COMMON
JESD-30 代码S-PQFP-G80
JESD-609代码e0
长度14 mm
内存密度262144 bit
内存集成电路类型DUAL-PORT SRAM
内存宽度8
湿度敏感等级3
功能数量1
端口数量2
端子数量80
字数32768 words
字数代码32000
工作模式ASYNCHRONOUS
最高工作温度85 °C
最低工作温度-40 °C
组织32KX8
输出特性3-STATE
封装主体材料PLASTIC/EPOXY
封装代码LQFP
封装等效代码QFP80,.64SQ
封装形状SQUARE
封装形式FLATPACK, LOW PROFILE
并行/串行PARALLEL
峰值回流温度(摄氏度)240
电源5 V
认证状态Not Qualified
座面最大高度1.6 mm
最大待机电流0.03 A
最小待机电流4.5 V
最大压摆率0.345 mA
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级INDUSTRIAL
端子面层Tin/Lead (Sn85Pb15)
端子形式GULL WING
端子节距0.65 mm
端子位置QUAD
处于峰值回流温度下的最长时间20
宽度14 mm
Base Number Matches1

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HIGH-SPEED
32K x 8 DUAL-PORT
STATIC RAM
Features
IDT7007S/L
True Dual-Ported memory cells which allow simulta-
neous reads of the same memory location
High-speed access
– Military: 25/35/55ns (max.)
– Industrial: 20/25/35/55ns (max.)
– Commercial: 15/20/25/35/55ns (max.)
Low-power operation
– IDT7007S
Active: 850mW (typ.)
Standby: 5mW (typ.)
– IDT7007L
Active: 850mW (typ.)
Standby: 1mW (typ.)
IDT7007 easily expands data bus width to 16 bits or
more using the Master/Slave select when cascading
more than one device
M/S = H for
BUSY
output flag on Master,
M/S = L for
BUSY
input on Slave
Interrupt Flag
On-chip port arbitration logic
Full on-chip hardware support of semaphore signaling
between ports
Fully asynchronous operation from either port
TTL-compatible, single 5V (±10%) power supply
Available in 68-pin PGA and PLCC and a 80-pin TQFP
Industrial temperature range (–40°C to +85°C) is available
for selected speeds
Green parts available, see ordering information
Functional Block Diagram
OE
L
CE
L
R/W
L
OE
R
CE
R
R/W
R
I/O
0L
- I/O
7L
I/O
Control
BUSY
L
A
14L
A
0L
(1,2)
I/O
0R
-I/O
7R
I/O
Control
BUSY
R
A
14R
A
0R
(1,2)
Address
Decoder
15
MEMORY
ARRAY
15
Address
Decoder
CE
L
OE
L
R/W
L
ARBITRATION
INTERRUPT
SEMAPHORE
LOGIC
CE
R
OE
R
R/W
R
SEM
L
(2)
INT
L
NOTES:
1. (MASTER):
BUSY
is output; (SLAVE):
BUSY
is input.
2.
BUSY
and
INT
outputs are non-tri-stated push-pull.
M/S
SEM
R
INT
R
(2)
2940 drw 01
AUGUST 2014
1
©2014 Integrated Device Technology, Inc.
DSC 2940/14
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