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74VCX162240TTR

产品描述ALVC/VCX/A SERIES, QUAD 4-BIT DRIVER, INVERTED OUTPUT, PDSO48, TSSOP-48
产品类别逻辑    逻辑   
文件大小79KB,共10页
制造商ST(意法半导体)
官网地址http://www.st.com/
标准
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74VCX162240TTR概述

ALVC/VCX/A SERIES, QUAD 4-BIT DRIVER, INVERTED OUTPUT, PDSO48, TSSOP-48

74VCX162240TTR规格参数

参数名称属性值
是否无铅不含铅
是否Rohs认证符合
厂商名称ST(意法半导体)
零件包装代码TSSOP
包装说明TSSOP, TSSOP48,.3,20
针数48
Reach Compliance Codecompliant
控制类型ENABLE LOW
系列ALVC/VCX/A
JESD-30 代码R-PDSO-G48
JESD-609代码e3
长度12.5 mm
逻辑集成电路类型BUS DRIVER
最大I(ol)0.012 A
湿度敏感等级1
位数4
功能数量4
端口数量2
端子数量48
最高工作温度125 °C
最低工作温度-55 °C
输出特性3-STATE WITH SERIES RESISTOR
输出极性INVERTED
封装主体材料PLASTIC/EPOXY
封装代码TSSOP
封装等效代码TSSOP48,.3,20
封装形状RECTANGULAR
封装形式SMALL OUTLINE, THIN PROFILE, SHRINK PITCH
包装方法TAPE AND REEL
峰值回流温度(摄氏度)225
电源3.3 V
Prop。Delay @ Nom-Sup4 ns
传播延迟(tpd)6.2 ns
认证状态Not Qualified
座面最大高度1.2 mm
最大供电电压 (Vsup)3.6 V
最小供电电压 (Vsup)1.8 V
标称供电电压 (Vsup)2.5 V
表面贴装YES
技术CMOS
温度等级MILITARY
端子面层MATTE TIN
端子形式GULL WING
端子节距0.5 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度6.1 mm
Base Number Matches1

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74VCX162240
LOW VOLTAGE CMOS 16-BIT BUS BUFFER (3-STATE INV.)
WITH 3.6V TOLERANT INPUTS AND OUTPUTS
s
s
s
s
s
s
s
s
s
3.6V TOLERANT INPUTS AND OUTPUTS
HIGH SPEED :
t
PD
= 3.4 ns (MAX.) at V
CC
= 3.0 to 3.6V
t
PD
= 3.8 ns (MAX.) at V
CC
= 2.3 to 2.7V
t
PD
= 5.7 ns (MAX.) at V
CC
= 1.8V
POWER DOWN PROTECTION ON INPUTS
AND OUTPUTS
SYMMETRICAL OUTPUT IMPEDANCE:
|I
OH
| = I
OL
= 12mA (MIN) at V
CC
= 3.0V
|I
OH
| = I
OL
= 8mA (MIN) at V
CC
= 2.3V
|I
OH
| = I
OL
= 4mA (MIN) at V
CC
= 1.8V
26Ω SERIE RESISTORS IN OUTPUTS
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 1.8V to 3.6V
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 162240
LATCH-UP PERFORMANCE EXCEEDS
300mA (JESD 17)
ESD PERFORMANCE:
HBM > 2000V (MIL STD 883 method 3015);
MM > 200V
TSSOP
ORDER CODES
PACKAGE
TSSOP
TUBE
T &R
74VCX162240TTR
PIN CONNECTION
DESCRIPTION
The 74VCX162240 is a low voltage CMOS 16 BIT
BUS BUFFER (INVERTED) fabricated with
sub-micron silicon gate and five-layer metal wiring
C
2
MOS technology. It is ideal for low power and
very high speed 1.8 to 3.6V applications; it can be
interfaced to 3.6V signal environment for both
inputs and outputs.
Any nG output control governs four BUS
BUFFERS. Output Enable input (nG) tied together
gives full 16-bit operation.
When nG is LOW, the outputs are on. When nG is
HIGH, the output are in high impedance state.
This device is designed to be used with 3 state
memory address drivers, etc.
The device circuits is including 26Ω series
resistance in the outputs. These resistors permit
to reduce line noise in high speed applications.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
September 2001
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