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74LVXC3245M: 产品描述LV/LV-A/LVX/H SERIES, 8-BIT TRANSCEIVER, TRUE OUTPUT, PDSO24, SOP-24; 产品类别逻辑逻辑; 文件大小177KB，共12页; 制造商ST(意法半导体); 官网地址http://www.st.com/

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74LVXC3245M概述

LV/LV-A/LVX/H SERIES, 8-BIT TRANSCEIVER, TRUE OUTPUT, PDSO24, SOP-24

74LVXC3245M规格参数

参数名称	属性值
是否Rohs认证	不符合
厂商名称	ST(意法半导体)
零件包装代码	SOIC
包装说明	SOP-24
针数	24
Reach Compliance Code	unknown
其他特性	PORT A OPERATES AT 4.5V TO 5.5V
控制类型	COMMON CONTROL
计数方向	BIDIRECTIONAL
系列	LV/LV-A/LVX/H
JESD-30 代码	R-PDSO-G24
JESD-609代码	e4
长度	15.4 mm
逻辑集成电路类型	BUS TRANSCEIVER
最大I（ol）	0.024 A
湿度敏感等级	3
位数	8
功能数量	1
端口数量	2
端子数量	24
最高工作温度	125 °C
最低工作温度	-55 °C
输出特性	3-STATE
输出极性	TRUE
封装主体材料	PLASTIC/EPOXY
封装代码	SOP
封装等效代码	SOP24,.4
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE
峰值回流温度（摄氏度）	250
电源	3/3.3,3/5 V
Prop。Delay @ Nom-Sup	9 ns
传播延迟（tpd）	9.5 ns
认证状态	Not Qualified
座面最大高度	2.65 mm
最大供电电压 (Vsup)	5.5 V
最小供电电压 (Vsup)	2.7 V
标称供电电压 (Vsup)	3 V
表面贴装	YES
技术	CMOS
温度等级	MILITARY
端子面层	Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式	GULL WING
端子节距	1.27 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	NOT SPECIFIED
翻译	3V & 3/5V
宽度	7.5 mm
Base Number Matches	1

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74LVXC3245

OCTAL DUAL SUPPLY BUS TRANSCEIVER

HIGH SPEED :

= 8ns (MAX.) at T

=25°C

CCA

= 3.3V, V

CCB

= 5.0V

LOW POWER DISSIPATION:

CCA

= I

CCB

= 5µA(MAX.) at T

=25°C

LOW NOISE: V

OLP

=0.3V (TYP.) at

CCA

=3.3V

SYMMETRICAL OUTPUT IMPEDANCE:

| = I

= 24mA (MIN)

BALANCED PROPAGATION DELAYS:

PLH

≅

PHL

OPERATING VOLTAGE RANGE:

CCA

(OPR) = 2.7V to 3.6V (1.2V Data Retention)

CCB

(OPR) = 2.7V to 5.5V (1.2V Data Retention)

PIN AND FUNCTION COMPATIBLE WITH

74 SERIES C3245

IMPROVED LATCH-UP IMMUNITY

SOP

TSSOP

ORDER CODES

PACKAGE

SOP

TSSOP

TUBE

74LVXC3245M

T&R

74LVXC3245MTR

74LVXC3245TTR

DESCRIPTION

The 74LVXC3245 is a dual supply 8 bit

configurable low voltage CMOS OCTAL BUS

TRANSCEIVER fabricated with sub-micron silicon

gate and double-layer metal wiring C

MOS

technology. Designed for use as an interface

between a 3.3V bus and a 3.3V to 5V bus in a

mixed 3.3V/5V supply systems, it achieves high

speed operation while maintaining the CMOS low

power dissipation.

PIN CONNECTION AND IEC LOGIC SYMBOLS

This IC is intended for two-way asynchronous

communication between data buses and the

direction of data transmission is determined by

DIR input. The enable input G can be used to

disable the device so that the buses are effectively

isolated.

The A-port interfaces with the 3V bus, the B-port

with the 5V bus.

All inputs are equipped with protection circuits

against static discharge, giving them 2KV ESD

immunity and transient excess voltage.

July 2001

1/12

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