DS1020S-15: 产品描述SILICON DELAY LINE, TRUE OUTPUT, PDSO16, 0.300 INCH, SOIC-16; 产品类别逻辑逻辑; 文件大小937KB，共13页; 制造商Rochester Electronics; 官网地址https://www.rocelec.com/

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DS1020S-15概述

SILICON DELAY LINE, TRUE OUTPUT, PDSO16, 0.300 INCH, SOIC-16

DS1020S-15规格参数

参数名称	属性值
是否无铅	含铅
是否Rohs认证	不符合
厂商名称	Rochester Electronics
零件包装代码	SOIC
包装说明	SOP,
针数	16
Reach Compliance Code	unknown
其他特性	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT
系列	CMOS
输入频率最大值（fmax）	10.3627 MHz
JESD-30 代码	R-PDSO-G16
JESD-609代码	e0
长度	10.3 mm
逻辑集成电路类型	SILICON DELAY LINE
湿度敏感等级	1
功能数量	1
抽头/阶步数	255
端子数量	16
最高工作温度	70 °C
最低工作温度
输出极性	TRUE
封装主体材料	PLASTIC/EPOXY
封装代码	SOP
封装形状	RECTANGULAR
封装形式	SMALL OUTLINE
峰值回流温度（摄氏度）	245
可编程延迟线	YES
认证状态	COMMERCIAL
座面最大高度	2.65 mm
最大供电电压 (Vsup)	5.25 V
最小供电电压 (Vsup)	4.75 V
标称供电电压 (Vsup)	5 V
表面贴装	YES
技术	CMOS
温度等级	COMMERCIAL
端子面层	TIN LEAD
端子形式	GULL WING
端子节距	1.27 mm
端子位置	DUAL
处于峰值回流温度下的最长时间	NOT SPECIFIED
总延迟标称（td）	48.25 ns
宽度	7.5 mm
Base Number Matches	1

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DS1020

PARALLEL MODE (S=1)

In the PARALLEL programming mode, the output of the DS1020 will reproduce the logic state of the

input after a delay determined by the state of the eight program input pins P0 - P7. The parallel inputs can

be programmed using DC levels or computer-generated data. For infrequent modification of the delay

value, jumpers may be used to connect the input pins to V

and ground. For applications requiring

frequent timing adjustment, DIP switches should be used. The enable pin (E) must be at a logic 1 in

hardwired implementations.

Maximum flexibility is obtained when the eight parallel programming bits are set using computer-

generated data. When the data setup (t

DSE

) and data hold (t

DHE

) requirements are observed, the enable pin

can be used to latch data supplied on an 8-bit bus. Enable must be held at a logic 1 if it is not used to latch

the data. After each change in delay value, a settling time (t

EDV

or t

PDV

) is required before input logic

levels are accurately delayed.

Since the DS1020 is a CMOS design, unused input pins (D and C) must be connected to well-defined

logic levels; they must not be allowed to float.

SERIAL MODE (S = 0)

In the SERIAL programming mode, the output of the DS1020 will reproduce the logic state of the input

after a delay time determined by an 8-bit value clocked into serial port D. While observing data setup

DSC

) and data hold (t

DHC

) requirements, timing data is loaded in MSB-to-LSB order by the rising edge of

the serial clock (C). The enable pin (E) must be at a logic 1 to load or read the internal 8-bit input register,

during which time the delay is determined by the last value activated. Data transfer ends and the new

delay value is activated when enable (E) returns to a logic 0. After each change, a settling time (t

EDV

) is

required before the delay is accurate.

As timing values are shifted into the serial data input (D), the previous contents of the 8-bit input register

are shifted out of the serial output pin (Q) in MSB-to-LSB order. By connecting the serial output of one

DS1020 to the serial input of a second DS1020, multiple devices can be daisy-chained (cascaded) for

programming purposes (Figure 3). The total number of serial bits must be eight times the number of units

daisy-chained and each group of 8 bits must be sent in MSB-to-LSB order.

Applications can read the setting of the DS1020 delay line by connecting the serial output pin (Q) to the

serial input (D) through a resistor with a value of 1k to 10k ohms (Figure 2). Since the read process is

destructive, the resistor restores the value read and provides isolation when writing to the device. The

resistor must connect the serial output (Q) of the last device to the serial input (D) of the first device of a

daisy-chain (Figure 3). For serial readout with automatic restoration through a resistor, the device used to

write serial data must go to a high impedance state.

To initiate a serial read, enable (E) is taken to a logic 1 while serial clock (C) is at a logic 0. After a

waiting time (t

EQV

), bit 7 (MSB) appears on the serial output (Q). On the first rising (0

→

1) transition of

the serial clock (C), bit 7 (MSB) is rewritten and bit 6 appears on the output after a time t

CQV

. To restore

the input register to its original state, this clocking process must be repeated 8 times. In the case of a

daisy-chain, the process must be repeated 8 times per package. If the value read is restored before enable

(E) is returned to logic 0, no settling time (t

EDV

) is required and the programmed delay remains

unchanged.

Since the DS1020 is a CMOS design, unused input pins (P1 - P7) must be connected to well-defined logic

levels; they must not be allowed to float. Serial output Q/P0 should be allowed to float if unused.

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	DS1020S-15	DS1020S-50	DS1020S-25	DS1020-50	DS1020S-50+	DS1020-15	DS1020-25	DS1020-200
描述	SILICON DELAY LINE, TRUE OUTPUT, PDSO16, 0.300 INCH, SOIC-16	SILICON DELAY LINE, TRUE OUTPUT, PDSO16, 0.300 INCH, SOIC-16	SILICON DELAY LINE, TRUE OUTPUT, PDSO16, 0.300 INCH, SOIC-16	SILICON DELAY LINE, TRUE OUTPUT, PDIP16, 0.300 INCH, PLASTIC, MS-001AA, DIP-16	SILICON DELAY LINE, TRUE OUTPUT, PDSO16, 0.300 INCH, ROHS COMPLIANT, SOIC-16	SILICON DELAY LINE, TRUE OUTPUT, PDIP16, 0.300 INCH, PLASTIC, MS-001AA, DIP-16	SILICON DELAY LINE, TRUE OUTPUT, PDIP16, 0.300 INCH, PLASTIC, MS-001AA, DIP-16	SILICON DELAY LINE, TRUE OUTPUT, PDIP16, 0.300 INCH, PLASTIC, MS-001AA, DIP-16
是否无铅	含铅	含铅	含铅	含铅	不含铅	含铅	含铅	含铅
是否Rohs认证	不符合	不符合	不符合	不符合	符合	不符合	不符合	不符合
厂商名称	Rochester Electronics	Rochester Electronics	Rochester Electronics	Rochester Electronics	Rochester Electronics	Rochester Electronics	Rochester Electronics	Rochester Electronics
零件包装代码	SOIC	SOIC	SOIC	DIP	SOIC	DIP	DIP	DIP
包装说明	SOP,	SOP,	SOP,	DIP,	SOP,	DIP,	DIP,	DIP,
针数	16	16	16	16	16	16	16	16
Reach Compliance Code	unknown	unknown	unknown	unknown	unknown	unknown	unknown	unknown
其他特性	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT	PROGRAMMABLE USING 3-WIRE SERIAL PORT OR 8-BIT PARALLEL PORT
系列	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS
输入频率最大值（fmax）	10.3627 MHz	3.63636 MHz	6.77966 MHz	3.63636 MHz	3.63636 MHz	10.3627 MHz	6.77966 MHz	0.961538 MHz
JESD-30 代码	R-PDSO-G16	R-PDSO-G16	R-PDSO-G16	R-PDIP-T16	R-PDSO-G16	R-PDIP-T16	R-PDIP-T16	R-PDIP-T16
JESD-609代码	e0	e0	e0	e0	e3	e0	e0	e0
长度	10.3 mm	10.3 mm	10.3 mm	19.175 mm	10.3 mm	19.175 mm	19.175 mm	19.175 mm
逻辑集成电路类型	SILICON DELAY LINE	SILICON DELAY LINE	SILICON DELAY LINE	SILICON DELAY LINE	SILICON DELAY LINE	SILICON DELAY LINE	SILICON DELAY LINE	SILICON DELAY LINE
湿度敏感等级	1	1	1	1	NOT SPECIFIED	1	1	1
功能数量	1	1	1	1	1	1	1	1
抽头/阶步数	255	255	255	255	255	255	255	255
端子数量	16	16	16	16	16	16	16	16
最高工作温度	70 °C	70 °C	70 °C	70 °C	70 °C	70 °C	70 °C	70 °C
输出极性	TRUE	TRUE	TRUE	TRUE	TRUE	TRUE	TRUE	TRUE
封装主体材料	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	SOP	SOP	SOP	DIP	SOP	DIP	DIP	DIP
封装形状	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR	RECTANGULAR
封装形式	SMALL OUTLINE	SMALL OUTLINE	SMALL OUTLINE	IN-LINE	SMALL OUTLINE	IN-LINE	IN-LINE	IN-LINE
峰值回流温度（摄氏度）	245	245	245	240	260	240	240	240
可编程延迟线	YES	YES	YES	YES	YES	YES	YES	YES
认证状态	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL
座面最大高度	2.65 mm	2.65 mm	2.65 mm	4.572 mm	2.65 mm	4.572 mm	4.572 mm	4.572 mm
最大供电电压 (Vsup)	5.25 V	5.25 V	5.25 V	5.25 V	5.25 V	5.25 V	5.25 V	5.25 V
最小供电电压 (Vsup)	4.75 V	4.75 V	4.75 V	4.75 V	4.75 V	4.75 V	4.75 V	4.75 V
标称供电电压 (Vsup)	5 V	5 V	5 V	5 V	5 V	5 V	5 V	5 V
表面贴装	YES	YES	YES	NO	YES	NO	NO	NO
技术	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS	CMOS
温度等级	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL	COMMERCIAL
端子面层	TIN LEAD	TIN LEAD	TIN LEAD	TIN LEAD	MATTE TIN	TIN LEAD	TIN LEAD	TIN LEAD
端子形式	GULL WING	GULL WING	GULL WING	THROUGH-HOLE	GULL WING	THROUGH-HOLE	THROUGH-HOLE	THROUGH-HOLE
端子节距	1.27 mm	1.27 mm	1.27 mm	2.54 mm	1.27 mm	2.54 mm	2.54 mm	2.54 mm
端子位置	DUAL	DUAL	DUAL	DUAL	DUAL	DUAL	DUAL	DUAL
处于峰值回流温度下的最长时间	NOT SPECIFIED	NOT SPECIFIED	NOT SPECIFIED	20	NOT SPECIFIED	20	20	20
总延迟标称（td）	48.25 ns	137.5 ns	73.75 ns	137.5 ns	137.5 ns	48.25 ns	73.75 ns	520 ns
宽度	7.5 mm	7.5 mm	7.5 mm	7.62 mm	7.5 mm	7.62 mm	7.62 mm	7.62 mm
Base Number Matches	1	1	1	1	1	-	-	-

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