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MACH230-10: 产品描述High-Density EE CMOS Programmable Logic; 文件大小151KB，共29页; 制造商Lattice(莱迪斯); 官网地址http://www.latticesemi.com

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MACH230-10概述

High-Density EE CMOS Programmable Logic

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FINAL

COM’L: -10/15/20

IND: -18/24

MACH230-10/15/20

High-Density EE CMOS Programmable Logic

DISTINCTIVE CHARACTERISTICS

84 Pins

128 Macrocells

10 ns t

Commercial

18 ns t

Industrial

100 MHz f

CNT

70 Inputs

64 Outputs

Lattice Semiconductor

128 Flip-flops; 4 clock choices

8 “PAL26V16” blocks with buried macrocells

Pin-compatible with MACH130, MACH131,

MACH231, and MACH435

GENERAL DESCRIPTION

The MACH230 is a member of the high-performance

EE CMOS MACH 2 device family. This device has ap-

proximately twelve times the logic macrocell capability

of the popular PAL22V10 without loss of speed.

The MACH230 consists of eight PAL blocks intercon-

nected by a programmable switch matrix. The switch

matrix connects the PAL blocks to each other and to all

input pins, providing a high degree of connectivity be-

tween the fully-connected PAL blocks. This allows

designs to be placed and routed efficiently.

The MACH230 has two kinds of macrocell: output and

buried. The output macrocell provides registered,

latched, or combinatorial outputs with programmable

polarity. If a registered configuration is chosen, the reg-

ister can be configured as D-type or T-type to help

reduce the number of product terms. The register type

decision can be made by the designer or by the soft-

ware. All output macrocells can be connected to an I/O

cell. If a buried macrocell is desired, the internal feed-

back path from the macrocell can be used, which frees

up the I/O pin for use as an input.

The MACH230 has dedicated buried macrocells which,

in addition to the capabilities of the output macrocell,

also provide input registers for use in synchronizing

signals and reducing setup time requirements.

BLOCK DIAGRAM

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please click on the box.

Publication#

14132

Rev.

Issue Date:

May 1995

Amendment

MACH230-10相似产品对比

	MACH230-10	MACH230-15JC	MACH230-20JC	MACH230-10JC
描述	High-Density EE CMOS Programmable Logic	High-Density EE CMOS Programmable Logic	High-Density EE CMOS Programmable Logic	High-Density EE CMOS Programmable Logic
是否Rohs认证	-	不符合	不符合	不符合
厂商名称	-	Lattice(莱迪斯)	Lattice(莱迪斯)	Lattice(莱迪斯)
零件包装代码	-	LCC	LCC	LCC
包装说明	-	QCCJ, LDCC84,1.2SQ	QCCJ, LDCC84,1.2SQ	PLASTIC, LCC-84
针数	-	84	84	84
Reach Compliance Code	-	_compli	compli	unknow
ECCN代码	-	EAR99	EAR99	EAR99
其他特性	-	NO	NO	NO
最大时钟频率	-	50 MHz	40 MHz	77 MHz
系统内可编程	-	NO	NO	NO
JESD-30 代码	-	S-PQCC-J84	S-PQCC-J84	S-PQCC-J84
JESD-609代码	-	e0	e0	e0
JTAG BST	-	NO	NO	NO
长度	-	29.2862 mm	29.2862 mm	29.2862 mm
湿度敏感等级	-	3	3	3
专用输入次数	-	2	2	2
I/O 线路数量	-	64	64	64
宏单元数	-	128	128	128
端子数量	-	84	84	84
最高工作温度	-	70 °C	70 °C	70 °C
组织	-	2 DEDICATED INPUTS, 64 I/O	2 DEDICATED INPUTS, 64 I/O	2 DEDICATED INPUTS, 64 I/O
输出函数	-	MACROCELL	MACROCELL	MACROCELL
封装主体材料	-	PLASTIC/EPOXY	PLASTIC/EPOXY	PLASTIC/EPOXY
封装代码	-	QCCJ	QCCJ	QCCJ
封装等效代码	-	LDCC84,1.2SQ	LDCC84,1.2SQ	LDCC84,1.2SQ
封装形状	-	SQUARE	SQUARE	SQUARE
封装形式	-	CHIP CARRIER	CHIP CARRIER	CHIP CARRIER
电源	-	5 V	5 V	5 V
可编程逻辑类型	-	EE PLD	EE PLD	EE PLD
传播延迟	-	15 ns	20 ns	10 ns
认证状态	-	Not Qualified	Not Qualified	Not Qualified
座面最大高度	-	4.57 mm	4.57 mm	4.57 mm
最大供电电压	-	5.25 V	5.25 V	5.25 V
最小供电电压	-	4.75 V	4.75 V	4.75 V
标称供电电压	-	5 V	5 V	5 V
表面贴装	-	YES	YES	YES
技术	-	CMOS	CMOS	CMOS
温度等级	-	COMMERCIAL	COMMERCIAL	COMMERCIAL
端子面层	-	Tin/Lead (Sn85Pb15)	Tin/Lead (Sn85Pb15)	Tin/Lead (Sn85Pb15)
端子形式	-	J BEND	J BEND	J BEND
端子节距	-	1.27 mm	1.27 mm	1.27 mm
端子位置	-	QUAD	QUAD	QUAD
宽度	-	29.2862 mm	29.2862 mm	29.2862 mm

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