Datasheet> 器件分类 > 逻辑> 逻辑> 813252CKI-02LFT

813252CKI-02LFT: 产品描述VFQFPN-32, Reel; 产品类别逻辑逻辑; 文件大小642KB，共23页; 制造商IDT (Integrated Device Technology); 标准

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813252CKI-02LFT概述

VFQFPN-32, Reel

813252CKI-02LFT规格参数

参数名称	属性值
Brand Name	Integrated Device Technology
是否无铅	不含铅
是否Rohs认证	符合
厂商名称	IDT (Integrated Device Technology)
零件包装代码	VFQFPN
包装说明	VFQFN-32
针数	32
制造商包装代码	NLG32P1
Reach Compliance Code	compliant
ECCN代码	EAR99
系列	813252
输入调节	DIFFERENTIAL MUX
JESD-30 代码	S-XQCC-N32
JESD-609代码	e3
长度	5 mm
逻辑集成电路类型	PLL BASED CLOCK DRIVER
湿度敏感等级	3
功能数量	1
反相输出次数
端子数量	32
实输出次数	2
最高工作温度	85 °C
最低工作温度	-40 °C
输出特性	OPEN-EMITTER
封装主体材料	UNSPECIFIED
封装代码	HVQCCN
封装形状	SQUARE
封装形式	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）	260
认证状态	Not Qualified
Same Edge Skew-Max（tskwd）	0.075 ns
座面最大高度	1 mm
最大供电电压 (Vsup)	3.465 V
最小供电电压 (Vsup)	3.135 V
标称供电电压 (Vsup)	3.3 V
表面贴装	YES
温度等级	INDUSTRIAL
端子面层	Matte Tin (Sn) - annealed
端子形式	NO LEAD
端子节距	0.5 mm
端子位置	QUAD
处于峰值回流温度下的最长时间	NOT SPECIFIED
宽度	5 mm
最小 fmax	312.5 MHz
Base Number Matches	1

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Jitter Attenuator & FemtoClock

Multiplier

ICS813252I-02

OBSOLETE

DATA SHEET

ENERAL

ESCRIPTION

The ICS813252I-02 is a PLL based synchronous multiplier that is

optimized for PDH or SONET to Ethernet clock jitter attenuation

and frequency translation. The device contains two internal

frequency multiplication stages that are cascaded in series. The ﬁrst

stage is a VCXO PLL that is optimized to provide reference clock

jitter attenuation. The second stage is a FemtoClock

frequency

multiplier that provides the low jitter, high frequency Ethernet

output clock that easily meets Gigabit and 10 Gigabit Ethernet jitter

requirements. Pre-divider and output divider multiplication ratios

are selected using device selection control pins. The multiplication

ratios are optimized to support most common clock rates used in

PDH, SONET and Ethernet applications. The VCXO requires the

use of an external, inexpensive pullable crystal. The VCXO uses

external passive loop ﬁlter components which allows conﬁguration

of the PLL loop bandwidth and damping characteristics. The

device is packaged in a space-saving 32-VFQFN package and

supports industrial temperature range.

EATURES

•

Two LVPECL outputs

Each output supports independent frequency selection at

25MHz, 125MHz, 156.25MHz and 312.5MHz

•

Two differential inputs support the following input types: LVPE-

CL, LVDS, LVHSTL, SSTL, HCSL

•

Accepts input frequencies from 8kHz to 155.52MHz including

8kHz, 1.544MHz, 2.048MHz, 19.44MHz, 25MHz, 77.76MHz,

125MHz and 155.52MHz

•

Attenuates the phase jitter of the input clock by using a low-

cost pullable fundamental mode VCXO crystal

•

VCXO PLL bandwidth can be optimized for jitter attenuation

and reference tracking

using external loop ﬁlter connection

•

FemtoClock frequency multiplier provides low jitter, high fre-

quency output

•

Absolute pull range: 50ppm

•

FemtoClock VCO frequency: 625MHz

•

RMS phase jitter @ 125MHz, using a 25MHz crystal

(10kHz – 20MHz): 1.3ps (maximum)

•

3.3V supply voltage

SSIGNMENT

XTAL_OUT

XTAL_IN

nCLK0

nCLK1

CLK0

CLK1

CCX

9 10 11 12 13 14 15 16

ODBSEL_1

ODBSEL_0

ODASEL_1

PDSEL_2

PDSEL_1

PDSEL_0

CCA

•

-40°C to 85°C ambient operating temperature

•

Available in lead-free (RoHS 6) package

•

For functional replacement device use 813N252CKI-02LF

32 31 30 29 28 27 26 25

LF1

LF0

ISET

CLK_SEL

RESERVED

nQB

CCO

nQA

ODASEL_0

ICS813252I-02

32-Lead VFQFN

5mm x 5mm x 0.925 package body

K Package

Top View

ICS813252CKI-02 REVISION A AUGUST 4, 2016

Integrated Device Technology, Inc.

813252CKI-02LFT相似产品对比

	813252CKI-02LFT	813252CKI-02LF
描述	VFQFPN-32, Reel	VFQFPN-32, Tray
Brand Name	Integrated Device Technology	Integrated Device Technology
是否无铅	不含铅	不含铅
是否Rohs认证	符合	符合
厂商名称	IDT (Integrated Device Technology)	IDT (Integrated Device Technology)
零件包装代码	VFQFPN	VFQFPN
包装说明	VFQFN-32	VFQFN-32
针数	32	32
制造商包装代码	NLG32P1	NLG32P1
Reach Compliance Code	compliant	compliant
ECCN代码	EAR99	EAR99
系列	813252	813252
输入调节	DIFFERENTIAL MUX	DIFFERENTIAL MUX
JESD-30 代码	S-XQCC-N32	S-XQCC-N32
JESD-609代码	e3	e3
长度	5 mm	5 mm
逻辑集成电路类型	PLL BASED CLOCK DRIVER	PLL BASED CLOCK DRIVER
湿度敏感等级	3	3
功能数量	1	1
端子数量	32	32
实输出次数	2	2
最高工作温度	85 °C	85 °C
最低工作温度	-40 °C	-40 °C
输出特性	OPEN-EMITTER	OPEN-EMITTER
封装主体材料	UNSPECIFIED	UNSPECIFIED
封装代码	HVQCCN	HVQCCN
封装形状	SQUARE	SQUARE
封装形式	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE	CHIP CARRIER, HEAT SINK/SLUG, VERY THIN PROFILE
峰值回流温度（摄氏度）	260	260
认证状态	Not Qualified	Not Qualified
Same Edge Skew-Max（tskwd）	0.075 ns	0.075 ns
座面最大高度	1 mm	1 mm
最大供电电压 (Vsup)	3.465 V	3.465 V
最小供电电压 (Vsup)	3.135 V	3.135 V
标称供电电压 (Vsup)	3.3 V	3.3 V
表面贴装	YES	YES
温度等级	INDUSTRIAL	INDUSTRIAL
端子面层	Matte Tin (Sn) - annealed	Matte Tin (Sn) - annealed
端子形式	NO LEAD	NO LEAD
端子节距	0.5 mm	0.5 mm
端子位置	QUAD	QUAD
处于峰值回流温度下的最长时间	NOT SPECIFIED	NOT SPECIFIED
宽度	5 mm	5 mm
最小 fmax	312.5 MHz	312.5 MHz
Base Number Matches	1	1

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