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74AC08B

产品描述Logic Gates
产品类别逻辑    逻辑   
文件大小192KB,共8页
制造商ST(意法半导体)
官网地址http://www.st.com/
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74AC08B概述

Logic Gates

74AC08B规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称ST(意法半导体)
零件包装代码DIP
包装说明DIP, DIP14,.3
针数14
Reach Compliance Codenot_compliant
系列AC
JESD-30 代码R-PDIP-T14
JESD-609代码e0
负载电容(CL)50 pF
逻辑集成电路类型AND GATE
最大I(ol)0.012 A
功能数量4
输入次数2
端子数量14
最高工作温度125 °C
最低工作温度-55 °C
封装主体材料PLASTIC/EPOXY
封装代码DIP
封装等效代码DIP14,.3
封装形状RECTANGULAR
封装形式IN-LINE
包装方法TUBE
电源3.3/5 V
Prop。Delay @ Nom-Sup10 ns
传播延迟(tpd)12.5 ns
认证状态Not Qualified
施密特触发器NO
座面最大高度5.1 mm
最大供电电压 (Vsup)6 V
最小供电电压 (Vsup)2 V
标称供电电压 (Vsup)3.3 V
表面贴装NO
技术CMOS
温度等级MILITARY
端子面层Tin/Lead (Sn/Pb)
端子形式THROUGH-HOLE
端子节距2.54 mm
端子位置DUAL
宽度7.62 mm

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74AC08
QUAD 2-INPUT AND GATE
s
s
s
s
s
s
s
s
s
HIGH SPEED: t
PD
= 4ns (TYP.) at V
CC
= 5V
LOW POWER DISSIPATION:
I
CC
= 2µA(MAX.) at T
A
=25°C
HIGH NOISE IMMUNITY:
V
NIH
= V
NIL
= 28 % V
CC
(MIN.)
50Ω TRANSMISSION LINE DRIVING
CAPABILITY
SYMMETRICAL OUTPUT IMPEDANCE:
|I
OH
| = I
OL
= 24mA (MIN)
BALANCED PROPAGATION DELAYS:
t
PLH
t
PHL
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 2V to 6V
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 08
IMPROVED LATCH-UP IMMUNITY
DIP
SOP
TSSOP
ORDER CODES
PACKAGE
DIP
SOP
TSSOP
TUBE
74AC08B
74AC08M
DESCRIPTION
The 74AC08 is an advanced high-speed CMOS
QUAD 2-INPUT AND GATE fabricated with
sub-micron silicon gate and double-layer metal
wiring C
2
MOS tecnology.
PIN CONNECTION AND IEC LOGIC SYMBOLS
O
so
b
te
le
ro
P
uc
d
s)
t(
so
b
-O
The internal circuit is composed of 2 stages
including buffer output, which enables high noise
immunity and stable output.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
P
te
le
od
r
s)
t(
uc
T&R
74AC08MTR
74AC08TTR
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1/8
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