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HCC4012BF

产品描述4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDIP14
产品类别逻辑    逻辑   
文件大小273KB,共12页
制造商ST(意法半导体)
官网地址http://www.st.com/
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HCC4012BF概述

4000/14000/40000 SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDIP14

4000/14000/40000 系列, 双正边沿D触发器, 互补输出, PDIP14

HCC4012BF规格参数

参数名称属性值
是否Rohs认证不符合
厂商名称ST(意法半导体)
零件包装代码DIP
包装说明FRIT SEALED, CERAMIC, DIP-14
针数14
Reach Compliance Codenot_compliant
系列4000/14000/40000
JESD-30 代码R-GDIP-T14
JESD-609代码e0
长度19.43 mm
负载电容(CL)50 pF
逻辑集成电路类型NAND GATE
功能数量2
输入次数4
端子数量14
最高工作温度125 °C
最低工作温度-55 °C
封装主体材料CERAMIC, GLASS-SEALED
封装代码DIP
封装等效代码DIP14,.3
封装形状RECTANGULAR
封装形式IN-LINE
峰值回流温度(摄氏度)NOT SPECIFIED
电源3/18 V
Prop。Delay @ Nom-Sup250 ns
传播延迟(tpd)250 ns
认证状态Not Qualified
施密特触发器NO
座面最大高度5.08 mm
最大供电电压 (Vsup)18 V
最小供电电压 (Vsup)3 V
标称供电电压 (Vsup)5 V
表面贴装NO
技术CMOS
温度等级MILITARY
端子面层Tin/Lead (Sn/Pb)
端子形式THROUGH-HOLE
端子节距2.54 mm
端子位置DUAL
处于峰值回流温度下的最长时间NOT SPECIFIED
宽度8.965 mm
Base Number Matches1

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HCC4011B/12B/23B
HCF4011B/12B/23B
NAND GATES
QUAD 2 INPUT HCC/HCF 4011B
DUAL 4 INPUT HCC/HCF 4012B
TRIPLE 3 INPUT HCC/HCF 4023B
.
.
.
.
.
.
.
PROPAGATION DELAY TIME = 60ns (typ.) AT
C
L
= 50pF, V
DD
= 10V
BUFFERED INPUTS AND OUTPUTS
QUIESCENT CURRENT SPECIFIED TO 20V
FOR HCC DEVICE
INPUT CURRENT OF 100nA AT 18V AND 25°C
FOR HCC DEVICE
100% TESTED FOR QUIESCENT CURRENT
5V, 10V AND 15V PARAMETRIC RATINGS
MEETS ALL REQUIREMENTS OF JEDEC TEN-
TATIVE STANDARD N
o
. 13A, ”STANDARD
SPECIFICATIONS FOR DESCRIPTION OF ”B”
SERIES CMOS DEVICES”
EY
(Plastic Package)
F
(Ceramic Frit Seal Package)
M1
(Micro Package)
C1
(Plastic Chip Carrier)
ORDER CODES :
HCC40XXBF
HCF40XXBM1
HCF40XXBEY
HCF40XXBC1
DESCRIPTION
The
HCC4011B, HCC4012B
and
HCC4023B
(ex-
tended temperature range) and
HCF4011B,
HCF4012B
and
HCF4023B
(intermediate tempera-
ture range) are monolithic, integrated circuit, avail-
able in 14-lead dual in-line plastic or ceramic
package and plastic micropackage.
PIN CONNECTIONS
4011B
The
HCC/HCF4011B, HCC/HCF4012B
and
HCC/HCF4023B
NAND gates provide the system
designer with direct implementation of the NAND
function and supplement the existing family of
COS/MOS gates. All inputs and outputs are buf-
fered.
4012B
4023B
June 1989
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