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74VHCT74AMTR

产品描述Flip Flops Dual "D" Flip-Flop
产品类别逻辑    逻辑   
文件大小356KB,共14页
制造商ST(意法半导体)
官网地址http://www.st.com/
标准
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74VHCT74AMTR概述

Flip Flops Dual "D" Flip-Flop

74VHCT74AMTR规格参数

参数名称属性值
是否无铅不含铅
是否Rohs认证符合
厂商名称ST(意法半导体)
零件包装代码SOIC
包装说明SOP, SOP14,.25
针数14
Reach Compliance Codecompliant
系列AHCT/VHCT
JESD-30 代码R-PDSO-G14
JESD-609代码e4
长度8.65 mm
负载电容(CL)50 pF
逻辑集成电路类型D FLIP-FLOP
最大频率@ Nom-Sup65000000 Hz
最大I(ol)0.008 A
湿度敏感等级1
位数1
功能数量2
端子数量14
最高工作温度125 °C
最低工作温度-55 °C
输出极性COMPLEMENTARY
封装主体材料PLASTIC/EPOXY
封装代码SOP
封装等效代码SOP14,.25
封装形状RECTANGULAR
封装形式SMALL OUTLINE
包装方法TAPE AND REEL
峰值回流温度(摄氏度)260
电源5 V
传播延迟(tpd)10 ns
认证状态Not Qualified
座面最大高度1.75 mm
最大供电电压 (Vsup)5.5 V
最小供电电压 (Vsup)4.5 V
标称供电电压 (Vsup)5 V
表面贴装YES
技术CMOS
温度等级MILITARY
端子面层Nickel/Palladium/Gold (Ni/Pd/Au)
端子形式GULL WING
端子节距1.27 mm
端子位置DUAL
处于峰值回流温度下的最长时间30
触发器类型POSITIVE EDGE
宽度3.9 mm
最小 fmax80 MHz
Base Number Matches1

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74VHCT74A
DUAL D-TYPE FLIP FLOP WITH PRESET AND CLEAR
s
s
s
s
s
s
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s
DESCRIPTION
The 74VHCT74A is an advanced high-speed
CMOS DUAL D-TYPE FLIP FLOP WITH PRESET
AND CLEAR fabricated with sub-micron silicon
gate and double-layer metal wiring C
2
MOS
technology.
A signal on the D INPUT is transferred to the Q
OUTPUT during the positive going transition of the
clock pulse.
Figure 1: Pin Connection And IEC Logic Symbols
O
s)
t(
uc
d
)
ro
(s
P
ct
te
du
le
o
so
Pr
b
e
O
et
) -
ol
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O
u
-
od
s)
r
(
P
ct
te
du
le
o
so
Pr
b
e
O
t
le
so
b
SOP
TSSOP
HIGH SPEED:
f
MAX
= 160 MHz (TYP.) at V
CC
= 5V
LOW POWER DISSIPATION:
I
CC
= 2
µA
(MAX.) at T
A
=25°C
COMPATIBLE WITH TTL OUTPUTS:
V
IH
= 2V (MIN.), V
IL
= 0.8V (MAX)
POWER DOWN PROTECTION ON INPUTS
& OUTPUTS
SYMMETRICAL OUTPUT IMPEDANCE:
|I
OH
| = I
OL
= 8 mA (MIN)
BALANCED PROPAGATION DELAYS:
t
PLH
t
PHL
OPERATING VOLTAGE RANGE:
V
CC
(OPR) = 4.5V to 5.5V
PIN AND FUNCTION COMPATIBLE WITH
74 SERIES 74
IMPROVED LATCH-UP IMMUNITY
Table 1: Order Codes
PACKAGE
SOP
TSSOP
T&R
74VHCT74AMTR
74VHCT74ATTR
CLR and PR are independent of the clock and
accomplished by a low setting on the appropriate
input.
Power down protection is provided on all inputs
and outputs and 0 to 7V can be accepted on
inputs with no regard to the supply voltage. This
device can be used to interface 5V to 3V since all
inputs are equipped with TTL threshold.
All inputs and outputs are equipped with
protection circuits against static discharge, giving
them 2KV ESD immunity and transient excess
voltage.
December 2004
Rev. 3
1/14

 
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