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CJ79L09-SOT-23-3L

产品描述Three-terminal negative voltage regulator
文件大小127KB,共2页
制造商长电科技(JCET)
官网地址http://www.cj-elec.com/

江苏长电科技股份有限公司专注于半导体封装测试业务,为海内外客户提供芯片测试、封装设计、封装测试等全套解决方案。公司于2003年在上海主板成功上市,成为国内首家半导体封测上市公司,现已拥有国家级企业技术中心、博士后科研工作站,是国家重点高新技术企业、高密度集成电路国家工程实验室依托单位及集成电路封装技术创新战略联盟的理事长单位。

分立器件:二极管(开关二极管,肖特基二极管(肖特基整流管),稳压二极管,Pin二极管,TVS二极管,整流二极管,快恢复二极管);晶体管(达林顿管,数字晶体管,MOSFET);晶闸管:可控硅整流器,三端双向可控硅;复合管:晶体管+场效应管,双晶体管,双数字晶体管,数字晶体管+晶体管,晶体管+二极管,场效应管+二极管,双场效应管。稳压电路;节能灯充电器开关管

引线框架:TO系列(TO);SOD系列(SOD);SOT系列(TSOT,SOT);FBP系列(WBFBP);QFN系列(QFNWB,DFNWB,DFNFC,QFNFC);QFP系列(LQFP:PQFP:PLCC:TQFP);SIP系列(SIP,HSIP,FSIP);SOP系列(SOP,HSOP,SSOP,MSOP,HTSOP,TSSOP);DIP系列(DIP,FDIP,SDIP);PDFN系列;PQFN系列;MIS系列(MISFC,MISWB)

九大核心技术:硅穿孔(TSV)封装技术;SiP射频封装技术;圆片级三维再布线封装工艺技术;铜凸点互连技术;高密度FC-BGA封测技术(Flip Chip BGA);多圈阵列四边无引脚封测技术;封装体三维立体堆叠技术;50μm以下超薄芯片三维立体堆叠封装技术;MEMS多芯片封装技术;MIS封装技术(预包封互联系统);BGA封装技术等。

 

 

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CJ79L09-SOT-23-3L概述

Three-terminal negative voltage regulator

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JIANGSU CHANGJIANG ELECTRONICS TECHNOLOGY CO., LTD
SOT-23-3L Encapsulate Three Terminal Voltage Regulator
SOT-23-3L
1.GND 
CJ79L09
Three
-terminal negative voltage regulator
FEATURES
Maximum Output
current
I
OM:
0.1 A
Output voltage
V
o
:
-9V
2.OUT 
3.IN
 
1.02
0.95±0.025
2.80±0.05
1.60±0.05
ABSOLUTE MAXIMUM RATINGS(Operating temperature range applies unless otherwise specified)
Parameter
Input Voltage
Operating Junction Temperature Range
Storage Temperature Range
Symbol
 ½
T
OPR
T
STG
Value
-30
0—+125 
-55—+150 
Unlts
        ℃ 
        ℃ 
ELECTRICAL CHARACTERISTICS
(Vi=15V,Io=40mA,0℃<Tj<125℃,C1=0.33μF,Co=0.1μF, unless otherwise specified )
Parameter
Output voltage
Load Regulation
Line regulation
Quiescent Current
Output Noise VoItage
Ripple Rejection
Symbol
V½ 
V½-I½ 
V½-V½ 
I½ 
 
RR 
Test conditions
V½=-15V,I
=40½A 
V½=-15V, I½=1½A~100½A 
V½=-12.5V~-24V, I
=40½A 
V½=-15V, I
=40½A 
=10H½~100KH½, V½=-15V, I
=40½A 
V½=-12V~-22V,I½=40½A, ½
½
=1V
P-P
, 
½=150H½ 
MIN
-8.64 
 
 
 
 
37 
TYP
-9 
12 
27 
3.5 
210 
64 
MAX
UNIT
-9.36    V 
90 
200 
6 
 
 
  ½V 
  ½V 
  ½A 
  ½V 
  ½B 
TYPICAL APPLICATION
Vi
2
  CJ79L09
UTC
3
V
O
  
  
 C½            
  C
 
0.1μF 
                                0.33μF                              
0.35
2.92±0.05
1.9
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原文地址:verilog中对inout信号的处理作者:bbccy 1、inout端口不能被赋值为reg型,因此,不能用于always语句中。 2、if等条件语句只能用于initial语句及always语句。 3、因此,对于i ......
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