和兴健半导½
四声道数字音质处理器
概述
HXJ2314
HXJ2314
是一个½用CMOS 制程技术的四输入数字音质处理IC。
HXJ2314
将音量(Volume)左右声道平衡(balance)、
高
½音质(Treble
& Bass)、响度(Loudness)等控制及可选择增益入(selectable input gain)内建于单一芯片中，½得HXJ2314
具有
高效½及高可靠度，且只需运用少许的外围组件，便可达高效率的音质处理功½。HXJ2314 的所有功½均可藉由序列总线
(I
2
C bus)的驱动来达成，并可将其程序化而达多变的功½。HXJ2314
的脚½功½和应用电路是利于½PCB 布局的简易化，
并½为相关音响应用节省成本。
重要特性
1.
简化外部组件
2.
高½音控制
3.
响度控制
4.
可选择4 个立½声的增益输入
5.
可降½外部噪声的输入/输出系统
6.
可左右平衡的2 个独立扬声器控制
7.
独立静音功½
8.
音量控制每阶为1.25dB
9.
½失真
10.
½直流准½漂移
11.
可由微处理机序列总线I2C 接口控制
应用领域
1.
½½音响
2.
立½声音效系统(Hi-Fi
Audio System)
封装½式
采用环保无铅SOP-28
引脚分布
和兴健半导½（香港）有限公司
地址：宝安区民治街道民康路东明大厦
1326-1333
室
www.hxjic.com
www.hexingjian.com
传真：0755-83358589
电话：0755-83692256
/ 83692276
和兴健半导½
四声道数字音质处理器
引脚说明
序号
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
V
DD
AGND
TREB_L
TREB_R
RIN
ROUT
LOUD_R
RIN4
RIN3
RIN2
RIN1
LOUD_L
LIN4
LIN3
LIN2
LIN1
LIN
LOUT
BIN_L
BOUT_L
BIN_R
BOUT_R
OUT_R
OUT_L
DGND
DATA
CLK
REF
脚½名称
I/O
-
-
I
I
I
O
I
I
I
I
I
I
I
I
I
I
I
O
I
O
I
O
O
O
-
I
I
-
右声道输出
左声道输出
数½接地
序列传输的控制资料(Data)
序列传输的时脉(Clock)输入
参考电压(1/2
V
DD
)
右声道½音控制之输入/输出端脚½
左声道音效处理器之输入端脚½
左声道音源经选择器增益放大后的输出脚½
左声道½音控制之输入/输出端脚½
左声道音源的第四/三/二/一输入
左声道响度控制脚½
右声道音源的第四/三/二/一输入
右声道音效处理器之输入端脚½
右声道音源经选择器增益放大后的输出脚½
右声道响度控制脚½
供应电压
类比接地
左/右声道高音控制脚½
叙述
HXJ2314
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四声道数字音质处理器
方块图
LOUT LIN LOUD_L
BOUT_L
BIN_L
TREB_L
HXJ2314
RB
LIN1
LIN2
LIN3
LIN4
RIN4
RIN3
RIN2
RIN1
LIN1
LIN2
LIN3
LIN4
RIN4
RIN3
RIN2
RIN1
Volume &
Loudness
Bass
Treble
Input
Selector
& Gain
Control
Serial Bus Decoder & Latches
Volume &
Loudness
Bass
Treble
Speaker
ATT
OUT_L
Mute
CLK
DATA
DGND
Speaker
ATT
OUT_R
Mute
RB
Supply
VDD
AGND
REF ROUT
RIN LOUD_R BOUT_R
BIN_R
TREB_R
功½叙述
序列汇流排介面（I
2
C Bus Interface）
籍由½用DATA和CLK汇流排，可½HXJ2314于微处理机间做资料的传输。
因此，DATA和CLK便构成此序列汇流排介面。
资料确认（Data
Validity）
½CLK讯号是在“高准½”时，DATA
Line上的资料才会被视为正确且稳定的资料。而只有½CLK讯号在“½准½”时，
DATA Line才可做高、½准½的切换。请参阅下图：
DATA
CLK
DATA LINE
STABLE
DATA VALID
DATA
CHANGE
ALLOWED
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四声道数字音质处理器
开始和结束（start
and stop conditions）
HXJ2314
½（1）CLK讯号设定在高准½，且（2）DATA讯号由高准½½换成½准½时；则表示序列资料的“开始”
。
½（1）CLK讯号设定在高准½，且（2）DATA讯号由½准½½换成高准½时；则表示序列资料的“结束”
。请参阅下列时
序图：
CLK
DATA
START
STOP
½元组格式（Byte
format）
每一个传输到DATA
Line
½元组（byte）有八个½元（bit）
，每一½元组后面需有一“认可”½元，且以最大符号½元
（MSB）为首的方式传送出去。
“认可”信号（Acknowledge）
在第九个时脉时主½（微处理机）先将DATA
Line
设定为电阻性的高准½，若周边设备（HXJ2314）认可此信号，则
DATA Line
将会被周边设备（HXJ2314）拉至½准½，½DATA
Line
在此时脉中保持一定稳定的抵准½状态。请参阅下图：
这个已被定址的音质处理器（HXJ2314）在收到每一½元组（BYTE）后，即产生一“认可”的动½；否则在第九个时
脉（CLOCK）的时间内Data
Line
将会一直保持着高准½状态。
CLK
1
DATA
MSB
ACKNOWLEDGEMENT
FROM RECEIVER
START
2
3
4
7
8
9
无“认可”信号的传输（Transmission
without Acknowledge）
如果您想省略此音质处理器（HXJ2314）对“认可”信号的侦测，可½用一较简单的传输方法。其方式为HXJ2314在
收到每一½元组（byte）后，等待一时脉（clock）
，不做时脉的确认。如果您½用此种方法，将会有较大的机会造成传输错
误，并且会减½对杂讯的免疫力。
介面协定（Interface
Protocol
）
介面协定包含：
1．
开始（start）条件
2．
包含有HXJ2314的½址（address）½元组。此½元组的第八个½元须为“0”
。如此HXJ2314才可确认此HXJ2314的
½址½元组已经结束。
3．
一资料序列（N个½元组+认可½元）
。
4．
结束（stop）条件。
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请参阅下图：
HXJ2314 Address
HXJ2314
MSB FIRST BYTE
START 1 0 0 0 1
注:ACK=
ACKNOWLEDGE
最大时脉速度=100K
BITS/S
LSB
0 0 0
MSB
ACK
LSB
MSB
LSB
DATA
ACK
DATA
ACK
DATA TRANSMITTED(N-BYTES+ACKNOWLEDGE)
STOP
控制资料（Data
Byte）的格式（Software Specification）
HXJ2314½址（address）
HXJ2314½址如下所示：
1
0
MSB
资料½元组（DATA
BYTES）
MSB
0
0
B2
1
1
0
1
1
1
0
1
0
0
0
1
0
0
0
LSB
B1
B1
B1
G1
B0
B0
B0
G0
A2
A2
A2
S2
A1
A1
A1
S1
LSB
A0
A0
A0
S0
C0
C0
0
1
1
0
C3
C2
C1
0
1
1
1
C3
C2
C1
½Ax=1.25dB/steps；Bx=10dB/stpes；Cx=2
dB/stpes；Gx=3.75 dB/stpes；
功½
音量控制
左声道衰减
右声道衰减
输入切换/响度/增益控
制
½音控制
高音控制
音量（Volume）
此为一音量的资料½元组之详细叙述表，例如，若右声音量衰减45dB，则以“00100100”表示之。
MSB
LSB
功½
0
0
B2
B1
B0
A2
A1
A0
每阶1.25dB的音量衰减
0
0
0
0dB
0
0
1
-1.25dB
0
1
0
-2.5dB
0
1
1
-3.75dB
1
0
0
-5dB
1
0
1
-6.25dB
1
1
0
-7.5dB
1
1
1
-8.75dB
0
0
B2
B1
B0
A2
A1
A0
每阶10dB的音量衰减
0
0
0
0dB
0
0
1
-10dB
0
1
0
-20dB
0
1
1
-30dB
1
0
0
-40dB
1
0
1
-50dB
1
1
0
-60dB
1
1
1
-70dB
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