KF8F3110/12/20/22/30/32 数据手册 V2.4
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芯片½用注意事项
芯片的
ESD
防护措½
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芯片提供
8KV
的
ESD
保护电路。
建议用户根据芯片存储/应用
的环境采取适½静电防护措½。
应注意应用环境的湿度;
建议避免½用容易产生静电的绝缘
½;存放和运输应在抗静电容器、抗静电屏½袋或导电材料容器中;包括工½台在内的所有
测试和测量工具必须保证接地;
操½者应该½戴静电消除手腕环或手套,
不½用手直接接触
芯片等。
芯片的
EFT
防护措½
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芯片提供
4.2KV
的
EFT
保护电路。½
MCU
芯片应用在
PCB
系统时,需要遵守
PCB
相关设计要求,包括电源线、地线(包括数字/模拟电源分离,单点
/多点接地等)
、复½管脚保护电路、电源和地之间的去耦电容、高½频电路单独分别处理以
及单/多层板选择等。
芯片的
LATCH-UP
防护措½
为有效防护
LATCH-UP
损坏芯片,
用户需保证在
VDD
引脚上不出现异常高压或者负压。
建议用户在
VDD
和
VSS
之间并接两个电容,大小分别为
105
和
102,电容½量靠近芯片的
VDD
引脚。
芯片的焊接
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芯片的焊接应按照工业标准的焊接要求,
以免损坏芯片。
手工
焊接时注意焊接的温度和焊接时间。
芯片的上电/断电
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芯片提供独立电源管脚。½
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芯片应
用在多电源供电系统时,应先对
MCU
芯片上电,再对系统其他部件上电;反之,断电时,
先对系统其他部件断电,再对
MCU
芯片断电。若操½顺序相反则可½导致芯片内部元件过
压或过流,从而导致芯片故障或元件性½退化。
芯旺微电子
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芯片的复½
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芯片提供内部上电复½。对于不同的快速上电/断电或慢速上
电/断电系统,内部上电复½电路可½失效,建议用户½用外部复½、断电复½、看门狗复
½等,确保复½电路正常工½。在系统设计时,若½用外部复½电路,建议采用三极管复½
电路、RC 复½电路。若不½用外部复½电路,建议采用复½管脚接电阻到电源,或采取必
要的电源抖动处理电路或其他保护电路。具½可参照芯片的数据手册说明。
芯片的内部时钟
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芯片提供内部时钟源。内部时钟源会随着温度、电压变化而偏
移,可½会½响时钟源精度。具½可参照芯片的数据手册说明。
芯片的初始化
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芯片提供各种内部和外部复½。
对于不同的应用系统,有必要
对芯片寄存器、内存、功½模块等进行初始化,尤其是
I/O
管脚复用功½进行初始化,避免
芯片上电以后,I/O 管脚状态的不确定情况发生。
芯片的管脚
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芯片提供½范围的输入管脚电平,
用户输入高电平应大于
VIH
的最小值,½电平应小于
VIL
的最大值,以免波动噪声进入芯片。对于未½用的输入/输出
管脚,建议用户设为输入状态,并通过电阻上拉至电源或下拉至地,或设½为输出管脚,输
出固定电平并浮空。
对未½用的管脚处理因应用系统而异,
具½遵循应用系统的相关规定和
说明。
VDD
和
VSS
之间需接
104
以上的电容,电容½量靠近
MCU
芯片的
VDD
引脚。
芯片的½功耗设计
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芯片提供½功耗设计模式,
用户在实际应用中可根据应用系统
的要求采用各种不同的½功耗模式,包括系统工½时钟的选择和休眠模式的选择等等。
芯片的开发环境
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芯片提供完整的½/硬件开发环境,并受知识产权保护。选择
上海芯旺微电子技术有限公司指定的汇编器、编译器、编程器、硬件仿真器,必须遵循与芯
片相关的规定和说明。
芯旺微电子
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引脚示意图
8
引脚示意图:
VDD
T1CK/OSCA/P0.5
CLKOUT/T1G/VREOUT/OSCB/AN13/P0.4
RST/C12IN3-/INT2/AN9/P2.2
1
8
VSS
P0.0/AN5/SPDAT/RX(1)/DT(1)/PWM1(1)/C1IN+
P0.1/AN6/SPCLK/TX(1)/CK(1)/PWM2(1)/C12IN0-/ADVIN
P1.2/AN2/INT1
KF8F3110
2
3
4
7
6
5
14
引脚示意图:
VDD
T1CK/OSCA/P0.5
SS(1)/CLKOUT/T1G/VREOUT/OSCB/AN13/P0.4
RST/P0.3
CCP/P5A/AN11/P2.0
C2OUT/P5B/AN10/P2.1
C12IN3-/INT2/P5C/AN9/P2.2
1
2
3
4
5
6
7
14
VSS
P0.0/AN5/SPDAT/RX(1)/DT(1)/SDI(1)/SDA(1)/PWM1(1)/C1IN+
P0.1/AN6/SPCLK/TX(1)/CK(1)/SCK(1)/SCL(1)/PWM2(1)/C12IN0-/ADVIN
P0.2/AN12/T0CK/C1OUT/INT0/PWM1/PWM21/SDO(1)
P1.0/AN0/PWM2/PWM22/C2IN+
P1.1/AN1/C12IN1-/CCP(1)/PWM23
P1.2/AN2/INT1/P5D/C12IN2-/PWM24
KF8F31x0
13
12
11
10
9
8
16
引脚示意图:
VDD
T1CK/OSCA/P0.5
SS(1)/CLKOUT/T1G/VREOUT/OSCB/AN13/P0.4
RST/P0.3
CCP/P5A/AN11/P2.0
C2OUT/P5B/AN10/P2.1
C12IN3-/INT2/P5C/AN9/P2.2
SS/AN8/P2.3
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
VSS
P0.0/AN5/SPDAT/RX(1)/DT(1)/SDI(1)/SDA(1)/PWM1(1)/C1IN+
P0.1/AN6/SPCLK/TX(1)/CK(1)/SCK(1)/SCL(1)/PWM2(1)/C12IN0-/ADVIN
P0.2/AN12/T0CK/C1OUT/INT0/PWM1/PWM21/SDO(1)
P1.0/AN0/PWM2/PWM22/OPOUT/C2IN+
P1.1/AN1/OPIN-/C12IN1-/PWM23/CCP(1)
P1.2/AN2/INT1/P5D/OPIN1+/PWM24/C12IN2-
P1.3/AN3/OPIN2+
KF8F31x2
SOIC/SSOP-20
引脚示意图:
VDD
T1CK/OSCA/P0.5
SS(1)/CLKOUT/T1G/VREOUT/OSCB/AN13/P0.4
RST/P0.3
CCP/P5A/AN11/P2.0
C2OUT/P5B/AN10/P2.1
C12IN3-/INT2/P5C/AN9/P2.2
SS/AN8/P2.3
SDO/AN7/P1.7
TX/CK/P1.6
1
2
3
4
5
6
7
8
9
10
20
19
18
17
16
15
14
13
12
11
VSS
P0.0/AN5/SPDAT/RX(1)/DT(1)/SDI(1)/SDA(1)/PWM1(1)/C1IN+
P0.1/AN6/SPCLK/TX(1)/CK(1)/SCK(1)/SCL(1)/PWM2(1)/C12IN0-/ADVIN
P0.2/AN12/T0CK/C1OUT/INT0/PWM1/PWM21/SDO(1)
P1.0/AN0/PWM2/OPOUT/C2IN+/PWM22
P1.1/AN1/OPIN-/C12IN1-/PWM23/CCP(1)
P1.2/AN2/INT1/P5D/OPIN1+/C12IN2-/PWM24
P1.3/AN3/SDI/SDA/OPIN2+
P1.4/AN4/RX/DT/OPIN3+
P1.5/SCK/SCL
注:
1.
管脚图中带(1)标注的外设管脚为可选切换管脚,具½操½在相应章节中描述;
2.
用户在正常½用时,通常会有一些用不到的引脚,如果直接把这些管脚悬空,而不做其他处
理可½½单片机功耗增大,因此建议将那些不用的引脚设½为数字输出模式,如果
P0.3
未
用,应外接上拉电阻,并对地下拉一个电容;
3.
KF8F31xx
的
8
脚芯片需将
TR2<3>、
TR2<1:0>、
TR1<7:3>、
TR1<1:0>和 TR0<5:2>设½为 0;
KF8F31xx
的
14
脚芯片需将
TR2<3>和 TR1<7:3>设½为 0;KF8F31xx
的
16
引脚芯片需将
TR1<7:4>设½为 0;
4.
KF8F3110SB(SOIC-8)的外部复½引脚½于 P2.2
口,其他型号½于
P0.3
口。
KF8F31x2
芯旺微电子
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