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PMS232-S20: 产品描述2Kx16bits OTP程序储存器,12位分辨率的ADC; 产品类别嵌入式处理器和控制器; 文件大小1MB，共91页; 制造商应广(PADAUK); 官网地址http://www.padauk.com.tw; 应广科技全系列产品以 FPPATM 技术为发展中心。 FPPATM (Field Programmable Processor Array 现场可编程处理器阵列）是一个带平行处理，并可提供多核心于单一晶片的技术。在FPPATM 的优越架构下，除了所有的核心可以各自独立执行自己的程序外，还能在运作中维持低功耗。

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PMS232-S20概述

2Kx16bits OTP程序储存器,12位分辨率的ADC

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PMC232/PMS232 Series

12-bit ADC Enhanced

Field Programmable Processor Array

(FPPA ) 8-bit Controller

Data Sheet

Version 0.03 – Mar. 27, 2017



10F-2, No. 1, Sec. 2, Dong-Da Road, Hsin-Chu 300, Taiwan, R.O.C.

TEL: 886-3-532-7598



www.padauk.com.tw

PMC232/PMS232 Series

12-bit ADC Enhanced FPPA

8-bit Controller

Table of content

1. Features ............................................................................................................................. 9

1-1. Special Features ....................................................................................................................9

1-2. High Performance RISC CPU Array.......................................................................................9

1-3. System Functions ..................................................................................................................9

1-4. Package Information ............................................................................................................10

2. General Description and Block Diagram ...................................................................... 11

3. Pin Assignment and Description................................................................................... 12

4. Device Characteristics ................................................................................................... 17

4-1. AC/DC Device Characteristics .............................................................................................17

4-2. Absolute Maximum Ratings .................................................................................................19

4-3. Typical ILRC frequency vs. VDD and temperature ...............................................................20

4-4. Typical IHRC frequency deviation vs. VDD and temperature ...............................................21

4-5. Typical operating current vs. VDD @ system clock = ILRC/n ...............................................22

4-6. Typical operating current vs. VDD @ system clock = IHRC/n ..............................................22

4-7. Typical operating current vs. VDD @ system clock = 4MHz EOSC / n .................................23

4-8. Typical operating current vs. VDD @ system clock = 32kHz EOSC / n ................................23

4-9. Typical IO driving current (I

) and sink current (I

) ............................................................24

4-10. Typical IO input high/low threshold voltage (V

) ...........................................................24

4-11. Typical resistance of IO pull high device ............................................................................24

4-12. Typical VDD/2 Bias output voltage .....................................................................................25

4-13. Timing charts for boot up conditions ..................................................................................25

5. Functional Description ................................................................................................... 26

5-1. Processing Units ..................................................................................................................26

5-1-1. Program Counter .......................................................................................................27

5-1-2. Stack Pointer .............................................................................................................27

5-1-3. Single FPP mode .......................................................................................................28

5-2. Program Memory -- OTP......................................................................................................29

5-2-1. Program Memory Assignment....................................................................................29

5-2-2. Example of Using Program Memory for Two FPP mode ............................................30

5-2-3. Example of Using Program Memory for Single FPP mode .........................................30

5-3. Program Structure ...............................................................................................................31

5-3-1. Program structure of two FPP units mode .................................................................31

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PDK-DS-PMx232_V003– Mar. 27, 2017

PMC232/PMS232 Series

12-bit ADC Enhanced FPPA

8-bit Controller

5-3-2. Program structure of single FPP mode ......................................................................31

5-4. Boot Procedure ....................................................................................................................32

5-5. Data Memory -- SRAM.........................................................................................................33

5-6. Arithmetic and Logic Unit .....................................................................................................33

5-7. Oscillator and clock ..............................................................................................................34

5-7-1. Internal High RC oscillator and Internal Low RC oscillator .........................................34

5-7-2. Chip calibration ..........................................................................................................34

5-7-3. IHRC Frequency Calibration and System Clock .........................................................34

5-7-4. External Crystal Oscillator..........................................................................................36

5-7-5. System Clock and LVR level ......................................................................................37

5-7-6. System Clock Switching.............................................................................................38

5-8. 16-bit Timer (Timer16) .........................................................................................................39

5-9. 8-bit Timer (Timer2) with PWM generation...........................................................................41

5-9-1. Using the Timer2 to generate periodical waveform ....................................................42

5-9-2. Using the Timer2 to generate 8-bit PWM waveform ...................................................44

5-9-3. Using the Timer2 to generate 6-bit PWM waveform ...................................................45

5-10. WatchDog Timer ................................................................................................................46

5-11. Interrupt .............................................................................................................................47

5-12. Power-Save and Power-Down ...........................................................................................49

5-12-1. Power-Save mode (“stopexe”) .................................................................................49

5-12-2. Power-Down mode (“stopsys”).................................................................................50

5-12-3. Wake-up ..................................................................................................................51

5-13. IO Pins ...............................................................................................................................52

5-14. Reset and LVR ..................................................................................................................53

5.14.1. Reset .......................................................................................................................53

5.14.2. LVR reset .................................................................................................................53

5-15. VDD/2 bias Voltage Generator ...........................................................................................53

5-16. Analog-to-Digital Conversion (ADC) module ......................................................................54

5-16-1. The input requirement for AD conversion .................................................................55

5-16-2. Select the ADC bit resolution ...................................................................................56

5-16-3. ADC clock selection .................................................................................................56

5-16-4. AD conversion .........................................................................................................56

5-16-5. Configure the analog pins ........................................................................................56

5-16-6. Using the ADC .........................................................................................................57

6. IO Registers .................................................................................................................... 58

6-1. ACC Status Flag Register (flag), IO address = 0x00 ............................................................58

6-2. FPP unit Enable Register (fppen), IO address = 0x01 ..........................................................58

6-3. Stack Pointer Register (sp), IO address = 0x02 ...................................................................58

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PMC232/PMS232 Series

12-bit ADC Enhanced FPPA

8-bit Controller

6-4. Clock Mode Register (clkmd), IO address = 0x03 ................................................................59

6-5. Interrupt Enable Register (inten), IO address = 0x04 ...........................................................59

6-6. Interrupt Request Register (intrq), IO address = 0x05 ..........................................................60

6-7. Timer16 mode Register (t16m), IO address = 0x06 .............................................................60

6-8. General Data register for IO (gdio), IO address = 0x07 ........................................................61

6-9. External Oscillator setting Register (eoscr), IO address = 0x0a ...........................................61

6-10. Internal High RC oscillator control Register (ihrcr), IO address = 0x0b...............................61

6-11. Interrupt Edge Select Register (integs), IO address = 0x0c ................................................61

6-12. Port A Digital Input Enable Register (padier), IO address = 0x0d .......................................62

6-13. Port B Digital Input Enable Register (pbdier), IO address = 0x0e .......................................63

6-14. Port A Data Register (pa), IO address = 0x10 ....................................................................63

6-15. Port A Control Register (pac), IO address = 0x11 ..............................................................63

6-16. Port A Pull-High Register (paph), IO address = 0x12 .........................................................63

6-17. Port B Data Register (pb), IO address = 0x14 ....................................................................63

6-18. Port B Control Register (pbc), IO address = 0x15 ..............................................................63

6-19. Port B Pull-High Register (pbph), IO address = 0x16 .........................................................64

6-20. Port C Data Register (pc), IO address = 0x17 ....................................................................64

6-21. Port C Control Register (pcc), IO address = 0x18 ..............................................................64

6-22. Port C Pull-High Register (pcph), IO address = 0x19 .........................................................64

6-23. ADC Control Register (adcc), IO address = 0x20 ...............................................................64

6-24. ADC Mode Register (adcm), IO address = 0x21 ................................................................65

6-25. ADC Result High Register (adcrh), IO address = 0x22.......................................................65

6-26. ADC Result Low Register (adcrl), IO address = 0x23 ........................................................65

6-27. Miscellaneous Register (misc), IO address = 0x3b ............................................................66

6-28. Timer2 Control Register (tm2c), IO address = 0x3c ...........................................................67

6-29. Timer2 Counter Register (tm2ct), IO address = 0x3d .........................................................67

6-30. Timer2 Scalar Register (tm2s), IO address = 0x37 ............................................................67

6-31. Timer2 Bound Register (tm2b), IO address = 0x09 ............................................................67

7. Instructions ..................................................................................................................... 68

7-1. Data Transfer Instructions ....................................................................................................68

7-2. Arithmetic Operation Instructions .........................................................................................72

7-3. Shift Operation Instructions ..................................................................................................74

7-4. Logic Operation Instructions ................................................................................................76

7-5. Bit Operation Instructions .....................................................................................................79

7-6. Conditional Operation Instructions .......................................................................................80

7-7. System control Instructions ..................................................................................................82

7-8. Summary of Instructions Execution Cycle ............................................................................84

7-9. Summary of affected flags by Instructions............................................................................85

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