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MKSV1GIL-CET: 产品描述坏块管理，1Gb SPI NAND, 工业级; 产品类别存储 FLASH存储器; 文件大小1MB，共52页; 制造商米客方德(MK); 官网地址http://www.mkfounder.com; 深圳米客方德半导体有限公司 (简称“MK-米客方德”)，是一家专注于嵌入式存储的高新技术企业，研发中心设在合肥、新竹，在深圳和香港设有营运据点。 MK-米客方德的核心成员均来自领先的半导体企业，具有相同的价值观、高效的执行力和强烈的使命感。 MK-米客方德拥有Flash控制器软硬件开发能力，依托深耕中国的市场和渠道能力，整合产业链的晶圆代工、封装、测试厂商的资源，推出一系列高可靠性、定制化、微型化特质的存储产品及解决方案。 MK-米客方德向客户提供的嵌入式存储芯片，广泛应用于工业、车载、医疗、电力、储能、智能穿戴等领域。

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MKSV1GIL-CET概述

坏块管理，1Gb SPI NAND, 工业级

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SPI NAND Flash Datasheet

Serial Peripheral Interface (SPI)

V 1.0

October 10, 2019

SPI NAND With Wear Leveling

Contents

Introduction............................................................................................................................. 7

1.1 Features ............................................................................................................................................... 7

1.2 General Description ............................................................................................................................. 8

1.3 Wear Leveling ...................................................................................................................................... 9

1.4 Memory Mapping Diagram ................................................................................................................ 10

1.5 ECC Protection and Spare Area ........................................................................................................ 12

1.6 Connection Diagram (including SPI controller and SPI NAND) ........................................................ 15

Device Operation .................................................................................................................. 16

2.1 SPI Mode ........................................................................................................................................... 16

2.2 Hold Mode .......................................................................................................................................... 17

2.3 Write Protection Mode ....................................................................................................................... 18

Write Operations ................................................................................................................... 19

Feature Operations ............................................................................................................... 20

Read Operations ................................................................................................................... 21

5.1 Read ID (9FH) .................................................................................................................................... 21

5.2 Page Read (13H) ............................................................................................................................... 22

5.3 Read from Cache x1 IO (03H/0BH) ................................................................................................... 24

5.4 Read from Cache x2 IO (3BH) ........................................................................................................... 25

5.5 Read from Cache x4 IO (6BH) ........................................................................................................... 26

5.6 Read from Cache Dual IO (BBH) ....................................................................................................... 27

5.7 Read from Cache Quad IO (EBH) ..................................................................................................... 28

Program Operations ............................................................................................................. 29

6.1 Program Load (PL) (02H) .................................................................................................................. 30

6.2 Program Load x4 IO (PL x4) (32H) .................................................................................................... 31

6.3 Program Execute (PE) (10H) ............................................................................................................. 32

Internal Data Move ................................................................................................................ 33

7.1 Program Load Random Data (84H) ................................................................................................... 33

7.2 Program Load Random Data x4 (C4H/34H) ...................................................................................... 34

7.3 Program Load Random Data Quad IO (72H) .................................................................................... 35

Erase Operation- Block Erase (D8H) ................................................................................... 36

Reset Operation - Reset (FFH) ............................................................................................. 37

One-Time Programmable (OTP) Function ........................................................................... 38

10.1 OTP Definition.................................................................................................................................. 38

10.2 Parameter Page Definition ............................................................................................................... 39

Block Protection ................................................................................................................... 41

Status Register ..................................................................................................................... 43

Block Management ............................................................................................................... 44

Power-On Process ................................................................................................................ 45

Electrical Characteristics ..................................................................................................... 46

Package Outline Information ............................................................................................... 50

www.mkfounder.com

SPI NAND With Wear Leveling

List of Figures

Figure 1-1. Functional Block Diagram

................................................................................................................8

Figure 1-2. Wear leveling architecture

................................................................................................................9

Figure 1-3. Memory Mapping Diagram for 1Gb...............................................................................................

Figure 1-4. Memory Mapping Diagram for 2Gb...............................................................................................

Figure 1-5. Memory Mapping Diagram for 4Gb................................................................................................

Figure 1-6. Memory Mapping Diagram for 8Gb................................................................................................

Figure 1-7. WSON8/LGA-8

................................................................................................................................. 15

Figure 2-1. Timing Diagram of SPI Modes

....................................................................................................... 16

Figure 2-2. Hold Condition Diagram

................................................................................................................ 17

Figure 3-1. Write Enable (06H) Sequence Diagram

........................................................................................ 19

Figure 3-2. Write Disable (04H) Sequence Diagram

....................................................................................... 19

Figure 4-1. Get Feature (0FH) Sequence Diagram

.......................................................................................... 20

Figure 4-2. Set Feature (1FH) Sequence Diagram

.......................................................................................... 20

Figure 5-1. Read ID (9FH) Sequence Diagram

................................................................................................ 21

Figure 5-2. Page Read to Cache (13H) Sequence Diagram

........................................................................... 23

Figure 5-3. Read from Cache x1 IO (03H/0BH) Sequence Diagram

.............................................................. 24

Figure 5-4. Read from Cache x2 IO (3BH) Sequence Diagram

...................................................................... 25

Figure 5-5. Read from Cache x4 IO (6BH) Sequence Diagram

...................................................................... 26

Figure 5-6. Read from Cache Dual IO (BBH) Sequence Diagram

................................................................. 27

Figure 5-7. Read from Cache Quad (EBH) Sequence Diagram

..................................................................... 28

Figure 6-1. Program Load (02H) Sequence Diagram

..................................................................................... 30

Figure 6-2. Program Load x4 IO (32H) Sequence Diagram

............................................................................ 31

Figure 6-3. Program Execute (10H) Sequence Diagram

................................................................................ 32

Figure 7-1. Program Load Random Data (84H) Sequence Diagram

............................................................. 33

Figure 7-2. Program Load Random Data x4 (C4H/34H) Sequence Diagram

................................................ 34

Figure 7-3. Program Load Random Data Quad IO (72H) Sequence Diagram

.............................................. 35

Figure 8-1. Block Erase (D8H) Sequence Diagram

......................................................................................... 36

Figure 9-1. Reset (FFH) Sequence Diagram

.................................................................................................... 37

Figure 14-1. Power-On Process

....................................................................................................................... 45

Figure 15-1. Serial Input Timing

....................................................................................................................... 48

Figure 15-2. Serial Output Timing

.................................................................................................................... 48

Figure 15-3. Hold# Timing

................................................................................................................................. 49

Figure 15-4. WP# Timing

................................................................................................................................... 49

Figure 16-1. LGA (8 x 6 x 0.8mm) Package Outline Drawing Information for 1Gb/2Gb

.............................. 51

Figure 16-2. LGA (8 x 6 x 0.8mm) Package Outline Drawing Information for 4Gb/8Gb

.............................. 52

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