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THC63LVDM63R

器件型号:THC63LVDM63R
文件大小:1991.4KB,共10页
厂商名称:THine Electronics, Inc.
厂商官网:https://www.thine.co.jp/
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器件描述

reduced swing lvds 24bit/18bit color host-lcd panel interface

THC63LVDM63R器件文档内容

THC63LVDM83R/THC63LVDM63R_Rev2.0

THC63LVDM83R/THC63LVDM63R

REDUCED SWING LVDS 24Bit/18Bit COLOR HOST-LCD PANEL INTERFACE

General Description                                              Features

The THC63LVDM83R transmitter converts 28bits of                  •  28:4 Data channel compression at up to

CMOS/TTL data into LVDS (Low Voltage Differential                   298 Megabytes per sec throughput

Signaling) data stream. A phase-locked transmit clock            •  Wide dot clock range: 20-85MHz suited for VGA,

is transmitted in parallel with the data streams over a             SVGA, XGA and SXGA

fifth LVDS link. At a transmit clock frequency of                •  Narrow bus (10 lines or 8 lines) reduces cable size

85MHz, 28bits of RGB data and 4bits of LCD timing                •

and control data (HSYNC, VSYNC, CNTL1, CNTL2)                       Support Reduced swing LVDS for Low EMI

are transmitted at a rate of 595Mbps per LVDS channel.           •  200mV swing LVDS/350mV swing LVDS

Also available is THC63LVDM63R that converts 21bits                 selectable

of CMOS/TTL data into LVDS(Low Voltage Differen-                 •  Support Spread Spectrum Clock Generator

tial Signaling) data stream. Both transmitters can be            •  On chip Input Jitter Filtering

programmed reduced swing LVDS through a dedicated                •

pin for low power consumption and EMI.                              PLL requires No external components

                                                                 •  Single 3.3V supply with 125mW(TYP)

                                                                 •  Power-Down Mode

                                                                 •  Low profile 56 or 48 Lead TSSOP Package

                                                                 •  Clock Edge Programmable

                                                                 •  Improved Replacement for the National DS90C383

                                                                    or DS90C363

Block Diagram

CMOS/TTL          THC63LVDM83R               DATA                   CMOS/TTL          THC63LVDM63R            DATA

INPUTS                                       (LVDS)                 INPUTS                                    (LVDS)

TA0-6          7     TTL PARALLEL TO SERIAL  TA +/-                 TA0-6          7  TTL PARALLEL TO SERIAL  TA +/-

TB0-6          7                             TB +/-                 TB0-6          7                          TB +/-

TC0-6          7                             TC +/-                 TC0-6          7                          TC +/-

TD0-6          7                             TD +/-

                                             (140-595Mbit/On Each                                             (140-595Mbit/On Each

                                             LVDS Channel)                                                    LVDS Channel)

TRANSMITTER                                                         TRANSMITTER

CLOCK IN             PLL                     TCLK +/-               CLOCK IN          PLL                     TCLK +/-

(20 to 85MHz)                                CLOCK                  (20 to 85MHz)                             CLOCK

R/F                                          (LVDS)                 R/F                                       (LVDS)

/PDWN                                        20-85MHz               /PDWN                                     20-85MHz

RS                                                                  RS

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THC63LVDM83R /THC63LVDM63R_Rev2.0

Pin Out

                  THC63LVDM83R                                               THC63LVDM63R

         RS   1                    56  TA4                          TA4  1                 48  TA3

         TD1  2                    55  TA3                          RS   2                 47  TA2

         TA5  3                    54  TA2                          TA5  3                 46  GND

         TA6  4                    53  GND                          TA6  4                 45  TA1

         GND  5                    52  TA1                          GND  5                 44  TA0

         TB0  6                    51  TA0                          TB0  6                 43  N/C

         TB1  7                    50  TD0                          TB1  7                 42  LVDS GND

         TD2  8                    49  LVDS GND                     VCC  8                 41  TA-

         VCC  9                    48  TA-                          TB2  9                 40  TA+

         TD3  10                   47  TA+                          TB3  10                39  TB-

         TB2  11                   46  TB-                          GND  11                38  TB+

         TB3  12                   45  TB+                          TB4  12                37  LVDS VCC

         GND  13                   44  LVDS VCC                     TB5  13                36  LVDS GND

         TB4  14                   43  LVDS GND                     R/F  14                35  TC-

         TB5  15                   42  TC-                          TB6  15                34  TC+

         TD4  16                   41  TC+                          TC0  16                33  TCLK-

         R/F  17                   40  TCLK-                        GND  17                32  TCLK+

         TD5  18                   39  TCLK+                        TC1  18                31  LVDS GND
                                                                                           30
         TB6  19                   38  TD-                          TC2  19                    PLL GND
                                                                                           29
         TC0  20                   37  TD+                          TC3  20                    PLL VCC

         GND  21                   36  LVDS GND                     VCC  21                28  PLL GND

         TC1  22                   35  PLL GND                      TC4  22                27  /PDWN

         TC2  23                   34  PLL VCC                      TC5  23                26  CLK IN

         TC3  24                   33  PLL GND                      GND  24                25  TC6

         TD6  25                   32  /PDWN

         VCC  26                   31  CLK IN

         TC4  27                   30  TC6

         TC5  28                   29  GND

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THC63LVDM83R /THC63LVDM63R_Rev2.0

THC63LVDM83R Pin Description

Pin Name      Pin #                                              Type                           Description

TA+, TA-      47, 48                                             LVDS OUT

TB+, TB-      45, 46                                             LVDS OUT   LVDS Data Out.

TC+, TC-      41, 42                                             LVDS OUT

TD+, TD-      37, 38                                             LVDS OUT

TCLK+, TCLK-  39, 40                                             LVDS OUT   LVDS Clock Out.

TA0 ~ TA6     51, 52, 54, 55, 56, 3, 4                           IN

TB0 ~ TB6     6, 7, 11, 12, 14, 15, 19                           IN         Pixel Data Inputs.

TC0 ~ TC6     20, 22, 23, 24, 27, 28, 30                         IN

TD0 ~ TD6     50, 2, 8, 10, 16, 18, 25                           IN

/PDWN         32                                                 IN         H: Normal operation,

                                                                            L: Power down (all outputs are Hi-Z)

                                                                            LVDS swing control.

RS            1                                                  IN                     RS        LVDS swing

                                                                                        VCC                  350mV

                                                                                        :                        :

                                                                                        GND                  200mV

R/F           17                                                 IN         Input Clock Triggering Edge Select.

                                                                            H: Rising edge, L: Falling edge

VCC           9, 26                                              Power      Power Supply Pins for TTL inputs and digital

                                                                            circuitry.

CLKIN         31                                                 IN         Clock in.

GND           5, 13, 21,                                         Ground     Ground Pins for TTL inputs and digital circuitry.

              29, 53

LVDS VCC      44                                                 Power      Power Supply Pins for LVDS Outputs.

LVDS GND      36, 43, 49                                         Ground     Ground Pins for LVDS Outputs.

PLL VCC       34                                                 Power      Power Supply Pin for PLL circuitry.

PLL GND       33, 35                                             Ground     Ground Pins for PLL circuitry.

THC63LVDM63R Pin Description

Pin Name      Pin #                                              Type                           Description

TA+, TA-      40, 41                                             LVDS OUT

TB+, TB-      38, 39                                             LVDS OUT   LVDS Data Out.

TC+, TC-      34, 35                                             LVDS OUT

TCLK+, TCLK-  32, 33                                             LVDS OUT   LVDS Clock Out.

TA0 ~ TA6     44, 45, 47, 48, 1, 3, 4                            IN

TB0 ~ TB6     6, 7, 9, 10, 12, 13, 15                            IN         Pixel Data Inputs.

TC0 ~ TC6     16, 18, 19, 20, 22, 23, 25                         IN

/PDWN         27                                                 IN         H: Normal operation,

                                                                            L: Power down (all outputs are Hi-Z)

                                                                            LVDS swing control.

RS            2                                                  IN                     RS        LVDS swing

                                                                                        VCC                  350mV

                                                                                        :                        :

                                                                                        GND                  200mV

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THC63LVDM83R /THC63LVDM63R_Rev2.0

Pin Name                      Pin #                              Type                                Description

     R/F                      14                                 IN                Input Clock Triggering Edge Select.

                                                                                   H: Rising edge, L: Falling edge

VCC                           8, 21                              Power             Power Supply Pins for TTL inputs and digital

                                                                                   circuitry.

CLKIN                         26                                 IN                Clock in.

GND                   5, 11, 17, 24, 46                          Ground            Ground Pins for TTL inputs and digital circuitry.

LVDS VCC                      37                                 Power             Power Supply Pins for LVDS Outputs.

LVDS GND                      36, 42                             Ground            Ground Pins for LVDS Outputs.

PLL VCC                       29                                 Power             Power Supply Pin for PLL circuitry.

PLL GND                       28, 30                             Ground            Ground Pins for PLL circuitry.

Absolute Maximum Ratings                       1

Supply Voltage (VCC)                                                     -0.3V ~ +4.0V

CMOS/TTL Input Voltage                                                   -0.3V ~ (VCC + 0.3V)

CMOS/TTL Output Voltage                                                  -0.3V ~ (VCC + 0.3V)

LVDS Driver Output Voltage                                               -0.3V ~ (VCC + 0.3V)

Output Current                                                           continuous

Junction Temperature                                                     +125 °C

Storage Temperature Range                                                -55 °C ~ +150 °C

Resistance to soldering heat                                             +260 °C /10sec

Maximum Power Dissipation     @+25       °  C                            0.5W

Electrical Characteristics

CMOS/TTL DC Specifications

                                                                                         VCC = 3.0V ~ 3.6V,         Ta = -10 °C  ~ +70 °C

Symbol                Parameter                                  Conditions                    Min.  Typ.           Max.         Units

VIH       High Level Input Voltage                                                             2.0                      VCC           V

VIL       Low Level Input Voltage                                                              GND                      0.8           V

IINC      Input Current                                          0V ≤ VIN ≤ VCC                                         ±10      µA

IPD       Pull Down Current                                      R/F pin, VIH=VCC                                       100      µA

IRS       RS Pull Down Current                                   RS pin, VIH=VCC                                        100      µA

1. “Absolute Maximum Ratings” are those valued beyond which the safety of the device can not be guaranteed. They

are not meant to imply that the device should be operated at these limits. The tables of “Electrical Characteristics”

specify conditions for device operation.

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LVDS Transmitter DC Specifications

                                                                               VCC = 3.0V    ~  3.6V,     Ta = -10 °C  ~ +70 °C

Symbol           Parameter                                       Conditions           Min.      Typ.      Max.         Units

                                                                    Normal

                                                                    swing             250       350       450          mV

VOD     Differential Output Voltage   RL=100Ω                       RS=VCC

                                                                    Reduced

                                                                    swing             100       200       300          mV

                                                                    RS=GND

∆VOD    Change in VOD between                                                                             35           mV

        complementary output states

VOC     Common Mode Voltage           RL=100Ω                                         1.125     1.25      1.375        V

∆VOC    Change in VOC between                                                                             35           mV

        complementary output states

IOS     Output Short Circuit Current  VOUT=0V, RL=100Ω                                                    -24          mA

IOZ     Output TRI-STATE Current      /PDWN=0V,                                                           ±10          µA

                                      VOUT=0V to VCC

THC63LVDM83R Supply Current

                                                                               VCC = 3.0V    ~  3.6V,     Ta = -10 °C  ~ +70 °C

Symbol  Parameter                                                Condition(*)                   Typ.      Max.         Units

                                      RL=100Ω,CL=5pF                         f=65MHz                  36  46           mA

                                      VCC=3.3V, RS=VCC                       f=85MHz                  39  49           mA

ITCCG   Transmitter Supply            16 Gray Scale Pattern

        Current                       RL=100Ω,CL=5pF                         f=65MHz                  31  41           mA

                                      VCC=3.3V, RS=GND                       f=85MHz                  34  44           mA

                                      16 Gray Scale Pattern

                                      RL=100Ω,CL=5pF                         f=65MHz                  38  48           mA

                                      VCC=3.3V, RS=VCC                       f=85MHz                  41  51           mA

ITCCW   Transmitter Supply            Worst Cace Pattern

        Current                       RL=100Ω,CL=5pF                         f=65MHz                  33  43           mA

                                      VCC=3.3V, RS=GND                       f=85MHz                  36  46           mA

                                      Worst Cace Pattern

ITCCS   Transmitter Power Down        /PDWN = L                                                                 10     µA

        Supply Current

                                                                                                                                   .

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THC63LVDM63R Supply Current

                                                                               VCC  =  3.0V  ~  3.6V,  Ta = -10 °C  ~ +70 °C

Symbol  Parameter                                                Condition(*)                   Typ.   Max.         Units

                                   RL=100Ω,CL=5pF                   f=65MHz                     33     41           mA

                                   VCC=3.3V, RS=VCC                 f=85MHz                     37     45           mA

ITCCG   Transmitter Supply         16 Gray Scale Pattern

        Current                    RL=100Ω,CL=5pF                   f=65MHz                     29     36           mA

                                   VCC=3.3V, RS=GND                 f=85MHz                     33     39           mA

                                   16 Gray Scale Pattern

                                   RL=100Ω,CL=5pF                   f=65MHz                     35     43           mA

                                   VCC=3.3V, RS=VCC                 f=85MHz                     39     47           mA

ITCCW   Transmitter Supply         Worst Cace Pattern

        Current                    RL=100Ω,CL=5pF                   f=65MHz                     31     38           mA

                                   VCC=3.3V, RS=GND                 f=85MHz                     35     42           mA

                                   Worst Cace Pattern

ITCCS   Transmitter Power Down     /PDWN = L                                                           10           µA

        Supply Current

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16  Gray  Scale Pattern

          CLKIN

          Tx0

          Tx1

          Tx2

          Tx3

          Tx4

          Tx5

          Tx6

Worst Case Pattern

          CLKIN

    Even TxIn

    Odd TxIN

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Switching Characteristics

                                                                                           VCC  =  3.0V ~ 3.6V,         Ta = -10 °C ~      +70 °C

Symbol                 Parameter                                             Min.                  Typ.                 Max.               Units

tTCIT   CLK IN Transition time                                                                                                        5.0  ns

tTCP    CLK IN Period                                                        11.76                 T                    50.0               ns

tTCH    CLK IN High Time                                                     0.35T                 0.5T                 0.65T              ns

tTCL    CLK IN Low Time                                                      0.35T                 0.5T                 0.65T              ns

tTCD    CLK IN to TCLK+/- Delay                                                                    2T/7                                    ns

tTS     TTL Data Setup to CLK IN                                             2.5                                                           ns

tTH     TTL Data Hold from CKL IN                                            2.5                                                           ns

tLVT    LVDS Transition Time                                                                       0.6                  1.5                ns

tTOP1   Output Data Position0 (T=11.76ns)                                    -0.2                  0.0                  +0.2               ns

tTOP0   Output Data Position1 (T=11.76ns)                                    T-7-- – 0.2              T-7--             T-7-- + 0.2        ns

tTOP6   Output Data Position2 (T=11.76ns)                                    2T-7-- – 0.2          2 T-7--              2T-7-- + 0.2       ns

tTOP5   Output Data Position3(T=11.76ns)                                     3T-7-- – 0.2          3 T-7--              3T-7-- + 0.2       ns

tTOP4   Output Data Position4 (T=11.76ns)                                    4T-7-- – 0.2          4 T-7--              4T-7-- + 0.2       ns

tTOP3   Output Data Position5 (T=11.76ns)                                    5T-7-- – 0.2          5 T-7--              5T-7-- + 0.2       ns

tTOP2   Output Data Position6 (T=11.76ns)                                    6T-7-- – 0.2          6 T-7--              6T-7-- + 0.2       ns

tTPLL   Phase Lock Loop Set                                                                                             10.0               ms

AC Timing Diagrams                                                   90%                                           90%

TTL Input                                CLK                     IN  10%                                           10%

LVDS    Output                                                               tTCIT                       tTCIT

        Vdiff=(TA+)-(TA-)                                            80%                                           80%

           TA+                           Vdiff                       20%                                           20%

                       5pF         100Ω

           TA-

        LVDS Output Load                                                     tLVT                            tLVT

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AC Timing Diagrams

TTL Inputs                                tTCP

                                   tTCH                                 tTCL

CLK IN              VCC/2                                        VCC/2             VCC/2

                                   tTS                                  tTH

Tx0-Tx6                            VCC/2  DATA VALID                                         VCC/2  DATA VALID

                                                                                   tTCD

Tx+/-                                                            Tx6          Tx5       Tx4  Tx3    Tx2  Tx1    Tx0

TCLK+       Vdiff = 0V                                                                                   Vdiff = 0V

            tTOP1

                    tTOP0

                    tTOP6

                    tTOP5

                    tTOP4

                    tTOP3

                    tTOP2

Note:

1)CLK IN: for THC63LVDM83R/THC63LVDM63R(R/F=GND), denote as solid line,

            for THC63LVDM83R/THC63LVDM63R(R/F=VCC), denote as dashed line

2)Vdiff = (Tyx+) - (Tyx-) , ---- (TCLKx+) - (TCLKx-)

Phase Lock Loop Set Time

/PDWN                              2.0V

                                                                                                                     3.6V

VCC                                3.0V

                                                                                 tTPLL

CLKIN

                                                                                                    Vdiff = 0V

TCLKx+/-

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Reduced  Swing  Characteristic (TA=25°C, VCC=3.3V,                                    RL=100Ω)

                                                     R  S  - VOD characteristic

                                             400

                                   VOD [mV]  300

                                             200

                                             100

                                             0

                                                  0        1.0   2.0     3.0     4.0

                                                                 RS [V]

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Package

56 Lead Molded Thin Shrink Small     Outline   Package, JEDEC

                                                                                            Unit : millimeters

                                                                 14.0 ± 0.1

                                     56                                          29

                  8.1 ± 0.1                                                                 6.1 ± 0.1

                               4.05

                                     1                                           28

                                                                                            (1.0)

                                                                                            1.2 MAX

                                     0.50 TYP                    0.20 TYP            0.10 ± 0.05

48  Lead  Molded  Thin Shrink  Small Outline   Package, JEDEC

                                                                                            Unit : millimeters

                                                                 12.5 ± 0.1

                                     48                                      25

                  8.1 ± 0.1                                                          6.1 ± 0.1

                               4.05

                                     1                                       24

                                                                                     (1.0)

                                                                                     1.2 MAX

                                     0.50 TYP                    0.20 TYP            0.10 ± 0.05

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Notes to Users:

1.  The contents of this data sheet are subject to change without prior notice.

2.  Circuit diagrams shown in this data sheet are examples of application. Therefore, please pay sufficient attention

    when designing circuits. Even if there are incorrect descriptions, we are not responsible for any problem due to

    them. Please note that incorrect descriptions sometimes cannot be corrected immediately if found.

3.  Our copyright and know-how are included in this data sheet. Duplication of the data sheet and disclosure to other

    persons are strictly prohibited without our permission.

4.  We  are  not  responsible  for  any  problems                of  industrial  proprietorship  occurring  during  THC63LVDM83R/

    THC63LVDM63R use, except for those directly related to THC63LVDM83R/THC63LVDM63R’s structure, manu-

    facture or functions. THC63LVDM83R/THC63LVDM63R is designed on the premise that it should be used for

    ordinary electronic devices. Therefore, it shall not be used for applications that require extremely high-reliability

    (space equipment, nuclear control equipment, medical equipment that affects people’s lives, etc.). In addition, when

    using THC63LVDM83R/THC63LVDM63R for traffic signals, safety devices and control/safety units in transporta-

    tion equipment, etc., appropriate measures should be taken.

5.  We are making the utmost effort to improve the quality and reliability of our products. However, there is a very

    slight possibility of failure in semiconductor devices. To avoid damage to social or official organizations, much care

    should be taken to provide sufficient redundancy and fail-safe design.

6.  No radiation-hardened design is incorporated in THC63LVDM83R/THC63LVDM63R.

7.  Judgment on whether THC63LVDM83R/THC63LVDM63R comes under strategic products prescribed by the For-

    eign Exchange and Foreign Trade Control Law is the user’s responsibility.

8.  This technical document was provisionally created during development of THC63LVDM83R/THC63LVDM63R,

    so there is a possibility of differences between it and the product’s final specifications. When designing circuits

    using THC63LVDM83R/THC63LVDM63R, be sure to refer to the final technical documents.

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