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THC63LVDF64B

器件型号:THC63LVDF64B
文件大小:1628.54KB,共10页
厂商名称:THine Electronics, Inc.
厂商官网:https://www.thine.co.jp/
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器件描述

lvds 24bit/18bit color host-lcd panel interface receiver

THC63LVDF64B器件文档内容

THC63LVDF84B/THC63LVDF64B_Rev2.0

        THC63LVDF84B/THC63LVDF64B

        LVDS 24Bit/18Bit COLOR HOST-LCD PANEL INTERFACE RECEIVER

General Description                                                   Features

The THC63LVDF84B/THC63LVDF64B receiver sup-                           •     Wide VCC range: 2.5~3.6V

ports wide VCC range(2.5~3.6V). At single 2.5V sup-                   •     Wide dot clock range: 20-85MHz suited for VGA,

ply, the THC63LVDF84B/THC63LVDF64B reduces                                  SVGA, XGA and SXGA (VCC=3.0~3.6V)

EMI and power consumption.                                            •     Wide dot clock range: 20-70MHz suited for VGA,

The THC63LVDF84B receiver convert the four                                  SVGA, XGA and SXGA (VCC=2.5V~3.6V)

LVDS(Low Voltage Differential Signaling) data streams                 •

back into 28bits of CMOS/TTL data with falling edge                         PLL requires No external components

clock.                                                                •     Rx power consumption < 80mW @VCC 2.5V,

At a transmit clock frequency of 85MHz, 28bits of RGB                       65MHz Grayscale

data and 4bits of LCD timing and control data                         •     Power-Down Mode

(HSYNC, VSYNC, CNTL1, CNTL2) are transmitted at                       •     Low profile 56 Lead or 48 Lead TSSOP Package

a rate of 2.3Gbps.                                                    •

Also the THC63LVDF64B receiver convert the three                            Pin compatible with THC63LVDF84A/F64A

LVDS data streams back into 21bits of CMOS/TTL data

with falling edge clock.

At a transmit clock frequency of 85MHz, 21bits of RGB

data and 4bits of LCD timing and control data

(HSYNC, VSYNC, CNTL1, CNTL2) are transmitted at

a rate of 1.78Gbps.

Block Diagram

                          THC63LVDF84B                                                     THC63LVDF64B

                                                     CMOS/TTL                                                         CMOS/TTL

                                                     OUTPUT                                                           OUTPUT

        RA +/-              LVDS TO TTL PARALLEL  7  RA0-6                                   LVDS TO TTL PARALLEL

                                                                              RA +/-                               7  RA0-6

        RB +/-                                    7  RB0-6

DATA                                                                  DATA    RB +/-                               7  RB0-6

(LVDS)                                            7  RC0-6            (LVDS)

        RC +/-                                                                                                     7

                                                  7                           RC +/-                                  RC0-6

        RD +/-                                       RD0-6

CLOCK                                                RECEIVER         CLOCK                                           RECEIVER

(LVDS)  RCLK +/-            PLL                      CLOCK OUT        (LVDS)  RCLK +/-       PLL                      CLOCK OUT

        20 to 85MHz                                  (20 to 85MHz)            20 to 85MHz                             (20 to 85MHz)

                                                     /PDWN                                                            /PDWN

                                                     (140-595Mbit/On  Each LVDS Channel)

Copyright 2001-2003 THine Electronics, Inc. All rights reserved       1                                            THine Electronics, Inc.
THC63LVDF84B/THC63LVDF64B _Rev2.0

Pin  Out

                      THC63LVDF84B                                           THC63LVDF64B

          RC3      1                56  VCC                         RC3      1             48  VCC

          RD6      2                55  RC2                         RC4      2             47  RC2

          RC4      3                54  RC1                         GND      3             46  RC1

          GND      4                53  RC0                         RC5      4             45  RC0

          RC5      5                52  GND                         RC6      5             44  GND

          RC6      6                51  RB6                         N/C      6             43  RB6

          RD0      7                50  RD5                         LVDSGND  7             42  VCC

     LVDSGND       8                49  RD4                         RA-      8             41  RB5

          RA-      9                48  VCC                         RA+      9             40  RB4

          RA+      10               47  RB5                         RB-      10            39  RB3

          RB-      11               46  RB4                         RB+      11            38  GND

          RB+      12               45  RB3                         LVDSVCC  12            37  RB2

          LVDSVCC  13               44  GND                         LVDSGND  13            36  VCC

     LVDSGND       14               43  RB2                         RC-      14            35  RB1

          RC-      15               42  RD3                         RC+      15            34  RB0

          RC+      16               41  RD2                         RCLK-    16            33  RA6

          RCLK-    17               40  VCC                         RCLK+    17            32  GND

          RCLK+    18               39  RB1                         LVDSGND  18            31  RA5

          RD-      19               38  RB0                         PLLGND   19            30  RA4

          RD+      20               37  RA6                         PLLVCC   20            29  RA3

     LVDSGND       21               36  GND                         PLLGND   21            28  VCC

          PLLGND   22               35  RA5                         /PDWN    22            27  RA2

          PLLVCC   23               34  RD1                         CLKOUT   23            26  RA1

          PLLGND   24               33  RA4                         RA0      24            25  GND

          /PDWN    25               32  RA3

          CLKOUT   26               31  VCC

          RA0      27               30  RA2

          GND      28               29  RA1

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THC63LVDF84B/THC63LVDF64B _Rev2.0

THC63LVDF84B Pin Description

Pin Name      Pin #                                              Type                         Description

RA+, RA-      9, 10                 LVDS IN

RB+, RB-      11, 12                LVDS IN                              LVDS Data Inputs

RC+, RC-      15, 16                LVDS IN

RD+, RD-      19, 20                LVDS IN

RCLK+, RCLK-  17, 18                LVDS IN                              LVDS Clock Inputs

RA0~RA6       27,29,30,32,33,35,37                               OUT

RB0~RB6       38,39,43,45,46,47,51                               OUT     Pixel Data Outputs

RC0~RC6       53,54,55,1,3,5,6                                   OUT

RD0~RD6       7,34,41,42,49,50,2                                 OUT

CLKOUT        26                                                 OUT     Pixel Clock Output

/PDWN         25                                                 IN      H: Normal operation

                                                                         L: Power down (all outputs are pulled to ground )

VCC           31,40,48,56                                        Power   Power Supply Pins for TTL outputs and digital circuitry

GND           4,28,36,44,52                                      Ground  Ground Pins for TTL outputs and digital circuitry

LVDSVCC       13                                                 Power   Power Supply Pin for LVDS inputs

LVDSGND       8,14,21                                            Ground  Ground Pins for LVDS inputs

PLLVCC        23                                                 Power   Power Supply Pin for PLL circuitry

PLLGND        22,24                                              Ground  Ground Pins for PLL circuitry

THC63LVDF64B Pin Description

Pin name      Pin #                                              Type                         Description

RA+, RA-      8,9                   LVDS IN

RB+, RB-      10,11                 LVDS IN                              LVDS Data Inputs

RC+, RC-      14,15                 LVDS IN

RCLK+, RCLK-  16,17                 LVDS IN                              LVDS Clock Inputs

RA0~RA6       24,26,27,29,30,31,33                               OUT

RB0~RB6       34,35,37,39,40,41,43                               OUT     Pixel Data Outputs

RC0~RC6       45,46,47,1,2,4,5                                   OUT

CLKOUT        23                                                 OUT     Pixel Clock Output

/PDWN         22                                                 IN      H: Normal operation

                                                                         L: Power down ( all outputs are pulled to ground)

VCC           28,36,42,48                                        Power   Power Supply Pins for TTL outputs and digital circuitry

GND           3,25,32,38,44                                      Ground  Ground Pins for TTL outputs and digital circuitry

LVDSVCC       12                                                 Power   Power Supply Pin for LVDS inputs

LVDSGND       7,13,18                                            Ground  Ground Pins for LVDS inputs

PLLVCC        20                                                 Power   Power Supply Pin for PLL circuitry

PLLGND        19,21                                              Ground  Ground Pins for PLL circuitry

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Electrical Characteristics

CMOS/TTL DC SPECIFICATIONS

                                                                                 VCC   =  2.5V ~   3.6V,  Ta = -10 °C ~ +70 °C

Symbol                Parameter                                  Conditions      Min.        Typ.         Max.         Units

VIH     High Level Input Voltage                                                 2.0                      VCC          V

VIL     Low Level Input Voltage                                                  GND                      0.8          V

VOH1    High Level Output Voltage         VCC= 3.0V ~ 3.6V                       2.4                                   V

                                          IOH = -4mA

VOL1    Low Level Output Voltage          VCC = 3.0V ~ 3.6V                                               0.4          V

                                          IOL = 4mA

VOH2    High Level Output Voltage         VCC= 2.5V ~ 3.0V                       2.1                                   V

                                          IOH = -2mA

VOL2    Low Level Output Voltage          VCC = 2.5V ~ 3.0V                                               0.4          V

                                          IOL = 2mA

IIN     Input Current                     0V £ VIN £ VCC                                                  ±10          uA

LVDS RECEIVER DC SPECIFICATIONS

                                                                                 VCC = 2.5V ~ 3.6V,       Ta = -10 °C  ~ +70 °C

Symbol                        Parameter                          Conditions            Min.        Typ.   Max.         Units

VTH     Differential Input High Threshold                        VOC = +1.2V                              100          mV

VTL     Differential Input Low Threshold                                               -100                            mV

IIN     Input Current                                            VIN = +2.4V/0V                           ±10          uA

                                                                 VCC = 3.6V

Absolute Maximum Ratings1

Supply Voltage (Vcc)                      -0.3 to +4V

CMOS/TTL Input Voltage                    -0.3 to (Vcc + 0.3V)

CMOS/TTL Output Voltage                   -0.3V to (Vcc + 0.3V)

LVDS Receiver Input Voltage               -0.3V to (Vcc + 0.3V)

Junction Temperature                      +125 °C

Storage Temperature Range                 -55 °C to +150 °C

Resistance to soldering heat             +260 °C /10sec

Maximum Power Dissipation@25°C            0.5W

1. “Absolute Maximum Ratings” are those valued beyond which the safety of the device can not be guaranteed. They

are not meant to imply that the device should be operated at these limits. The tables of “Electrical Characteristics”

specify conditions for device operation.

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Supply Current

                                                                               VCC = 2.5V  ~  3.6V,  Ta = -10 °C  ~ +70 °C

Symbol          Parameter                                        Condition(*)                 Typ.       Max.     Units

          Receiver Supply Current  CL=8pF, VCC=3.3V                 f = 65MHz                        41  53       mA

IRCCG     16Grayscale Pattern                                       f = 85MHz                        52  64       mA

                                   CL=8pF, VCC=2.5V                 f = 65MHz                        30  42       mA

          Receiver Supply Current  CL=8pF, VCC=3.3V                 f = 65MHz                        72  94       mA

IRCCW     Worst Case Pattern                                        f = 85MHz                        84  96       mA

                                   CL=8pF, VCC=2.5V                 f = 65MHz                        42  64       mA

IRCCS     Receiver Power Down      /PDWN = L                                                             10       µA

          Supply Current

16  Gray  Scale Pattern

               CLKIN

                  Rx0

                  Rx1

                  Rx2

                  Rx3

                  Rx4

                  Rx5

                  Rx6

Worst Case Pattern

        CLKIN

        EVEN RxIN

        ODD RxIN

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Switching Characteristics

                                                                                           VCC=  2.5V  ~  3.6V,  Ta = -10 °C  ~ +70 °C

Symbo                                                                                                                         Unit

l                       Parameter                                               Min.             Typ.            Max.         s

tRCP   CLK OUT Period              VCC = 3.0                     -  3.6V        11.76            T               50.0         ns

                                   VCC = 2.5                     -  3.6V        14.28            T               50.0         ns

tRCH   CLK OUT High Time                                                                         4T/7                         ns

tRCL   CLK OUT Low Time                                                                          3T/7                         ns

tRCD   RCLK +/- to CLK OUT Delay                                                                 5T/7                         ns

tRS    TTL Data Setup to CLK OUT                                                0.35T-0.3                                     ns

tRH    TTL Data Hold from CKL OUT                                               0.45T-1.6                                     ns

tTLH   TTL Low to High Transition Time                                                           2.0             3.0          ns

tTHL   TTL High to Low Transition Time                                                           1.8             3.0          ns

tRIP1  Input Data Position0 (T = 11.76ns)                                       -0.4             0.0             0.4          ns

tRIP0  Input Data Position1 (T = 11.76ns)                                       T/7-0.4          T/7             T/7+0.4      ns

tRIP6  Input Data Position2 (T = 11.76ns)                                       2T/7-0.4         2T/7            2T/7+0.4     ns

tRIP5  Input Data Position3 (T = 11.76ns)                                       3T/7-0.4         3T/7            3T/7+0.4     ns

tRIP4  Input Data Position4 (T = 11.76ns)                                       4T/7-0.4         4T/7            4T/7+0.4     ns

tRIP3  Input Data Position5 (T = 11.76ns)                                       5T/7-0.4         5T/7            5T/7+0.4     ns

tRIP2  Input Data Position6 (T = 11.76ns)                                       6T/7-0.4         6T/7            6T/7+0.4     ns

tRPLL  Phase Lock Loop Set                                                                                       10.0         ms

AC Timing Diagrams

TTL Output

                                                                    80%                                   80%

            8pF                    TTL Output

                                                                    20%                                   20%

       TTL Output Load

                                                                          tTLH                   tTHL

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AC Timing  Diagrams

                                               tRIP2

                                               tRIP3

                                               tRIP4

                                               tRIP5

                                               tRIP6

                                               tRIP0

                                        tRIP1

Rx+/-      Rx6    Rx5              Rx4  Rx3                      Rx2  Rx1         Rx0

RCLK+                                                                 Vdiff = 0V                                   Vdiff =  0V

                                                                                       tRCD

                                        tRCP                                             tRCH                tRCL

CLKOUT     VCC/2                                                                  VCC/2        VCC/2                        VCC/2

                                                                                             tRS        tRH

Rx0 - Rx6                          DATA VALID                         VCC/2                       DATA  VALID      VCC/2

Note:

1) Vdiff = (RA+) - (RA-),  ......  (RCLK+) - (RCLK-)

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AC Timing Diagrams

Phase Lock Loop Set Time

/PDWN               VCC/2

                                                                                  3.6V

VCC                 VCC/2                                           tRPLL

RCLK+/-

CLKOUT                                                                     VCC/2

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Package

56 Lead Molded Thin Shrink Small     Outline   Package, JEDEC

                                                                                            Unit : millimeters

                                                                 14.0 ± 0.1

                                     56                                          29

                  8.1 ± 0.1                                                                 6.1 ± 0.1

                               4.05

                                     1                                           28

                                                                                            (1.0)

                                                                                            1.2 MAX

                                     0.50 TYP                    0.20 TYP            0.10 ± 0.05

48  Lead  Molded  Thin Shrink  Small Outline   Package, JEDEC

                                                                                            Unit : millimeters

                                                                 12.5 ± 0.1

                                     48                                      25

                  8.1 ± 0.1                                                          6.1 ± 0.1

                               4.05

                                     1                                       24

                                                                                     (1.0)

                                                                                     1.2 MAX

                                     0.50 TYP                    0.20 TYP            0.10 ± 0.05

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Notes to Users:

1.  The contents of this data sheet are subject to change without prior notice.

2.  Circuit diagrams shown in this data sheet are examples of application. Therefore, please pay sufficient attention

    when designing circuits. Even if there are incorrect descriptions, we are not responsible for any problem due to

    them. Please note that incorrect descriptions sometimes cannot be corrected immediately if found.

3.  Our copyright and know-how are included in this data sheet. Duplication of the data sheet and disclosure to other

    persons are strictly prohibited without our permission.

4.  We  are  not  responsible  for  any  problems                of  industrial  proprietorship  occurring  during  THC63LVDF84B/

    THC63LVDF64B use, except for those directly related to THC63LVDF84B/THC63LVDF64B’s structure, manu-

    facture or functions. THC63LVDF84B/THC63LVDF64B is designed on the premise that it should be used for ordi-

    nary electronic devices. Therefore, it shall not be used for applications that require extremely high-reliability (space

    equipment, nuclear control equipment, medical equipment that affects people’s lives, etc.). In addition, when using

    THC63LVDF84B/THC63LVDF64B for traffic signals, safety devices and control/safety units in transportation

    equipment, etc., appropriate measures should be taken.

5.  We are making the utmost effort to improve the quality and reliability of our products. However, there is a very

    slight possibility of failure in semiconductor devices. To avoid damage to social or official organizations, much care

    should be taken to provide sufficient redundancy and fail-safe design.

6.  No radiation-hardened design is incorporated in THC63LVDF84B/THC63LVDF64B.

7.  Judgment on whether THC63LVDF84B/THC63LVDF64B comes under strategic products prescribed by the For-

    eign Exchange and Foreign Trade Control Law is the user’s responsibility.

8.  This technical document was provisionally created during development of THC63LVDF84B/THC63LVDF64B, so

    there is a possibility of differences between it and the product’s final specifications. When designing circuits using

    THC63LVDF84B/THC63LVDF64B, be sure to refer to the final technical documents.

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3-3-6, Nihombashi-Honcho,

Chuo-ku, Tokyo, 103-0023 Japan

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Fax: 81-3-3270-0688

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