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THC63LVD104A

器件型号:THC63LVD104A
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厂商名称:THine Electronics, Inc.
厂商官网:https://www.thine.co.jp/
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器件描述

90mhz 30bits color lvds receiver

THC63LVD104A器件文档内容

THC63LVD104A Rev.1.0                                                                                                    THine

                                   THC63LVD104A

                                   90MHz 30Bits COLOR LVDS Receiver

General Description                                                             Features

The THC63LVD104A receiver is designed to support                                •  Wide dot clock range: 8-90MHz suited for NTSC,

pixel data transmission between Host and Flat Panel                                VGA, SVGA, XGA, and WXGA

Display from NTSC up to WXGA resolutions. The                                   •  PLL requires no external components

THC63LVD104A converts the LVDS data streams back                                •  50% output clock duty cycle

into 35bits of CMOS/TTL data with rising edge or fall-                          •  TTL clock edge programmable

ing edge clock for convenient with a variety of LCD                             •

panel controllers.At a transmit clock frequency of                                 Power down mode

90MHz, 30bits of RGB data and 5bits of timing and                               •  Low power single 3.3V CMOS design

control data (HSYNC,VSYNC,DE,CNTL1,CNTL2)                                       •  64pin TQFP

are transmitted at an effective rate of 630Mbps per                             •  Backward compatible with THC63LVDF64x

LVDS channel.Using a 90MHz clock, the data through-                                (18bits) / F84x(24bits)

put is 394Mbytes per second.

Block  Diagram

       LVDS INPUT                                                                              CMOS/TTL OUTPUT

                      RA+/-                                                        7                RA6-RA0

                      RB+/-                                 SERIAL TO PARALLEL     7                RB6-RB0

                      RC+/-                                                        7                RC6-RC0

                      RD+/-                                                        7                RD6-RD0

                      RE+/-                                                        7                RE6-RE0

                      RCLK+/-                               PLL                                     CLKOUT

                      (8 to90MHz)

       CMOS/TTL INPUT

                      TEST

                      PD

                      OE

                      R/F

Copyright 2003 THine Electronics, Inc. All rights reserved  1                                                   THine Electronics, Inc.
THC63LVD104A  Rev.1.0                                                                                             THine

Pin Out

                           VCC  RA0   RA1  RA2  GND  RA3    RA4  RA5  RA6  RB0  RB1  VCC  RB2  RB3  RB4  RB5

                           48   47    46   45   44   43     42   41   40   39   38   37   36   35   34   33

RA-                    49                                                                                     32  RB6

RA+                    50                                                                                     31  CLKOUT

RB-                    51                                                                                     30  GND

RB+                    52                                                                                     29  RC0

LVCC                   53                                                                                     28  RC1

RC-                    54                                                                                     27  RC2

RC+                    55                                                                                     26  RC3

RCLK-                  56                                                                                     25  RC4

RCLK+                  57                                                                                     24  RC5

LGND                   58                                                                                     23  VCC

RD-                    59                                                                                     22  RC6

RD+                    60                                                                                     21  RD0

RE-                    61                                                                                     20  RD1

RE+                    62                                                                                     19  RD2

PGND                   63                                                                                     18  RD3

PVCC                   64                                                                                     17  RD4

                           1    2     3    4    5    6      7    8    9    10   11   12   13   14   15   16

                           GND  TEST  PD   OE   R/F  RE6    RE5  RE4  VCC  RE3  RE2  RE1  RE0  RD6  RD5  GND

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THC63LVD104A   Rev.1.0                                                                                                THine

Pin Description

    Pin Name               Pin #                                   Type                      Description

    RA+, RA-               50, 49                           LVDS IN

    RB+, RB-               52, 51                           LVDS IN

    RC+, RC-               55, 54                           LVDS IN          LVDS Data In.

    RD+, RD-               60, 59                           LVDS IN

    RE+,RE-                62, 61                           LVDS IN

    RCLK+, RCLK-           57, 56                           LVDS IN          LVDS Clock In.

    RA6 ~ RA0              40,41,42,43,45,46,47                    OUT

    RB6 ~ RB0              32,33,34,35,36,38,39                    OUT

    RC6 ~ RC0              22,24,25,26,27,28,29                    OUT       CMOS/TTL Data Outputs.

    RD6 ~ RD0              14,15,17,18,19,20,21                    OUT

    RE6 ~ RE0              6,7,8,10,11,12,13                       OUT

         TEST              2                                          IN     Test pin, must be “L” for normal operation.

         PD                3                                          IN     H: Normal operation,

                                                                             L: Power down (all outputs are “L”)

         OE                4                                          IN     H:Output enable (Normal operation).

                                                                             L:Output disable(all outputs are Hi-Z)

         R/F               5                                          IN     Output Clock Triggering Edge Select.

                                                                             H: Rising edge, L: Falling edge

         VCC               9,23,37,48                              Power     Power Supply Pins for TTL outputs and digital

                                                                             circuitry.

    CLKOUT                 31                                      OUT       Clock out.

         GND               1,16,30,44                             Ground     Ground Pins for TTL outputs and digital cir-

                                                                             cuitry.

         LVCC              53                                      Power     Power Supply Pin for LVDS inputs.

    LGND                   58                               Ground           Ground Pin for LVDS inputs.

         PVCC              64                                      Power     Power Supply Pin for PLL circuitry.

    PGND                   63                               Ground           Ground Pin for PLL circuitry.

    PD               R/F       OE                Data Outputs                            CLKOUT

                                                            (Rxn)

    0                   0         0                         Hi-Z                             Hi-Z

    0                   0         1                         All 0                        Fixed Low

    0                   1         0                         Hi-Z                             Hi-Z

    0                   1         1                         All 0                        Fixed Low

    1                   0         0                         Hi-Z                             Hi-Z

    1                   0         1                         Data Out         It latches output data on falling edge.

    1                   1         0                         Hi-Z                             Hi-Z

    1                   1         1                         Data Out         It latches output data on rising edge.

**  Rxn

x   = A,B,C,D,E

n   = 0,1,2,3,4,5,6

Copyright 2003 THine Electronics, Inc. All rights reserved                3                                   THine Electronics, Inc.
THC63LVD104A  Rev.1.0                                                                                       THine

Absolute Maximum Ratings                  1

Supply Voltage (VCC)                                              -0.3V ~ +4.0V

CMOS/TTL Input Voltage                                            -0.3V ~ (VCC + 0.3V)

CMOS/TTL Output Voltage                                           -0.3V ~ (VCC + 0.3V)

LVDS Receiver Input Voltage                                       -0.3V ~ (VCC + 0.3V)

Output Current                                                    -30mA ~ 30mA

Junction Temperature                                              +125 °C

Storage Temperature Range                                         -55°C ~ +125°C

Resistance to soldering heat                                      +260 °C /10sec

Maximum Power Dissipation @+25°C                                  1.0W

Electrical Characteristics

CMOS/TTL DC Specifications

                                                                                  VCC = 3.0V ~ 3.6V,  Ta = 0 °C  ~ +70 °C

Symbol                 Parameter                                  Conditions      Min.       Typ.     Max.       Units

VIH           High Level Input Voltage                                                  2.0           VCC              V

VIL           Low Level Input Voltage                                             GND                 0.8              V

                                                            IOH=  -4mA (data)

VOH           High Level Output Voltage                     IOH=  -8mA (clock)          2.4                            V

                                                            IOL=  4mA (data)

VOL           Low Level Output Voltage                      IOL= 8mA (clock)                          0.4              V

IINC          Input Current                                 0V ≤ VIN ≤ VCC                            ±10              µA

LVDS Receiver DC Specifications

                                                                                  VCC = 3.0V ~ 3.6V,  Ta = 0 °C  ~ +70 °C

Symbol                 Parameter                                  Conditions      Min.       Typ.     Max.       Units

VTH           Differential Input High Threshold             VOC= 1.2V                                 100        mV

VTL           Differential Input Low Threshold              VOC= 1.2V             -100                           mV

IINL          Input Current                                 VIN= 2.4V / 0V                            ±20              µA

                                                            VCC= 3.6V

1. “Absolute Maximum Ratings” are those valued beyond which the safety of the device can not be guaranteed. They

are not meant to imply that the device should be operated at these limits. The tables of “Electrical Characteristics”

specify conditions for device operation.

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Supply Current

                                                                               VCC  =  3.0V  ~  3.6V,  Ta = 0 °C  ~ +70 °C

Symbol                 Parameter                                   Conditions                   Typ.   Max.       Units

              Receiver Supply                                          CL=8pF,

IRCCG         Current                              fCLKOUT   =  90MHz                           70                mA

              (Gray Scale Pattern)                                     Vcc=3.3V

              Receiver Supply                                          CL=8pF,

IRCCW         Current                              fCLKOUT   =  90MHz                           112               mA

              (Checker Pattern)                                        Vcc=3.3V

IRCCS         Receiver Power Down                  PD = L                                              10         µA

              Supply Current

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Incremental Pattern(Gray            Scale)

              CLKOUT

                       Rx0

                       Rx1

                       Rx2

                       Rx3

                       Rx4

                       Rx5

                       Rx6

                       x=A,B,C,D,E

Toggle Pattern(Checker)

              CLKOUT

                       Rx0

                       Rx1

                       Rx2

                       Rx3

                       Rx4

                       Rx5

                       Rx6

                       x=A,B,C,D,E

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Switching Characteristics

                                                                                          VCC = 3.0V ~         3.6V,     Ta = 0 °C            ~ +70 °C

Symbol                      Parameter                            Min.                     Typ.                        Max.                    Units

tRCP          CLKOUT Period                                                       11.1             T                     125.0                ns

tRCH          CLKOUT High Time                                                            T------–----1--                                     ns
                                                                                                2

tRCL          CLKOUT Low Time                                                             T------–----1--                                     ns
                                                                                                2

tRS           TTL Data Setup to CLKOUT                         tRCP - 7.0                                                                     ns

tRH           TTL Data Hold from CLKOUT                                           1.0                                                         ns

tTLH          TTL Low to High Transition Time                                                   1.0                         2.0               ns

tTHL          TTL High to Low Transition Time                                                   1.0                         2.0               ns

tRIP1         Input Data Position0                                                -0.25         0.0                      +0.25                ns

tRIP0         Input Data Position1                             -t-R----C---I--P-  – 0.25  t--R----C---I--P-         -t-R----C---I--P- + 0.25  ns
                                                                 7                              7                     7

tRIP6         Input Data Position2                          2  -t-R----C---I--P-  – 0.25  2 t--R----C---I--P-  2t--R----C---I--P- + 0.25      ns
                                                                 7                              7                     7

tRIP5         Input Data Position3                          3  t--R----C---I--P-  – 0.25  3 t--R----C---I--P-  3t--R----C---I--P- + 0.25      ns
                                                                 7                              7                     7

tRIP4         Input Data Position4                          4  t--R----C---I--P-  – 0.25  4 t--R----C---I--P-  4t--R----C---I--P- + 0.25      ns
                                                                 7                              7                     7

tRIP3         Input Data Position5                          5  t--R----C---I--P-  – 0.25  5 t--R----C---I--P-  5t--R----C---I--P- + 0.25      ns
                                                                 7                              7                     7

tRIP2         Input Data Position6                          6  t--R----C---I--P-  – 0.25  6 t--R----C---I--P-  6t--R----C---I--P- + 0.25      ns
                                                                 7                              7                     7

tRPLL         Phase Lock Loop Set                                                                                           10.0              ms

tRCIP         CLKIN Period                                                        11.1                                   125.0                ns

AC Timing Diagrams

TTL Outputs

                       TTL Output                              80%                                 80%

                                    CL=8pF

                                                            20%                                                20%

                       TTL Output Load

                                                                 tTLH                              tTHL

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AC Timing Diagrams

TTL Outputs

                                                                     tRCH               tRCL

                                                                                              R/F = L

CLKOUT                      2.0V                               2.0V       2.0V

                                                                                  0.8V  0.8V

                                        tRCP                                                  R/F = H

                                                                     tRS          tRH

                                                               2.0V               2.0V

Rxn

                                                               0.8V               0.8V

     x = A,B,C,D,E

     n = 0,1,2,3,4,5,6

Phase Lock            Loop  Set   Time

VCC                               3.0V

RCLK+/-

PD                                                             2.0V

                                                                           tRPLL

                                                                                  2.0V

CLKOUT

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Power Up Sequence

Power Up Sequence must              be Sequence1 or Sequence2.

1)Sequence1

VCC                                       VCC/2

PVCC

LVCC

                                          Min 100usec

PD                                                          VCC/2

                                    Recommended PD Pin Circuit

                                                   VCC

                                          100kohm

                                                                        PD Pin

                                          0.1uF

2)Sequence2

     VCC                                  3.0V                                  VCC

     PVCC

     LVCC

                      GND

                                                                                VCC

     PD

                      GND                 GND

         PD           pin must  be  High  after VCC voltage  is  3.0V.

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AC Timing Diagrams

LVDS Inputs

                                                            tRIP2

                                                            tRIP3

                                                            tRIP4

                                                            tRIP5

                                                            tRIP6

                                                            tRIP0

                                     tRIP1

Rx+/-                 Rx6  Rx5  Rx4  Rx3                           Rx2  Rx1          Rx0  Rx6  Rx5  Rx4  Rx3  Rx2  Rx1

RCLK+                                                                   Vdiff =  0V                                Vdiff = 0V

       x = A,B,C,D,E                                                                      tRCIP

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AC Timing Diagrams

LVDS Inputs

                      Vdiff = 0V                                                     Vdiff =   0V

RCLK+

(Differential)

RA+/-                 RA3’   RA2’   RA1’  RA0’              RA6  RA5  RA4  RA3  RA2  RA1       RA0  RA6’’

RB+/-                 RB3’   RB2’   RB1’  RB0’              RB6  RB5  RB4  RB3  RB2  RB1       RB0  RB6’’

RC+/-                 RC3’   RC2’   RC1’  RC0’              RC6  RC5  RC4  RC3  RC2  RC1       RC0  RC6’’

RD+/-                 RD3’   RD2’   RD1’  RD0’              RD6  RD5  RD4  RD3  RD2  RD1       RD0  RD6’’

RE+/-                 RE3’   RE2’   RE1’  RE0’              RE6  RE5  RE4  RE3  RE2  RE1       RE0  RE6’’

                Previous Cycle                                                  Current Cycle       Next   Cycle

                      tRIP1

                             tRIP0

                             tRIP6

                             tRIP5

                             tRIP4

                             tRIP3

                             tRIP2

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Package

                       INDEX   ∆             64                   49

              PIN No.1                                                48

                       0.5TYP

              0.22                                                        10.0TYP  12.0TYP

                               16                                     33

                                             17                   32

              1.00TYP          1.2MAX

                                                                          UNITS:   mm

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Notes to Users:

1.  The contents of this data sheet are subject to change without prior notice.

2.  Circuit diagrams shown in this data sheet are examples of application. Therefore, please pay sufficient attention

    when designing circuits. EVEN IF THERE ARE INCORRECT DESCRIPTIONS, THINE IS NOT RESPOSIBLE

    FOR ANY PROBLEM DUE TO THEM. Please note that incorrect descriptions sometimes cannot be corrected

    immediately if found.

3.  THine’s copyright, know-how and other intellectual property rights are included in this data sheet. Duplication of

    the data sheet and disclosure to other persons are strictly prohibited without THine’s prior written permission.

4.  THINE IS NOT RESPONSIBLE FOR ANY PROBLEMS OF INTELLECTUAL PROPERTY RIGHTS OCCUR-

    RING DURING THC63LVD104A USE, EXCEPT FOR DAMAGES RESULTING FROM INFRINGEMENT

    CAUSED ONLY BY THC63LVD104A WITHOUT ANY ITEM NOT SOLD BY THINE AND/OR ANY USERS’

    ACTION. THINE IS NOT RESPONSIBLE FOR PROBLEMS CAUSED BY SPECIFICATIONS SUPPLIED BY

    USERS. THC63LVD104A is designed on the premise that it should be used for ordinary electronic devices. There-

    fore, it shall not be used for applications that require extremely high-reliability (space equipment, nuclear control

    equipment, medical equipment that affects people’s lives, etc.). In addition, when using THC63LVD104A for traffic

    signals, safety devices and control/safety units in transportation equipment, etc., appropriate measures should be

    taken.

5.  THINE   IS  MAKING     THE  UTMOST           EFFORT         TO  IMPROVE      THE  QUALITY  AND  RELIABILITY            OF

    THINE’S PRODUCTS. HOWEVER, THERE IS A VERY SLIGHT POSSIBILITY OF FAILURE IN SEMICON-

    DUCTOR DEVICES. To avoid damage to social or official organizations, much care should be taken to provide

    sufficient redundancy and fail-safe design.

6.  No radiation-hardened design is incorporated in THC63LVD104A.

7.  Judgment on whether THC63LVD104A comes under strategic products prescribed by the Foreign Exchange and

    Foreign Trade Control Law is the user’s responsibility.

8.  This technical document was provisionally created during development of THC63LVD104A, so there is a possibil-

    ity of differences between it and the product’s final specifications. When designing circuits using THC63LVD104A,

    be sure to refer to the final technical documents.

THine Electronics, Inc.

Wakamatsu Bldg, 6F

3-3-6, Nihombashi-Honcho,

Chuo-ku, Tokyo, 103-0023 Japan

Tel: 81-3-3270-0666

Fax: 81-3-3270-0688

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