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SN74LVC2G32YZAR

器件型号:SN74LVC2G32YZAR
器件类别:半导体    逻辑   
厂商名称:Texas Instruments
厂商官网:http://www.ti.com/
标准:
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器件描述

Logic Gates Dual 2-Input Pos

参数
产品属性属性值
Product AttributeAttribute Value
制造商:
Manufacturer:
Texas Instruments
产品种类:
Product Category:
Logic Gates
RoHS:YES
产品:
Product:
Single-Function Gate
Logic Function:OR
Logic Family:74LVC
Number of Gates:2 Gate
Number of Input Lines:2 Input
Number of Output Lines:1 Output
High Level Output Current:- 32 mA
Low Level Output Current:32 mA
传播延迟时间:
Propagation Delay Time:
3.8 ns
电源电压-最大:
Supply Voltage - Max:
5.5 V
电源电压-最小:
Supply Voltage - Min:
1.65 V
最小工作温度:
Minimum Operating Temperature:
- 40 C
最大工作温度:
Maximum Operating Temperature:
+ 85 C
安装风格:
Mounting Style:
SMD/SMT
封装 / 箱体:
Package / Case:
DSBGA-8
Function:Dual 2-Input Pos
高度:
Height:
0.35 mm
长度:
Length:
1.9 mm
宽度:
Width:
0.9 mm
商标:
Brand:
Texas Instruments
Logic Type:2-Input OR
工作电源电压:
Operating Supply Voltage:
1.8 V, 2.5 V, 3.3 V, 5 V
产品类型:
Product Type:
Logic Gates
工厂包装数量:
Factory Pack Quantity:
1
子类别:
Subcategory:
Logic ICs
单位重量:
Unit Weight:
0.000081 oz

SN74LVC2G32YZAR器件文档内容

                                                                                               SN74LVC2G32
                                                                       DUAL 2INPUT POSITIVEOR GATE

D Available in the Texas Instruments                                                 SCES201J - APRIL 1999 - REVISED SEPTEMBER 2003

     NanoStar and NanoFree Packages                                                       DCT OR DCU PACKAGE
                                                                                                   (TOP VIEW)
D Supports 5-V VCC Operation
D Inputs Accept Voltages to 5.5 V                                                       1A 1  8 VCC
                                                                                        1B 2  7 1Y
D Max tpd of 3.8 ns at 3.3 V                                                            2Y 3  6 2B
D Low Power Consumption, 10-A Max ICC                                               GND 4    5 2A
D 24-mA Output Drive at 3.3 V
                                                                                     YEA, YEP, YZA OR YZP PACKAGE
D Typical VOLP (Output Ground Bounce)                                                            (BOTTOM VIEW)

     <0.8 V at VCC = 3.3 V, TA = 25C                                                       GND 4 5 2A
                                                                                                2Y 3 6 2B
D Typical VOHV (Output VOH Undershoot)                                                          1B 2 7 1Y
                                                                                                1A 1 8 VCC
     >2 V at VCC = 3.3 V, TA = 25C

D Ioff Supports Partial-Power-Down Mode

     Operation

D Latch-Up Performance Exceeds 100 mA Per

     JESD 78, Class II

D ESD Protection Exceeds JESD 22

     - 2000-V Human-Body Model (A114-A)

     - 200-V Machine Model (A115-A)

     - 1000-V Charged-Device Model (C101)

description/ordering information
       This dual 2-input positive-OR gate is designed for 1.65-V to 5.5-V VCC operation.
       The SN74LVC2G32 performs the Boolean function Y + A ) B or Y + A B in positive logic.

                            ORDERING INFORMATION

TA                          PACKAGE                                                   ORDERABLE       TOP-SIDE
                                                                                     PART NUMBER      MARKING

               NanoStar - WCSP (DSBGA)                                               SN74LVC2G32YEAR
               0.17-mm Small Bump - YEA

               NanoFree - WCSP (DSBGA)                                 Reel of 3000  SN74LVC2G32YZAR  _ _ _CG_
               0.17-mm Small Bump - YZA (Pb-free)                                    SN74LVC2G32YEPR

-40C to 85C  NanoStar - WCSP (DSBGA)
               0.23-mm Large Bump - YEP
                                                                                     SN74LVC2G32YZPR
               NanoFree - WCSP (DSBGA)
               0.23-mm Large Bump - YZP (Pb-free)

               SSOP - DCT                                              Reel of 3000 SN74LVC2G32DCTR C32_ _ _

               VSSOP - DCU                                             Reel of 3000  SN74LVC2G32DCUR  C32_
                                                                       Reel of 250   SN74LVC2G32DCUT

Package drawings, standard packing quantities, thermal data, symbolization, and PCB design guidelines are available at

  www.ti.com/sc/package.
DCT: The actual top-side marking has three additional characters that designate the year, month, and assembly/test site.

  DCU: The actual top-side marking has one additional character that designates the assembly/test site.

  YEA/YZA, YEP/YZP: The actual top-side marking has three preceding characters to denote year, month, and sequence code,

  and one following character to designate the assembly/test site. Pin 1 identifier indicates solder-bump composition

(1 = SnPb, = Pb-free).

Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.

NanoStar and NanoFree are trademarks of Texas Instruments.                           Copyright  2003, Texas Instruments Incorporated

PRODUCTION DATA information is current as of publication date.
Products conform to specifications per the terms of Texas Instruments
standard warranty. Production processing does not necessarily include
testing of all parameters.

                            POST OFFICE BOX 655303 DALLAS, TEXAS 75265                                                   1
SN74LVC2G32
DUAL 2INPUT POSITIVEOR GATE

SCES201J - APRIL 1999 - REVISED SEPTEMBER 2003

description/ordering information (continued)

       NanoStar and NanoFree package technology is a major breakthrough in IC packaging concepts, using the
       die as the package.

       This device is fully specified for partial-power-down applications using Ioff. The Ioff circuitry disables the outputs,
       preventing damaging current backflow through the device when it is powered down.

                                               FUNCTION TABLE
                                                    (each gate)

                                            INPUTS  OUTPUT
                                                         Y
                                            A  B

                                            H  X    H

                                            X  H    H

                                            L  L    L

logic diagram (positive logic)

                                         1                       7
                                1A                                     1Y

                                         2                       3
                                1B                                     2Y

                                        5
                                2A

                                        6
                                2B

absolute maximum ratings over operating free-air temperature range (unless otherwise noted)

       Supply voltage range, VCC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -0.5 V to 6.5 V
       Input voltage range, VI (see Note 1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -0.5 V to 6.5 V
       Voltage range applied to any output in the high-impedance or power-off state, VO

          (see Note 1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -0.5 V to 6.5 V

       Voltage range applied to any output in the high or low state, VO
          (see Notes 1 and 2) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -0.5 V to VCC + 0.5 V

       Input clamp current, IIK (VI < 0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -50 mA
       Output clamp current, IOK (VO < 0) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -50 mA
       Continuous output current, IO . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50 mA
       Continuous current through VCC or GND . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 100 mA
       Package thermal impedance, JA (see Note 3): DCT package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 220C/W

                                                                       DCU package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 227C/W
                                                                       YEA/YZA package . . . . . . . . . . . . . . . . . . . . . . . . . . . 140C/W
                                                                       YEP/YZP package . . . . . . . . . . . . . . . . . . . . . . . . . . . 102C/W
       Storage temperature range, Tstg . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -65C to 150C

Stresses beyond those listed under "absolute maximum ratings" may cause permanent damage to the device. These are stress ratings only, and

  functional operation of the device at these or any other conditions beyond those indicated under "recommended operating conditions" is not

  implied. Exposure to absolute-maximum-rated conditions for extended periods may affect device reliability.

NOTES: 1. The input negative-voltage and output voltage ratings may be exceeded if the input and output current ratings are observed.

              2. The value of VCC is provided in the recommended operating conditions table.
              3. The package thermal impedance is calculated in accordance with JESD 51-7.

2                               POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                                     SN74LVC2G32
                                                             DUAL 2INPUT POSITIVEOR GATE

                                                                SCES201J - APRIL 1999 - REVISED SEPTEMBER 2003

recommended operating conditions (see Note 4)

                                                                                      MIN   MAX        UNIT

                                        Operating                                     1.65  5.5
                                        Data retention only
VCC Supply voltage                                                                                                       V
                                                                                      1.5

VIH High-level input voltage            VCC = 1.65 V to 1.95 V                        0.65 VCC
                                        VCC = 2.3 V to 2.7 V
                                        VCC = 3 V to 3.6 V                                  1.7
                                        VCC = 4.5 V to 5.5 V                                                                    V
                                        VCC = 1.65 V to 1.95 V
                                        VCC = 2.3 V to 2.7 V                                   2
                                        VCC = 3 V to 3.6 V
VIL  Low-level input voltage            VCC = 4.5 V to 5.5 V                          0.7 VCC

                                        VCC = 1.65 V                                                   0.35 VCC
                                        VCC = 2.3 V
                                                                                                              0.7
                                        VCC = 3 V                                                                             V

                                                                                                              0.8

                                                                                            0.3 VCC

VI   Input voltage                                                                    0     5.5        V

VO   Output voltage                                                                   0     VCC        V

                                                                                            -4

                                                                                            -8

IOH High-level output current                                                               -16        mA

                                                                                            -24

                                        VCC = 4.5 V                                         -32
                                        VCC = 1.65 V
                                        VCC = 2.3 V                                         4

                                        VCC = 3 V                                           8

IOL  Low-level output current                                                               16         mA

                                                                                            24

                                        VCC = 4.5 V                                         32

                                        VCC = 1.8 V 0.15 V, 2.5 V 0.2 V                 20

t/v Input transition rise or fall rate  VCC = 3.3 V 0.3 V                                 10         ns/V

                                        VCC = 5 V 0.5 V                                   5

TA   Operating free-air temperature                                                   -40   85         C

NOTE 4: All unused inputs of the device must be held at VCC or GND to ensure proper device operation. Refer to the TI application report,
              Implications of Slow or Floating CMOS Inputs, literature number SCBA004.

                                        POST OFFICE BOX 655303 DALLAS, TEXAS 75265                                               3
SN74LVC2G32
DUAL 2INPUT POSITIVEOR GATE

SCES201J - APRIL 1999 - REVISED SEPTEMBER 2003

electrical characteristics over recommended operating free-air temperature range (unless
otherwise noted)

       PARAMETER                          TEST CONDITIONS                               VCC           MIN       TYP  MAX   UNIT
   VOH                                                                            1.65 V to 5.5 V  VCC-0.1                   V
                  IOH = -100 mA
                  IOH = -4 mA                                                          1.65 V          1.2
                  IOH = -8 mA                                                            2.3 V         1.9
                  IOH = -16 mA                                                                         2.4
                  IOH = -24 mA                                                              3V         2.3

                  IOH = -32 mA                                                          4.5 V      3.8
                  IOL = 100 mA
                  IOL = 4 mA                                                      1.65 V to 5.5 V                    0.1
                  IOL = 8 mA
                  IOL = 16 mA                                                           1.65 V                       0.45
                  IOL = 24 mA
                                                                                        2.3 V                        0.3

   VOL                                                                                                               0.4   V

                                                                                        3V                           0.55

                  IOL = 32 mA                                                            4.5 V                       0.55
                                                                                     0 to 5.5 V
   II    A or B inputs VI = 5.5 V or GND                                                                             5 mA
                                                                                               0
   Ioff           VI or VO = 5.5 V                                                1.65 V to 5.5 V                    10 mA

   ICC            VI = 5.5 V or GND,                IO = 0                          3 V to 5.5 V                     10 mA
                                                    Other inputs at VCC or GND           3.3 V
   ICC            One input at VCC - 0.6 V,                                                                          500 mA

   Ci             VI = VCC or GND                                                                               5          pF

All typical values are at VCC = 3.3 V, TA = 25C.

switching characteristics over recommended operating free-air temperature range (unless
otherwise noted) (see Figure 1)

   PARAMETER       FROM                        TO               VCC = 1.8 V  VCC = 2.5 V        VCC = 3.3 V     VCC = 5 V  UNIT
         tpd      (INPUT)                 (OUTPUT)                0.15 V       0.2 V             0.3 V         0.5 V   ns

                   A or B                       Y               MIN MAX       MIN MAX            MIN MAX        MIN MAX

                                                                2.4  8            1 4.4              1 3.8          1 3.2

operating characteristics, TA = 25C

         PARAMETER                        TEST CONDITIONS            VCC = 1.8 V  VCC = 2.5 V      VCC = 3.3 V  VCC = 5 V  UNIT
                                                                          TYP          TYP              TYP         TYP     pF
   Cpd Power dissipation capacitance                f = 10 MHz
                                                                             17           17               17         19

4                                          POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                                                              SN74LVC2G32
                                                                                      DUAL 2INPUT POSITIVEOR GATE

                                                                                                                   SCES201J - APRIL 1999 - REVISED SEPTEMBER 2003

                                 PARAMETER MEASUREMENT INFORMATION

                                                 VLOAD

                                 RL      S1          Open

From Output                                          GND                                            TEST       S1
  Under Test
                             RL                                                                  tPLH/tPHL   Open
                 CL                                                                              tPLZ/tPZL  VLOAD
   (see Note A)                                                                                  tPHZ/tPZH
                                                                                                             GND

                     LOAD CIRCUIT

                                                 INPUTS

                              VCC            VI      tr/tf        VM   VLOAD           CL          RL         V

                         1.8 V 0.15 V  VCC          2 ns      VCC/2  2 VCC        30 pF      1 k        0.15 V
                         2.5 V 0.2 V   VCC          2 ns      VCC/2  2 VCC        30 pF      500        0.15 V
                         3.3 V 0.3 V   3V          2.5 ns     1.5 V                 50 pF      500        0.3 V
                           5 V 0.5 V               2.5 ns     VCC/2     6V          50 pF      500        0.3 V
                                         VCC                           2 VCC

                             tw                                        Timing Input                                                    VI
                                                                          Data Input                        VM

                                                                                                                                       0V

                                                            VI                                   tsu        th

Input                VM                      VM                                                                              VI

                                                                                                 VM                    VM

                                                            0V                                                               0V

              VOLTAGE WAVEFORMS                                                                   VOLTAGE WAVEFORMS
                 PULSE DURATION                                                                  SETUP AND HOLD TIMES

                                                       VI                      Output                                        VI
                                                                              Control                                        0V
Input                    VM              VM                                                      VM         VM
                                                                                           tPZL        VM           tPLZ     VLOAD/2
                                                       0V                      Output                                        VOL
                                                                        Waveform 1                             VOL + V
        tPLH                                       tPHL                S1 at VLOAD
                                                                        (see Note B)
Output                       VM                           VOH
                                                 VM

                                                          VOL

        tPHL                                     tPLH                             tPZH                                 tPHZ
                                                                       Output
                                                       VOH                                                                   VOH
                                                                       Waveform 2                                            0 V
Output                       VM                  VM                      S1 at GND               VM                 VOH - V

                                                       VOL             (see Note B)

                     VOLTAGE WAVEFORMS                                                           VOLTAGE WAVEFORMS
                 PROPAGATION DELAY TIMES
       INVERTING AND NONINVERTING OUTPUTS                                                        ENABLE AND DISABLE TIMES

                                                                                      LOW- AND HIGH-LEVEL ENABLING

NOTES: A. CL includes probe and jig capacitance.
             B. Waveform 1 is for an output with internal conditions such that the output is low except when disabled by the output control.

                  Waveform 2 is for an output with internal conditions such that the output is high except when disabled by the output control.

             C. All input pulses are supplied by generators having the following characteristics: PRR  10 MHz, ZO = 50 .
             D. The outputs are measured one at a time with one transition per measurement.

             E. tPLZ and tPHZ are the same as tdis.
             F. tPZL and tPZH are the same as ten.
             G. tPLH and tPHL are the same as tpd.
             H. All parameters and waveforms are not applicable to all devices.

                                         Figure 1. Load Circuit and Voltage Waveforms

                                                 POST OFFICE BOX 655303 DALLAS, TEXAS 75265                                                    5
DCT (R-PDSO-G8)                                                                                                MECHANICAL DATA

              0,65                                                                                  MPDS049B MAY 1999 REVISED OCTOBER 2002
                       8
                                                                                                PLASTIC SMALL-OUTLINE PACKAGE

                                        0,30  0,13 M
                                        0,15
                                   5

PIN1           2,90 4,25                                                         0,15 NOM
                                   2,70 3,75                                                                  Gage Plane
INDEX AREA
                                                                                                0 8                   0,25
1                               4                                                                                         0,60
                                                                                                                          0,20
                          3,15
                          2,75                                                                                               4188781/C 09/02

                                   1,30 MAX

                                                                               Seating Plane

                                                                                          0,10
           0,10
           0,00

NOTES: A. All linear dimensions are in millimeters.
             B. This drawing is subject to change without notice.
             C. Body dimensions do not include mold flash or protrusion
             D. Falls within JEDEC MO-187 variation DA.

                                    POST OFFICE BOX 655303 DALLAS, TEXAS 75265                                                               1
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