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R5F213MCKNNP#W0

器件型号:R5F213MCKNNP#W0
器件类别:集成电路    嵌入式 - 微控制器   
文件大小:8360.77KB,共8页
厂商名称:Renesas Electronics Corporation
厂商官网:https://www.renesas.com/
标准:  
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器件描述

IC mcu 16bit 128kb flash 40hwqfn

参数

Datasheets:
R8C/3MU,MK Group:
Product Photos:
40-QFN:
Standard Package : 3,000
Category: Integrated Circuits (ICs)
Family: Embedded - Microcontrollers
Series: R8C/3x/3MK
Packaging : Tape & Reel (TR)
Core Processor: R8C
Core Size: 16-Bit
Speed: 20MHz
Connectivity: I²C, LIN, SIO, SSU, UART/USART, USB
Peripherals: POR, PWM, Voltage Detect, WDT
Number of I/O: 30
Program Memory Size: 128KB (128K x 8)
Program Memory Type: FLASH
EEPROM Size: -
RAM Size: 10K x 8
Voltage - Supply (Vcc/Vdd): 1.8 V ~ 5.5 V
Data Converters: A/D 10x10b
Oscillator Type: Internal
Operating Temperature: -20°C ~ 85°C
Package / Case: 40-WFQFN Exposed Pad
Supplier Device Package: 40-HWQFN (6x6)

R5F213MCKNNP#W0器件文档内容

                              Datasheet

R8C/3MU Group, R8C/3MK Group  R01DS0112EJ0110
                                            Rev.1.10
RENESAS MCU
                                       Jun 15, 2011

1. Overview

1.1 Features

    The R8C/3MU Group, R8C/3MK Group of single-chip MCUs incorporates the R8C CPU core, employing
    sophisticated instructions for a high level of efficiency. With 1 Mbyte of address space, and it is capable of
    executing instructions at high speed. In addition, the CPU core boasts a multiplier for high-speed operation
    processing.
    Power consumption is low, and the supported operating modes allow additional power control. These MCUs are
    designed to maximize EMI/EMS performance.
    Integration of many peripheral functions, including multifunction timer and serial interface, reduces the number of
    system components.
    The R8C/3MU Group, R8C/3MK Group has data flash (1 KB 4 blocks) with the background operation (BGO)
    function.

1.1.1 Applications

        Peripherals (USB applicable), audio components, cameras, televisions, household appliances, office equipment,
        communication devices, mobile devices, industrial equipment, and other applications.

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Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                                                  1. Overview

1.1.2 Differences between Groups                                             R8C/3MK Group
                                                                   64 KB/8 KB, 128 KB/10 KB
      Table 1.1 lists the Differences between Groups.              Activation sources: 26
                                                                   Host/peripheral function
Table 1.1 Differences between Groups                               Supported

                             Item               R8C/3MU Group
Memory (ROM/RAM)                      32 KB/4 KB, 64 KB/8 KB
DTC (Data Transfer Controller)        Activation sources: 25
                                      No DTC activation
USB Functions                         by A/D conversion interrupt
A/D Converter                         Peripheral function
                                      None

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R8C/3MU Group, R8C/3MK Group                                                           1. Overview

1.1.3 Specifications

      Tables 1.2 and 1.3 outline the Specifications for R8C/3MU Group, R8C/3MK Group.

Table 1.2 Specifications for R8C/3MU Group, R8C/3MK Group (1)

      Item          Function                                                 Specification
CPU          Central processing  R8C CPU core
             unit                Number of fundamental instructions: 89
                                  Minimum instruction execution time:
Memory       ROM, RAM,
                                     50 ns (f(XIN) = 20 MHz, VCC = 2.7 to 5.5 V)
             Data flash              200 ns (f(XIN) = 5 MHz, VCC = 1.8 to 5.5 V)
                                  Multiplier: 16 bits 16 bits  32 bits
Power Supply Voltage detection    Multiply-accumulate instruction: 16 bits 16 bits + 32 bits  32 bits
                                  Operation mode: Single-chip mode (address space: 1 Mbyte)
Voltage      circuit             Refer to Table 1.4 Product List for R8C/3MU Group, and Table 1.5 Product
                                 List for R8C/3MK Group.
Detection                         Power-on reset
                                  Voltage detection 3 (detection level of voltage detection 0 and voltage
I/O Ports    Programmable I/O     detection 1 selectable)
                                  CMOS I/O ports: 30, selectable pull-up resistor
             ports                High current drive ports: 30
                                  4 circuits: XIN clock oscillation circuit,
Clock        Clock generation
                                                 High-speed on-chip oscillator (with frequency adjustment function),
             circuits                            Low-speed on-chip oscillator
                                                 PLL frequency synthesizer
Interrupts                        Oscillation stop detection: XIN clock oscillation stop detection function
                                  Frequency divider circuit: Dividing selectable 1, 2, 4, 8, and 16
Watchdog Timer                   Low power consumption modes:
                                  Standard operating mode (XIN clock, PLL frequency synthesizer, high-speed
DTC (Data    R8C/3MU Group        on-chip oscillator, low-speed on-chip oscillator), wait mode, stop mode
Transfer     R8C/3MK Group       Interrupt Vectors: 69
Controller)                      External: 9 sources (INT 5, key input 4)
                                  Priority levels: 7 levels
Timer        Timer RA             14 bits 1 (with prescaler)
                                  Reset start selectable
             Timer RB             Low-speed on-chip oscillator for watchdog timer selectable
                                  1 channel
             Timer RC             Activation sources: 25
                                  Transfer modes: 2 (normal mode, repeat mode)
Serial       UART0, UART1,       1 channel
                                  Activation sources: 26
Interface    UART3                Transfer modes: 2 (normal mode, repeat mode)
                                 8 bits 1 (with 8-bit prescaler)
             UART2                 Timer mode (period timer), pulse output mode (output level inverted every
                                   period), event counter mode, pulse width measurement mode, pulse period
Synchronous Serial                 measurement mode
                                 8 bits 1 (with 8-bit prescaler)
Communication Unit (SSU)           Timer mode (period timer), programmable waveform generation mode (PWM
                                   output), programmable one-shot generation mode, programmable wait one-
I2C bus                            shot generation mode
                                 16 bits 1 (with 4 capture/compare registers)
LIN Module                         Timer mode (input capture function, output compare function), PWM mode
                                   (output 3 pins), PWM2 mode (PWM output pin)
                                 Clock synchronous serial I/O/UART 3 channel

                                 Clock synchronous serial I/O, UART, multiprocessor communication function
                                 1 (shared with I2C bus)

                                 1 (shared with SSU)

                                 Hardware LIN: 1 (timer RA, UART0)

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R8C/3MU Group, R8C/3MK Group                                   1. Overview

Table 1.3 Specifications for R8C/3MU Group, R8C/3MK Group (2)

      Item         Function                                                Specification
            R8C/3MU Group
USB                            USB 2.0 specification compliant, Full speed (12 Mbps) supported
Functions                      USB function controller and USB transceiver incorporated
                               5 pipes provided with individual FIFO
            R8C/3MK Group
                                Arbitrary EP numbers can be specified for PIPE4 to 7
A/D Converter (1)               FIFO size (total 448 bytes: DCP (EP0) = 64 bytes, PIPE4 and PIPE5 =
Comparator B
Flash Memory                    128 bytes (64-byte double buffer), PIPE6 and PIPE7 = 64 bytes
                               Supported transfer: DCP = Control transfer IN/OUT, PIPE4 and PIPE5 = Bulk
Operating Frequency/Supply
Voltage                         transfer IN/OUT, PIPE6 and PIPE7 = Interrupt transfer IN/OUT
Current consumption
                               USB 2.0 specification compliant, Full speed (12 Mbps) supported
Operating Ambient Temperature   USB Device Controller (UDC), transceiver for USB2.0 are incorporated, and
Package
                                on-chip USB transceiver
                               5 pipes provided with individual FIFO

                                Arbitrary EP numbers can be specified for PIPE4 to 7
                               FIFO size (total 448 bytes):

                                DCP (EP0) = 64 bytes,
                                PIPE4 and PIPE5 = 128 bytes (64-byte double buffer),
                                PIPE6 and PIPE7 = 64 bytes
                               Supported transfer:
                                DCP = Control transfer IN/OUT, PIPE4 and PIPE5 = Bulk transfer IN/OUT,
                                PIPE6 and PIPE7 = Interrupt transfer IN/OUT
                               When the host controller is selected
                                Automatic scheduling for SOF and packet transmissions
                                Programmable intervals for interrupt transfers

                               10-bit resolution 10 channels, includes sample and hold function, with sweep
                               mode

                               2 circuits

                               Programming and erasure voltage: VCC = 2.7 to 5.5 V
                               Programming and erasure endurance: 10,000 times (data flash)

                                                                                    1,000 times (program ROM)
                               Program security: ROM code protect, ID code check
                               Debug functions: On-chip debug, on-board flash rewrite function
                               Background operation (BGO) function (data flash)

                               f(XIN) = 20 MHz (VCC = 2.7 to 5.5 V)(USB not used)
                               f(XIN) = 5 MHz (VCC = 1.8 to 5.5 V)(USB not used)

                               Typ. 7.0 mA (VCC = 5.0 V, f(XIN) = 20 MHz)
                               Typ. 3.5 mA (VCC = 3.0 V, f(XIN) = 10 MHz)
                               Typ. 4.0 A (VCC = 3.0 V, wait mode)
                               Typ. 2.0 A (VCC = 3.0 V, stop mode)

                               -20 to 85C (N version)

                               40-pin QFN
                                 Package code: PWQN0040KB-B (previous code: 40PJS-B)

Note:
    1. Not available in the R8C/3MU Group.

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R8C/3MU Group, R8C/3MK Group                                                                1. Overview

1.2 Product List

    Tables 1.4 and 1.5 list Product List for Each Group. Figures 1.1 and 1.2 show a Part Number, Memory Size, and
    Package of Each Group.

Table 1.4 Product List for R8C/3MU Group                                       Current of Jun 2011

                          ROM Capacity      RAM
                                          Capacity
          Part No.  Program   Data flash              Package Type                 Remarks
                      ROM                                           N version
R5F213M6UNNP                                        PWQN0040KB-B
R5F213M8UNNP        32 Kbytes 1 Kbyte 4 4 Kbytes  PWQN0040KB-B
R5F213M6UNXXXNP                                     PWQN0040KB-B
R5F213M8UNXXXNP     64 Kbytes 1 Kbyte 4 8 Kbytes  PWQN0040KB-B

                    32 Kbytes 1 Kbyte 4 4 Kbytes                  N version  Factory
                                                                               programming
                    64 Kbytes 1 Kbyte 4 8 Kbytes                             product (1)

Note:
    1. The user ROM is programmed before shipment.

Part No. R 5 F 21 3M 8 U N XXX NP

                                                    Package type:
                                                       NP: PWQN0040KB-B

                                                    ROM number

                                                    Classification
                                                       N: Operating ambient temperature -20C to 85C

                                                    ROM capacity
                                                       6: 32 KB
                                                       8: 64 KB

                                                    R8C/3MU Group

                                                    R8C/3x Series

                                                    Memory type
                                                       F: Flash memory

                                                    Renesas MCU

                                                    Renesas semiconductor

Figure 1.1 Part Number, Memory Size, and Package of R8C/3MU Group

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R8C/3MU Group, R8C/3MK Group                                                    1. Overview

Table 1.5 Product List for R8C/3MK Group                                        Current of Jun 2011

                          ROM Capacity      RAM
                                          Capacity
          Part No.  Program   Data flash               Package Type             Remarks
                      ROM
R5F213M8KNNP                                         PWQN0040KB-B                      Factory
R5F213MCKNNP        64 Kbytes 1 Kbyte 4 8 Kbytes   PWQN0040KB-B    N version         programming
R5F213M8KNXXXNP                                      PWQN0040KB-B    N version         product (1)
R5F213MCKNXXXNP     128Kbytes 1 Kbyte 4 10 Kbytes  PWQN0040KB-B

                    64Kbytes 1 Kbyte 4 8 Kbytes

                    128Kbytes 1 Kbyte 4 10 Kbytes

Note:
    1. The user ROM is programmed before shipment.

Part No. R 5 F 21 3M 8 K N XXX NP

                                                     Package type:
                                                        NP: PWQN0040KB-B

                                                     ROM number

                                                     Classification
                                                        N: Operating ambient temperature -20C to 85C

                                                     ROM capacity
                                                        8: 64 KB
                                                        C: 128 KB

                                                     R8C/3MK Group

                                                     R8C/3x Series

                                                     Memory type
                                                        F: Flash memory

                                                     Renesas MCU

                                                     Renesas semiconductor

Figure 1.2 Part Number, Memory Size, and Package of R8C/3MK Group

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R8C/3MU Group, R8C/3MK Group                                                                                1. Overview

   1.3 Block Diagram

        Figures 1.3 and 1.4 show Block Diagram of Each Group.

6                         8        5                           3          3  2                           3

I/O ports Port P0         Port P1  Port P3  Port P4               Port P6    Port P7  Port P8

Peripheral functions

          Timers                              UART or                      System clock generation
                                   clock synchronous serial I/O                         circuit
Timer RA (8 bits 1)
Timer RB (8 bits 1)                       (8 bits 4)                             XIN-XOUT
Timer RC (16 bits 1)                                                    High-speed on-chip oscillator
                                         I2C bus or SSU                   Low-speed on-chip oscillator
Watchdog timer                              (8 bits 1)                  PLL frequency synthesizer
     (14 bits)
                                          Comparator B                    Low-speed on-chip oscillator
                                                                                for watchdog timer
                                          USB Function
                                      (USB2.0 Full speed)                   Voltage detection circuit

                                             USB FIFO                                    DTC
                                            (448 bytes)
                                                                                    LIN module

                                   R8C CPU core                     SB       Memory
                                                                     USP
                                     R0H R0L                         ISP              ROM (1)
                                     R1H R1L                      INTB                 RAM (2)
                                                                   PC
                                            R2                       FLG              Multiplier
                                            R3

                                              A0
                                              A1
                                              FB

                                                                  Notes:
                                                                  1. ROM size varies with MCU type.
                                                                  2. RAM size varies with MCU type.

Figure 1.3 Block Diagram of R8C/3MU Group

R01DS0112EJ0110 Rev.1.10                                                                                    Page 7 of 88
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R8C/3MU Group, R8C/3MK Group                                                                               1. Overview

6                             8    5              3                      3  2                           3

I/O ports Port P0         Port P1  Port P3  Port P4              Port P6    Port P7  Port P8

Peripheral functions

          Timers                              UART or                     System clock generation
                                   clock synchronous serial I/O                        circuit
Timer RA (8 bits 1)
Timer RB (8 bits 1)                       (8 bits 4)                            XIN-XOUT
Timer RC (16 bits 1)                                                   High-speed on-chip oscillator
                                         I2C bus or SSU                  Low-speed on-chip oscillator
    Watchdog timer                          (8 bits 1)                 PLL frequency synthesizer
         (14 bits)
                                          Comparator B                   Low-speed on-chip oscillator
      A/D converter                                                            for watchdog timer
(10 bits 10 channels)                   USB Function
                                      (USB2.0 Full speed)                  Voltage detection circuit

                                             USB FIFO                                   DTC
                                            (448 bytes)
                                                                                   LIN module

                                   R8C CPU core                    SB       Memory
                                                                    USP
                                     R0H R0L                        ISP              ROM (1)
                                     R1H R1L                     INTB                 RAM (2)
                                                                  PC
                                            R2                      FLG              Multiplier
                                            R3

                                              A0
                                              A1
                                              FB

                                                                 Notes:
                                                                      1. ROM size varies with MCU type.
                                                                      2. RAM size varies with MCU type.

Figure 1.4 Block Diagram of R8C/3MK Group

R01DS0112EJ0110 Rev.1.10                                                                                   Page 8 of 88
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R8C/3MU Group, R8C/3MK Group                                                                                                                                                                                                                                       1. Overview

1.4 Pin Assignment

    Figures 1.5 and 1.6 show Pin Assignment (Top View) of Each Group. Table 1.6 outlines the Pin Name Information
    by Pin Number.

                                           P1_2/KI2(/TRCIOB)  P1_3/KI3/TRBO(/TRCIOC)  P1_4(/TXD0/TRCCLK)  P1_5(/INT1/RXD0/TRAIO)  P1_6/IVREF1(/CLK0)  P1_7/IVCMP1/INT1(/TRAIO)  P4_5/INT0(/RXD2)  P6_5/INT4(/CLK2/CLK1)  P6_6/INT2(/TXD2)  P6_7/INT3(/TRCIOD)

                                           30                 29                      28                  27                      26                  25                        24                23                     22                21

   P1_1/KI1(/TRCIOA/TRCTRG)            31                                                                                                                                                                                                                      20  USB_DPUPE
                P1_0/KI0(/TRCIOD)                                                                                                                                                                                                                                  USB_VCC
                      P0_7(/TRCIOC)    32                                                                                                                                                                                                                      19  USB_DP
                      P0_4(/TRCIOB)                                                                                                                                                                                                                                USB_DM
                                       33                                                                                                                                                                                                                      18  USB_VBUS
             P0_3(/CLK1/TRCIOB)                                                                                                                                                                                                                                    P7_6
P0_2(/RXD1/TRCIOA/TRCTRG)              34 R8C/3MU Group 17                                                                                                                                                                                                         P7_7
P0_1(/TXD1/TRCIOA/TRCTRG)                                                                                                                                                                                                                                          P3_3/IVCMP3/SCS(/CTS2/RTS2/TRCCLK)
                                       35                                                                                                                                                                                                                      16  P3_4/IVREF3/SSI(/TRCIOC)
        P0_0(/TRCIOA/TRCTRG)                                                                                                                                                                                                                                       P3_5/SCL/SSCK(/TRCIOD)
                         P8_3(/RXD3)   36                                                                                                                                                                                                                      15
                          P8_2(/TXD3)
                                       37                     PWQN0040KB-B (40PJS-B)                                                                                                                                                                           14
                                                                         (Top view)

                                       38                                                                                                                                                                                                                      13

                                       39                                                                                                                                                                                                                      12

                                       40                                                                                                                                                                                                                      11

                                           1                  2                       3                   4                       5                   6                         7                 8                      9                 10

                                           P8_1(/CLK3)        P3_0(/TRAO)             NC (3)              MODE                    RESET               P4_7/XOUT                 VSS               P4_6/XIN               VCC               P3_7/SSO/SDA/TRAO

     Notes:
     1. Can be assigned to the pin in parentheses by a program.
     2. Confirm the pin 1 position on the package by referring to the package dimensions.
     3. NC: Non-Connection. Connect to VCC.

Figure 1.5 Pin Assignment (Top View) of R8C/3MU Group

R01DS0112EJ0110 Rev.1.10                                                                                                                                                                                                                                           Page 9 of 88
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R8C/3MU Group, R8C/3MK Group                                                                                                                                                                                                                                                             1. Overview

                                                 P1_2/KI2/AN10(/TRCIOB)  P1_3/KI3/AN11/TRBO(/TRCIOC)  P1_4(/TXD0/TRCCLK)  P1_5(/INT1/RXD0/TRAIO)  P1_6/IVREF1(/CLK0)  P1_7/IVCMP1/INT1(/TRAIO)  P4_5/ADTRG/INT0(/RXD2)  P6_5/INT4(/CLK2/CLK1)  P6_6/INT2(/TXD2)  P6_7/INT3(/TRCIOD)

                                                 30                      29                           28                  27                      26                  25                        24                      23                     22                21

   P1_1/AN9/KI1(/TRCIOA/TRCTRG)              31                                                                                                                                                                                                                                      20  USB_DPUPE
                P1_0/AN8/KI0(/TRCIOD)                                                                                                                                                                                                                                                    USB_VCC
                      P0_7/AN0(/TRCIOC)      32                                                                                                                                                                                                                                      19  USB_DP
                      P0_4/AN3(/TRCIOB)                                                                                                                                                                                                                                                  USB_DM
                                             33                                                                                                                                                                                                                                      18  USB_VBUS
             P0_3/AN4(/CLK1/TRCIOB)                                                                                                                                                                                                                                                      P7_6/USB_OVRCURA
P0_2/AN5(/RXD1/TRCIOA/TRCTRG)                34 R8C/3MK Group 17                                                                                                                                                                                                                         P7_7/USB_VBUSEN
P0_1/AN6(/TXD1/TRCIOA/TRCTRG)                                                                                                                                                                                                                                                            P3_3/IVCMP3/SCS(/CTS2/RTS2/TRCCLK)
                                             35                                                                                                                                                                                                                                      16  P3_4/IVREF3/SSI(/TRCIOC)
        P0_0/AN7(/TRCIOA/TRCTRG)                                                                                                                                                                                                                                                         P3_5/SCL/SSCK(/TRCIOD)
                                P8_3(/RXD3)  36                                                                                                                                                                                                                                      15
                                P8_2(/TXD3)
                                             37                          PWQN0040KB-B (40PJS-B)                                                                                                                                                                                      14
                                                                                    (Top view)

                                             38                                                                                                                                                                                                                                      13

                                             39                                                                                                                                                                                                                                      12

                                             40                                                                                                                                                                                                                                      11

                                                 1                       2                            3                   4                       5                   6                         7                       8                      9                 10

                                                 P8_1(/CLK3)             P3_0(/TRAO)                  VREF                MODE                    RESET               P4_7/XOUT                 VSS/AVSS                P4_6/XIN               VCC/AVCC          P3_7/SSO/SDA/TRAO

   Notes:
   1. Can be assigned to the pin in parentheses by a program.
   2. Confirm the pin 1 position on the package by referring to the package dimensions.

Figure 1.6 Pin Assignment (Top View) of R8C/3MK Group

R01DS0112EJ0110 Rev.1.10                                                                                                                                                                                                                                                                 Page 10 of 88
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R8C/3MU Group, R8C/3MK Group                                                                   1. Overview

Table 1.6 Pin Name Information by Pin Number

   Pin                                               I/O Pin Functions for Peripheral Modules
Number
        Control Pin  Port                  Timer       Serial    SSU  I2C  USB                 A/D Converter,
    1                          Interrupt  (TRAO)     Interface        bus                      Comparator B
    2     MODE
    3     RESET      P8_1                            (CLK3)                                        VREF (2)
    4      XOUT      P3_0
    5                                                                                              IVREF3
    6       VSS/     P4_7
         AVSS (2)
    7                P4_6
            XIN
    8      VCC/      P3_7
         AVCC (2)    P3_5
    9                P3_4
                                            TRAO                 SSO SDA
   10                                     (TRCIOD)               SSCK SCL
   11                                     (TRCIOC)
   12                                                             SSI

13                   P3_3                 (TRCCLK) (CTS2/        SCS                           IVCMP3
                                                     RTS2)

14                   P7_7                                                  USB_VBUSEN (2)
                                                                           USB_OVRCURA (2)
15                   P7_6
                                                                                USB_VBUS
16                                                                               USB_DM
                                                                                  USB_DP
17                                                                              USB_VCC

18                                                                            USB_DPUPE

19

20

21                   P6_7 INT3 (TRCIOD)

22                   P6_6 INT2                       (TXD2)

23                   P6_5 INT4                       (CLK2/
                                                     CLK1)

24                   P4_5 INT0                       (RXD2)                                    ADTRG (2)
                                                                                                 IVCMP1
25                   P1_7 INT1 (TRAIO)                                                           IVREF1

26                   P1_6                            (CLK0)                                     AN11 (2)
                                                                                                AN10 (2)
27                   P1_5 (INT1) (TRAIO)             (RXD0)                                      AN9 (2)
                                                                                                 AN8 (2)
28                   P1_4                 (TRCCLK) (TXD0)                                        AN0 (2)
                                                                                                 AN3 (2)
29                   P1_3     KI3            TRBO                                                AN4 (2)
                                          (/TRCIOC)                                              AN5 (2)
                                                                                                 AN6 (2)
30                   P1_2 KI2 (TRCIOB)
                                                                                                 AN7 (2)
31                   P1_1 KI1             (TRCIOA/
                                          TRCTRG)

32                   P1_0 KI0 (TRCIOD)

33                   P0_7                 (TRCIOC)

34                   P0_4                 (TRCIOB)

35                   P0_3                 (TRCIOB) (CLK1)

36                   P0_2                 (TRCIOA/   (RXD1)
                                          TRCTRG)

37                   P0_1                 (TRCIOA/   (TXD1)
                                          TRCTRG)

38                   P0_0                 (TRCIOA/
                                          TRCTRG)

39                   P8_3                            (RXD3)

40                   P8_2                            (TXD3)

Notes:
     1. Can be assigned to the pin in parentheses by a program.
     2. This pin is not available in the R8C/3MU Group.

R01DS0112EJ0110 Rev.1.10                                                                       Page 11 of 88
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R8C/3MU Group, R8C/3MK Group                                                                     1. Overview

1.5 Pin Functions

    Tables 1.7 and 1.8 list Pin Functions.

Table 1.7 Pin Functions (1)

          Item             Pin Name         I/O Type                      Description

Power supply input VCC, VSS                 -- Apply 1.8 to 5.5 V to the VCC pin.
                                                     Apply 0 V to the VSS pin.

Analog power         AVCC, AVSS (2)         -- Power supply for the A/D converter.
supply input                                         Connect a capacitor between AVCC and AVSS.
Reset input          RESET
                     MODE                   I Input "L" on this pin resets the MCU.
MODE                 XIN
XIN clock input      XOUT                    I Connect this pin to VCC via a resistor.
XIN clock output
                                             I These pins are provided for XIN clock generation circuit I/O.
INT interrupt input  INT0 to INT4           I/O Connect a ceramic resonator or a crystal oscillator between
Key input interrupt
Timer RA             KI0 to KI3                      the XIN and XOUT pins. (1)
Timer RB             TRAIO                           To use an external clock, input it to the XOUT pin and leave
Timer RC             TRAO                            the XIN pin open.
                     TRBO
Serial interface     TRCCLK                  I INT interrupt input pins.
                     TRCTRG
                     TRCIOA, TRCIOB,         I Key input interrupt input pins.
                     TRCIOC, TRCIOD
                     CLK0, CLK1, CLK2,      I/O Timer RA I/O pin.
                     CLK3                   O Timer RA output pin.
                     RXD0, RXD1, RXD2,      O Timer RB output pin.
                     RXD3                    I External clock input pin.
                     TXD0, TXD1, TXD2,       I External trigger input pin.
                     TXD3                   I/O Timer RC I/O pins.

                                            I/O Transfer clock I/O pins.

                                            I Serial data input pins.

                                            O Serial data output pins.

                     CTS2                    I Transmission control input pin.
                                            O Reception control output pin.
SSU                  RTS2                   I/O Data I/O pin.
                     SSI                    I/O Chip-select signal I/O pin.
                                            I/O Clock I/O pin.
I2C bus              SCS                    I/O Data I/O pin.
                     SSCK                   I/O Clock I/O pin.
                     SSO                    I/O Data I/O pin.
                     SCL
                     SDA

I: Input        O: Output    I/O: Input and output

Notes:

1. Refer to the oscillator manufacturer for oscillation characteristics.

2. This pin is not available in the R8C/3MU Group.

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Table 1.8 Pin Functions (2)

         Item              Pin Name      I/O Type                   Description
USB                USB_DP/USB_DM
                   USB_VBUS              I/O D+/D- I/O pin of the USB on-chip transceiver.
Reference voltage                                 Connect this pin to the D+/D- pin of the USB bus.
input              USB_VBUSEN (1)
A/D converter      USB_OVRCURA (1)       I USB cable connection monitor pin.
                                                 Connect this pin to VBUS of the USB bus. Whether VBUS is
                   USB_DPUPE                     connected or disconnected can be detected during operation
                   USB_VCC                       as a function.
                   VREF (1)
                   AN0, AN3 to AN11 (1)  O VBUS (5 V) supply enable signal for external power supply
                                                  chip.

                                         I External overcurrent detection signal should be connected to
                                                 this pin. VBUS comparator signal should be connected to this
                                                 pin when the USB host power supply chip is connected.

                                         O 1.5 k pull-up resistor control signal for USB D+ signal when
                                                  operating as a function controller.

                                         I/O USB power supply pin.

                                         I Reference voltage input pin to A/D converter.

                                         I Analog input pins to A/D converter.

Comparator B       ADTRG (1)             I AD external trigger input pin.
                   IVCMP1, IVCMP3        I Comparator B analog voltage input pins.

I/O port           IVREF1, IVREF3         I Comparator B reference voltage input pins.

                   P0_0 to P0_4, P0_7,   I/O CMOS I/O ports. Each port has an I/O select direction
                   P1_0 to P1_7,                  register, allowing each pin in the port to be directed for input
                   P3_0, P3_3 to P3_5,            or output individually.
                   P3_7,                          Any port set to input can be set to use a pull-up resistor or not
                   P4_5 to P4_7,                  by a program.
                   P6_5 to P6_7,
                   P7_6, P7_7,
                   P8_1 to P8_3

I: Input  O: Output       I/O: Input and output

Note:
    1. This pin is not available in the R8C/3MU Group.

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2. Central Processing Unit (CPU)

  Figure 2.1 shows the CPU Registers. The CPU contains 13 registers. R0, R1, R2, R3, A0, A1, and FB configure a
  register bank. There are two sets of register bank.

b31                              b15                                  b8b7   b0

                     R2          R0H (high-order of R0) R0L (low-order of R0)
                     R3
                                 R1H (high-order of R1) R1L (low-order of R1)
                                                                                                                  Data registers (1)
                                                     R2
                                                     R3                                                          Address registers (1)
                                                     A0                                                          Frame base register (1)
                                                     A1
                                                     FB

                          b19    b15                                         b0

                          INTBH                                       INTBL                                      Interrupt table register
                                                                                                                 Program counter
                          The 4 high order bits of INTB are INTBH and
                          the 16 low order bits of INTB are INTBL.

                          b19                                                b0

                                                               PC

                                 b15                                         b0

                                                                      USP                                        User stack pointer

                                                                      ISP                                        Interrupt stack pointer

                                                                      SB                                         Static base register

                                                          b15                                                b0  Flag register

                         b15                                          FLG                                        Carry flag
                                                                                                                 Debug flag
                                IPL                            b8 b7         b0                                  Zero flag
                                                                                                                 Sign flag
                                                               U I OB S ZDC                                      Register bank select flag
                                                                                                                 Overflow flag
                                                                                                                 Interrupt enable flag
                                                                                                                 Stack pointer select flag
                                                                                                                 Reserved bit
                                                                                                                 Processor interrupt priority level
                                                                                                                 Reserved bit

                  Note:
                       1. These registers comprise a register bank. There are two register banks.

Figure 2.1 CPU Registers

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2.1 Data Registers (R0, R1, R2, and R3)

    R0 is a 16-bit register for transfer, arithmetic, and logic operations. The same applies to R1 to R3. R0 can be split
    into high-order bits (R0H) and low-order bits (R0L) to be used separately as 8-bit data registers. R1H and R1L are
    analogous to R0H and R0L. R2 can be combined with R0 and used as a 32-bit data register (R2R0). R3R1 is
    analogous to R2R0.

2.2 Address Registers (A0 and A1)

    A0 is a 16-bit register for address register indirect addressing and address register relative addressing. It is also
    used for transfer, arithmetic, and logic operations. A1 is analogous to A0. A1 can be combined with A0 and as a 32-
    bit address register (A1A0).

2.3 Frame Base Register (FB)

    FB is a 16-bit register for FB relative addressing.

2.4 Interrupt Table Register (INTB)

    INTB is a 20-bit register that indicates the starting address of an interrupt vector table.

2.5 Program Counter (PC)

    PC is 20 bits wide and indicates the address of the next instruction to be executed.

2.6 User Stack Pointer (USP) and Interrupt Stack Pointer (ISP)

    The stack pointers (SP), USP and ISP, are each 16 bits wide. The U flag of FLG is used to switch between
    USP and ISP.

2.7 Static Base Register (SB)

    SB is a 16-bit register for SB relative addressing.

2.8 Flag Register (FLG)

    FLG is an 11-bit register indicating the CPU state.

2.8.1 Carry Flag (C)

        The C flag retains carry, borrow, or shift-out bits that have been generated by the arithmetic and logic unit.

2.8.2 Debug Flag (D)

        The D flag is for debugging only. Set it to 0.

2.8.3 Zero Flag (Z)

        The Z flag is set to 1 when an arithmetic operation results in 0; otherwise to 0.

2.8.4 Sign Flag (S)

        The S flag is set to 1 when an arithmetic operation results in a negative value; otherwise to 0.

2.8.5 Register Bank Select Flag (B)

        Register bank 0 is selected when the B flag is 0. Register bank 1 is selected when this flag is set to 1.

2.8.6 Overflow Flag (O)

        The O flag is set to 1 when an operation results in an overflow; otherwise to 0.

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2.8.7 Interrupt Enable Flag (I)

      The I flag enables maskable interrupts.
      Interrupts are disabled when the I flag is set to 0, and are enabled when the I flag is set to 1. The I flag is set to 0
      when an interrupt request is acknowledged.

2.8.8 Stack Pointer Select Flag (U)

      ISP is selected when the U flag is set to 0; USP is selected when the U flag is set to 1.
      The U flag is set to 0 when a hardware interrupt request is acknowledged or the INT instruction of software
      interrupt numbers 0 to 31 is executed.

2.8.9 Processor Interrupt Priority Level (IPL)

      IPL is 3 bits wide and assigns processor interrupt priority levels from level 0 to level 7.
      If a requested interrupt has higher priority than IPL, the interrupt is enabled.

2.8.10 Reserved Bit

      If necessary, set to 0. When read, the content is undefined.

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3. Memory

  3.1 R8C/3MU Group

      Figure 3.2 is a Memory Map of R8C/3MU Group. The R8C/3MU Group has a 1-Mbyte address space from
      addresses 00000h to FFFFFh. For example, a 64-Kbyte internal ROM area is allocated addresses 04000h to 13FFFh.
      The fixed interrupt vector table is allocated addresses 0FFDCh to 0FFFFh. The starting address of each interrupt
      routine is stored here.
      The internal ROM (data flash) is allocated addresses 03000h to 03FFFh.
      The internal RAM is allocated higher addresses, beginning with address 00400h. For example, a 8-Kbyte internal
      RAM area is allocated addresses 00400h to 023FFh. The internal RAM is used not only for data storage but also as
      a stack area when a subroutine is called or when an interrupt request is acknowledged.
      Special function registers (SFRs) are allocated addresses 00000h to 002FFh and 02C00h to 02FFFh (the SFR areas
      for the DTC and other modules). Peripheral function control registers are allocated here. All unallocated spaces
      within the SFRs are reserved and cannot be accessed by users.

00000h              SFR
002FFh
        (Refer to 4. Special Function
               Registers (SFRs))

00400h

        Internal RAM

0XXXXh

02C00h            SFR (2)              0FFDCh                          Undefined instruction
                                       0FFFFh                                   Overflow
02FFFh  (Refer to 4. Special Function
03000h         Registers (SFRs))                                           BRK instruction
                                                                           Address match
03FFFh        Internal ROM
             (data flash) (1)                                                 Single step
                                               Watchdog timer, oscillation stop detection, voltage monitor
0YYYYh   Internal ROM
0FFFFh  (program ROM)                                                       Address break
                                                                              (Reserved)
                                                                                  Reset

         Internal ROM
        (program ROM)

ZZZZZh

FFFFFh

Notes:
    1. The data flash indicates block A (1 Kbyte), block B (1 Kbyte), block C (1 Kbyte), and block D (1 Kbyte).
    2. The SFR areas for the DTC and other modules are allocated to addresses 02C00h to 02FFFh.
    3. The blank areas are reserved and cannot be accessed by users.

   Part Number                             Internal ROM                     Internal RAM
                                       Address 0YYYYh Address ZZZZZh
R5F213M6UNNP                 Size                                     Size      Address 0XXXXh
R5F213M6UNXXXNP           32 Kbytes          08000h
R5F213M8UNNP              64 Kbytes                                   4 Kbytes  013FFh
R5F213M8UNXXXNP
                                       04000h  13FFFh                 8 Kbytes  023FFh

Figure 3.1 Memory Map of R8C/3MU Group

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3.2 R8C/3MK Group

    Figure 3.2 is a Memory Map of R8C/3MK Group. The R8C/3MK Group has a 1-Mbyte address space from
    addresses 00000h to FFFFFh. A 64-Kbyte internal ROM area is allocated addresses 04000h to 13FFFh.
    The fixed interrupt vector table is allocated addresses 0FFDCh to 0FFFFh. The starting address of each interrupt
    routine is stored here.
    The internal ROM (data flash) is allocated addresses 03000h to 03FFFh.
    The internal RAM is allocated higher addresses, beginning with address 00400h. For example, a 8-Kbyte internal
    RAM area is allocated addresses 00400h to 023FFh. The internal RAM is used not only for data storage but also as
    a stack area when a subroutine is called or when an interrupt request is acknowledged.
    Special function registers (SFRs) are allocated addresses 00000h to 002FFh and 02C00h to 02FFFh (the SFR areas
    for the DTC and other modules). Peripheral function control registers are allocated here. All unallocated spaces
    within the SFRs are reserved and cannot be accessed by users.

00000h              SFR
002FFh
        (Refer to 4. Special Function
               Registers (SFRs))

00400h

        Internal RAM

0XXXXh

02C00h            SFR (2)              0FFDCh                          Undefined instruction
                                       0FFFFh                                   Overflow
02FFFh  (Refer to 4. Special Function
03000h         Registers (SFRs))                                           BRK instruction
                                                                           Address match
03FFFh        Internal ROM
             (data flash) (1)                                                 Single step
                                               Watchdog timer, oscillation stop detection, voltage monitor
0YYYYh   Internal ROM
0FFFFh  (program ROM)                                                       Address break
                                                                              (Reserved)
                                                                                  Reset

         Internal ROM
        (program ROM)

ZZZZZh

FFFFFh

Notes:
    1. The data flash indicates block A (1 Kbyte), block B (1 Kbyte), block C (1 Kbyte), and block D (1 Kbyte).
    2. The SFR areas for the DTC and other modules are allocated to addresses 02C00h to 02FFFh.
    3. The blank areas are reserved and cannot be accessed by users.

   Part Number                             Internal ROM                     Internal RAM
                                       Address 0YYYYh Address ZZZZZh
R5F213M8KNNP                  Size                                    Size       Address 0XXXXh
R5F213M8KNXXXNP           64 Kbytes
R5F213MCKNNP                           04000h  13FFFh                 8 Kbytes   023FFh
R5F213MCKNXXXNP           128 Kbytes
                                       04000h  23FFFh                 10 Kbytes  02BFFh

Figure 3.2 Memory Map of R8C/3MK Group

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Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                          4. Special Function Registers (SFRs)

4. Special Function Registers (SFRs)

  An SFR (special function register) is a control register for a peripheral function. Tables 4.1 to 4.15 list the special
  function registers. Table 4.16 lists the ID Code Areas and Option Function Select Area.

Table 4.1 SFR Information (1) (1)

Address                                                     Register        Symbol  After Reset
0000h
0001h   Processor Mode Register 0                                    PM0           00h
0002h   Processor Mode Register 1                                    PM1           00h
0003h   System Clock Control Register 0                              CM0           00101000b
0004h   System Clock Control Register 1                              CM1           00100000b
0005h   Module Standby Control Register                              MSTCR         00h
0006h   System Clock Control Register 3                              CM3           00h
0007h   Protect Register                                             PRCR          00h
0008h   Reset Source Determination Register                          RSTFR         0XXXXXXXb (2)
0009h   Oscillation Stop Detection Register                                        00000100b
000Ah   Watchdog Timer Reset Register                                OCD           XXh
000Bh   Watchdog Timer Start Register                                WDTR          XXh
         Watchdog Timer Control Register                              WDTS          00111111b
000Ch                                                                WDTC
000Dh   High-Speed On-Chip Oscillator Control Register 7
000Eh                                                                FRA7          When shipping
000Fh   Count Source Protection Mode Register
0010h                                                                CSPR          00h
0011h                                                                              10000000b (3)
0012h
0013h
0014h
0015h
0016h
0017h
0018h
0019h
001Ah
001Bh
001Ch

001Dh    High-Speed On-Chip Oscillator Control Register 0             FRA0          00h
001Eh    High-Speed On-Chip Oscillator Control Register 1             FRA1          When shipping
001Fh    High-Speed On-Chip Oscillator Control Register 2             FRA2          00h
0020h    On-Chip Reference Voltage Control Register                   OCVREFCR      00h
0021h
0022h    Clock Prescaler Reset Flag                                   CPSRF         00h
0023h    High-Speed On-Chip Oscillator Control Register 4             FRA4          When shipping
0024h    High-Speed On-Chip Oscillator Control Register 5             FRA5          When shipping
0025h    High-Speed On-Chip Oscillator Control Register 6             FRA6          When shipping
0026h
0027h    High-Speed On-Chip Oscillator Control Register 3             FRA3          When shipping
0028h    Voltage Monitor Circuit Control Register                     CMPA          00h
0029h    Voltage Monitor Circuit Edge Select Register                 VCAC          00h
002Ah
002Bh    Voltage Detect Register 1                                    VCA1          00001000b
002Ch    Voltage Detect Register 2                                    VCA2          00h (4)
002Dh                                                                               00100000b (5)
002Eh                                                                 VD1LS
002Fh                                                                               00000111b
0030h                                                                 VW0C
0031h                                                                               1100X010b (4)
0032h                                                                 VW1C          1100X011b (5)
0033h                                                                               10001010b
0034h

0035h    Voltage Detection 1 Level Select Register
0036h    Voltage Monitor 0 Circuit Control Register
0037h
0038h

0039h Voltage Monitor 1 Circuit Control Register

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. The CWR bit in the RSTFR register is set to 0 after power-on and voltage monitor 0 reset. Hardware reset, software reset, or watchdog timer

          reset does not affect this bit.
      3. The CSPROINI bit in the OFS register is set to 0.
      4. The LVDAS bit in the OFS register is set to 1.
      5. The LVDAS bit in the OFS register is set to 0.

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Table 4.2 SFR Information (2) (1)

Address                                                     Register                     Symbol           After Reset
003Ah   Voltage Monitor 2 Circuit Control Register                             VW2C             10000010b
003Bh
003Ch   Flash Memory Ready Interrupt Control Register                          FMRDYIC          XXXXX000b
003Dh
003Eh   INT4 Interrupt Control Register                                        INT4IC           XX00X000b
003Fh   Timer RC Interrupt Control Register                                    TRCIC            XXXXX000b
0040h   USB RESUME Interrupt Control Register
0041h   UART2 Transmit Interrupt Control Register                              USBRSMIC         XXXXX000b
0042h   UART2 Receive Interrupt Control Register
0043h   Key Input Interrupt Control Register                                   S2TIC            XXXXX000b
0044h   A/D Conversion Interrupt Control Register (3)                          S2RIC            XXXXX000b
0045h   SSU Interrupt Control Register/IIC bus Interrupt Control Register (2)  KUPIC            XXXXX000b
0046h   UART0 Transmit Interrupt Control Register                              ADIC             XXXXX000b
0047h   UART0 Receive Interrupt Control Register                               SSUIC/IICIC      XXXXX000b
0048h   UART1 Transmit Interrupt Control Register
0049h   UART1 Receive Interrupt Control Register                               S0TIC            XXXXX000b
004Ah   INT2 Interrupt Control Register                                        S0RIC            XXXXX000b
004Bh   Timer RA Interrupt Control Register                                    S1TIC            XXXXX000b
004Ch   Timer RB Interrupt Control Register                                    S1RIC            XXXXX000b
004Dh   INT1 Interrupt Control Register                                        INT2IC           XX00X000b
004Eh   INT3 Interrupt Control Register                                        TRAIC            XXXXX000b

004Fh   INT0 Interrupt Control Register                                        TRBIC            XXXXX000b
         UART2 Bus Collision Detection Interrupt Control Register               INT1IC           XX00X000b
0050h                                                                          INT3IC           XX00X000b
0051h   USB INT Interrupt Control Register
0052h   UART3 Transmit Interrupt Control Register                              INT0IC           XX00X000b
0053h   UART3 Receive Interrupt Control Register                               U2BCNIC          XXXXX000b
0054h
0055h   Voltage Monitor 1 Interrupt Control Register                           USBINTIC         XXXXX000b
0056h   Voltage Monitor 2 Interrupt Control Register                           S3RIC            XXXXX000b
0057h                                                                          S3TIC            XXXXX000b
0058h
0059h                                                                          VCMP1IC          XXXXX000b
005Ah                                                                          VCMP2IC          XXXXX000b
005Bh
005Ch
005Dh
005Eh
005Fh
0060h
0061h
0062h
0063h
0064h
0065h
0066h
0067h
0068h
0069h
006Ah
006Bh
006Ch
006Dh
006Eh
006Fh
0070h
0071h
0072h
0073h
0074h
0075h
0076h
0077h
0078h
0079h
007Ah
007Bh
007Ch
007Dh
007Eh
007Fh

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. Selectable by the IICSEL bit in the SSUIICSR register.
      3. This register is not available in the R8C/3MU Group.

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Table 4.3 SFR Information (3) (1)

Address                                    Register                              Symbol           After Reset
0080h                                                                  DTCTL            00h
0081h   DTC Activation Control Register
0082h
0083h   DTC Activation Enable Register 0                               DTCEN0           00h
0084h   DTC Activation Enable Register 1
0085h   DTC Activation Enable Register 2                               DTCEN1           00h
0086h   DTC Activation Enable Register 3
0087h                                                                  DTCEN2           00h
0088h   DTC Activation Enable Register 6
0089h                                                                  DTCEN3           00h
008Ah
008Bh                                                                  DTCEN6           00h
008Ch
008Dh   UART0 Transmit/Receive Mode Register                           U0MR             00h
008Eh   UART0 Bit Rate Register                                        U0BRG            XXh
008Fh   UART0 Transmit Buffer Register                                 U0TB             XXh
0090h   UART0 Transmit/Receive Control Register 0                                       XXh
0091h   UART0 Transmit/Receive Control Register 1                      U0C0             00001000b
0092h   UART0 Receive Buffer Register                                  U0C1             00000010b
0093h   UART2 Transmit/Receive Mode Register                           U0RB             XXh
0094h   UART2 Bit Rate Register                                                         XXh
0095h   UART2 Transmit Buffer Register                                 U2MR             00h
0096h   UART2 Transmit/Receive Control Register 0                      U2BRG            XXh
0097h   UART2 Transmit/Receive Control Register 1                      U2TB             XXh
0098h   UART2 Receive Buffer Register                                                   XXh
0099h   UART2 Digital Filter Function Select Register                  U2C0             00001000b
009Ah                                                                  U2C1             00000010b
009Bh   UART2 Special Mode Register 5                                  U2RB             XXh
009Ch   UART2 Special Mode Register 3                                                   XXh
009Dh                                                                  URXDF            00h
009Eh
009Fh                                                                  U2SMR5           00h
00A0h                                                                  U2SMR3           000X0X0Xb
00A1h
00A2h
00A3h
00A4h
00A5h
00A6h
00A7h
00A8h
00A9h
00AAh
00ABh
00ACh
00ADh
00AEh
00AFh
00B0h
00B1h
00B2h
00B3h
00B4h
00B5h
00B6h
00B7h
00B8h
00B9h
00BAh
00BBh
00BCh
00BDh
00BEh
00BFh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

R01DS0112EJ0110 Rev.1.10                                                                      Page 21 of 88
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R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.4 SFR Information (4) (1)

Address                                 Register                                 Symbol           After Reset
00C0h                                                                  AD0              XXh
00C1h   A/D Register 0 (2)                                             AD1              000000XXb
00C2h   A/D Register 1 (2)                                             AD2              XXh
00C3h   A/D Register 2 (2)                                             AD3              000000XXb
00C4h   A/D Register 3 (2)                                             AD4              XXh
00C5h   A/D Register 4 (2)                                             AD5              000000XXb
00C6h   A/D Register 5 (2)                                             AD6              XXh
00C7h   A/D Register 6 (2)                                             AD7              000000XXb
00C8h   A/D Register 7 (2)                                                              XXh
00C9h                                                                                   000000XXb
00CAh    A/D Mode Register (2)                                                           XXh
00CBh    A/D Input Select Register (2)                                                   000000XXb
00CCh    A/D Control Register 0 (2)                                                      XXh
00CDh    A/D Control Register 1 (2)                                                      000000XXb
00CEh                                                                                    XXh
00CFh   Port P0 Register                                                                000000XXb
00D0h   Port P1 Register
00D1h   Port P0 Direction Register                                     ADMOD            00h
00D2h   Port P1 Direction Register                                     ADINSEL          11000000b
00D3h   Port P3 Register                                               ADCON0           00h
00D4h   Port P3 Direction Register                                     ADCON1           00h
         Port P4 Register
00D5h   Port P4 Direction Register                                     P0               XXh
         Port P6 Register
00D6h   Port P7 Register                                               P1               XXh
         Port P6 Direction Register
00D7h   Port P7 Direction Register                                     PD0              00h
         Port P8 Register
00D8h   Port P8 Direction Register                                     PD1              00h
00D9h
00DAh                                                                   P3               XXh
00DBh
00DCh                                                                   PD3              00h
00DDh
00DEh                                                                   P4               XXh
00DFh
00E0h                                                                  PD4              00h
00E1h
00E2h                                                                  P6               XXh
00E3h
00E4h                                                                  P7               XXh
00E5h
00E6h                                                                  PD6              00h
00E7h
00E8h                                                                  PD7              00h
00E9h
00EAh                                                                  P8               XXh
00EBh
00ECh                                                                   PD8              00h
00EDh
00EEh
00EFh
00F0h
00F1h
00F2h
00F3h
00F4h
00F5h
00F6h
00F7h
00F8h
00F9h
00FAh
00FBh
00FCh
00FDh
00FEh
00FFh

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. This register is not available in the R8C/3MU Group.

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Table 4.5 SFR Information (5) (1)

Address                                                     Register             Symbol           After Reset
0100h   Timer RA Control Register                                      TRACR            00h
0101h   Timer RA I/O Control Register                                  TRAIOC           00h
0102h   Timer RA Mode Register                                         TRAMR            00h
0103h   Timer RA Prescaler Register                                    TRAPRE           FFh
0104h   Timer RA Register                                              TRA              FFh
0105h   LIN Control Register 2                                         LINCR2           00h
0106h   LIN Control Register                                           LINCR            00h
0107h   LIN Status Register                                            LINST            00h
0108h   Timer RB Control Register                                      TRBCR            00h
0109h   Timer RB One-Shot Control Register                             TRBOCR           00h
010Ah   Timer RB I/O Control Register                                  TRBIOC           00h
010Bh   Timer RB Mode Register                                         TRBMR            00h
010Ch   Timer RB Prescaler Register                                    TRBPRE           FFh
010Dh   Timer RB Secondary Register                                    TRBSC            FFh
010Eh   Timer RB Primary Register                                      TRBPR            FFh
010Fh
0110h   Timer RC Mode Register                                         TRCMR            01001000b
0111h   Timer RC Control Register 1                                    TRCCR1           00h
0112h   Timer RC Interrupt Enable Register                             TRCIER           01110000b
0113h   Timer RC Status Register                                       TRCSR            01110000b
0114h   Timer RC I/O Control Register 0                                TRCIOR0          10001000b
0115h   Timer RC I/O Control Register 1                                TRCIOR1          10001000b
0116h   Timer RC Counter                                               TRC              00h
0117h                                                                                   00h
0118h   Timer RC General Register A                                    TRCGRA           FFh
0119h                                                                                   FFh
011Ah   Timer RC General Register B                                    TRCGRB           FFh
011Bh                                                                                   FFh
011Ch   Timer RC General Register C                                    TRCGRC           FFh
011Dh                                                                                   FFh
011Eh   Timer RC General Register D                                    TRCGRD           FFh
011Fh                                                                                   FFh
0120h   Timer RC Control Register 2                                    TRCCR2           00011000b
0121h   Timer RC Digital Filter Function Select Register               TRCDF            00h
0122h   Timer RC Output Master Enable Register                         TRCOER           01111111b
0123h   Timer RC Trigger Control Register (2)                          TRCADCR          00h
0124h
0125h
0126h
0127h
0128h
0129h
012Ah
012Bh
012Ch
012Dh
012Eh
012Fh
0130h
0131h
0132h
0133h

0134h
0135h
0136h
0137h
0138h
0139h
013Ah
013Bh
013Ch
013Dh
013Eh
013Fh

Notes:
      1. The blank areas are reserved and cannot be accessed by users.
      2. This register is not available in the R8C/3MU Group.

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Table 4.6 SFR Information (6) (1)

Address                                                     Register    Symbol  After Reset
0140h
0141h   UART1 Transmit/Receive Mode Register                           U1MR    00h
0142h   UART1 Bit Rate Register                                        U1BRG   XXh
0143h   UART1 Transmit Buffer Register                                 U1TB    XXh
0144h   UART1 Transmit/Receive Control Register 0                              XXh
0145h   UART1 Transmit/Receive Control Register 1                      U1C0    00001000b
0146h   UART1 Receive Buffer Register                                  U1C1    00000010b
0147h   UART3 Transmit/Receive Mode Register                           U1RB    XXh
0148h   UART3 Bit Rate Register                                                XXh
0149h   UART3 Transmit Buffer Register                                 U3MR    00h
014Ah   UART3 Transmit/Receive Control Register 0                      U3BRG   XXh
014Bh   UART3 Transmit/Receive Control Register 1                      U3TB    XXh
014Ch   UART3 Receive Buffer Register                                          XXh
014Dh                                                                  U3C0    00001000b
014Eh                                                                  U3C1    00000010b
014Fh                                                                  U3RB    XXh
0150h                                                                          XXh
0151h
0152h
0153h
0154h
0155h
0156h
0157h
0158h
0159h
015Ah
015Bh
015Ch
015Dh
015Eh
015Fh
0160h
0161h
0162h
0163h
0164h
0165h
0166h
0167h
0168h
0169h
016Ah
016Bh
016Ch
016Dh
016Eh
016Fh
0170h
0171h
0172h
0173h
0174h
0175h
0176h
0177h
0178h
0179h
017Ah
017Bh
017Ch
017Dh
017Eh
017Fh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

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Table 4.7 SFR Information (7) (1)

Address                                   Register                                  Symbol           After Reset
0180h                                                                     TRASR            00h
0181h   Timer RA Pin Select Register                                      TRBRCSR          00h
0182h   Timer RC Pin Select Register                                      TRCPSR0          00h
0183h   Timer RC Pin Select Register 0                                    TRCPSR1          00h
0184h   Timer RC Pin Select Register 1
0185h
0186h   UART0 Pin Select Register                                         U0SR             00h
0187h   UART1 Pin Select Register
0188h   UART2 Pin Select Register 0                                       U1SR             00h
0189h   UART2 Pin Select Register 1
018Ah   SSU/IIC Pin Select Register                                       U2SR0            00h
018Bh
018Ch   INT Interrupt Input Pin Select Register                           U2SR1            00h
018Dh   I/O Function Pin Select Register
018Eh                                                                     SSUIICSR         00h
018Fh   SS Bit Counter Register
0190h   SS Transmit Data Register L / IIC bus Transmit Data Register (2)  INTSR            00h
0191h   SS Transmit Data Register H (2)
0192h   SS Receive Data Register L / IIC bus Receive Data Register (2)    PINSR            00h
0193h   SS Receive Data Register H (2)
0194h   SS Control Register H / IIC bus Control Register 1 (2)            SSBR             11111000b
         SS Control Register L / IIC bus Control Register 2 (2)            SSTDR / ICDRT    FFh
0195h   SS Mode Register / IIC bus Mode Register (2)                      SSTDRH           FFh
         SS Enable Register / IIC bus Interrupt Enable Register (2)        SSRDR / ICDRR    FFh
0196h   SS Status Register / IIC bus Status Register (2)                  SSRDRH           FFh
         SS Mode Register 2 / Slave Address Register (2)                   SSCRH / ICCR1    00h
0197h                                                                     SSCRL / ICCR2    01111101b
                                                                           SSMR / ICMR      00010000b / 00011000b
0198h                                                                     SSER / ICIER     00h
                                                                           SSSR / ICSR      00h / 0000X000b
0199h                                                                     SSMR2 / SAR      00h

019Ah   Flash Memory Status Register                                      FST              10000X00b

019Bh   Flash Memory Control Register 0                                   FMR0             00h
         Flash Memory Control Register 1                                   FMR1             00h
019Ch   Flash Memory Control Register 2                                   FMR2             00h

019Dh

019Eh
019Fh
01A0h
01A1h
01A2h
01A3h
01A4h
01A5h
01A6h
01A7h
01A8h
01A9h
01AAh
01ABh
01ACh
01ADh
01AEh
01AFh
01B0h
01B1h
01B2h
01B3h
01B4h
01B5h
01B6h
01B7h
01B8h
01B9h
01BAh
01BBh
01BCh
01BDh
01BEh
01BFh

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. Selectable by the IICSEL bit in the SSUIICSR register.

R01DS0112EJ0110 Rev.1.10                                                                         Page 25 of 88
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Table 4.8 SFR Information (8) (1)

Address                                                     Register             Symbol           After Reset
01C0h   Address Match Interrupt Register 0                             RMAD0            XXh
01C1h                                                                                   XXh
01C2h                                                                  AIER0            0000XXXXb
                                                                        RMAD1            00h
01C3h    Address Match Interrupt Enable Register 0                                       XXh
01C4h    Address Match Interrupt Register 1                             AIER1            XXh
01C5h                                                                                    0000XXXXb
01C6h                                                                                    00h

01C7h    Address Match Interrupt Enable Register 1                      PUR0             00h
01C8h
01C9h    Pull-Up Control Register 0                                     PUR1             00h
01CAh    Pull-Up Control Register 1
01CBh    Pull-Up Control Register 2                                     PUR2             00h
01CCh
01CDh    Port P1 Drive Capacity Control Register                        P1DRR            00h
01CEh    Drive Capacity Control Register 0
01CFh    Drive Capacity Control Register 1                              DRR0             00h
01D0h    Drive Capacity Control Register 2
01D1h    Input Threshold Control Register 0                             DRR1             00h
01D2h    Input Threshold Control Register 1
01D3h    Input Threshold Control Register 2                             DRR2             00h
01D4h    Comparator B Control Register 0
01D5h    External Input Enable Register 0                               VLT0             00h
01D6h    External Input Enable Register 1
01D7h    INT Input Filter Select Register 0                             VLT1             00h
01D8h    INT Input Filter Select Register 1
01D9h    Key Input Enable Register 0                                    VLT2             00h
01DAh
01DBh                                                                   INTCMP           00h
01DCh
01DDh                                                                   INTEN            00h
01DEh
01DFh                                                                   INTEN1           00h
01E0h
01E1h                                                                   INTF             00h
01E2h
01E3h                                                                   INTF1            00h
01E4h
01E5h                                                                   KIEN             00h
01E6h
01E7h
01E8h
01E9h
01EAh
01EBh
01ECh
01EDh
01EEh
01EFh
01F0h
01F1h
01F2h
01F3h
01F4h
01F5h
01F6h
01F7h
01F8h
01F9h
01FAh
01FBh
01FCh
01FDh
01FEh
01FFh

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Note:

      1. The blank areas are reserved and cannot be accessed by users.

R01DS0112EJ0110 Rev.1.10                                                                      Page 26 of 88
Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.9 SFR Information (9) (1)

Address                            Register                                      Symbol           After Reset
2C00h                                                                                   XXh
2C01h   DTC Transfer Vector Area                                       DTCD0            XXh
2C02h   DTC Transfer Vector Area                                       DTCD1            XXh
2C03h   DTC Transfer Vector Area                                       DTCD2            XXh
2C04h   DTC Transfer Vector Area                                       DTCD3            XXh
2C05h   DTC Transfer Vector Area                                       DTCD4            XXh
2C06h   DTC Transfer Vector Area                                       DTCD5            XXh
2C07h   DTC Transfer Vector Area                                                        XXh
2C08h   DTC Transfer Vector Area                                                        XXh
2C09h   DTC Transfer Vector Area                                                        XXh
2C0Ah    DTC Transfer Vector Area                                                        XXh
         DTC Transfer Vector Area                                                        XXh
     :   DTC Transfer Vector Area                                                        XXh
     :   DTC Transfer Vector Area                                                        XXh
2C3Ah    DTC Transfer Vector Area                                                        XXh
2C3Bh    DTC Transfer Vector Area                                                        XXh
2C3Ch    DTC Transfer Vector Area                                                        XXh
2C3Dh    DTC Transfer Vector Area                                                        XXh
2C3Eh    DTC Transfer Vector Area                                                        XXh
2C3Fh   DTC Transfer Vector Area                                                        XXh
2C40h   DTC Control Data 0                                                              XXh
2C41h                                                                                   XXh
2C42h   DTC Control Data 1                                                              XXh
2C43h                                                                                   XXh
2C44h   DTC Control Data 2                                                              XXh
2C45h                                                                                   XXh
2C46h   DTC Control Data 3                                                              XXh
2C47h                                                                                   XXh
2C48h   DTC Control Data 4                                                              XXh
2C49h                                                                                   XXh
2C4Ah    DTC Control Data 5                                                              XXh
2C4Bh                                                                                    XXh
2C4Ch                                                                                    XXh
2C4Dh                                                                                    XXh
2C4Eh                                                                                    XXh
2C4Fh                                                                                   XXh
2C50h                                                                                   XXh
2C51h                                                                                   XXh
2C52h                                                                                   XXh
2C53h                                                                                   XXh
2C54h                                                                                   XXh
2C55h                                                                                   XXh
2C56h                                                                                   XXh
2C57h                                                                                   XXh
2C58h                                                                                   XXh
2C59h                                                                                   XXh
2C5Ah                                                                                    XXh
2C5Bh                                                                                    XXh
2C5Ch                                                                                    XXh
2C5Dh                                                                                    XXh
2C5Eh                                                                                    XXh
2C5Fh                                                                                   XXh
2C60h                                                                                   XXh
2C61h                                                                                   XXh
2C62h                                                                                   XXh
2C63h                                                                                   XXh
2C64h                                                                                   XXh
2C65h                                                                                   XXh
2C66h                                                                                   XXh
2C67h                                                                                   XXh
2C68h                                                                                   XXh
2C69h                                                                                   XXh
2C6Ah                                                                                    XXh
2C6Bh                                                                                    XXh
2C6Ch                                                                                    XXh
2C6Dh                                                                                    XXh
2C6Eh                                                                                    XXh
2C6Fh

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Note:

      1. The blank areas are reserved and cannot be accessed by users.

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Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.10 SFR Information (10) (1)

Address                       Register                                           Symbol           After Reset
2C70h                                                                  DTCD6            XXh
2C71h   DTC Control Data 6                                             DTCD7            XXh
2C72h   DTC Control Data 7                                             DTCD8            XXh
2C73h   DTC Control Data 8                                             DTCD9            XXh
2C74h   DTC Control Data 9                                             DTCD10           XXh
2C75h   DTC Control Data 10                                            DTCD11           XXh
2C76h   DTC Control Data 11                                            DTCD12           XXh
2C77h   DTC Control Data 12                                            DTCD13           XXh
2C78h   DTC Control Data 13                                                             XXh
2C79h                                                                                   XXh
2C7Ah                                                                                    XXh
2C7Bh                                                                                    XXh
2C7Ch                                                                                    XXh
2C7Dh                                                                                    XXh
2C7Eh                                                                                    XXh
2C7Fh                                                                                   XXh
2C80h                                                                                   XXh
2C81h                                                                                   XXh
2C82h                                                                                   XXh
2C83h                                                                                   XXh
2C84h                                                                                   XXh
2C85h                                                                                   XXh
2C86h                                                                                   XXh
2C87h                                                                                   XXh
2C88h                                                                                   XXh
2C89h                                                                                   XXh
2C8Ah                                                                                    XXh
2C8Bh                                                                                    XXh
2C8Ch                                                                                    XXh
2C8Dh                                                                                    XXh
2C8Eh                                                                                    XXh
2C8Fh                                                                                   XXh
2C90h                                                                                   XXh
2C91h                                                                                   XXh
2C92h                                                                                   XXh
2C93h                                                                                   XXh
2C94h                                                                                   XXh
2C95h                                                                                   XXh
2C96h                                                                                   XXh
2C97h                                                                                   XXh
2C98h                                                                                   XXh
2C99h                                                                                   XXh
2C9Ah                                                                                    XXh
2C9Bh                                                                                    XXh
2C9Ch                                                                                    XXh
2C9Dh                                                                                    XXh
2C9Eh                                                                                    XXh
2C9Fh                                                                                   XXh
2CA0h                                                                                    XXh
2CA1h                                                                                    XXh
2CA2h                                                                                    XXh
2CA3h                                                                                    XXh
2CA4h                                                                                    XXh
2CA5h                                                                                    XXh
2CA6h                                                                                    XXh
2CA7h                                                                                    XXh
2CA8h                                                                                    XXh
2CA9h                                                                                    XXh
2CAAh                                                                                    XXh
2CABh                                                                                    XXh
2CACh                                                                                    XXh
2CADh                                                                                    XXh
2CAEh                                                                                    XXh
2CAFh                                                                                    XXh

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R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.11 SFR Information (11) (1)

Address                       Register                                           Symbol           After Reset
2CB0h                                                                   DTCD14           XXh
2CB1h    DTC Control Data 14                                            DTCD15           XXh
2CB2h    DTC Control Data 15                                            DTCD16           XXh
2CB3h    DTC Control Data 16                                            DTCD17           XXh
2CB4h    DTC Control Data 17                                            DTCD18           XXh
2CB5h    DTC Control Data 18                                            DTCD19           XXh
2CB6h    DTC Control Data 19                                            DTCD20           XXh
2CB7h    DTC Control Data 20                                            DTCD21           XXh
2CB8h    DTC Control Data 21                                                             XXh
2CB9h                                                                                    XXh
2CBAh                                                                                    XXh
2CBBh                                                                                    XXh
2CBCh                                                                                    XXh
2CBDh                                                                                    XXh
2CBEh                                                                                    XXh
2CBFh                                                                                    XXh
2CC0h                                                                                    XXh
2CC1h                                                                                    XXh
2CC2h                                                                                    XXh
2CC3h                                                                                    XXh
2CC4h                                                                                    XXh
2CC5h                                                                                    XXh
2CC6h                                                                                    XXh
2CC7h                                                                                    XXh
2CC8h                                                                                    XXh
2CC9h                                                                                    XXh
2CCAh                                                                                    XXh
2CCBh                                                                                    XXh
2CCCh                                                                                    XXh
2CCDh                                                                                    XXh
2CCEh                                                                                    XXh
2CCFh                                                                                    XXh
2CD0h                                                                                    XXh
2CD1h                                                                                    XXh
2CD2h                                                                                    XXh
2CD3h                                                                                    XXh
2CD4h                                                                                    XXh
2CD5h                                                                                    XXh
2CD6h                                                                                    XXh
2CD7h                                                                                    XXh
2CD8h                                                                                    XXh
2CD9h                                                                                    XXh
2CDAh                                                                                    XXh
2CDBh                                                                                    XXh
2CDCh                                                                                    XXh
2CDDh                                                                                    XXh
2CDEh                                                                                    XXh
2CDFh                                                                                    XXh
2CE0h                                                                                    XXh
2CE1h                                                                                    XXh
2CE2h                                                                                    XXh
2CE3h                                                                                    XXh
2CE4h                                                                                    XXh
2CE5h                                                                                    XXh
2CE6h                                                                                    XXh
2CE7h                                                                                    XXh
2CE8h                                                                                    XXh
2CE9h                                                                                    XXh
2CEAh                                                                                    XXh
2CEBh                                                                                    XXh
2CECh                                                                                    XXh
2CEDh                                                                                    XXh
2CEEh                                                                                    XXh
2CEFh                                                                                    XXh

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Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.12 SFR Information (12) (1)

Address                               Register                                   Symbol           After Reset
2CF0h                                                                  DTCD22           XXh
2CF1h   DTC Control Data 22                                                             XXh
2CF2h                                                                  DTCD23           XXh
2CF3h   DTC Control Data 23                                                             XXh
2CF4h                                                                                   XXh
2CF5h                                                                                   XXh
2CF6h                                                                                   XXh
2CF7h                                                                                   XXh
2CF8h                                                                                   XXh
2CF9h                                                                                   XXh
2CFAh                                                                                    XXh
2CFBh                                                                                    XXh
2CFCh                                                                                    XXh
2CFDh                                                                                    XXh
2CFEh                                                                                    XXh
2CFFh                                                                                    XXh
2D00h
         System Configuration Control Register                          SYSCFG           00h
     :   System Configuration Status Register 0                         SYSSTS0          00h
2DFFh    Device State Control Register 0                                DVSTCTR0
2E00h                                                                                   00000X00b
2E01h                                                                                   XX000000b
2E02h
2E03h                                                                                   00h
2E04h                                                                                   00h
2E05h
2E06h   CFIFO Port Register                                            CFIFO            00h
2E07h
2E08h                                                                                   00h
2E09h
2E0Ah   CFIFO Port Select Register                                     CFIFOSEL         00h
2E0Bh   CFIFO Port Control Register
2E0Ch                                                                                    00h
2E0Dh
2E0Eh                                                                  CFIFOCTR         00h
2E0Fh
2E10h                                                                                   00h
2E11h
2E12h
2E13h
2E14h
2E15h
2E16h
2E17h
2E18h
2E19h
2E1Ah
2E1Bh
2E1Ch
2E1Dh
2E1Eh
2E1Fh
2E20h
2E21h
2E22h
2E23h
2E24h
2E25h
2E26h
2E27h
2E28h
2E29h
2E2Ah
2E2Bh
2E2Ch
2E2Dh
2E2Eh
2E2Fh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

R01DS0112EJ0110 Rev.1.10                                                                      Page 30 of 88
Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.13 SFR Information (13) (1)

Address                                     Register                             Symbol           After Reset
2E30h                                                                  INTENB0          00h
2E31h   Interrupt Enable Register 0                                    INTENB1          00h
2E32h   Interrupt Enable Register 1 (2)                                                 00h
2E33h                                                                  BRDYENB          00h
2E34h   BRDY Interrupt Enable Register                                 NRDYENB
2E35h   NRDY Interrupt Enable Register                                 BEMPENB          00h
2E36h   BEMP Interrupt Enable Register                                 SOFCFG           00h
2E37h   SOF Output Configuration Register                                               00h
2E38h                                                                  INTSTS0          00h
2E39h   Interrupt Status Register 0                                    INTSTS1          00h
2E3Ah   Interrupt Status Register 1 (2)                                                 00h
2E3Bh                                                                  BRDYSTS          00h
2E3Ch    BRDY Interrupt Status Register                                 NRDYSTS          00h
2E3Dh    NRDY Interrupt Status Register                                 BEMPSTS
2E3Eh   BEMP Interrupt Status Register                                 FRMNUM           X0000000b
2E3Fh   Frame Number Register                                                           X0000000b
2E40h                                                                  USBADDR          00h
2E41h   USB Address Register                                                            XX0X0000b
2E42h                                                                  USBREQ
2E43h   USB Request Type Register                                      USBVAL           00h
2E44h   USB Request Value Register                                     USBINDX          00h
2E45h   USB Request Index Register                                     USBLENG          00h
2E46h   USB Request Length Register                                    DCPCFG           00h
2E47h   DCP Configuration Register                                     DCPMAXP          00h
2E48h   DCP Max Packet Size Register                                   DCPCTR           00h
2E49h   DCP Control Register                                                            00h
2E4Ah                                                                  PIPESEL          00h
2E4Bh   Pipe Window Select Register
2E4Ch                                                                   PIPECFG          00h
2E4Dh    Pipe Configuration Register                                                     00h
2E4Eh                                                                  PIPEMAXP
2E4Fh   Pipe Max Packet Size Register                                  PIPEPERI         00h
2E50h   Pipe Period Control Register (2)                                                00h
2E51h                                                                                   00h
2E52h                                                                                   00h
2E53h                                                                                   00h
2E54h                                                                                   00h
2E55h                                                                                   00h
2E56h                                                                                   00h
2E57h                                                                                   00h
2E58h                                                                                   00h
2E59h                                                                                   40h
2E5Ah                                                                                   00h
2E5Bh                                                                                   00h
2E5Ch                                                                                    00h
2E5Dh
2E5Eh                                                                                   00h
2E5Fh                                                                                   00h
2E60h
2E61h                                                                                   00h
2E62h                                                                                   00h
2E63h
2E64h                                                                                   00h
2E65h                                                                                   00h
2E66h                                                                                   00h
2E67h                                                                                   00h
2E68h
2E69h
2E6Ah
2E6Bh
2E6Ch
2E6Dh
2E6Eh
2E6Fh

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. This register is not available in the R8C/3MU Group.

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Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.14 SFR Information (14) (1)

Address                                                     Register    Symbol         After Reset
2E70h
2E71h   Pipe 4 Control Register                                        PIPE4CTR  00h
2E72h   Pipe 5 Control Register
2E73h   Pipe 6 Control Register                                                  00h
2E74h   Pipe 7 Control Register
2E75h                                                                  PIPE5CTR  00h
2E76h   Pipe 4 Transaction Counter Enable Register
2E77h   Pipe 4 Transaction Counter Register                                      00h
2E78h   Pipe 5 Transaction Counter Enable Register
2E79h   Pipe 5 Transaction Counter Register                            PIPE6CTR  00h
2E7Ah
2E7Bh   Device Address 0 Configuration Register (2)                              00h
2E7Ch    Device Address 1 Configuration Register (2)
2E7Dh    Device Address 2 Configuration Register (2)                    PIPE7CTR  00h
2E7Eh   Device Address 3 Configuration Register (2)
2E7Fh   Device Address 4 Configuration Register (2)                              00h
2E80h   Device Address 5 Configuration Register (2)
                                                                        PIPE4TRE  00h
     :
2E8Fh                                                                            00h
2E90h
2E91h                                                                  PIPE4TRN  00h
2E92h
2E93h                                                                            00h
2E94h
2E95h                                                                  PIPE5TRE  00h
2E96h
2E97h                                                                            00h
2E98h
2E99h                                                                  PIPE5TRN  00h
2E9Ah
2E9Bh                                                                            00h
2E9Ch
2E9Dh                                                                   DEVADD0   00h
2E9Eh
2E9Fh                                                                            00h
2EA0h
2EA1h                                                                  DEVADD1   00h
2EA2h
2EA3h                                                                            00h
2EA4h
2EA5h                                                                  DEVADD2   00h
2EA6h
2EA7h                                                                            00h
2EA8h
2EA9h                                                                  DEVADD3   00h
2EAAh
2EABh                                                                             00h
2EACh
2EADh                                                                   DEVADD4   00h

     :                                                                            00h
2ECFh
2ED0h                                                                   DEVADD5   00h
2ED1h
2ED2h                                                                             00h
2ED3h
2ED4h
2ED5h
2ED6h
2ED7h
2ED8h
2ED9h
2EDAh
2EDBh
2EDCh
2EDDh

     :
2EFFh

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. This register is not available in the R8C/3MU Group.

R01DS0112EJ0110 Rev.1.10                                                               Page 32 of 88
Jun 15, 2011
R8C/3MU Group, R8C/3MK Group                                            4. Special Function Registers (SFRs)

Table 4.15 SFR Information (15) (1)

Address                                 Register                                 Symbol           After Reset
2F00h                                                                  USBMC            00X10000b
2F01h   USB Module Control Register                                    PLC0             0010X000b
2F02h   PLL Control Register 0                                         PLC1             00001100b
2F03h   PLL Control Register 1                                         PLDIV            00001011b
2F04h   PLL Division Control Register
2F05h                                                                  USBSR0           00h
2F06h   USB Pin Select Register 0
2F07h   UART3 Pin Select Register                                      U3SR             00h
2F08h
2F09h
2F0Ah
2F0Bh
2F0Ch
2F0Dh
2F0Eh
2F0Fh
2F10h
2F11h
2F12h
2F13h
2F14h
2F15h
2F16h
2F17h
2F18h
2F19h
2F1Ah
2F1Bh
2F1Ch
2F1Dh
2F1Eh
2F1Fh

     :
2FFFh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

Table 4.16 ID Code Areas and Option Function Select Area

Address                                                  Area Name               Symbol           After Reset
     :   Option Function Select Register 2                              OFS2             (Note 1)
         ID1                                                                             (Note 2)
FFDBh    ID2                                                            OFS              (Note 2)
     :   ID3                                                                             (Note 2)
         ID4                                                                             (Note 2)
FFDFh    ID5                                                                             (Note 2)
     :   ID6                                                                             (Note 2)
         ID7                                                                             (Note 2)
FFE3h   Option Function Select Register                                                 (Note 1)
     :

FFEBh
     :

FFEFh
     :

FFF3h
     :

FFF7h
     :

FFFBh
     :

FFFFh

Notes:
      1. The option function select area is allocated in the flash memory, not in the SFRs. Set appropriate values as ROM data by a program.
          Do not write additions to the option function select area. If the block including the option function select area is erased, the option function select
          area is set to FFh.
          When blank products are shipped, the option function select area is set to FFh. It is set to the written value after written by the user.
          When factory-programming products are shipped, the value of the option function select area is the value programmed by the user.
      2. The ID code areas are allocated in the flash memory, not in the SFRs. Set appropriate values as ROM data by a program.
          Do not write additions to the ID code areas. If the block including the ID code areas is erased, the ID code areas are set to FFh.
          When blank products are shipped, the ID code areas are set to FFh. They are set to the written value after written by the user.
          When factory-programming products are shipped, the value of the ID code areas is the value programmed by the user.

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R8C/3MU Group, R8C/3MK Group                                             5. Electrical Characteristics

5. Electrical Characteristics

5.1 R8C/3MU Group

Table 5.1 Absolute Maximum Ratings

Symbol                            Parameter                  Condition  Rated Value        Unit
VCC      Supply voltage                       -20C  Topr  85C
VI       Input voltage                                                   -0.3 to 6.5        V
VO       Output voltage
Pd       Power dissipation                                               -0.3 to VCC + 0.3  V
Topr     Operating ambient temperature
Tstg     Storage temperature                                             -0.3 to VCC + 0.3  V

                                                                         500                mW

                                                                         -20 to 85 (N version) C

                                                                         -65 to 150         C

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Table 5.2 Recommended Operating Conditions (1)

Symbol                            Parameter                                      Conditions            Standard        Unit
VCC
UVCC                                                                        VCC = 3.0 to 3.6 V  Min. Typ. Max.            V
                                                                            VCC = 1.8 to 5.5 V                            V
VSS        Supply voltage When USB function is used                                                3.0  5.0       5.5     V
VIH                                                                         4.0 V  VCC  5.5 V                             V
                              When USB function is not used                 2.7 V  VCC < 4.0 V     1.8  5.0       5.5
VIL                                                                         1.8 V  VCC < 2.7 V                            V
           USB Supply         When USB function is used                     4.0 V  VCC  5.5 V      --   VCC (4)   --      V
IOH(sum)                                                                    2.7 V  VCC < 4.0 V                            V
IOH(sum)   Voltage (When When USB function is not used                      1.8 V  VCC < 2.7 V     --   VCC (4)   --      V
IOH(peak)  UVCC pin is                                                      4.0 V  VCC  5.5 V                             V
IOH(avg)                                                                    2.7 V  VCC < 4.0 V                            V
IOL(sum)   input)                                                           1.8 V  VCC < 2.7 V                            V
IOL(sum)                                                                                                                  V
IOL(peak)  Supply voltage                                                   4.0 V  VCC  5.5 V      --   0         --      V
IOL(avg)                                                                    2.7 V  VCC < 4.0 V                            V
f(XIN)     Input "H" voltage Other than CMOS input                          1.8 V  VCC < 2.7 V  0.8 VCC --        VCC     V
fOCO40M                                                                     4.0 V  VCC  5.5 V                             V
fOCO-F                        CMOS Input level Input level selection:       2.7 V  VCC < 4.0 V  0.5 VCC --        VCC     V
--                                                                          1.8 V  VCC < 2.7 V                            V
f(BCLK)                       input switching 0.35 VCC                      4.0 V  VCC  5.5 V   0.55 VCC --       VCC     V
tsu(PLL)                                                                    2.7 V  VCC < 4.0 V                            V
                                   function                                 1.8 V  VCC < 2.7 V  0.65 VCC --       VCC     V
                                                                                                                          V
                                   (I/O port) Input level selection:        2.7 V  VCC  5.5 V   0.65 VCC --       VCC     V
                                                                            1.8 V  VCC < 2.7 V                            V
                                                  0.5 VCC                   2.7 V  VCC  5.5 V   0.7 VCC --        VCC     V
                                                                            2.7 V  VCC  5.5 V                             V
                                                                            1.8 V  VCC < 2.7 V  0.8 VCC --        VCC     V
                                                                            2.7 V  VCC  5.5 V                           mA
                                                  Input level selection:    1.8 V  VCC < 2.7 V  0.85 VCC --       VCC
                                                  0.7 VCC                   2.7 V  VCC  5.5 V                           mA
                                                                            1.8 V  VCC < 2.7 V  0.85 VCC --       VCC
                                                                            4.0 V  VCC  5.5 V                           mA
                                                                            2.7 V  VCC < 4.0 V  0.85 VCC --       VCC   mA
                                                                                                                        mA
                              External clock input (XOUT)                                          1.2  --        VCC   mA
                              Other than CMOS input                                                                     mA
           Input "L" voltage  CMOS Input level Input level selection:                              0    -- 0.2 VCC
                              input switching 0.35 VCC                                                                  mA
                                                                                                   0    -- 0.2 VCC
                                         function                                                                       mA
                                         (I/O port) Input level selection:                         0    -- 0.2 VCC      mA
                                                                                                                        mA
                                                         0.5 VCC                                   0    -- 0.2 VCC      mA
                                                                                                                        MHz
                                                                                                   0    -- 0.4 VCC      MHz
                                                                                                                        MHz
                                                                                                   0    -- 0.3 VCC      MHz
                                                                                                                        MHz
                                                                                                   0    -- 0.2 VCC      MHz
                                                                                                                        MHz
                                                  Input level selection:                           0    -- 0.55 VCC     MHz
                                                  0.7 VCC                                                               MHz
                                                                                                   0    -- 0.45 VCC      ms
                                                                                                                         ms
                                                                                                   0    -- 0.35 VCC

                              External clock input (XOUT)                                          0    --        0.4

           Peak sum output "H"     Sum of all pins IOH(peak)                                       --   --        -160

           current

           Average sum output "H" Sum of all pins IOH(avg)                                         --   --        -80

           current

           Peak output "H" current Drive capacity Low                                              --   --        -10

                                   Drive capacity High                                             --   --        -40

           Average output "H"      Drive capacity Low                                              --   --        -5

           current                 Drive capacity High                                             --   --        -20

           Peak sum output "L"     Sum of all pins IOL(peak)                                       --   --        160

           current

           Average sum output "L" Sum of all pins IOL(avg)                                         --   --        80

           current

           Peak output "L" current Drive capacity Low                                              --   --        10

                                   Drive capacity High                                             --   --        40

           Average output "L"      Drive capacity Low                                              --   --        5

           current                 Drive capacity High                                             --   --        20

           XIN clock input oscillation frequency                                                   --   --        20

                                                                                                   --   --        5

           When used as the count source for timer RC (3)                                          32   --        40
           fOCO-F frequency
                                                                                                   --   --        20

                                                                                                   --   --        5

           System clock frequency                                                                  --   --        20

                                                                                                   --   --        5

           CPU clock frequency                                                                     --   --        20

                                                                                                   --   --        5

           PLL frequency symthesizer stabilization wait time                                       --   --        2

                                                                                                   --   --        3

Notes:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. The average output current indicates the average value of current measured during 100 ms.
     3. fOCO40M can be used as the count source for timer RC in the range of VCC = 2.7 to 5.5 V.
     4. Connect VCC for the UVCC pin input.

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R8C/3MU Group, R8C/3MK Group                                                                       5. Electrical Characteristics

                                                P0

                                                P1

                                                P3  30pF

                                                P4

                                                P6

                                                P7

                                                P8

Figure 5.1 Ports P0, P1, P3, P4, P6, P7 and P8 Timing Measurement Circuit

Table 5.3 Comparator B Electrical Characteristics

Symbol  Parameter                                   Condition                                      Standard        Unit

                                                                                             Min.  Typ.      Max.
                                                                                               0
Vref    IVREF1, IVREF3 input reference voltage                                                     --        VCC - 1.4 V
VI      IVCMP1, IVCMP3 input voltage                                                         -0.3
--      Offset                                                                                --   --        VCC + 0.3 V
td      Comparator output delay time (2)                                                      --
ICMP    Comparator operating current                                                          --   5         100   mV

                                                VI = Vref 100 mV                                 0.1       --    s
                                                VCC = 5.0 V
                                                                                                   17.5      --    A

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. When the digital filter is disabled.

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Table 5.4 USB Characteristics

Symbol                      Parameter                                     Condition          Standard
                                                                                                                      Unit
                         Input "H" voltage                    Figures 5.2 and 5.3
                         Input "L" voltage                                           Min. Typ. Max.
                         Differential input sensitivity       Figures 5.2 and 5.3
VIH     Input            Differential common mode range       ICH = 200A            2.0 --                              --   V
                         Output "H" voltage                   Figures 5.2 and 5.3
VIL     characteristics                                       ICL = 2 mA             --   --                             0.8  V
                         Output "L" voltage                   Figures 5.2 and 5.3
VDI                                                           Figures 5.2 and 5.3    0.2 --                              --   V
                                                              Figures 5.2 and 5.3
VCM                                                           Figures 5.2 and 5.3    0.8  --                             2.5  V
                                                              (tR/tF)
VOH     Output                                                Figures 5.2 and 5.3    2.8 --                              --   V
                                                              Includes RS = 27
        characteristics                                       VCC = 4.0 to 5.5V,
                                                              PXXCON = VDDUSBE = 1
VOL                                                           PXXCON = 0             --   --                             0.3  V
                                                              VCC = 4.0 to 5.5 V
VCRS                     Crossover voltage                    UVCC - VSS 0.33 F     1.3  --                             2.0  V
tR                       Rise time                            VCC - VSS 0.1 F
tF                       Fall time                                                   4.0 -- 20.0 ns
tRFM                     Rise time / Fall time matching
                                                                                     4.0 -- 20.0 ns

                                                                                     90.0 -- 111.1 %

ZDRV                     Output resistance                                           28   -- 44.0

UVCC UVCC output voltage                                                             3.0 3.3 3.6                              V

                                                                                     --   VCC                            --   V

Isusp   Consumption current of the Internal power supply for                              50                                  A

        USB

Note:
     1. Referenced to VCC = 3.0 to 5.5 V, UVCC = 3.0 V, at Topr = -20 to 85 C (N version), unless otherwise specified.

        D+ D-            VCRS      Rising time                 Falling time               Differential
                                                  90 %        90 %                        Date Lines

                               10 %                                           10 %
                                           tR                           tF

Figure 5.2 Data Signal Timing Diagram

                               D+ RS = 27                     Test point
                               D- RS = 27                     Test point

    Figure 5.3 Load Condition                                                                                            Page 37 of 88

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Table 5.5 Flash Memory (Program ROM) Electrical Characteristics

Symbol                    Parameter                  Conditions                              Standard              Unit

                                                                                    Min.     Typ.      Max.        times
                                                                                  1,000 (3)                         s
--          Program/erase endurance (2)                                                      --        --            s
--          Byte program time                                                         --                            ms
--          Block erase time                                                          --     80        500
td(SR-SUS)  Time delay from suspend request until                                     --                            s
            suspend                                                                          0.3       --
--          Interval from erase start/restart until                                   0
            following suspend request                                                        --    5 + CPU clock
--          Time from suspend until erase restart                                     --
                                                                                                       3 cycles

                                                                                             --        --

                                                                                             -- 30 + CPU clock s
                                                                                                            1 cycle

td(CMDRST Time from when command is forcibly                                      -          -     30 + CPU clock s

-READY) stopped until reading is enabled                                                                1 cycle

--          Program, erase voltage                                                2.7        --        5.5         V

--          Read voltage                                                          1.8        --        5.5         V

--          Program, erase temperature                                            0          --        60          C

--          Data hold time (7)                       Ambient temperature = 55 C  20         --        --          year

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = 0 to 60 C, unless otherwise specified.
     2. Definition of programming/erasure endurance
         The programming and erasure endurance is defined on a per-block basis.
         If the programming and erasure endurance is n (n = 1,000), each block can be erased n times. For example, if 1,024 1-byte
         writes are performed to different addresses in block A, a 1 Kbyte block, and then the block is erased, the
         programming/erasure endurance still stands at one. However, the same address must not be programmed more than once
         per erase operation (overwriting prohibited).
     3. Endurance to guarantee all electrical characteristics after program and erase. (1 to Min. value can be guaranteed.)
     4. In a system that executes multiple programming operations, the actual erasure count can be reduced by writing to sequential
         addresses in turn so that as much of the block as possible is used up before performing an erase operation. For example,
         when programming groups of 16 bytes, the effective number of rewrites can be minimized by programming up to 128 groups
         before erasing them all in one operation. It is also advisable to retain data on the erasure endurance of each block and limit
         the number of erase operations to a certain number.
     5. If an error occurs during block erase, attempt to execute the clear status register command, then execute the block erase
         command at least three times until the erase error does not occur.
     6. Customers desiring program/erase failure rate information should contact their Renesas technical support representative.
     7. The data hold time includes time that the power supply is off or the clock is not supplied.

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Table 5.6 Flash Memory (Data flash Block A to Block D) Electrical Characteristics

Symbol                    Parameter                  Conditions                      Min.     Standard        Max.        Unit
                                                                                  10,000 (3)  Typ.             --
--          Program/erase endurance (2)                                                        --                         times
--                                                                                    --      160             1500         s
--          Byte program time
--          (program/erase endurance  1,000 times)                                --          300             1500        s
--
td(SR-SUS)  Byte program time                                                     --          0.2             1           s
--          (program/erase endurance > 1,000 times)
--                                                                                --          0.3             1           s
            Block erase time
            (program/erase endurance  1,000 times)                                --          -- 5 + CPU clock ms

            Block erase time                                                                                  3 cycles
            (program/erase endurance > 1,000 times)
                                                                                  0           --              --          s
            Time delay from suspend request until
            suspend                                                               --          -- 30 + CPU clock s

            Interval from erase start/restart until
            following suspend request

            Time from suspend until erase restart

                                                                                                               1 cycle

td(CMDRST Time from when command is forcibly                                      -           - 30 + CPU clock s
-READY) stopped until reading is enabled
                                                                                                               1 cycle

--          Program, erase voltage                                                2.7         --              5.5         V

--          Read voltage                                                          1.8         --              5.5         V

--          Program, erase temperature                                            -20         --              85          C

--          Data hold time (7)                       Ambient temperature = 55 C  20          --              --          year

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. Definition of programming/erasure endurance
         The programming and erasure endurance is defined on a per-block basis.
         If the programming and erasure endurance is n (n = 10,000), each block can be erased n times. For example, if 1,024 1-byte
         writes are performed to different addresses in block A, a 1 Kbyte block, and then the block is erased, the
         programming/erasure endurance still stands at one. However, the same address must not be programmed more than once
         per erase operation (overwriting prohibited).
     3. Endurance to guarantee all electrical characteristics after program and erase. (1 to Min. value can be guaranteed.)
     4. In a system that executes multiple programming operations, the actual erasure count can be reduced by writing to sequential
         addresses in turn so that as much of the block as possible is used up before performing an erase operation. For example,
         when programming groups of 16 bytes, the effective number of rewrites can be minimized by programming up to 128 groups
         before erasing them all in one operation. In addition, averaging the erasure endurance between blocks A to D can further
         reduce the actual erasure endurance. It is also advisable to retain data on the erasure endurance of each block and limit the
         number of erase operations to a certain number.
     5. If an error occurs during block erase, attempt to execute the clear status register command, then execute the block erase
         command at least three times until the erase error does not occur.
     6. Customers desiring program/erase failure rate information should contact their Renesas technical support representative.
     7. The data hold time includes time that the power supply is off or the clock is not supplied.

            Suspend request
                  (FMR21 bit)

                       FST7 bit
                       FST6 bit

                                                     Fixed time  Clock-dependent
                                                                         time
                                                                                              Access restart

                                                                 td(SR-SUS)

Figure 5.4   FST6, FST7: Bit in FST register
             FMR21: Bit in FMR2 register

            Time delay until Suspend

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Table 5.7 Voltage Detection 0 Circuit Electrical Characteristics

Symbol                        Parameter                          Condition                            Standard
                                                                                                                                  Unit

                                                                                             Min. Typ. Max.

Vdet0    Voltage detection level Vdet0_0 (2)                                                 1.80 1.90 2.05 V

         Voltage detection level Vdet0_1 (2)                                                 2.15 2.35 2.50 V

         Voltage detection level Vdet0_2 (2)                                                 2.70 2.85 3.05 V

         Voltage detection level Vdet0_3 (2)                                                 3.55 3.80 4.05 V

--       Voltage detection 0 circuit response time (4)           At the falling of VCC from  --  6     150 s

                                                                 5.0 V to (Vdet0_0 - 0.1) V

--       Voltage detection circuit self power consumption        VCA25 = 1, VCC = 5.0 V      --  1.5   --  A

td(E-A)  Waiting time until voltage detection circuit operation                              --  --    100 s
         starts (3)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version).
     2. Select the voltage detection level with bits VDSEL0 and VDSEL1 in the OFS register.
     3. Necessary time until the voltage detection circuit operates when setting to 1 again after setting the VCA25 bit in the VCA2
         register to 0.
     4. Time until the voltage monitor 0 reset is generated after the voltage passes Vdet0.

Table 5.8 Voltage Detection 1 Circuit Electrical Characteristics

Symbol                        Parameter                          Condition                            Standard
                                                                                                                                  Unit

                                                                                             Min. Typ. Max.

Vdet1    Voltage detection level Vdet1_0 (2)                     At the falling of VCC       2.00 2.20 2.40 V

         Voltage detection level Vdet1_1 (2)                     At the falling of VCC       2.15 2.35 2.55 V

         Voltage detection level Vdet1_2 (2)                     At the falling of VCC       2.30 2.50 2.70 V

         Voltage detection level Vdet1_3 (2)                     At the falling of VCC       2.45 2.65 2.85 V

         Voltage detection level Vdet1_4 (2)                     At the falling of VCC       2.60 2.80 3.00 V

         Voltage detection level Vdet1_5 (2)                     At the falling of VCC       2.75 2.95 3.15 V

         Voltage detection level Vdet1_6 (2)                     At the falling of VCC       2.85 3.10 3.40 V

         Voltage detection level Vdet1_7 (2)                     At the falling of VCC       3.00 3.25 3.55 V

         Voltage detection level Vdet1_8 (2)                     At the falling of VCC       3.15 3.40 3.70 V

         Voltage detection level Vdet1_9 (2)                     At the falling of VCC       3.30 3.55 3.85 V

         Voltage detection level Vdet1_A (2)                     At the falling of VCC       3.45 3.70 4.00 V

         Voltage detection level Vdet1_B (2)                     At the falling of VCC       3.60 3.85 4.15 V

         Voltage detection level Vdet1_C (2)                     At the falling of VCC       3.75 4.00 4.30 V

         Voltage detection level Vdet1_D (2)                     At the falling of VCC       3.90 4.15 4.45 V

         Voltage detection level Vdet1_E (2)                     At the falling of VCC       4.05 4.30 4.60 V

         Voltage detection level Vdet1_F (2)                     At the falling of VCC       4.20 4.45 4.75 V

--       Hysteresis width at the rising of VCC in voltage        Vdet1_0 to Vdet1_5          --  0.07  --  V

         detection 1 circuit                                     selected

                                                                 Vdet1_6 to Vdet1_F          --  0.10  --  V
                                                                 selected

--       Voltage detection 1 circuit response time (3)           At the falling of VCC from  --  60    150 s

                                                                 5.0 V to (Vdet1_0 - 0.1) V

--       Voltage detection circuit self power consumption        VCA26 = 1, VCC = 5.0 V      --  1.7   --  A

td(E-A)  Waiting time until voltage detection circuit operation                              --  --    100 s
         starts (4)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version).
     2. Select the voltage detection level with bits VD1S0 to VD1S3 in the VD1LS register.
     3. Time until the voltage monitor 1 interrupt request is generated after the voltage passes Vdet1.
     4. Necessary time until the voltage detection circuit operates when setting to 1 again after setting the VCA26 bit in the VCA2
         register to 0.

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Table 5.9 Voltage Detection 2 Circuit Electrical Characteristics

Symbol                        Parameter                          Condition                                             Standard
                                                                                                                                                   Unit

                                                                                                              Min. Typ. Max.

Vdet2    Voltage detection level Vdet2_0                         At the falling of VCC                        3.70 4.00 4.30 V

--       Hysteresis width at the rising of VCC in voltage                                                     --  0.10          --   V

         detection 2 circuit

--       Voltage detection 2 circuit response time (2)           At the falling of VCC from                   --  20            150 s

                                                                 5.0 V to (Vdet2_0 - 0.1) V

--       Voltage detection circuit self power consumption        VCA27 = 1, VCC = 5.0 V                       --  1.7           --   A

td(E-A)  Waiting time until voltage detection circuit operation                                               --  --            100 s
         starts (3)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version).
     2. Time until the voltage monitor 2 interrupt request is generated after the voltage passes Vdet2.
     3. Necessary time until the voltage detection circuit operates after setting to 1 again after setting the VCA27 bit in the VCA2
         register to 0.

Table 5.10 Power-on Reset Circuit (2)

Symbol                        Parameter                                    Condition                  Standard
                                                                                                                                     Unit
                                                                 (1)
                                                                                             Min. Typ. Max.

trth     External power VCC rise gradient                                                                  0      -- 50,000 mV/msec

Notes:
     1. The measurement condition is Topr = -20 to 85 C (N version), unless otherwise specified.
     2. To use the power-on reset function, enable voltage monitor 0 reset by setting the LVDAS bit in the OFS register to 0.

     Vdet0 (1)                                                                                                            Vdet0 (1)

   External                      trth                                                                trth
Power VCC       tw(por) (2)
                                                         Voltage detection 0
       0.5 V                                            circuit response time

     Internal
reset signal

                                              1          32                                                         1    32
                                           fOCO-S                                                                 fOCO-S

       Notes:
          1. Vdet0 indicates the voltage detection level of the voltage detection 0 circuit. Refer to 6. Voltage Detection
              Circuit of User's Manual: Hardware for details.
          2. tw(por) indicates the duration the external power VCC must be held below the valid voltage (0.5 V) to enable
              a power-on reset. When turning on the power after it falls with voltage monitor 0 reset disabled, maintain
              tw(por) for 1 ms or more.

Figure 5.5 Power-on Reset Circuit Electrical Characteristics

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Table 5.11 High-speed On-Chip Oscillator Circuit Electrical Characteristics

Symbol                    Parameter                           Condition                                    Standard        Unit
                                                                                                                           MHz
                                                                                                     Min. Typ. Max.

--       High-speed on-chip oscillator frequency after        VCC = 1.8 V to 5.5 V                   36.0  40        44.0

         reset

         High-speed on-chip oscillator frequency when the     VCC = 1.8 V to 5.5 V                   33.178 36.864 40.550 MHz
         FRA4 register correction value is written into the
         FRA1 register and the FRA5 register correction
         value into the FRA3 register (2)

         High-speed on-chip oscillator frequency when the     VCC = 1.8 V to 5.5 V                   28.8  32        35.2 MHz
         FRA6 register correction value is written into the
         FRA1 register and the FRA7 register correction
         value into the FRA3 register

--       Oscillation stability time                           VCC = 5.0 V, Topr = 25 C              --    0.5       3     ms

--       Self power consumption at oscillation                VCC = 5.0 V, Topr = 25 C              --    400       --    A

Notes:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. This enables the setting errors of bit rates such as 9600 bps and 38400 bps to be 0% when the serial interface is used in
         UART mode.

Table 5.12 Low-speed On-Chip Oscillator Circuit Electrical Characteristics

Symbol                    Parameter                           Condition                                       Standard
                                                                                                                                          Unit

                                                                                                     Min. Typ. Max.

fOCO-S   Low-speed on-chip oscillator frequency                                                      60    125       250 kHz
--       Oscillation stability time
--       Self power consumption at oscillation                VCC = 5.0 V, Topr = 25 C --                 30        100 s

                                                              VCC = 5.0 V, Topr = 25 C --                 2         --    A

Note:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.

Table 5.13 Power Supply Circuit Timing Characteristics

Symbol                    Parameter                           Condition                                       Standard
                                                                                                                                          Unit

                                                                                                     Min. Typ. Max.

td(P-R)  Time for internal power supply stabilization during                                         --    -- 2,000 s
         power-on (2)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = 25 C.
     2. Waiting time until the internal power supply generation circuit stabilizes during power-on.

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Table 5.14 Timing Requirements of Synchronous Serial Communication Unit (SSU)

Symbol  Parameter                        Conditions                      Standard                                        Unit

                                                             Min.        Typ.                            Max.           tCYC (2)
                                                                                                          --            tSUCYC
tSUCYC SSCK clock cycle time                                 4           --                               0.6           tSUCYC
                                                                                                          0.6           tCYC (2)
tHI     SSCK clock "H" width                                 0.4         --                                1
tLO                                                                                                        1               s
tRISE   SSCK clock "L" width                                 0.4         --                                1            tCYC (2)
                                                                                                           1
tFALL   SSCK clock rising        Master                      --          --                               --               s
        time                     Slave                                                                    --               ns
tSU                                                          --          --                               --            tCYC (2)
tH                                                                                                                         ns
        SSCK clock falling       Master                      --          --
        time                     Slave
                                                             --          --

        SSO, SSI data input setup time                       100         --

        SSO, SSI data input hold time                        1           --

tLEAD   SCS setup time           Slave                       1tCYC + 50  --
tLAG
tOD     SCS hold time            Slave                       1tCYC + 50  --                              --             ns

        SSO, SSI data output delay time                      --          --                                      1      tCYC (2)
                                                                                                         1.5tCYC + 100     ns
tSA     SSI slave access time            2.7 V  VCC  5.5 V   --          --                              1.5tCYC + 200     ns
                                                                                                         1.5tCYC + 100     ns
                                         1.8 V  VCC < 2.7 V  --          --                              1.5tCYC + 200     ns

tOR     SSI slave out open time          2.7 V  VCC  5.5 V   --          --

                                         1.8 V  VCC < 2.7 V  --          --

Notes:
     1. VCC = 1.8 to 5.5 V, VSS = 0 V, and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. 1tCYC = 1/f1(s)

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4-Wire Bus Communication Mode, Master, CPHS = 1

SCS (output)              VIH or VOH
                             VIL or VOL
                                      tHI       tFALL                                             tRISE

SSCK (output)                              tLO
   (CPOS = 1)                              tHI

SSCK (output)
   (CPOS = 0)

                               tLO              tSUCYC

SSO (output)

                                                                               tOD

SSI (input)

                          tSU  tH

4-Wire Bus Communication Mode, Master, CPHS = 0

SCS (output)              VIH or VOH
                             VIL or VOL
                                      tHI       tFALL                                             tRISE

SSCK (output)                              tLO
   (CPOS = 1)                              tHI

SSCK (output)
   (CPOS = 0)

                               tLO               tSUCYC

SSO (output)

                                                                                             tOD

SSI (input)

                               tSU         tH

CPHS, CPOS: Bits in SSMR register

Figure 5.6 I/O Timing of Synchronous Serial Communication Unit (SSU) (Master)

R01DS0112EJ0110 Rev.1.10                                                                                 Page 44 of 88
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4-Wire Bus Communication Mode, Slave, CPHS = 1

SCS (input)                    VIH or VOH
                                  VIL or VOL

                                      tLEAD        tHI                   tFALL         tRISE             tLAG
                                                                                                               tOR
SSCK (input)                                                tLO
(CPOS = 1)                                                 tHI                               tLAG
                                                                                                    tOR
SSCK (input)
(CPOS = 0)

                                                   tLO             tSUCYC

SSO (input)

                                              tSU       tH

SSI (output)

                                      tSA                                tOD

4-Wire Bus Communication Mode, Slave, CPHS = 0

SCS (input)                    VIH or VOH
                                  VIL or VOL

                               tLEAD          tHI           tFALL               tRISE

SSCK (input)                                       tLO
(CPOS = 1)                                        tHI

SSCK (input)
(CPOS = 0)

                                              tLO                tSUCYC

SSO (input)

                                              tSU       tH

SSI (output)

                          tSA                                            tOD

                                CPHS, CPOS: Bits in SSMR register

Figure 5.7 I/O Timing of Synchronous Serial Communication Unit (SSU) (Slave)

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                                          tHI

                  VIH or VOH

            SSCK

                  VIL or VOL                   tSUCYC
                                     tLO

SSO (output)

                                                                                             tOD

SSI (input)

                              tSU         tH

Figure 5.8  I/O Timing of Synchronous Serial Communication Unit (SSU) (Clock Synchronous
            Communication Mode)

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Table 5.15 Timing Requirements of I2C bus Interface

Symbol                        Parameter                     Condition                      Standard                               Unit
                                                                                                                    Max.
                                                                                     Min.                Typ.

tSCL    SCL input cycle time                                           12tCYC + 600 (2)                  --         --     ns
tSCLH   SCL input "H" width
tSCLL   SCL input "L" width                                            3tCYC + 300 (2)                   --         --     ns
tsf     SCL, SDA input fall time
tSP     SCL, SDA input spike pulse rejection time                      5tCYC + 500 (2)                   --         --     ns

                                                                                     --                  --         300    ns

                                                                                     --                  --    1tCYC (2)   ns

tBUF    SDA input bus-free time                                        5tCYC (2)                         --         --     ns
tSTAH   Start condition input hold time
tSTAS   Retransmit start condition input setup time                    3tCYC (2)                         --         --     ns
tSTOP   Stop condition input setup time
tSDAS   Data input setup time                                          3tCYC (2)                         --         --     ns
tSDAH   Data input hold time
                                                                       3tCYC (2)                         --         --     ns

                                                                       1tCYC + 40 (2)                    --         --     ns

                                                                                     10                  --         --     ns

Notes:
     1. VCC = 1.8 to 5.5 V, VSS = 0 V, and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. 1tCYC = 1/f1(s)

       SDA                      VIH
                                VIL
                   tBUF         tSTAH

                                         tSCLH                                tSTAS                      tSP tSTOP
                                                                       Sr (3)
       SCL

            P (2)        S (1)                                                                                      P (2)

                         tSf    tSCLL          tSr                                         tSDAS

                                         tSCL        tSDAH

            Notes:
                1. Start condition
                2. Stop condition
                3. Retransmit start condition

Figure 5.9 I/O Timing of I2C bus Interface

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Table 5.16 Electrical Characteristics (1) [4.2 V  VCC  5.5 V]

Symbol               Parameter                              Condition                       Standard
                                                                                                                        Unit

                                                                                     Min. Typ. Max.

VOH      Output "H" Other than XOUT       Drive capacity High VCC = 5 V IOH = -20 mA VCC - 2.0 --                 VCC  V

         voltage                          Drive capacity Low VCC = 5 V IOH = -5 mA VCC - 2.0 --                   VCC  V

                     XOUT                 VCC = 5 V                    IOH = -200 A 1.0                      --  VCC  V

VOL      Output "L" Other than XOUT       Drive capacity High VCC = 5 V IOL = 20 mA  --                       --  2.0  V

         voltage                          Drive capacity Low VCC = 5 V IOL = 5 mA    --                       --  2.0  V

                     XOUT                 VCC = 5 V                    IOL = 200 A  --                       --  0.5  V

VT+-VT-  Hysteresis  INT0, INT1, INT2,                                               0.1                      1.2 --   V
                     INT3, INT4,
                     KI0, KI1, KI2, KI3,
                     TRAIO,TRCIOA,
                     TRCIOB, TRCIOC,
                     TRCIOD,
                     USB_VBUS,
                     TRCTRG, TRCCLK,
                     RXD0, RXD1, RXD2,
                     RXD3, CLK0, CLK1,
                     CLK2, CLK3, CTS2,
                     SSI, SCL, SDA, SSO,
                     SSCK, SCS

                     RESET                                                           0.1                      1.2 --   V

IIH      Input "H" current                VI = 5 V, VCC = 5.0 V                      --                       -- 5.0 A

IIL      Input "L" current                VI = 0 V, VCC = 5.0 V                      --                       -- -5.0 A

RPULLUP Pull-up resistance                VI = 0 V, VCC = 5.0 V                      25                       50 100 k

RfXIN    Feedback XIN                                                                --                       0.3 -- M
         resistance

VRAM     RAM hold voltage                 During stop mode                           1.8                      --  --   V

Note:
     1. 4.2 V  VCC  5.5 V, Topr = -20 to 85 C (N version), and f(XIN) = 20 MHz, unless otherwise specified.

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Table 5.17 Electrical Characteristics (2) [3.3 V  VCC  5.5 V]
                   (Topr = -20 to 85 C (N version), unless otherwise specified.)

Symbol  Parameter                                           Condition                               Standard  Unit
                                                                                             Min. Typ. Max.

ICC     Power supply current High-speed    XIN = 20 MHz (square wave)                        -- 6.5 15 mA

        (VCC = 3.3 to 5.5 V) clock mode    High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
        Single-chip mode,
                                           No division

        output pins are open,              XIN = 16 MHz (square wave)                        -- 5.3 12.5 mA
        other pins are VSS                 High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           No division

                                           XIN = 10 MHz (square wave)                        -- 3.6 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           No division

                                           XIN = 20 MHz (square wave)                        -- 3.0 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN = 16 MHz (square wave)                        -- 2.2 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN = 10 MHz (square wave)                        -- 1.5 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                               High-speed  XIN clock off                                     -- 7.0 15 mA

                               on-chip     High-speed on-chip oscillator on fOCO-F = 20 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                               oscillator mode No division

                                           XIN clock off                                     -- 3.0 -- mA
                                           High-speed on-chip oscillator on fOCO-F = 20 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN clock off                                     --  1  -- mA
                                           High-speed on-chip oscillator on fOCO-F = 4 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-16, MSTIIC=MSTTRC=1

                               Low-speed   XIN clock off                                     -- 90 400 A

                               on-chip     High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                               oscillator mode Divide-by-8, FMR27 = 1, VCA20 = 0

                               Wait mode   XIN clock off                                     -- 15 100 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock operation
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                           XIN clock off                                     --  4  90 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                           XIN clock off                                     -- 3.5 -- A
                                           High-speed on-chip oscillator off                 -- 2.0 5.0 A
                                           Low-speed on-chip oscillator off
                                           While a WAIT instruction is executed
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode   XIN clock off, Topr = 25 C
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

                                           XIN clock off, Topr = 85 C                       -- 15 -- A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

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Timing Requirements (Unless Otherwise Specified: VCC = 5 V, VSS = 0 V, Topr = 25 C)

Table 5.18 External Clock Input (XOUT)

Symbol                                         Parameter                         Standard      Unit

                                                                             Min.     Max.

tc(XOUT)    XOUT input cycle time                                            50            --  ns
tWH(XOUT)   XOUT input "H" width
tWL(XOUT)   XOUT input "L" width                                             24            --  ns

                                                                             24            --  ns

                                                          tC(XOUT)                    VCC = 5 V
                                                                  tWL(XOUT)
                                    tWH(XOUT)

External clock input

Figure 5.10 External Clock Input Timing Diagram when VCC = 5 V

Table 5.19 TRAIO Input

Symbol                                         Parameter                         Standard      Unit

                                                                             Min.     Max.

tc(TRAIO)   TRAIO input cycle time                                           100           --  ns
tWH(TRAIO)  TRAIO input "H" width
tWL(TRAIO)  TRAIO input "L" width                                            40            --  ns

                                                                             40            --  ns

                                                          tC(TRAIO)                   VCC = 5 V
                                                               tWL(TRAIO)
                                    tWH(TRAIO)

TRAIO input

Figure 5.11 TRAIO Input Timing Diagram when VCC = 5 V

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Table 5.20 Serial Interface

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tc(CK)     CLKi input cycle time                                                         200                    --    ns
tW(CKH)    CLKi input "H" width
tW(CKL)    CLKi input "L" width                                                          100                    --    ns
td(C-Q)    TXDi output delay time
th(C-Q)    TXDi hold time                                                                100                    --    ns
tsu(D-C)   RXDi input setup time
th(C-D)    RXDi input hold time                                                          --                     50    ns

i = 0 to 3                                                                                0                      --    ns

                                                                                          50                     --    ns

                                                                                          90                     --    ns

                                                                tC(CK)                             VCC = 5 V
                                                                       tW(CKL)
                                    tW(CKH)

CLKi

TXDi                                                   td(C-Q)                  tsu(D-C)                th(C-Q)
RXDi                                                                                      th(C-D)

Figure 5.12     i = 0 to 3
                Serial Interface Timing Diagram when VCC = 5 V

Table 5.21 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tW(INH)     INTi input "H" width, KIi input "H" width                                     250 (1)                --    ns
tW(INL)     INTi input "L" width, KIi input "L" width
                                                                                          250 (2)                --    ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.

  INTi input                                                                                       VCC = 5 V
  (i = 0 to 4)
  KIi input                         tW(INL)
  (i = 0 to 3)
                                                                tW(INH)
Figure 5.13
                Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi
                when VCC = 5 V

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Table 5.22 Electrical Characteristics (3) [2.7 V  VCC < 4.2 V]

Symbol              Parameter                                 Condition                     Standard                Unit

                                                                                      Min.  Typ. Max.

VOH     Output "H" voltage Other than XOUT Drive capacity High IOH = -5 mA VCC - 0.5 --                        VCC  V

                                                 Drive capacity Low IOH = -1 mA VCC - 0.5 --                   VCC  V

                            XOUT                                        IOH = -200 A 1.0   --                 VCC  V

VOL     Output "L" voltage Other than XOUT Drive capacity High IOL = 5 mA             --    --                 0.5  V

                                                 Drive capacity Low IOL = 1 mA        --    --                 0.5  V

                            XOUT                                        IOL = 200 A  --    --                 0.5  V

VT+-VT- Hysteresis          INT0, INT1, INT2,    VCC = 3.0 V                          0.1   0.4                --   V
                            INT3, INT4,
                            KI0, KI1, KI2, KI3,
                            TRAIO, TRCIOA,
                            TRCIOB, TRCIOC,
                            TRCIOD,
                            USB_VBUS,
                            TRCTRG, TRCCLK,
                            RXD0, RXD1, RXD2,
                            RXD3, CLK0, CLK1,
                            CLK2, CLK3, CTS2,
                            SSI, SCL, SDA,
                            SSO, SSCK, SCS

                            RESET                VCC = 3.0 V                          0.1   0.5                --   V

IIH     Input "H" current                        VI = 3 V, VCC = 3.0 V                --    --                 4.0  A

IIL     Input "L" current                        VI = 0 V, VCC = 3.0 V                --    --                 -4.0 A

RPULLUP Pull-up resistance                       VI = 0 V, VCC = 3.0 V                42    84                 168 k

RfXIN   Feedback            XIN                                                       --    0.3                --   M

        resistance

VRAM    RAM hold voltage                         During stop mode                     1.8   --                 --   V

Note:
     1. 2.7 V  VCC < 4.2 V, Topr = -20 to 85 C (N version), and f(XIN) = 10 MHz, unless otherwise specified.
     2. 3.0 V  VCC < 3.6 V for the USB associated pins.

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Table 5.23 Electrical Characteristics (4) [2.7 V  VCC < 3.3 V]
                   (Topr = -20 to 85 C (N version), unless otherwise specified.)

Symbol  Parameter                                            Condition                                   Standard
                                                                                                  Min. Typ. Max. Unit
ICC     Power supply current High-speed         XIN = 10 MHz (square wave)                         -- 3.5 10 mA

        (VCC = 2.7 to 3.3 V)   clock mode       High-speed on-chip oscillator off
        Single-chip mode,                       Low-speed on-chip oscillator on = 125 kHz
        output pins are open,                   No division                                       -- 1.5 7.5 mA
        other pins are VSS
                                                XIN = 10 MHz (square wave)
                                                High-speed on-chip oscillator off

                                                Low-speed on-chip oscillator on = 125 kHz

                                                Divide-by-8

                               High-speed       XIN clock off                                     -- 7.0 15 mA
                               on-chip          High-speed on-chip oscillator on fOCO-F = 20 MHz
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                No division

                                                XIN clock off                                     -- 3.0 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 20 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8

                                                XIN clock off                                     -- 4.0 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 10 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                No division

                                                XIN clock off                                     -- 1.5 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 10 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8

                                                XIN clock off                                     --  1  -- mA
                                                High-speed on-chip oscillator on fOCO-F = 4 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-16, MSTIIC=MSTTRC=1

                               Low-speed        XIN clock off                                     -- 90 390 A
                               on-chip          High-speed on-chip oscillator off
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8, FMR27 = 1, VCA20 = 0

                               Wait mode        XIN clock off                                     -- 15 90 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock operation
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                     --  4  80 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                     -- 3.5 -- A
                                                High-speed on-chip oscillator off                 -- 2.0 5.0 A
                                                Low-speed on-chip oscillator off
                                                While a WAIT instruction is executed
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode        XIN clock off, Topr = 25 C
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

                                                XIN clock off, Topr = 85 C                       -- 15 -- A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

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Timing requirements (Unless Otherwise Specified: VCC = 3 V, VSS = 0 V, Topr = 25 C)

Table 5.24 External Clock Input (XOUT)

Symbol                                          Parameter                       Standard         Unit

                                                                            Min.      Max.

tc(XOUT)    XOUT input cycle time                                           50            --     ns
tWH(XOUT)   XOUT input "H" width
tWL(XOUT)   XOUT input "L" width                                            24            --     ns

                                                                            24            --     ns

                                                tC(XOUT)                              VCC = 3 V
                                                        tWL(XOUT)
                                    tWH(XOUT)

External clock input

Figure 5.14 External Clock Input Timing Diagram when VCC = 3 V

Table 5.25 TRAIO Input

Symbol                                          Parameter                       Standard         Unit

                                                                            Min.      Max.

tc(TRAIO)   TRAIO input cycle time                                          300           --     ns
tWH(TRAIO)  TRAIO input "H" width
tWL(TRAIO)  TRAIO input "L" width                                           120           --     ns

                                                                            120           --     ns

                                                           tC(TRAIO)                  VCC = 3 V
                                                                tWL(TRAIO)
                                    tWH(TRAIO)

TRAIO input

Figure 5.15 TRAIO Input Timing Diagram when VCC = 3 V

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Table 5.26 Serial Interface

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tc(CK)     CLKi input cycle time                                                         300                    --    ns
tW(CKH)    CLKi input "H" width
tW(CKL)    CLKi Input "L" width                                                          150                    --    ns
td(C-Q)    TXDi output delay time
th(C-Q)    TXDi hold time                                                                150                    --    ns
tsu(D-C)   RXDi input setup time
th(C-D)    RXDi input hold time                                                          --                     80    ns

i = 0 to 3                                                                                0                      --    ns

                                                                                          70                     --    ns

                                                                                          90                     --    ns

                                                                tC(CK)                             VCC = 3 V
                                                                       tW(CKL)
                                    tW(CKH)

CLKi

TXDi                                                   td(C-Q)                  tsu(D-C)                th(C-Q)
RXDi                                                                                      th(C-D)

Figure 5.16      i = 0 to 3
                 Serial Interface Timing Diagram when VCC = 3 V

Table 5.27 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tW(INH)     INTi input "H" width, KIi input "H" width                                     380 (1)                --    ns
tW(INL)     INTi input "L" width, KIi input "L" width
                                                                                          380 (2)                --    ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.

   INTi input                                                                                      VCC = 3 V
   (i = 0 to 4)
   KIi input                        tW(INL)
   (i = 0 to 3)
                                                                tW(INH)
Figure 5.17
                 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi
                 when VCC = 3 V

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Table 5.28 Electrical Characteristics (5) [1.8 V  VCC < 2.7 V]

Symbol              Parameter                    Condition                                  Standard                     Unit

                                                                                      Min.                    Typ. Max.

VOH     Output "H" voltage Other than XOUT       Drive capacity High IOH = -2 mA VCC - 0.5 --                       VCC  V

                                                 Drive capacity Low IOH = -1 mA VCC - 0.5 --                        VCC  V

                            XOUT                                        IOH = -200 A 1.0                     --    VCC  V

VOL     Output "L" voltage Other than XOUT Drive capacity High IOL = 2 mA             --                      --    0.5  V

                                                 Drive capacity Low IOL = 1 mA        --                      --    0.5  V

                            XOUT                                        IOL = 200 A  --                      --    0.5  V

VT+-VT- Hysteresis          NT0, INT1, INT2,                                          0.05                    0.20  --   V
                            INT3, INT4,
                            KI0, KI1, KI2, KI3,
                            TRAIO, TRCIOA,
                            TRCIOB, TRCIOC,
                            TRCIOD, TRCTRG,
                            TRCCLK, RXD0,
                            RXD1, RXD2, RXD3,
                            CLK0, CLK1, CLK2,
                            CLK3, CTS2, SSI,
                            SCL, SDA, SSO,
                            SSCK, SCS

                            RESET                                                     0.05                    0.20  --   V

IIH     Input "H" current                        VI = 2.2 V, VCC = 2.2 V              --                      --    4.0  A

IIL     Input "L" current                        VI = 0 V, VCC = 2.2 V                --                      --    -4.0 A

RPULLUP Pull-up resistance                       VI = 0 V, VCC = 2.2 V                70                      140   300  k

RfXIN   Feedback            XIN                                                       --                      0.3   --   M

        resistance

VRAM    RAM hold voltage                         During stop mode                     1.8                     --    --   V

Note:
     1. 1.8 V  VCC < 2.7 V, Topr = -20 to 85 C (N version), and f(XIN) = 5 MHz, unless otherwise specified.

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Table 5.29 Electrical Characteristics (6) [1.8 V  VCC < 2.7 V]
                   (Topr = -20 to 85 C (N version), unless otherwise specified.)

Symbol  Parameter                                            Condition                                  Standard
                                                                                                                                 Unit
ICC     Power supply current High-speed         XIN = 5 MHz (square wave)
                                                                                                 Min. Typ. Max.
                                                                                                  -- 2.2 -- mA

        (VCC = 1.8 to 2.7 V)   clock mode       High-speed on-chip oscillator off
        Single-chip mode,                       Low-speed on-chip oscillator on = 125 kHz
        output pins are open,                   No division                                      -- 0.8 -- mA
        other pins are VSS
                                                XIN = 5 MHz (square wave)
                                                High-speed on-chip oscillator off

                                                Low-speed on-chip oscillator on = 125 kHz

                                                Divide-by-8

                               High-speed       XIN clock off                                    -- 2.5 10 mA
                               on-chip          High-speed on-chip oscillator on fOCO-F = 5 MHz
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                No division

                                                XIN clock off                                    -- 1.7 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 5 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8

                                                XIN clock off                                    --  1   -- mA
                                                High-speed on-chip oscillator on fOCO-F = 4 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-16, MSTIIC=MSTTRC=1

                               Low-speed        XIN clock off                                    -- 90 300 A
                               on-chip          High-speed on-chip oscillator off
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8, FMR27 = 1, VCA20 = 0

                               Wait mode        XIN clock off                                    -- 15 90 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock operation
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                    --  4   80 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                    -- 3.5 -- A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                While a WAIT instruction is executed
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode        XIN clock off, Topr = 25 C                      -- 2.0  5  A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

                                                XIN clock off, Topr = 85 C                      -- 15 -- A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

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Timing requirements (Unless Otherwise Specified: VCC = 2.2 V, VSS = 0 V, Topr = 25 C)

Table 5.30 External Clock Input (XOUT)

Symbol                                          Parameter                       Standard      Unit

                                                                            Min.        Max.

tc(XOUT)    XOUT input cycle time                                           200           --   ns
tWH(XOUT)   XOUT input "H" width
tWL(XOUT)   XOUT input "L" width                                            90            --   ns

                                                                            90            --   ns

                                                tC(XOUT)                          VCC = 2.2 V
                                                        tWL(XOUT)
                                    tWH(XOUT)

External clock input

Figure 5.18 External Clock Input Timing Diagram when VCC = 2.2 V

Table 5.31 TRAIO Input

Symbol                                          Parameter                       Standard      Unit

                                                                            Min.        Max.

tc(TRAIO)   TRAIO input cycle time                                          500           --   ns
tWH(TRAIO)  TRAIO input "H" width
tWL(TRAIO)  TRAIO input "L" width                                           200           --   ns

                                                                            200           --   ns

                                                           tC(TRAIO)              VCC = 2.2 V
                                                                tWL(TRAIO)
                                    tWH(TRAIO)

TRAIO input

Figure 5.19 TRAIO Input Timing Diagram when VCC = 2.2 V

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Table 5.32 Serial Interface

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tc(CK)     CLKi input cycle time                                                         800                    --    ns
tW(CKH)    CLKi input "H" width
tW(CKL)    CLKi input "L" width                                                          400                    --    ns
td(C-Q)    TXDi output delay time
th(C-Q)    TXDi hold time                                                                400                    --    ns
tsu(D-C)   RXDi input setup time
th(C-D)    RXDi input hold time                                                          --                     200   ns

i = 0 to 3                                                                                0                      --    ns

                                                                                          150                    --    ns

                                                                                          90                     --    ns

                                                                tC(CK)                              VCC = 2.2 V
                                                                       tW(CKL)
                                    tW(CKH)

CLKi

TXDi                                                   td(C-Q)                  tsu(D-C)                th(C-Q)
RXDi                                                                                      th(C-D)

Figure 5.20      i = 0 to 3
                 Serial Interface Timing Diagram when VCC = 2.2 V

Table 5.33 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tW(INH)     INTi input "H" width, KIi input "H" width                                     1000 (1)               --    ns
tW(INL)     INTi input "L" width, KIi input "L" width
                                                                                          1000 (2)               --    ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.

   INTi input                                                                                       VCC = 2.2 V
   (i = 0 to 4)
   KIi input                        tW(INL)
   (i = 0 to 3)
                                                                tW(INH)
Figure 5.21
                 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi
                 when VCC = 2.2 V

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5.2 R8C/3MK Group

Table 5.34 Absolute Maximum Ratings

Symbol                     Parameter                   Condition  Rated Value        Unit
                                       -20C  Topr  85C
VCC/AVCC Supply voltage                                           -0.3 to 6.5        V

VI      Input voltage                                             -0.3 to VCC + 0.3  V

VO      Output voltage                                            -0.3 to VCC + 0.3  V

Pd      Power dissipation                                         500                mW

Topr    Operating ambient temperature                             -20 to 85 (N version) C

Tstg    Storage temperature                                       -65 to 150         C

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Table 5.35 Recommended Operating Conditions (1)

Symbol                               Parameter                                         Conditions         Standard        Unit
VCC/AVCC                      When USB function is used
UVCC                          When USB function is not used                       VCC/AVCC = 3.0 to   Min. Typ. Max.         V
                              When USB function is used                           3.6 V                                      V
VSS/AVSS   Supply voltage                                                                             3.0  5.0       5.5     V
VIH                           When USB function is not used                       VCC/AVCC = 1.8 to
           USB Supply                                                             5.5 V               1.8  5.0       5.5     V
VIL        Voltage (When
           UVCC pin is                                                            4.0 V  VCC  5.5 V   --   VCC/      --      V
IOH(sum)   input)                                                                 2.7 V  VCC < 4.0 V                         V
IOH(sum)                                                                          1.8 V  VCC < 2.7 V       AVCC              V
IOH(peak)                                                                         4.0 V  VCC  5.5 V                          V
IOH(avg)                                                                          2.7 V  VCC < 4.0 V       (4)               V
IOL(sum)                                                                          1.8 V  VCC < 2.7 V                         V
IOL(sum)                                                                          4.0 V  VCC  5.5 V   --   VCC/      --      V
IOL(peak)                                                                         2.7 V  VCC < 4.0 V                         V
IOL(avg)                                                                          1.8 V  VCC < 2.7 V       AVCC              V
f(XIN)                                                                                                                       V
fOCO40M                                                                           4.0 V  VCC  5.5 V        (4)               V
fOCO-F                                                                            2.7 V  VCC < 4.0 V                         V
--         Supply voltage                                                         1.8 V  VCC < 2.7 V  --   0         --      V
f(BCLK)    Input "H" voltage Other than CMOS input                                4.0 V  VCC  5.5 V                          V
tsu(PLL)                                                                          2.7 V  VCC < 4.0 V  0.8 VCC --     VCC     V
                                   CMOS Input level Input level selection:        1.8 V  VCC < 2.7 V                         V
                                   input switching 0.35 VCC                       4.0 V  VCC  5.5 V   0.5 VCC --     VCC     V
                                                                                  2.7 V  VCC < 4.0 V                         V
                                               function                           1.8 V  VCC < 2.7 V  0.55 VCC --    VCC     V
                                               (I/O port) Input level selection:                                             V
                                                                                  2.7 V  VCC  5.5 V   0.65 VCC --    VCC     V
                                                               0.5 VCC            1.8 V  VCC < 2.7 V                         V
                                                                                  2.7 V  VCC  5.5 V   0.65 VCC --    VCC     V
                                                                                  2.7 V  VCC  5.5 V                        mA
                                                                                  1.8 V  VCC < 2.7 V  0.7 VCC --     VCC
                                                                                  2.7 V  VCC  5.5 V                        mA
                                                                                  1.8 V  VCC < 2.7 V  0.8 VCC --     VCC
                                                                                  2.7 V  VCC  5.5 V                        mA
                                                  Input level selection:          1.8 V  VCC < 2.7 V  0.85 VCC --    VCC   mA
                                                  0.7 VCC                         4.0 V  VCC  5.5 V                        mA
                                                                                  2.7 V  VCC < 4.0 V  0.85 VCC --    VCC   mA
                                                                                                                           mA
                                                                                                      0.85 VCC --    VCC
                                                                                                                           mA
                              External clock input (XOUT)                                             1.2  --        VCC
                              Other than CMOS input                                                                        mA
           Input "L" voltage  CMOS Input level Input level selection:                                 0    -- 0.2 VCC      mA
                              input switching 0.35 VCC                                                                     mA
                                                                                                      0    -- 0.2 VCC      mA
                                         function                                                                          MHz
                                         (I/O port) Input level selection:                            0    -- 0.2 VCC      MHz
                                                                                                                           MHz
                                                         0.5 VCC                                      0    -- 0.2 VCC      MHz
                                                                                                                           MHz
                                                                                                      0    -- 0.4 VCC      MHz
                                                                                                                           MHz
                                                                                                      0    -- 0.3 VCC      MHz
                                                                                                                           MHz
                                                                                                      0    -- 0.2 VCC       ms
                                                                                                                            ms
                                                  Input level selection:                              0    -- 0.55 VCC
                                                  0.7 VCC
                                                                                                      0    -- 0.45 VCC

                                                                                                      0    -- 0.35 VCC

                              External clock input (XOUT)                                             0    --        0.4

           Peak sum output "H"     Sum of all pins IOH(peak)                                          --   --        -160

           current

           Average sum output "H" Sum of all pins IOH(avg)                                            --   --        -80

           current

           Peak output "H" current Drive capacity Low                                                 --   --        -10

                                   Drive capacity High                                                --   --        -40

           Average output "H"      Drive capacity Low                                                 --   --        -5

           current                 Drive capacity High                                                --   --        -20

           Peak sum output "L"     Sum of all pins IOL(peak)                                          --   --        160

           current

           Average sum output "L" Sum of all pins IOL(avg)                                            --   --        80

           current

           Peak output "L" current Drive capacity Low                                                 --   --        10

                                   Drive capacity High                                                --   --        40

           Average output "L"      Drive capacity Low                                                 --   --        5

           current                 Drive capacity High                                                --   --        20

           XIN clock input oscillation frequency                                                      --   --        20

                                                                                                      --   --        5

           When used as the count source for timer RC (3)                                             32   --        40
           fOCO-F frequency
                                                                                                      --   --        20

                                                                                                      --   --        5

           System clock frequency                                                                     --   --        20

                                                                                                      --   --        5

           CPU clock frequency                                                                        --   --        20

                                                                                                      --   --        5

           PLL frequency symthesizer stabilization wait time                                          --   --        2

                                                                                                      --   --        3

Notes:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. The average output current indicates the average value of current measured during 100 ms.
     3. fOCO40M can be used as the count source for timer RC in the range of VCC = 2.7 to 5.5 V.
     4. Connect VCC/AVCC for the UVCC pin input.

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                              P0

                              P1

                              P3  30pF

                              P4

                              P6

                              P7

                              P8

Figure 5.22 Ports P0, P1, P3, P4, P6, P7 and P8 Timing Measurement Circuit

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Table 5.36 A/D Converter Characteristics

Symbol                 Parameter                             Conditions                         Standard
                                                                                                                           Unit

                                                                                        Min. Typ. Max.

--      Resolution                              Vref = AVCC                             --   --  10 Bit
--      Absolute accuracy
                                   10-bit mode  Vref = AVCC = 5.0 V  AN0, AN3 to AN7    --   --  3 LSB
AD                                                                   input,
--                                                                   AN8 to AN11 input
tCONV
tSAMP                                           Vref = AVCC = 3.3 V  AN0, AN3 to AN7    --   --  5 LSB
IVref                                                                input,
Vref                                                                 AN8 to AN11 input
VIA
OCVREF                                          Vref = AVCC = 3.0 V  AN0, AN3 to AN7    --   --  5 LSB
                                                                     input,
                                                                     AN8 to AN11 input

                                                Vref = AVCC = 2.2 V  AN0, AN3 to AN7    --   --  5 LSB
                                                                     input,
                                                                     AN8 to AN11 input

                                   8-bit mode   Vref = AVCC = 5.0 V  AN0, AN3 to AN7    --   --  2 LSB
                                                                     input,
                                                                     AN8 to AN11 input

                                                Vref = AVCC = 3.3 V  AN0, AN3 to AN7    --   --  2 LSB
                                                                     input,
                                                                     AN8 to AN11 input

                                                Vref = AVCC = 3.0 V  AN0, AN3 to AN7    --   --  2 LSB
                                                                     input,
                                                                     AN8 to AN11 input

                                                Vref = AVCC = 2.2 V  AN0, AN3 to AN7    --   --  2 LSB
                                                                     input,
                                                                     AN8 to AN11 input

        A/D conversion clock                    4.0 V  Vref = AVCC  5.5 V (2)           2    --  20 MHz

                                                3.2 V  Vref = AVCC  5.5 V (2)           2    --  16 MHz

                                                2.7 V  Vref = AVCC  5.5 V (2)           2    --  10 MHz

                                                2.2 V  Vref = AVCC  5.5 V (2)           2    --  5 MHz

        Tolerance level impedance                                                       --   3   --  k

        Conversion time            10-bit mode  Vref = AVCC = 5.0 V, AD = 20 MHz        2.2  --  --  s
                                                Vref = AVCC = 5.0 V, AD = 20 MHz
                                   8-bit mode   AD = 20 MHz                             2.2  --  --  s
                                                VCC = 5.0 V, XIN = f1 = AD = 20 MHz
        Sampling time                                                                   0.8  --  --  s

        Vref current                                                                    --   45  --  A

        Reference voltage                                                               2.2  -- AVCC V

        Analog input voltage(3)                                                         0    --  Vref V

        On-chip reference voltage               2 MHz  AD  4 MHz                        1.19 1.34 1.49 V

Notes:
     1. VCC/AVCC = Vref = 2.2 to 5.5 V, VSS = 0 V, and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. The A/D conversion result will be undefined in wait mode, stop mode, when the flash memory stops, and in low-current-
         consumption mode. Do not perform A/D conversion in these states or transition to these states during A/D conversion.
     3. When the analog input voltage is over the reference voltage, the A/D conversion result will be 3FFh in 10-bit mode and FFh in
         8-bit mode.

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Table 5.37 Comparator B Electrical Characteristics

Symbol  Parameter                               Condition                                          Standard        Unit

                                                                                             Min.  Typ.      Max.
                                                                                               0
Vref    IVREF1, IVREF3 input reference voltage                                                     --        VCC - 1.4 V
VI      IVCMP1, IVCMP3 input voltage                                                         -0.3
--      Offset                                                                                --   --        VCC + 0.3 V
td      Comparator output delay time (2)                                                      --
ICMP    Comparator operating current                                                          --   5         100   mV

                                                VI = Vref 100 mV                                 0.1       --    s
                                                VCC = 5.0 V
                                                                                                   17.5      --    A

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. When the digital filter is disabled.

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R8C/3MU Group, R8C/3MK Group                                                         5. Electrical Characteristics

Table 5.38 USB Characteristics

Symbol                      Parameter                                     Condition          Standard
                                                                                                                      Unit
                         Input "H" voltage                    Figures 5.23 and 5.24
                         Input "L" voltage                                           Min. Typ. Max.
                         Differential input sensitivity       Figures 5.23 and 5.24
VIH     Input            Differential common mode range       ICH = 200A            2.0 --                             --   V
                         Output "H" voltage                   Figures 5.23 and 5.24
VIL     characteristics                                       ICL = 2 mA             --   --                            0.8  V
                         Output "L" voltage                   Figures 5.23 and 5.24
VDI                                                           Figures 5.23 and 5.24  0.2 --                             --   V
                                                              Figures 5.23 and 5.24
VCM                                                           Figures 5.23 and 5.24  0.8  --                            2.5  V
                                                              (tR/tF)
VOH     Output                                                Figures 5.23 and 5.24  2.8 --                             --   V
                                                              Includes RS = 27
        characteristics                                       VCC = 4.0 to 5.5V,
                                                              PXXCON = VDDUSBE = 1
VOL                                                           PXXCON = 0             --   --                            0.3  V
                                                              VCC = 4.0 to 5.5 V
VCRS                     Crossover voltage                    UVCC - VSS 0.33 F     1.3  --                            2.0  V
tR                       Rise time                            VCC - VSS 0.1 F
tF                       Fall time                                                   4.0 -- 20.0 ns
tRFM                     Rise time / Fall time matching
                                                                                     4.0 -- 20.0 ns

                                                                                     90.0 -- 111.1 %

ZDRV                     Output resistance                                           28   -- 44.0

UVCC UVCC output voltage                                                             3.0 3.3 3.6                             V

                                                                                     --   VCC                           --   V

Isusp   Consumption current of the Internal power supply for                              50                                 A

        USB

Note:
     1. Referenced to VCC = 3.0 to 5.5 V, UVCC = 3.0 V, at Topr = -20 to 85 C (N version) unless otherwise specified.

        D+ D-            VCRS       Rising time                Falling time               Differential
                                                   90 %       90 %                        Date Lines

                                10 %                                          10 %
                                            tR                          tF

Figure 5.23 Data Signal Timing Diagram

                                D+ RS = 27                    Test point
                                D- RS = 27                    Test point

    Figure 5.24 Load Condition                                                                                          Page 65 of 88

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Table 5.39 Flash Memory (Program ROM) Electrical Characteristics

Symbol                    Parameter                  Conditions                              Standard              Unit

                                                                                    Min.     Typ.      Max.        times
                                                                                  1,000 (3)                         s
--          Program/erase endurance (2)                                                      --        --            s
--          Byte program time                                                         --                            ms
--          Block erase time                                                          --     80        500
td(SR-SUS)  Time delay from suspend request until                                     --                            s
            suspend                                                                          0.3       --
--          Interval from erase start/restart until                                   0
            following suspend request                                                        --    5 + CPU clock
--          Time from suspend until erase restart                                     --
                                                                                                       3 cycles

                                                                                             --        --

                                                                                             -- 30 + CPU clock s
                                                                                                            1 cycle

td(CMDRST Time from when command is forcibly                                      -          -     30 + CPU clock s

-READY) stopped until reading is enabled                                                                1 cycle

--          Program, erase voltage                                                2.7        --        5.5         V

--          Read voltage                                                          1.8        --        5.5         V

--          Program, erase temperature                                            0          --        60          C

--          Data hold time (7)                       Ambient temperature = 55 C  20         --        --          year

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = 0 to 60 C, unless otherwise specified.
     2. Definition of programming/erasure endurance
         The programming and erasure endurance is defined on a per-block basis.
         If the programming and erasure endurance is n (n = 1,000), each block can be erased n times. For example, if 1,024 1-byte
         writes are performed to different addresses in block A, a 1 Kbyte block, and then the block is erased, the
         programming/erasure endurance still stands at one. However, the same address must not be programmed more than once
         per erase operation (overwriting prohibited).
     3. Endurance to guarantee all electrical characteristics after program and erase. (1 to Min. value can be guaranteed.)
     4. In a system that executes multiple programming operations, the actual erasure count can be reduced by writing to sequential
         addresses in turn so that as much of the block as possible is used up before performing an erase operation. For example,
         when programming groups of 16 bytes, the effective number of rewrites can be minimized by programming up to 128 groups
         before erasing them all in one operation. It is also advisable to retain data on the erasure endurance of each block and limit
         the number of erase operations to a certain number.
     5. If an error occurs during block erase, attempt to execute the clear status register command, then execute the block erase
         command at least three times until the erase error does not occur.
     6. Customers desiring program/erase failure rate information should contact their Renesas technical support representative.
     7. The data hold time includes time that the power supply is off or the clock is not supplied.

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Table 5.40 Flash Memory (Data flash Block A to Block D) Electrical Characteristics

Symbol                    Parameter                  Conditions                      Min.     Standard        Max.  Unit
                                                                                  10,000 (3)  Typ.             --
--          Program/erase endurance (2)                                                        --                   times
--                                                                                    --      160             1500   s
--          Byte program time
--          (program/erase endurance  1,000 times)                                    --      300             1500  s
--
td(SR-SUS)  Byte program time                                                         --      0.2             1     s
--          (program/erase endurance > 1,000 times)
--                                                                                    --      0.3             1     s
            Block erase time
            (program/erase endurance  1,000 times)                                    --      -- 5 + CPU clock ms
                                                                                                          3 cycles
            Block erase time                                                           0
            (program/erase endurance > 1,000 times)                                           --              --    s
                                                                                      --
            Time delay from suspend request until                                             -- 30 + CPU clock s
            suspend                                                                    -                   1 cycle

            Interval from erase start/restart until                                   2.7
            following suspend request                                                 1.8
                                                                                     -20
            Time from suspend until erase restart                                     20

td(CMDRST Time from when command is forcibly                                                  - 30 + CPU clock s
-READY) stopped until reading is enabled                                                                   1 cycle

--          Program, erase voltage                                                            --              5.5   V

--          Read voltage                                                                      --              5.5   V

--          Program, erase temperature                                                        --              85    C

--          Data hold time (7)                       Ambient temperature = 55 C              --              --    year

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. Definition of programming/erasure endurance
         The programming and erasure endurance is defined on a per-block basis.
         If the programming and erasure endurance is n (n = 10,000), each block can be erased n times. For example, if 1,024 1-byte
         writes are performed to different addresses in block A, a 1 Kbyte block, and then the block is erased, the
         programming/erasure endurance still stands at one. However, the same address must not be programmed more than once
         per erase operation (overwriting prohibited).
     3. Endurance to guarantee all electrical characteristics after program and erase. (1 to Min. value can be guaranteed.)
     4. In a system that executes multiple programming operations, the actual erasure count can be reduced by writing to sequential
         addresses in turn so that as much of the block as possible is used up before performing an erase operation. For example,
         when programming groups of 16 bytes, the effective number of rewrites can be minimized by programming up to 128 groups
         before erasing them all in one operation. In addition, averaging the erasure endurance between blocks A to D can further
         reduce the actual erasure endurance. It is also advisable to retain data on the erasure endurance of each block and limit the
         number of erase operations to a certain number.
     5. If an error occurs during block erase, attempt to execute the clear status register command, then execute the block erase
         command at least three times until the erase error does not occur.
     6. Customers desiring program/erase failure rate information should contact their Renesas technical support representative.
     7. The data hold time includes time that the power supply is off or the clock is not supplied.

             Suspend request
                   (FMR21 bit)

                        FST7 bit
                        FST6 bit

                                                     Fixed time  Clock-dependent
                                                                         time
                                                                                              Access restart

                                                                 td(SR-SUS)

Figure 5.25   FST6, FST7: Bit in FST register
              FMR21: Bit in FMR2 register

             Time delay until Suspend

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Table 5.41 Voltage Detection 0 Circuit Electrical Characteristics

Symbol                        Parameter                          Condition                            Standard
                                                                                                                                  Unit

                                                                                             Min. Typ. Max.

Vdet0    Voltage detection level Vdet0_0 (2)                                                 1.80 1.90 2.05  V

         Voltage detection level Vdet0_1 (2)                                                 2.15 2.35 2.50  V

         Voltage detection level Vdet0_2 (2)                                                 2.70 2.85 3.05  V

         Voltage detection level Vdet0_3 (2)                                                 3.55 3.80 4.05  V

--       Voltage detection 0 circuit response time (4)           At the falling of VCC from  --  6     150 s

                                                                 5.0 V to (Vdet0_0 - 0.1) V

--       Voltage detection circuit self power consumption        VCA25 = 1, VCC = 5.0 V      --  1.5   --    A

td(E-A)  Waiting time until voltage detection circuit operation                              --  --    100 s
         starts (3)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version).
     2. Select the voltage detection level with bits VDSEL0 and VDSEL1 in the OFS register.
     3. Necessary time until the voltage detection circuit operates when setting to 1 again after setting the VCA25 bit in the VCA2
         register to 0.
     4. Time until the voltage monitor 0 reset is generated after the voltage passes Vdet0.

Table 5.42 Voltage Detection 1 Circuit Electrical Characteristics

Symbol                        Parameter                          Condition                            Standard
                                                                                                                                  Unit

                                                                                             Min. Typ. Max.

Vdet1    Voltage detection level Vdet1_0 (2)                     At the falling of VCC       2.00 2.20 2.40  V

         Voltage detection level Vdet1_1 (2)                     At the falling of VCC       2.15 2.35 2.55  V

         Voltage detection level Vdet1_2 (2)                     At the falling of VCC       2.30 2.50 2.70  V

         Voltage detection level Vdet1_3 (2)                     At the falling of VCC       2.45 2.65 2.85  V

         Voltage detection level Vdet1_4 (2)                     At the falling of VCC       2.60 2.80 3.00  V

         Voltage detection level Vdet1_5 (2)                     At the falling of VCC       2.75 2.95 3.15  V

         Voltage detection level Vdet1_6 (2)                     At the falling of VCC       2.85 3.10 3.40  V

         Voltage detection level Vdet1_7 (2)                     At the falling of VCC       3.00 3.25 3.55  V

         Voltage detection level Vdet1_8 (2)                     At the falling of VCC       3.15 3.40 3.70  V

         Voltage detection level Vdet1_9 (2)                     At the falling of VCC       3.30 3.55 3.85  V

         Voltage detection level Vdet1_A (2)                     At the falling of VCC       3.45 3.70 4.00  V

         Voltage detection level Vdet1_B (2)                     At the falling of VCC       3.60 3.85 4.15  V

         Voltage detection level Vdet1_C (2)                     At the falling of VCC       3.75 4.00 4.30  V

         Voltage detection level Vdet1_D (2)                     At the falling of VCC       3.90 4.15 4.45  V

         Voltage detection level Vdet1_E (2)                     At the falling of VCC       4.05 4.30 4.60  V

         Voltage detection level Vdet1_F (2)                     At the falling of VCC       4.20 4.45 4.75  V

--       Hysteresis width at the rising of VCC in voltage        Vdet1_0 to Vdet1_5          --  0.07  --    V

         detection 1 circuit                                     selected

                                                                 Vdet1_6 to Vdet1_F          --  0.10  --    V
                                                                 selected

--       Voltage detection 1 circuit response time (3)           At the falling of VCC from  --  60    150 s

                                                                 5.0 V to (Vdet1_0 - 0.1) V

--       Voltage detection circuit self power consumption        VCA26 = 1, VCC = 5.0 V      --  1.7   --    A

td(E-A)  Waiting time until voltage detection circuit operation                              --  --    100 s
         starts (4)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version).
     2. Select the voltage detection level with bits VD1S0 to VD1S3 in the VD1LS register.
     3. Time until the voltage monitor 1 interrupt request is generated after the voltage passes Vdet1.
     4. Necessary time until the voltage detection circuit operates when setting to 1 again after setting the VCA26 bit in the VCA2
         register to 0.

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Table 5.43 Voltage Detection 2 Circuit Electrical Characteristics

Symbol                        Parameter                          Condition                                             Standard
                                                                                                                                                   Unit

                                                                                                              Min. Typ. Max.

Vdet2    Voltage detection level Vdet2_0                         At the falling of VCC                        3.70 4.00 4.30       V

--       Hysteresis width at the rising of VCC in voltage                                                     --  0.10       --    V

         detection 2 circuit

--       Voltage detection 2 circuit response time (2)           At the falling of VCC from                   --  20         150 s

                                                                 5.0 V to (Vdet2_0 - 0.1) V

--       Voltage detection circuit self power consumption        VCA27 = 1, VCC = 5.0 V                       --  1.7        --    A

td(E-A)  Waiting time until voltage detection circuit operation                                               --  --         100 s
         starts (3)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version).
     2. Time until the voltage monitor 2 interrupt request is generated after the voltage passes Vdet2.
     3. Necessary time until the voltage detection circuit operates after setting to 1 again after setting the VCA27 bit in the VCA2
         register to 0.

Table 5.44 Power-on Reset Circuit (2)

Symbol                        Parameter                                    Condition                  Standard
                                                                                                                                    Unit
                                                                 (1)
                                                                                             Min. Typ. Max.

trth     External power VCC rise gradient                                                                  0      -- 50,000 mV/msec

Notes:
     1. The measurement condition is Topr = -20 to 85 C (N version), unless otherwise specified.
     2. To use the power-on reset function, enable voltage monitor 0 reset by setting the LVDAS bit in the OFS register to 0.

     Vdet0 (1)                                                                                                          Vdet0 (1)

   External                      trth                                                                trth
Power VCC       tw(por) (2)
                                                         Voltage detection 0
       0.5 V                                            circuit response time

     Internal
reset signal

                                              1 32                                                                 1 32
                                           fOCO-S                                                                 fOCO-S

       Notes:
          1. Vdet0 indicates the voltage detection level of the voltage detection 0 circuit. Refer to 6. Voltage Detection
              Circuit of User's Manual: Hardware for details.
          2. tw(por) indicates the duration the external power VCC must be held below the valid voltage (0.5 V) to enable
              a power-on reset. When turning on the power after it falls with voltage monitor 0 reset disabled, maintain
              tw(por) for 1 ms or more.

Figure 5.26 Power-on Reset Circuit Electrical Characteristics

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Table 5.45 High-speed On-Chip Oscillator Circuit Electrical Characteristics

Symbol                    Parameter                           Condition                                    Standard        Unit
                                                                                                                           MHz
                                                                                                     Min. Typ. Max.

--       High-speed on-chip oscillator frequency after        VCC = 1.8 V to 5.5 V                   36.0  40        44.0

         reset

         High-speed on-chip oscillator frequency when the     VCC = 1.8 V to 5.5 V                   33.178 36.864 40.550 MHz
         FRA4 register correction value is written into the
         FRA1 register and the FRA5 register correction
         value into the FRA3 register (2)

         High-speed on-chip oscillator frequency when the     VCC = 1.8 V to 5.5 V                   28.8  32        35.2 MHz
         FRA6 register correction value is written into the
         FRA1 register and the FRA7 register correction
         value into the FRA3 register

--       Oscillation stability time                           VCC = 5.0 V, Topr = 25 C              --    0.5       3     ms

--       Self power consumption at oscillation                VCC = 5.0 V, Topr = 25 C              --    400       --    A

Notes:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. This enables the setting errors of bit rates such as 9600 bps and 38400 bps to be 0% when the serial interface is used in
         UART mode.

Table 5.46 Low-speed On-Chip Oscillator Circuit Electrical Characteristics

Symbol                    Parameter                           Condition                                       Standard
                                                                                                                                          Unit

                                                                                                     Min. Typ. Max.

fOCO-S   Low-speed on-chip oscillator frequency                                                      60    125       250 kHz
--       Oscillation stability time
--       Self power consumption at oscillation                VCC = 5.0 V, Topr = 25 C --                 30        100 s

                                                              VCC = 5.0 V, Topr = 25 C --                 2         --    A

Note:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85 C (N version), unless otherwise specified.

Table 5.47 Power Supply Circuit Timing Characteristics

Symbol                    Parameter                           Condition                                       Standard
                                                                                                                                          Unit

                                                                                                     Min. Typ. Max.

td(P-R)  Time for internal power supply stabilization during                                         --    -- 2,000 s
         power-on (2)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = 25 C.
     2. Waiting time until the internal power supply generation circuit stabilizes during power-on.

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Table 5.48 Timing Requirements of Synchronous Serial Communication Unit (SSU)

Symbol  Parameter                        Conditions                      Standard                                        Unit

                                                             Min.        Typ.                            Max.           tCYC (2)
                                                                                                          --            tSUCYC
tSUCYC SSCK clock cycle time                                 4           --                               0.6           tSUCYC
                                                                                                          0.6           tCYC (2)
tHI     SSCK clock "H" width                                 0.4         --                                1
tLO                                                                                                        1               s
tRISE   SSCK clock "L" width                                 0.4         --                                1            tCYC (2)
                                                                                                           1
tFALL   SSCK clock rising        Master                      --          --                               --               s
        time                     Slave                                                                    --               ns
tSU                                                          --          --                               --            tCYC (2)
tH                                                                                                                         ns
        SSCK clock falling       Master                      --          --
        time                     Slave
                                                             --          --

        SSO, SSI data input setup time                       100         --

        SSO, SSI data input hold time                        1           --

tLEAD   SCS setup time           Slave                       1tCYC + 50  --
tLAG
tOD     SCS hold time            Slave                       1tCYC + 50  --                              --             ns

        SSO, SSI data output delay time                      --          --                                      1      tCYC (2)
                                                                                                         1.5tCYC + 100     ns
tSA     SSI slave access time            2.7 V  VCC  5.5 V   --          --                              1.5tCYC + 200     ns
                                                                                                         1.5tCYC + 100     ns
                                         1.8 V  VCC < 2.7 V  --          --                              1.5tCYC + 200     ns

tOR     SSI slave out open time          2.7 V  VCC  5.5 V   --          --

                                         1.8 V  VCC < 2.7 V  --          --

Notes:
     1. VCC = 1.8 to 5.5 V, VSS = 0 V, and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. 1tCYC = 1/f1(s)

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4-Wire Bus Communication Mode, Master, CPHS = 1

SCS (output)              VIH or VOH
                             VIL or VOL
                                      tHI       tFALL                                             tRISE

SSCK (output)                              tLO
   (CPOS = 1)                              tHI

SSCK (output)
   (CPOS = 0)

                               tLO              tSUCYC

SSO (output)

                                                                               tOD

SSI (input)

                          tSU  tH

4-Wire Bus Communication Mode, Master, CPHS = 0

SCS (output)              VIH or VOH
                             VIL or VOL
                                      tHI       tFALL                                             tRISE

SSCK (output)                              tLO
   (CPOS = 1)                              tHI

SSCK (output)
   (CPOS = 0)

                               tLO               tSUCYC

SSO (output)

                                                                                             tOD

SSI (input)

                               tSU         tH

CPHS, CPOS: Bits in SSMR register

Figure 5.27 I/O Timing of Synchronous Serial Communication Unit (SSU) (Master)

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4-Wire Bus Communication Mode, Slave, CPHS = 1

SCS (input)                    VIH or VOH
                                  VIL or VOL

                                           tLEAD  tHI                   tFALL         tRISE             tLAG
                                                                                                              tOR
SSCK (input)                                               tLO
(CPOS = 1)                                                tHI                               tLAG
                                                                                                   tOR
SSCK (input)
(CPOS = 0)

                                                  tLO             tSUCYC

SSO (input)

                                           tSU         tH

SSI (output)

                                      tSA                               tOD

4-Wire Bus Communication Mode, Slave, CPHS = 0

                               VIH or VOH

SCS (input)

                               VIL or VOL

                               tLEAD       tHI             tFALL               tRISE

SSCK (input)                                      tLO
(CPOS = 1)                                       tHI

SSCK (input)
(CPOS = 0)

                                           tLO                  tSUCYC

SSO (input)

                                           tSU         tH

SSI (output)

                          tSA                                           tOD

                                CPHS, CPOS: Bits in SSMR register

Figure 5.28 I/O Timing of Synchronous Serial Communication Unit (SSU) (Slave)

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                                     tHI

             VIH or VOH

SSCK

             VIL or VOL                   tSUCYC
                                tLO

SSO (output)

                                                                                             tOD

SSI (input)

                              tSU    tH

Figure 5.29 I/O Timing of Synchronous Serial Communication Unit (SSU) (Clock Synchronous
                     Communication Mode)

R01DS0112EJ0110 Rev.1.10                                                                          Page 74 of 88
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Table 5.49 Timing Requirements of I2C bus Interface

Symbol                        Parameter                     Condition                      Standard                               Unit
                                                                                                                    Max.
                                                                                     Min.                Typ.

tSCL    SCL input cycle time                                           12tCYC + 600 (2)                  --         --     ns
tSCLH   SCL input "H" width
tSCLL   SCL input "L" width                                            3tCYC + 300 (2)                   --         --     ns
tsf     SCL, SDA input fall time
tSP     SCL, SDA input spike pulse rejection time                      5tCYC + 500 (2)                   --         --     ns

                                                                                     --                  --         300    ns

                                                                                     --                  --    1tCYC (2)   ns

tBUF    SDA input bus-free time                                        5tCYC (2)                         --         --     ns
tSTAH   Start condition input hold time
tSTAS   Retransmit start condition input setup time                    3tCYC (2)                         --         --     ns
tSTOP   Stop condition input setup time
tSDAS   Data input setup time                                          3tCYC (2)                         --         --     ns
tSDAH   Data input hold time
                                                                       3tCYC (2)                         --         --     ns

                                                                       1tCYC + 40 (2)                    --         --     ns

                                                                                     10                  --         --     ns

Notes:
     1. VCC = 1.8 to 5.5 V, VSS = 0 V, and Topr = -20 to 85 C (N version), unless otherwise specified.
     2. 1tCYC = 1/f1(s)

       SDA                      VIH
                                VIL
                   tBUF         tSTAH

                                         tSCLH                                tSTAS                      tSP tSTOP
                                                                       Sr (3)
       SCL

            P (2)        S (1)                                                                                      P (2)

                         tSf    tSCLL          tSr                                         tSDAS

                                         tSCL        tSDAH

            Notes:
                1. Start condition
                2. Stop condition
                3. Retransmit start condition

Figure 5.30 I/O Timing of I2C bus Interface

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Table 5.50 Electrical Characteristics (1) [4.2 V  VCC  5.5 V]

Symbol               Parameter                              Condition                       Standard
                                                                                                                        Unit

                                                                                     Min. Typ. Max.

VOH      Output "H" Other than XOUT       Drive capacity High VCC = 5 V IOH = -20 mA VCC - 2.0 --                 VCC  V

         voltage                          Drive capacity Low VCC = 5 V IOH = -5 mA VCC - 2.0 --                   VCC  V

                     XOUT                 VCC = 5 V                    IOH = -200 A 1.0                      --  VCC  V

VOL      Output "L" Other than XOUT       Drive capacity High VCC = 5 V IOL = 20 mA  --                       --  2.0  V

         voltage                          Drive capacity Low VCC = 5 V IOL = 5 mA    --                       --  2.0  V

                     XOUT                 VCC = 5 V                    IOL = 200 A  --                       --  0.5  V

VT+-VT-  Hysteresis  INT0, INT1, INT2,                                               0.1                      1.2 --   V
                     INT3, INT4,
                     KI0, KI1, KI2, KI3,
                     TRAIO,TRCIOA,
                     TRCIOB, TRCIOC,
                     TRCIOD,
                     USB_OVRCURA,
                     USB_VBUS,
                     TRCTRG, TRCCLK,
                     ADTRG, RXD0,
                     RXD1, RXD2, RXD3,
                     CLK0, CLK1, CLK2,
                     CLK3, CTS2, SSI,
                     SCL, SDA, SSO,
                     SSCK, SCS

                     RESET                                                           0.1                      1.2 --   V

IIH      Input "H" current                VI = 5 V, VCC = 5.0 V                      --                       -- 5.0 A

IIL      Input "L" current                VI = 0 V, VCC = 5.0 V                      --                       -- -5.0 A

RPULLUP Pull-up resistance                VI = 0 V, VCC = 5.0 V                      25                       50 100 k

RfXIN    Feedback XIN                                                                --                       0.3 -- M
         resistance

VRAM     RAM hold voltage                 During stop mode                           1.8                      --  --   V

Note:
     1. 4.2 V  VCC  5.5 V, Topr = -20 to 85 C (N version), and f(XIN) = 20 MHz, unless otherwise specified.

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Table 5.51 Electrical Characteristics (2) [3.3 V  VCC  5.5 V]
                   (Topr = -20 to 85 C (N version), unless otherwise specified.)

Symbol  Parameter                                           Condition                               Standard  Unit
                                                                                             Min. Typ. Max.

ICC     Power supply current High-speed    XIN = 20 MHz (square wave)                        -- 6.5 15 mA

        (VCC = 3.3 to 5.5 V) clock mode    High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
        Single-chip mode,
                                           No division

        output pins are open,              XIN = 16 MHz (square wave)                        -- 5.3 12.5 mA
        other pins are VSS                 High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           No division

                                           XIN = 10 MHz (square wave)                        -- 3.6 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           No division

                                           XIN = 20 MHz (square wave)                        -- 3.0 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN = 16 MHz (square wave)                        -- 2.2 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN = 10 MHz (square wave)                        -- 1.5 -- mA
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                               High-speed  XIN clock off                                     -- 7.0 15 mA

                               on-chip     High-speed on-chip oscillator on fOCO-F = 20 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                               oscillator mode No division

                                           XIN clock off                                     -- 3.0 -- mA
                                           High-speed on-chip oscillator on fOCO-F = 20 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN clock off                                     --  1  -- mA
                                           High-speed on-chip oscillator on fOCO-F = 4 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-16, MSTIIC = MSTTRC = 1

                               Low-speed   XIN clock off                                     -- 90 400 A

                               on-chip     High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                               oscillator mode Divide-by-8, FMR27 = 1, VCA20 = 0

                               Wait mode   XIN clock off                                     -- 15 100 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock operation
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                           XIN clock off                                     --  4  90 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                           XIN clock off                                     -- 3.5 -- A
                                           High-speed on-chip oscillator off                 -- 2.0 5.0 A
                                           Low-speed on-chip oscillator off
                                           While a WAIT instruction is executed
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode   XIN clock off, Topr = 25 C
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

                                           XIN clock off, Topr = 85 C                       -- 15 -- A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

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Timing Requirements (Unless Otherwise Specified: VCC = 5 V, VSS = 0 V, Topr = 25 C)

Table 5.52 External Clock Input (XOUT)

Symbol                                         Parameter                         Standard      Unit

                                                                             Min.     Max.

tc(XOUT)    XOUT input cycle time                                            50            --  ns
tWH(XOUT)   XOUT input "H" width
tWL(XOUT)   XOUT input "L" width                                             24            --  ns

                                                                             24            --  ns

                                                          tC(XOUT)                    VCC = 5 V
                                                                  tWL(XOUT)
                                    tWH(XOUT)

External clock input

Figure 5.31 External Clock Input Timing Diagram when VCC = 5 V

Table 5.53 TRAIO Input

Symbol                                         Parameter                         Standard      Unit

                                                                             Min.     Max.

tc(TRAIO)   TRAIO input cycle time                                           100           --  ns
tWH(TRAIO)  TRAIO input "H" width
tWL(TRAIO)  TRAIO input "L" width                                            40            --  ns

                                                                             40            --  ns

                                                          tC(TRAIO)                   VCC = 5 V
                                                               tWL(TRAIO)
                                    tWH(TRAIO)

TRAIO input

Figure 5.32 TRAIO Input Timing Diagram when VCC = 5 V

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Table 5.54 Serial Interface

Symbol                                         Parameter                                        Standard                 Unit

                                                                                            Min.                   Max.

tc(CK)       CLKi input cycle time                                                         200                    --    ns
tW(CKH)      CLKi input "H" width
tW(CKL)      CLKi input "L" width                                                          100                    --    ns
td(C-Q)      TXDi output delay time
th(C-Q)      TXDi hold time                                                                100                    --    ns
tsu(D-C)     RXDi input setup time
th(C-D)      RXDi input hold time                                                          --                     50    ns

i = 0 to 3                                                                                  0                      --    ns

                                                                                            50                     --    ns

                                                                                            90                     --    ns

                                                                  tC(CK)                             VCC = 5 V
                                                                         tW(CKL)
                                      tW(CKH)

CLKi

TXDi                                                     td(C-Q)                  tsu(D-C)                th(C-Q)
RXDi                                                                                        th(C-D)

Figure 5.33   i = 0 to 3
              Serial Interface Timing Diagram when VCC = 5 V

Table 5.55 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

Symbol                                         Parameter                                        Standard                 Unit

                                                                                            Min.                   Max.

tW(INH)       INTi input "H" width, KIi input "H" width                                     250 (1)                --    ns
tW(INL)       INTi input "L" width, KIi input "L" width
                                                                                            250 (2)                --    ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.

INTi input                                                                                           VCC = 5 V
(i = 0 to 4)
                                      tW(INL)
KIi input
(i = 0 to 3)                                                      tW(INH)

Figure 5.34 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi
                     when VCC = 5 V

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Table 5.56 Electrical Characteristics (3) [2.7 V  VCC < 4.2 V]

Symbol              Parameter                                 Condition                     Standard                Unit

                                                                                      Min.  Typ. Max.

VOH     Output "H" voltage Other than XOUT Drive capacity High IOH = -5 mA VCC - 0.5 --                        VCC  V

                                                 Drive capacity Low IOH = -1 mA VCC - 0.5 --                   VCC  V

                            XOUT                                        IOH = -200 A 1.0   --                 VCC  V

VOL     Output "L" voltage Other than XOUT Drive capacity High IOL = 5 mA             --    --                 0.5  V

                                                 Drive capacity Low IOL = 1 mA        --    --                 0.5  V

                            XOUT                                        IOL = 200 A  --    --                 0.5  V

VT+-VT- Hysteresis          INT0, INT1, INT2,    VCC = 3.0 V                          0.1   0.4                --   V
                            INT3, INT4,
                            KI0, KI1, KI2, KI3,
                            TRAIO, TRCIOA,
                            TRCIOB, TRCIOC,
                            TRCIOD,
                            USB_OVRCURA,
                            USB_VBUS,
                            TRCTRG, TRCCLK,
                            ADTRG, RXD0,
                            RXD1, RXD2, RXD3,
                            CLK0, CLK1, CLK2,
                            CLK3, CTS2, SSI,
                            SCL, SDA, SSO,
                            SSCK, SCS

                            RESET                VCC = 3.0 V                          0.1   0.5                --   V

IIH     Input "H" current                        VI = 3 V, VCC = 3.0 V                --    --                 4.0  A

IIL     Input "L" current                        VI = 0 V, VCC = 3.0 V                --    --                 -4.0 A

RPULLUP Pull-up resistance                       VI = 0 V, VCC = 3.0 V                42    84                 168 k

RfXIN   Feedback            XIN                                                       --    0.3                --   M

        resistance

VRAM    RAM hold voltage                         During stop mode                     1.8   --                 --   V

Note:
     1. 2.7 V  VCC < 4.2 V, Topr = -20 to 85 C (N version), and f(XIN) = 10 MHz, unless otherwise specified.
     2. 3.0 V  VCC < 3.6 V for the USB associated pins.

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Table 5.57 Electrical Characteristics (4) [2.7 V  VCC < 3.3 V]
                   (Topr = -20 to 85 C (N version), unless otherwise specified.)

Symbol  Parameter                                            Condition                                   Standard
                                                                                                  Min. Typ. Max. Unit
ICC     Power supply current High-speed         XIN = 10 MHz (square wave)                         -- 3.5 10 mA

        (VCC = 2.7 to 3.3 V)   clock mode       High-speed on-chip oscillator off
        Single-chip mode,                       Low-speed on-chip oscillator on = 125 kHz
        output pins are open,                   No division                                       -- 1.5 7.5 mA
        other pins are VSS
                                                XIN = 10 MHz (square wave)
                                                High-speed on-chip oscillator off

                                                Low-speed on-chip oscillator on = 125 kHz

                                                Divide-by-8

                               High-speed       XIN clock off                                     -- 7.0 15 mA
                               on-chip          High-speed on-chip oscillator on fOCO-F = 20 MHz
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                No division

                                                XIN clock off                                     -- 3.0 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 20 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8

                                                XIN clock off                                     -- 4.0 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 10 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                No division

                                                XIN clock off                                     -- 1.5 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 10 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8

                                                XIN clock off                                     --  1  -- mA
                                                High-speed on-chip oscillator on fOCO-F = 4 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-16, MSTIIC = MSTTRC = 1

                               Low-speed        XIN clock off                                     -- 90 390 A
                               on-chip          High-speed on-chip oscillator off
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8, FMR27 = 1, VCA20 = 0

                               Wait mode        XIN clock off                                     -- 15 90 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock operation
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                     --  4  80 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                     -- 3.5 -- A
                                                High-speed on-chip oscillator off                 -- 2.0 5.0 A
                                                Low-speed on-chip oscillator off
                                                While a WAIT instruction is executed
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode        XIN clock off, Topr = 25 C
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

                                                XIN clock off, Topr = 85 C                       -- 15 -- A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

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Timing requirements (Unless Otherwise Specified: VCC = 3 V, VSS = 0 V, Topr = 25 C)

Table 5.58 External Clock Input (XOUT)

Symbol                                          Parameter                       Standard         Unit

                                                                            Min.      Max.

tc(XOUT)    XOUT input cycle time                                           50            --     ns
tWH(XOUT)   XOUT input "H" width
tWL(XOUT)   XOUT input "L" width                                            24            --     ns

                                                                            24            --     ns

                                                tC(XOUT)                              VCC = 3 V
                                                        tWL(XOUT)
                                    tWH(XOUT)

External clock input

Figure 5.35 External Clock Input Timing Diagram when VCC = 3 V

Table 5.59 TRAIO Input

Symbol                                          Parameter                       Standard         Unit

                                                                            Min.      Max.

tc(TRAIO)   TRAIO input cycle time                                          300           --     ns
tWH(TRAIO)  TRAIO input "H" width
tWL(TRAIO)  TRAIO input "L" width                                           120           --     ns

                                                                            120           --     ns

                                                           tC(TRAIO)                  VCC = 3 V
                                                                tWL(TRAIO)
                                    tWH(TRAIO)

TRAIO input

Figure 5.36 TRAIO Input Timing Diagram when VCC = 3 V

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Table 5.60 Serial Interface

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tc(CK)     CLKi input cycle time                                                         300                    --    ns
tW(CKH)    CLKi input "H" width
tW(CKL)    CLKi Input "L" width                                                          150                    --    ns
td(C-Q)    TXDi output delay time
th(C-Q)    TXDi hold time                                                                150                    --    ns
tsu(D-C)   RXDi input setup time
th(C-D)    RXDi input hold time                                                          --                     80    ns

i = 0 to 3                                                                                0                      --    ns

                                                                                          70                     --    ns

                                                                                          90                     --    ns

                                                                tC(CK)                             VCC = 3 V
                                                                       tW(CKL)
                                    tW(CKH)

CLKi

TXDi                                                   td(C-Q)                  tsu(D-C)                th(C-Q)
RXDi                                                                                      th(C-D)

Figure 5.37      i = 0 to 3
                 Serial Interface Timing Diagram when VCC = 3 V

Table 5.61 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tW(INH)     INTi input "H" width, KIi input "H" width                                     380 (1)                --    ns
tW(INL)     INTi input "L" width, KIi input "L" width
                                                                                          380 (2)                --    ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.

   INTi input                                                                                      VCC = 3 V
   (i = 0 to 4)
   KIi input                        tW(INL)
   (i = 0 to 3)
                                                                tW(INH)
Figure 5.38
                 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi
                 when VCC = 3 V

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Table 5.62 Electrical Characteristics (5) [1.8 V  VCC < 2.7 V]

Symbol              Parameter                    Condition                                  Standard                     Unit

                                                                                      Min.                    Typ. Max.

VOH     Output "H" voltage Other than XOUT       Drive capacity High IOH = -2 mA VCC - 0.5 --                       VCC  V

                                                 Drive capacity Low IOH = -1 mA VCC - 0.5 --                        VCC  V

                            XOUT                                        IOH = -200 A 1.0                     --    VCC  V

VOL     Output "L" voltage Other than XOUT Drive capacity High IOL = 2 mA             --                      --    0.5  V

                                                 Drive capacity Low IOL = 1 mA        --                      --    0.5  V

                            XOUT                                        IOL = 200 A  --                      --    0.5  V

VT+-VT- Hysteresis          NT0, INT1, INT2,                                          0.05                    0.20  --   V
                            INT3, INT4,
                            KI0, KI1, KI2, KI3,
                            TRAIO, TRCIOA,
                            TRCIOB, TRCIOC,
                            TRCIOD, TRCTRG,
                            TRCCLK, ADTRG,
                            RXD0, RXD1, RXD2,
                            RXD3, CLK0, CLK1,
                            CLK2, CLK3, CTS2,
                            SSI, SCL, SDA,
                            SSO, SSCK, SCS

                            RESET                                                     0.05                    0.20  --   V

IIH     Input "H" current                        VI = 2.2 V, VCC = 2.2 V              --                      --    4.0  A

IIL     Input "L" current                        VI = 0 V, VCC = 2.2 V                --                      --    -4.0 A

RPULLUP Pull-up resistance                       VI = 0 V, VCC = 2.2 V                70                      140   300  k

RfXIN   Feedback            XIN                                                       --                      0.3   --   M

        resistance

VRAM    RAM hold voltage                         During stop mode                     1.8                     --    --   V

Note:
     1. 1.8 V  VCC < 2.7 V, Topr = -20 to 85 C (N version), and f(XIN) = 5 MHz, unless otherwise specified.

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Table 5.63 Electrical Characteristics (6) [1.8 V  VCC < 2.7 V]
                   (Topr = -20 to 85 C (N version), unless otherwise specified.)

Symbol  Parameter                                            Condition                                  Standard
                                                                                                                                 Unit
ICC     Power supply current High-speed         XIN = 5 MHz (square wave)
                                                                                                 Min. Typ. Max.
                                                                                                  -- 2.2 -- mA

        (VCC = 1.8 to 2.7 V)   clock mode       High-speed on-chip oscillator off
        Single-chip mode,                       Low-speed on-chip oscillator on = 125 kHz
        output pins are open,                   No division                                      -- 0.8 -- mA
        other pins are VSS
                                                XIN = 5 MHz (square wave)
                                                High-speed on-chip oscillator off

                                                Low-speed on-chip oscillator on = 125 kHz

                                                Divide-by-8

                               High-speed       XIN clock off                                    -- 2.5 10 mA
                               on-chip          High-speed on-chip oscillator on fOCO-F = 5 MHz
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                No division

                                                XIN clock off                                    -- 1.7 -- mA
                                                High-speed on-chip oscillator on fOCO-F = 5 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8

                                                XIN clock off                                    --  1   -- mA
                                                High-speed on-chip oscillator on fOCO-F = 4 MHz
                                                Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-16, MSTIIC = MSTTRC = 1

                               Low-speed        XIN clock off                                    -- 90 300 A
                               on-chip          High-speed on-chip oscillator off
                               oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                                Divide-by-8, FMR27 = 1, VCA20 = 0

                               Wait mode        XIN clock off                                    -- 15 90 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock operation
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                    --  4   80 A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator on = 125 kHz
                                                While a WAIT instruction is executed
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                                XIN clock off                                    -- 3.5 -- A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                While a WAIT instruction is executed
                                                VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode        XIN clock off, Topr = 25 C                      -- 2.0  5  A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

                                                XIN clock off, Topr = 85 C                      -- 15 -- A
                                                High-speed on-chip oscillator off
                                                Low-speed on-chip oscillator off
                                                CM10 = 1
                                                Peripheral clock off
                                                VCA27 = VCA26 = VCA25 = 0

R01DS0112EJ0110 Rev.1.10                                                                                 Page 85 of 88
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R8C/3MU Group, R8C/3MK Group                                                5. Electrical Characteristics

Timing requirements (Unless Otherwise Specified: VCC = 2.2 V, VSS = 0 V, Topr = 25 C)

Table 5.64 External Clock Input (XOUT)

Symbol                                          Parameter                       Standard      Unit

                                                                            Min.        Max.

tc(XOUT)    XOUT input cycle time                                           200           --   ns
tWH(XOUT)   XOUT input "H" width
tWL(XOUT)   XOUT input "L" width                                            90            --   ns

                                                                            90            --   ns

                                                tC(XOUT)                          VCC = 2.2 V
                                                        tWL(XOUT)
                                    tWH(XOUT)

External clock input

Figure 5.39 External Clock Input Timing Diagram when VCC = 2.2 V

Table 5.65 TRAIO Input

Symbol                                          Parameter                       Standard      Unit

                                                                            Min.        Max.

tc(TRAIO)   TRAIO input cycle time                                          500           --   ns
tWH(TRAIO)  TRAIO input "H" width
tWL(TRAIO)  TRAIO input "L" width                                           200           --   ns

                                                                            200           --   ns

                                                           tC(TRAIO)              VCC = 2.2 V
                                                                tWL(TRAIO)
                                    tWH(TRAIO)

TRAIO input

Figure 5.40 TRAIO Input Timing Diagram when VCC = 2.2 V

R01DS0112EJ0110 Rev.1.10                                                                  Page 86 of 88
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R8C/3MU Group, R8C/3MK Group                                                              5. Electrical Characteristics

Table 5.66 Serial Interface

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tc(CK)     CLKi input cycle time                                                         800                    --    ns
tW(CKH)    CLKi input "H" width
tW(CKL)    CLKi input "L" width                                                          400                    --    ns
td(C-Q)    TXDi output delay time
th(C-Q)    TXDi hold time                                                                400                    --    ns
tsu(D-C)   RXDi input setup time
th(C-D)    RXDi input hold time                                                          --                     200   ns

i = 0 to 3                                                                                0                      --    ns

                                                                                          150                    --    ns

                                                                                          90                     --    ns

                                                                tC(CK)                              VCC = 2.2 V
                                                                       tW(CKL)
                                    tW(CKH)

CLKi

TXDi                                                   td(C-Q)                  tsu(D-C)                th(C-Q)
RXDi                                                                                      th(C-D)

Figure 5.41      i = 0 to 3
                 Serial Interface Timing Diagram when VCC = 2.2 V

Table 5.67 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

Symbol                                       Parameter                                        Standard                 Unit

                                                                                          Min.                   Max.

tW(INH)     INTi input "H" width, KIi input "H" width                                     1000 (1)               --    ns
tW(INL)     INTi input "L" width, KIi input "L" width
                                                                                          1000 (2)               --    ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
         frequency 3) or the minimum value of standard, whichever is greater.

   INTi input                                                                                       VCC = 2.2 V
   (i = 0 to 4)
   KIi input                        tW(INL)
   (i = 0 to 3)
                                                                tW(INH)
Figure 5.42
                 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi
                 when VCC = 2.2 V

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R8C/3MU Group, R8C/3MK Group

Package Dimensions

    Diagrams showing the latest package dimensions and mounting information are available in the "Packages" section of
    the Renesas Electronics website.

R01DS0112EJ0110 Rev.1.10  Page 88 of 88
Jun 15, 2011
REVISION HISTORY         R8C/3MU Group, R8C/3MK Group Datasheet

Rev.  Date         Page                         Description
                                                          Summary

R8C/3MU Group Datasheet (R01DS0037EJ0100)

0.01 May 17, 2010 -- First Edition issued

0.02 Nov 08, 2010 All Package code: "PWQN0040KB-A (previous code: 40PJS-A)"
                                                                   "PWQN0040KB-B (previous code: 40PJS-B)"

                   2     Table 1.1 I/O Ports, DTC revised

                         LIN Module added

                   3     Table 1.2 Package revised

                   4     Table 1.3 revised

                         Figure 1.1 revised

                   5     Figure 1.2 LIN Module, Note 1 and 2 added

                   6     Figure 1.3 revised

                   7     Table 1.4 Part Number 25, 34, 38 revised

                   8     Table 1.5 Serial interface revised

                   13 Figure 3.1 "Part Number" revised

                   15 Table 4.2 004Ah deleted

                   16 Table 4.3 008Ch, 008Dh, 009Ch to 009Fh, 00BCh, 00BEh, 00BFh
                                             deleted

                   20 Table 4.7 0186h deleted

                   25 Table 4.12 2E02h, 2E03h deleted

                   29 Package Dimensions added

1.00 Feb 25, 2011 All pages "Preliminary", "Under development" deleted

                   2     Table 1.1 DTC revised

                   3     Table 1.2 revised

                   4     Table 1.3, Figure 1.1 revised

                   5     Figure 1.2 revised

                   6     Figure 1.3 revised

                   8     Table 1.5 revised

                   13 3.1 revised, Figure 3.1 "Part Number" added

                   15 Table 4.2 0041h revised

                   16 Table 4.3 00BBh revised

                   18 Table 4.5 0133h deleted

                   20 Table 4.7 0181h revised

                   25 Table 4.12 2E04h and 2E05h revised

                   26 Table 4.13 2E40h and 2E41h revised
                                             2E32h, 2E33h, 2E42h, 2E43h, 2E6Eh and 2E6Fh deleted

                   27 Table 4.14 2ED0h to 2EDBh deleted

                   28 Table 4.15 2F04h, 2F11h and 2F13h deleted

                   29 to 54 5. Electrical Characteristics added

R8C/3MK Group Datasheet (R01DS0038EJ0100)

0.01 Jun 30, 2010  --    First Edition issued

0.02 Nov 08, 2010 All Package code: "PWQN0040KB-A (previous code: 40PJS-A)"
                                                                   "PWQN0040KB-B (previous code: 40PJS-B)"

                   2     Table 1.1 I/O Ports, DTC revised

                         LIN Module added

                         C-1
REVISION HISTORY         R8C/3MU Group, R8C/3MK Group Datasheet

Rev.  Date         Page                        Description
                                                         Summary

0.02 Nov 08, 2010  3     Table 1.2 A/D converter, Package revised

                   4     Table 1.3 "(D)"added

                         Table 1.3, Figure 1.1 Package revised

                   5     Figure 1.2 I/O Ports, A/D converter revised

                         LIN Module added

                   6     Figure 1.3 revised

                   7     Table 1.4 Pin Number 2, 7, 9, 22 revised

                   9     Table 1.6 USB "USB_OVRCURA" added

                   14 Table 4.1 0026h "On-Chip Reference Voltage Control Register
                                              OCVREFCR 00h" added

                   15 Table 4.2 004Ah deleted

                   16 Table 4.3 00BBh "UART2 Special Mode Register 5 U2SMR5 XXh"
                                              added
                                              00BDh "UART2 Special Mode Register 3 U2SMR3
                                              000X0X0Xb2" added

                   18 Table 4.5 0105h "LIN Control Register 2 LINCR2 00h" added
                                              0106h "LIN Control Register LINCR 00h" added
                                              0107h "LIN Status Register LINST 00h" added

                   25 Table 4.12 2E02h, 2E03h deleted

                   29 Package Dimensions added

1.00 Feb 25, 2011 All pages "Preliminary", "Under development" deleted

                   3     Table 1.2 revised

                   4     Table 1.3, Figure 1.1 revised

                   5     Figure 1.2 revised

                   6     Figure 1.3 revised

                   7     Table 1.4 revised

                   9     Table 1.6 revised

                   13 3.1 revised, Figure 3.1 "Part Number" added

                   14 Table 4.1 0026h revised

                   15 Table 4.2 0041h revised

                   16 Table 4.3 00BBh revised

                   20 Table 4.7 0181h revised

                   25 Table 4.12 2E04h and 2E05h revised

                   26 Table 4.13 2E40h to 2E43h revised

                   27 Table 4.14 2ED2h to 2ED7h deleted

                   28 Table 4.15 2F04h, 2F11h and 2F13h deleted, 2F10h added

                   29 to 56 5. Electrical Characteristics added

                         C-2
REVISION HISTORY  R8C/3MU Group, R8C/3MK Group Datasheet

Rev.  Date  Page                          Description
                                                    Summary

1.10 Jun 15, 2011 All pages R8C/34MU Group Datasheet (R01DS0037EJ0100) and
                                              R8C/34MK Group Datasheet (R01DS0038EJ0100): revised and
                                              combined into one document

            2     1.1.2, Table 1.1 added

           &nb