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R5F21358MNFP#30

器件型号:R5F21358MNFP#30
器件类别:半导体    嵌入式处理器和控制器   
文件大小:5482.5KB,共8页
厂商名称:Renesas Electronics Corporation
厂商官网:https://www.renesas.com/
标准:  
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器件描述

IC mcu 16bit 64kb flash 52lqfp

参数

Datasheets:
R8C/35M Group:
R8C/35M Group Hardware Manual:
Product Photos:
52-LQFP:
Featured Product:
Flasher Series of Production Tools:
Standard Package : 1
Category: Integrated Circuits (ICs)
Family: Embedded - Microcontrollers
Series: R8C/3x/35M
Packaging : Tray
Core Processor: R8C
Core Size: 16-Bit
Speed: 20MHz
Connectivity: I²C, LIN, SIO, SSU, UART/USART
Peripherals: POR, PWM, Voltage Detect, WDT
Number of I/O: 47
Program Memory Size: 64KB (64K x 8)
Program Memory Type: FLASH
EEPROM Size: -
RAM Size: 6K x 8
Voltage - Supply (Vcc/Vdd): 1.8 V ~ 5.5 V
Data Converters: A/D 12x10b
D/A 2x8b:
Oscillator Type: Internal
Operating Temperature: -20°C ~ 85°C
Package / Case: 52-LQFP
Supplier Device Package: 52-LQFP (10x10)

R5F21358MNFP#30器件文档内容

                          Datasheet

R8C/35M Group             R01DS0021EJ0100
                                        Rev.1.00
RENESAS MCU
                                   Jun 20, 2011

1. Overview

1.1 Features

    The R8C/35M Group of single-chip MCUs incorporates the R8C CPU core, employing sophisticated instructions
    for a high level of efficiency. With 1 Mbyte of address space, and it is capable of executing instructions at high
    speed. In addition, the CPU core boasts a multiplier for high-speed operation processing.
    Power consumption is low, and the supported operating modes allow additional power control. These MCUs are
    designed to maximize EMI/EMS performance.
    Integration of many peripheral functions, including multifunction timer and serial interface, reduces the number of
    system components.
    The R8C/35M Group has data flash (1 KB 4 blocks) with the background operation (BGO) function.

1.1.1 Applications

        Electronic household appliances, office equipment, audio equipment, consumer equipment, etc.

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Jun 20, 2011
R8C/35M Group                                                                                         1. Overview

1.1.2 Specifications

      Tables 1.1 and 1.2 outline the Specifications for R8C/35M Group.

Table 1.1 Specifications for R8C/35M Group (1)

      Item            Function                                        Specification
CPU            Central processing R8C CPU core

               unit               Number of fundamental instructions: 89

                                  Minimum instruction execution time:

                                     50 ns (f(XIN) = 20 MHz, VCC = 2.7 to 5.5 V)
                                     200 ns (f(XIN) = 5 MHz, VCC = 1.8 to 5.5 V)
                                  Multiplier: 16 bits 16 bits  32 bits
                                  Multiply-accumulate instruction: 16 bits 16 bits + 32 bits  32 bits

Memory         ROM, RAM, Data    Operation mode: Single-chip mode (address space: 1 Mbyte)
               flash             Refer to Table 1.3 Product List for R8C/35M Group.

Power Supply Voltage detection Power-on reset

Voltage        circuit            Voltage detection 3 (detection level of voltage detection 0 and voltage

Detection                                    detection 1 selectable)
I/O Ports      Programmable I/O Input-only: 1 pin

               ports             CMOS I/O ports: 47, selectable pull-up resistor
                                  High current drive ports: 47

Clock          Clock generation  4 circuits: XIN clock oscillation circuit,
               circuits                        XCIN clock oscillation circuit (32 kHz),
                                               High-speed on-chip oscillator (with frequency adjustment function),
                                               Low-speed on-chip oscillator

                                  Oscillation stop detection: XIN clock oscillation stop detection function

                                  Frequency divider circuit: Dividing selectable 1, 2, 4, 8, and 16
                                  Low power consumption modes:

                                 Standard operating mode (high-speed clock, low-speed clock, high-speed
                                 on-chip oscillator, low-speed on-chip oscillator), wait mode, stop mode

Interrupts                       Real-time clock (timer RE)
Watchdog Timer                   Number of interrupt vectors: 69
                                  External Interrupt: 9 (INT 5, Key input 4)
                                  Priority levels: 7 levels
                                  14 bits 1 (with prescaler)

                                  Reset start selectable
                                  Low-speed on-chip oscillator for watchdog timer selectable

DTC (Data Transfer Controller)    1 channel
                                  Activation sources: 33

Timer          Timer RA          Transfer modes: 2 (normal mode, repeat mode)

                                 8 bits 1 (with 8-bit prescaler)
                                   Timer mode (period timer), pulse output mode (output level inverted every

                                   period), event counter mode, pulse width measurement mode, pulse period

               Timer RB            measurement mode

                                 8 bits 1 (with 8-bit prescaler)
                                   Timer mode (period timer), programmable waveform generation mode (PWM

                                 output), programmable one-shot generation mode, programmable wait one-
                                 shot generation mode

               Timer RC          16 bits 1 (with 4 capture/compare registers)
                                   Timer mode (input capture function, output compare function), PWM mode

                                   (output 3 pins), PWM2 mode (PWM output pin)

               Timer RD          16 bits 2 (with 4 capture/compare registers)
                                   Timer mode (input capture function, output compare function), PWM mode

                                   (output 6 pins), reset synchronous PWM mode (output three-phase

                                 waveforms (6 pins), sawtooth wave modulation), complementary PWM mode
                                 (output three-phase waveforms (6 pins), triangular wave modulation), PWM3
                                 mode (PWM output 2 pins with fixed period)

               Timer RE          8 bits 1
                                   Real-time clock mode (count seconds, minutes, hours, days of week), output

                                   compare mode

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R8C/35M Group                                                        1. Overview

Table 1.2 Specifications for R8C/35M Group (2)

      Item           Function                                               Specification
Serial         UART0, UART1    Clock synchronous serial I/O/UART 2 channel
Interface      UART2           Clock synchronous serial I/O/UART, I2C mode (I2C-bus), multiprocessor
                               communication function
Synchronous Serial             1 (shared with I2C-bus)
Communication Unit (SSU)
I2C bus                        1 (shared with SSU)
LIN Module
A/D Converter                  Hardware LIN: 1 (timer RA, UART0)
                               10-bit resolution 12 channels, includes sample and hold function, with sweep
D/A Converter                  mode
Comparator A                   8-bit resolution 2 circuits
                               2 circuits (shared with voltage monitor 1 and voltage monitor 2)
Comparator B                   External reference voltage input available
Flash Memory                   2 circuits
                               Programming and erasure voltage: VCC = 2.7 to 5.5 V
Operating Frequency/Supply      Programming and erasure endurance: 10,000 times (data flash)
Voltage
Current consumption                                                                  1,000 times (program ROM)
                               Program security: ROM code protect, ID code check
Operating Ambient Temperature   Debug functions: On-chip debug, on-board flash rewrite function
Package                         Background operation (BGO) function
                               f(XIN) = 20 MHz (VCC = 2.7 to 5.5 V)
                               f(XIN) = 5 MHz (VCC = 1.8 to 5.5 V)

                               Typ. 6.5 mA (VCC = 5.0 V, f(XIN) = 20 MHz)
                               Typ. 3.5 mA (VCC = 3.0 V, f(XIN) = 10 MHz)
                               Typ. 3.5 A (VCC = 3.0 V, wait mode (f(XCIN) = 32 kHz))
                               Typ. 2.0 A (VCC = 3.0 V, stop mode)
                               -20 to 85C (N version)
                               -40 to 85C (D version) (1)
                               52-pin LQFP

                                 Package code: PLQP0052JA-A (previous code: 52P6A-A)

Note:
    1. Specify the D version if D version functions are to be used.

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Jun 20, 2011
R8C/35M Group                                                         1. Overview

1.2 Product List

    Table 1.3 lists Product List for R8C/35M Group, and Figure 1.1 shows a Part Number, Memory Size, and Package
    of R8C/35M Group.

Table 1.3 Product List for R8C/35M Group                           Current of Jun 2011

         Part No.            ROM Capacity       RAM     Package Type  Remarks
                   Program ROM Data flash     Capacity
R5F21354MNFP       16 Kbytes 1 Kbyte 4   1.5 Kbytes   PLQP0052JA-A  N version
R5F21355MNFP       24 Kbytes 1 Kbyte 4   2 Kbytes     PLQP0052JA-A  D version
R5F21356MNFP       32 Kbytes 1 Kbyte 4   2.5 Kbytes   PLQP0052JA-A
R5F21357MNFP       48 Kbytes 1 Kbyte 4   4 Kbytes     PLQP0052JA-A
R5F21358MNFP       64 Kbytes 1 Kbyte 4   6 Kbytes     PLQP0052JA-A
R5F2135AMNFP       96 Kbytes 1 Kbyte 4   8 Kbytes     PLQP0052JA-A
R5F2135CMNFP       128 Kbytes 1 Kbyte 4  10 Kbytes    PLQP0052JA-A
R5F21354MDFP       16 Kbytes 1 Kbyte 4   1.5 Kbytes   PLQP0052JA-A
R5F21355MDFP       24 Kbytes 1 Kbyte 4   2 Kbytes     PLQP0052JA-A
R5F21356MDFP       32 Kbytes 1 Kbyte 4   2.5 Kbytes   PLQP0052JA-A
R5F21357MDFP       48 Kbytes 1 Kbyte 4   4 Kbytes     PLQP0052JA-A
R5F21358MDFP       64 Kbytes 1 Kbyte 4   6 Kbytes     PLQP0052JA-A
R5F2135AMDFP       96 Kbytes 1 Kbyte 4   8 Kbytes     PLQP0052JA-A
R5F2135CMDFP       128 Kbytes 1 Kbyte 4  10 Kbytes    PLQP0052JA-A

Part No. R 5 F 21 35 6 M N FP

                                          Package type:
                                             FP: PLQP0052JA-A (0.65 mm pin-pitch, 10 mm square body)

                                          Classification
                                             N: Operating ambient temperature -20C to 85C
                                             D: Operating ambient temperature -40C to 85C

                                          ROM capacity
                                             4: 16 KB
                                             5: 24 KB
                                             6: 32 KB
                                             7: 48 KB
                                             8: 64 KB
                                             A: 96 KB
                                             C: 128 KB

                                          R8C/35M Group

                                          R8C/3x Series

                                          Memory type
                                             F: Flash memory

                                          Renesas MCU

                                          Renesas semiconductor

Figure 1.1 Part Number, Memory Size, and Package of R8C/35M Group

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R8C/35M Group                                                                                                         1. Overview

   1.3 Block Diagram

        Figure 1.2 shows a Block Diagram.

                          8                8  8              8              51       2                             8

I/O ports  Port P0           Port P1          Port P2  Port P3              Port P4  Port P5  Port P6

Peripheral functions                                     UART or                     System clock generation
                                              clock synchronous serial I/O                        circuit
              Timers
                                                       (8 bits 3)                            XIN-XOUT
     Timer RA (8 bits 1)                                                          High-speed on-chip oscillator
     Timer RB (8 bits 1)                          I2C bus or SSU                  Low-speed on-chip oscillator
    Timer RC (16 bits 1)                             (8 bits 1)
     Timer RD (16 bits 2)                                                                  XCIN-XCOUT
     Timer RE (8 bits 1)                             LIN module
                                                                                    Low-speed on-chip oscillator
        Watchdog timer                               Comparator A                         for watchdog timer
              (14 bits)
                                                     Comparator B                     Voltage detection circuit
          A/D converter
                                                                                                   DTC
   (10 bits 12 channels)

          D/A converter

         (8 bits 2)

                                              R8C CPU core                   SB      Memory
                                                                               USP
                                                R0H R0L                        ISP            ROM (1)
                                                R1H R1L                     INTB               RAM (2)
                                                                             PC
                                                       R2                      FLG            Multiplier
                                                       R3

                                                         A0
                                                         A1
                                                         FB

                                                                            Notes:
                                                                               1. ROM size varies with MCU type.
                                                                               2. RAM size varies with MCU type.

Figure 1.2 Block Diagram

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R8C/35M Group                                                                                                                                          1. Overview

1.4 Pin Assignment

    Figure 1.3 shows the Pin Assignment (Top View). Tables 1.4 and 1.5 outline the Pin Name Information by Pin
    Number.

                                                     P0_7/AN0/DA1(/TRCIOC)
                                                         P1_0/AN8/LVCMP1/KI0(/TRCIOD)
                                                             P1_1/AN9/LVCMP2/KI1(/TRCIOA/TRCTRG)
                                                                  P1_2/AN10/LVREF/Kl2(/TRCIOB)
                                                                      P1_3/AN11/LVCOUT1/Kl3/TRBO(/TRCIOC)
                                                                           P1_4(/TXD0/TRCCLK)
                                                                               P1_5(/INT1/RXD0/TRAIO)
                                                                                    P1_6/LVCOUT2/IVREF1(/CLK0)
                                                                                        P1_7/IVCMP1/INT1(/TRAIO)
                                                                                             P4_5/ADTRG/INT0(/RXD2/SCL2)
                                                                                                 P6_5/INT4(/CLK1/CLK2/TRCIOB)
                                                                                                      P6_6/INT2(/TXD2/SDA2/TRCIOC)
                                                                                                          P6_7(/INT3/TRCIOD)

                                                     39 38 37 36 35 34 33 32 31 30 29 28 27

               P0_6/AN1/DA0(/TRCIOD)             40                                                                                                26  P3_1(/TRBO)
                      P0_5/AN2(/TRCIOB)                                                                                                                P3_6(/INT1)
                                                 41                                                                                                25  P2_0(/INT1/TRCIOB/TRDIOA0/TRDCLK)
             P0_4/AN3/TREO(/TRCIOB)                                                                                                                    P2_1(/TRCIOC/TRDIOC0)
             P0_3/AN4(/CLK1/TRCIOB)              42                                                                                                24  P2_2(/TRCIOD/TRDIOB0)
P0_2/AN5(/RXD1/TRCIOA/TRCTRG)                                                                                                                          P2_3(/TRDIOD0)
P0_1/AN6(/TXD1/TRCIOA/TRCTRG)                    43                                                                                                23  P2_4(/TRDIOA1)
        P0_0/AN7(/TRCIOA/TRCTRG)                                                                                                                       P2_5(/TRDIOB1)
                                                 44                                                                                                22  P2_6(/TRDIOC1)
                                P6_4(/RXD1)                                                                                                            P2_7(/TRDIOD1)
                                P6_3(/TXD1)      45                                                                                                21  P3_3/IVCMP3/INT3/SCS(/CTS2/RTS2/TRCCLK)
                                P6_2(/CLK1)                                                                                                            P3_4/IVREF3/SSI(/RXD2/SCL2/TXD2/SDA2/TRCIOC)
                                                 46 R8C/35M Group 20                                                                                   P3_5/SCL/SSCK(/CLK2/TRCIOD)
                                           P6_1
                                P6_0(/TREO)      47                                                                                                19

                                           P5_7  48                                                                                                18

                                                 49  PLQP0052JA-A(52P6A-A)                                                                         17

                                                 50  (top view)                                                                                    16

                                                 51                                                                                                15

                                                 52                                                                                                14

                                                     1 2 3 4 5 6 7 8 9 10 11 12 13

                                                     P5_6(/TRAO)
                                                         P3_2(/INT1/INT2/TRAIO)

                                                             P3_0(/TRAO)
                                                                  P4_2/VREF
                                                                      MODE
                                                                           P4_3(/XCIN)

                                                                               P4_4(/XCOUT)
                                                                                    RESET

                                                                                        P4_7/XOUT
                                                                                             VSS/AVSS

                                                                                                 P4_6/XIN
                                                                                                      VCC/AVCC
                                                                                                          P3_7/SDA/SSO/TRAO(/RXD2/SCL2/TXD2/SDA2)

                               Notes:
                                  1. Can be assigned to the pin in parentheses by a program.
                                  2. Confirm the pin 1 position on the package by referring to the package dimensions.

Figure 1.3 Pin Assignment (Top View)

R01DS0021EJ0100 Rev.1.00                                                                                                                               Page 6 of 54
Jun 20, 2011
R8C/35M Group                                                                               1. Overview

Table 1.4 Pin Name Information by Pin Number (1)

                                                  I/O Pin Functions for Peripheral Modules

   Pin         Control Pin  Port                  Timer           Serial   SSU I2C          A/D Converter,
Number                                 Interrupt                Interface            bus    D/A Converter,
                  MODE                                                                      Comparator A,
    1             (XCIN)    P5_6                                                            Comparator B
    2           (XCOUT)     P3_2 (INT1/INT2)
    3            RESET      P3_0                  (TRAO)
    4             XOUT      P4_2
    5          VSS/AVSS                           (TRAIO)
    6
    7               XIN                           (TRAO)
    8          VCC/AVCC
    9                                                                                       VREF
   10
   11                       P4_3
   12                       P4_4
   13
                            P4_7
   14
   15                       P4_6

   16                       P3_7                     TRAO    (RXD2/SCL2/   SSO   SDA
   17                                                        TXD2/SDA2)    SSCK  SCL
   18                       P3_5                  (TRCIOD)
   19                       P3_4   INT3           (TRCIOC)       (CLK2)     SSI             IVREF3
   20                                                        (RXD2/SCL2/                    IVCMP3
   21                       P3_3  (INT1)          (TRCCLK)   TXD2/SDA2)     SCS
   22                       P2_7  (INT1)
                            P2_6  (INT3)          (TRDIOD1)  (CTS2/RTS2)
   23                       P2_5   INT2           (TRDIOC1)
                            P2_4   INT4           (TRDIOB1)
   24                       P2_3   INT0           (TRDIOA1)
                            P2_2   INT1           (TRDIOD0)
   25                             (INT1)          (TRCIOD/
   26                       P2_1                  TRDIOB0)
   27                               KI3           (TRCIOC/
   28                       P2_0                  TRDIOC0)
   29                                              (TRCIOB/
   30                       P3_6                  TRDIOA0/
   31                       P3_1                   TRDCLK)
   32                       P6_7
   33                       P6_6                   (TRBO)
   34                       P6_5                  (TRCIOD)
   35                       P4_5
                            P1_7                  (TRCIOC) (TXD2/SDA2)
                            P1_6
                            P1_5                  (TRCIOB) (CLK1/CLK2)
                            P1_4
                            P1_3                             (RXD2/SCL2)                         ADTRG
                                                                                                IVCMP1
                                                  (TRAIO)                                 LVCOUT2/IVREF1

                                                  (TRAIO)       (CLK0)                     AN11/LVCOUT1
                                                                (RXD0)

                                                  (TRCCLK)      (TXD0)

                                                     TRBO
                                                  (/TRCIOC)

Note:
    1. Can be assigned to the pin in parentheses by a program.

R01DS0021EJ0100 Rev.1.00                                                                    Page 7 of 54
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R8C/35M Group                                                                              1. Overview

Table 1.5 Pin Name Information by Pin Number (2)

                                                 I/O Pin Functions for Peripheral Modules

   Pin         Control Pin  Port                 Timer            Serial   SSU I2C         A/D Converter,
Number                                Interrupt                 Interface            bus   D/A Converter,
                                                                                           Comparator A,
   36                                                                                      Comparator B
   37
                            P1_2  KI2            (TRCIOB)                                  AN10/LVREF
   38
   39                       P1_1  KI1            (TRCIOA/                                  AN9/LVCMP2
   40                                            TRCTRG)                                   AN8/LVCMP1
   41                       P1_0  KI0
   42                                            (TRCIOD)
   43
   44                       P0_7                 (TRCIOC)                                  AN0/DA1
                                                 (TRCIOD)                                  AN1/DA0
   45                       P0_6                 (TRCIOB)
                                                                                              AN2
   46                       P0_5                   TREO                                       AN3
   47                                            (/TRCIOB)                                    AN4
   48                       P0_4                 (TRCIOB)                                     AN5
   49                                            (TRCIOA/
   50                       P0_3                 TRCTRG)        (CLK1)                        AN6
   51                                            (TRCIOA/       (RXD1)
   52                       P0_2                 TRCTRG)        (TXD1)                        AN7
                                                 (TRCIOA/
                            P0_1                 TRCTRG)        (RXD1)
                                                                (TXD1)
                            P0_0                                (CLK1)

                            P6_4                 (TREO)
                            P6_3
                            P6_2
                            P6_1
                            P6_0
                            P5_7

Note:
    1. Can be assigned to the pin in parentheses by a program.

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1.5 Pin Functions

    Tables 1.6 and 1.7 list Pin Functions.

Table 1.6 Pin Functions (1)

          Item               Pin Name       I/O Type                      Description
Power supply input   VCC, VSS
Analog power         AVCC, AVSS             - Apply 1.8 V to 5.5 V to the VCC pin. Apply 0 V to the VSS pin.
supply input
Reset input          RESET                  - Power supply for the A/D converter.
MODE                 MODE                           Connect a capacitor between AVCC and AVSS.
XIN clock input      XIN
                                            I Input "L" on this pin resets the MCU.

                                            I Connect this pin to VCC via a resistor.

XIN clock output XOUT                        I These pins are provided for XIN clock generation circuit I/O.

                                                     Connect a ceramic resonator or a crystal oscillator between

                                            I/O the XIN and XOUT pins (1). To use an external clock, input it
                                                     to the XOUT pin and leave the XIN pin open.

XCIN clock input XCIN                       I These pins are provided for XCIN clock generation circuit I/O.
XCIN clock output XCOUT
                                                    Connect a crystal oscillator between the XCIN and XCOUT

                                            O pins (1). To use an external clock, input it to the XCIN pin and
                                                    leave the XCOUT pin open.

INT interrupt input INT0 to INT4             I INT interrupt input pins.
                                                     INT0 is timer RB, RC and RD input pin.
Key input interrupt  KI0 to KI3
Timer RA             TRAIO                   I Key input interrupt input pins
Timer RB             TRAO                   I/O Timer RA I/O pin
Timer RC             TRBO                   O Timer RA output pin
                     TRCCLK                 O Timer RB output pin
Timer RD             TRCTRG
                     TRCIOA, TRCIOB,         I External clock input pin
Timer RE             TRCIOC, TRCIOD          I External trigger input pin
Serial interface     TRDIOA0, TRDIOA1,      I/O Timer RC I/O pins
                     TRDIOB0, TRDIOB1,
I2C bus              TRDIOC0, TRDIOC1,      I/O Timer RD I/O pins
SSU                  TRDIOD0, TRDIOD1
                     TRDCLK                  I External clock input pin
                     TREO                   O Divided clock output pin
                     CLK0, CLK1, CLK2       I/O Transfer clock I/O pins
                     RXD0, RXD1, RXD2        I Serial data input pins
                     TXD0, TXD1, TXD2       O Serial data output pins
                                             I Transmission control input pin
                     CTS2                   O Reception control output pin
                                            I/O I2C mode clock I/O pin
                     RTS2                   I/O I2C mode data I/O pin
                     SCL2                   I/O Clock I/O pin
                     SDA2                   I/O Data I/O pin
                     SCL                    I/O Data I/O pin
                     SDA                    I/O Chip-select signal I/O pin
                     SSI                    I/O Clock I/O pin
                                            I/O Data I/O pin
                     SCS
                     SSCK
                     SSO

I: Input       O: Output  I/O: Input and output

Note:

1. Refer to the oscillator manufacturer for oscillation characteristics.

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Table 1.7 Pin Functions (2)

          Item            Pin Name  I/O Type           Description
Reference voltage
input              VREF             I Reference voltage input pin to A/D converter and D/A
A/D converter                               converter
D/A converter
Comparator A       AN0 to AN11      I Analog input pins to A/D converter

Comparator B       ADTRG            I A/D external trigger input pin
I/O port
                   DA0, DA1         O D/A converter output pins
Input port
                   LVCMP1, LVCMP2   I Comparator A analog voltage input pins

                   LVREF            I Comparator A reference voltage input pin

                   LVCOUT1, LVCOUT2 O Comparator A output pins

                   IVCMP1, IVCMP3   I Comparator B analog voltage input pins

                   IVREF1, IVREF3   I Comparator B reference voltage input pins

                   P0_0 to P0_7,    I/O CMOS I/O ports. Each port has an I/O select direction
                   P1_0 to P1_7,             register, allowing each pin in the port to be directed for input
                   P2_0 to P2_7,             or output individually.
                   P3_0 to P3_7,             Any port set to input can be set to use a pull-up resistor or not
                   P4_3 to P4_7,             by a program.
                   P5_6, P5_7,               All ports can be used as LED drive ports.
                   P6_0 to P6_7

                   P4_2             I Input-only port

I: Input       O: Output     I/O: Input and output

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2. Central Processing Unit (CPU)

  Figure 2.1 shows the CPU Registers. The CPU contains 13 registers. R0, R1, R2, R3, A0, A1, and FB configure a
  register bank. There are two sets of register bank.

b31                                  b15         b8b7                  b0

                     R2              R0H (high-order of R0) R0L (low-order of R0)
                     R3
                                     R1H (high-order of R1) R1L (low-order of R1)

                                                 R2                                                Data registers (1)

                                                 R3                                               Address registers (1)
                                                 A0                                               Frame base register (1)
                                                 A1
                                                 FB

                          b19        b15                               b0

                          INTBH                  INTBL                                            Interrupt table register
                                                                                                  Program counter
                          The 4 high order bits of INTB are INTBH and
                          the 16 low order bits of INTB are INTBL.

                          b19                                          b0

                                          PC

                                     b15                               b0

                                                 USP                                              User stack pointer
                                                                                                  Interrupt stack pointer
                                                 ISP                                              Static base register

                                                 SB                                               Flag register

                                     b15                               b0                         Carry flag
                                                                                                  Debug flag
                                                 FLG                                              Zero flag
                                                                                                  Sign flag
                         b15              b8 b7                        b0                         Register bank select flag
                                                                                                  Overflow flag
                                IPL       U I OB S ZDC                                            Interrupt enable flag
                                                                                                  Stack pointer select flag
                                                                                                  Reserved bit
                                                                                                  Processor interrupt priority level
                                                                                                  Reserved bit

                 Note:
                      1. These registers comprise a register bank. There are two register banks.

Figure 2.1 CPU Registers

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2.1 Data Registers (R0, R1, R2, and R3)

    R0 is a 16-bit register for transfer, arithmetic, and logic operations. The same applies to R1 to R3. R0 can be split
    into high-order bits (R0H) and low-order bits (R0L) to be used separately as 8-bit data registers. R1H and R1L are
    analogous to R0H and R0L. R2 can be combined with R0 and used as a 32-bit data register (R2R0). R3R1 is
    analogous to R2R0.

2.2 Address Registers (A0 and A1)

    A0 is a 16-bit register for address register indirect addressing and address register relative addressing. It is also
    used for transfer, arithmetic, and logic operations. A1 is analogous to A0. A1 can be combined with A0 and as a 32-
    bit address register (A1A0).

2.3 Frame Base Register (FB)

    FB is a 16-bit register for FB relative addressing.

2.4 Interrupt Table Register (INTB)

    INTB is a 20-bit register that indicates the starting address of an interrupt vector table.

2.5 Program Counter (PC)

    PC is 20 bits wide and indicates the address of the next instruction to be executed.

2.6 User Stack Pointer (USP) and Interrupt Stack Pointer (ISP)

    The stack pointers (SP), USP and ISP, are each 16 bits wide. The U flag of FLG is used to switch between
    USP and ISP.

2.7 Static Base Register (SB)

    SB is a 16-bit register for SB relative addressing.

2.8 Flag Register (FLG)

    FLG is an 11-bit register indicating the CPU state.

2.8.1 Carry Flag (C)

        The C flag retains carry, borrow, or shift-out bits that have been generated by the arithmetic and logic unit.

2.8.2 Debug Flag (D)

        The D flag is for debugging only. Set it to 0.

2.8.3 Zero Flag (Z)

        The Z flag is set to 1 when an arithmetic operation results in 0; otherwise to 0.

2.8.4 Sign Flag (S)

        The S flag is set to 1 when an arithmetic operation results in a negative value; otherwise to 0.

2.8.5 Register Bank Select Flag (B)

        Register bank 0 is selected when the B flag is 0. Register bank 1 is selected when this flag is set to 1.

2.8.6 Overflow Flag (O)

        The O flag is set to 1 when an operation results in an overflow; otherwise to 0.

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2.8.7 Interrupt Enable Flag (I)

      The I flag enables maskable interrupts.
      Interrupts are disabled when the I flag is set to 0, and are enabled when the I flag is set to 1. The I flag is set to 0
      when an interrupt request is acknowledged.

2.8.8 Stack Pointer Select Flag (U)

      ISP is selected when the U flag is set to 0; USP is selected when the U flag is set to 1.
      The U flag is set to 0 when a hardware interrupt request is acknowledged or the INT instruction of software
      interrupt numbers 0 to 31 is executed.

2.8.9 Processor Interrupt Priority Level (IPL)

      IPL is 3 bits wide and assigns processor interrupt priority levels from level 0 to level 7.
      If a requested interrupt has higher priority than IPL, the interrupt is enabled.

2.8.10 Reserved Bit

      If necessary, set to 0. When read, the content is undefined.

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3. Memory

  3.1 R8C/35M Group

      Figure 3.1 is a Memory Map of R8C/35M Group. The R8C/35M Group has a 1-Mbyte address space from
      addresses 00000h to FFFFFh. For example, a 32-Kbyte internal ROM area is allocated addresses 08000h to
      0FFFFh.
      The fixed interrupt vector table is allocated addresses 0FFDCh to 0FFFFh. The starting address of each interrupt
      routine is stored here.
      The internal ROM (data flash) is allocated addresses 03000h to 03FFFh.
      The internal RAM is allocated higher addresses, beginning with address 00400h. For example, a 2.5-Kbyte internal
      RAM area is allocated addresses 00400h to 00DFFh. The internal RAM is used not only for data storage but also as
      a stack area when a subroutine is called or when an interrupt request is acknowledged.
      Special function registers (SFRs) are allocated addresses 00000h to 002FFh and 02C00h to 02FFFh. Peripheral
      function control registers are allocated here. All unallocated spaces within the SFRs are reserved and cannot be
      accessed by users.

00000h                  SFR                        0FFD8h
002FFh        (Refer to 4. Special
00400h        Function Registers

0XXXXh                 (SFRs))

                Internal RAM

                                                                          Reserved area

02C00h                    SFR           0FFDCh                               Undefined instruction
02FFFh   (Refer to 4. Special Function  0FFFFh                                       Overflow
03000h
                Registers (SFRs))                                               BRK instruction
03FFFh                                                                           Address match
0YYYYh         Internal ROM
               (data flash) (1)                                                    Single step
0FFFFh
             Internal ROM                                   Watchdog timer, oscillation stop detection, voltage monitor
            (program ROM)
                                                                                 Address break
                                                                                   (Reserved)
                                                                                       Reset

                Internal ROM
               (program ROM)

ZZZZZh

FFFFFh

Notes:
      1. Data flash indicates block A (1 Kbyte), block B (1 Kbyte), block C (1 Kbyte), and block D (1 Kbyte).
      2. The blank areas are reserved and cannot be accessed by users.

                                                            Internal ROM                                                 Internal RAM

                Part Number                 Size    Address 0YYYYh Address ZZZZZh        Size                            Address 0XXXXh
                                        16 Kbytes
R5F21354MNFP, R5F21354MDFP              24 Kbytes           0C000h            -          1.5 Kbytes                      009FFh
R5F21355MNFP, R5F21355MDFP              32 Kbytes           0A000h            -           2 Kbytes                       00BFFh
R5F21356MNFP, R5F21356MDFP              48 Kbytes           08000h            -          2.5 Kbytes                      00DFFh
R5F21357MNFP, R5F21357MDFP              64 Kbytes           04000h            -           4 Kbytes                       013FFh
R5F21358MNFP, R5F21358MDFP              96 Kbytes           04000h        13FFFh          6 Kbytes                       01BFFh
R5F2135AMNFP, R5F2135AMDFP              128 Kbytes          04000h        1BFFFh          8 Kbytes                       023FFh
R5F2135CMNFP, R5F2135CMDFP                                  04000h        23FFFh         10 Kbytes                       02BFFh

Figure 3.1 Memory Map of R8C/35M Group

R01DS0021EJ0100 Rev.1.00                                                                                                 Page 14 of 54
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R8C/35M Group                                                        4. Special Function Registers (SFRs)

4. Special Function Registers (SFRs)

  An SFR (special function register) is a control register for a peripheral function. Tables 4.1 to 4.12 list the special
  function registers and Table 4.13 lists the ID Code Areas and Option Function Select Area.

Table 4.1 SFR Information (1) (1)

Address                                                    Register        Symbol  After Reset
0000h
0001h   Processor Mode Register 0                                   PM0           00h
0002h   Processor Mode Register 1                                   PM1           00h
0003h   System Clock Control Register 0                             CM0           00101000b
0004h   System Clock Control Register 1                             CM1           00100000b
0005h   Module Standby Control Register                             MSTCR         00h
0006h   System Clock Control Register 3                             CM3           00h
0007h   Protect Register                                            PRCR          00h
0008h   Reset Source Determination Register                         RSTFR         0XXXXXXXb (2)
0009h   Oscillation Stop Detection Register                                       00000100b
000Ah   Watchdog Timer Reset Register                               OCD           XXh
000Bh   Watchdog Timer Start Register                               WDTR          XXh
         Watchdog Timer Control Register                             WDTS          00111111b
000Ch                                                               WDTC
000Dh   High-Speed On-Chip Oscillator Control Register 7
000Eh                                                               FRA7          When shipping
000Fh   Count Source Protection Mode Register
0010h                                                               CSPR          00h
0011h                                                                             10000000b (3)
0012h
0013h
0014h
0015h
0016h
0017h
0018h
0019h
001Ah
001Bh
001Ch

001Dh    High-Speed On-Chip Oscillator Control Register 0            FRA0          00h
001Eh    High-Speed On-Chip Oscillator Control Register 1            FRA1          When shipping
001Fh    High-Speed On-Chip Oscillator Control Register 2            FRA2          00h
0020h    On-Chip Reference Voltage Control Register                  OCVREFCR      00h
0021h
0022h    Clock Prescaler Reset Flag                                  CPSRF         00h
0023h    High-Speed On-Chip Oscillator Control Register 4            FRA4          When Shipping
0024h    High-Speed On-Chip Oscillator Control Register 5            FRA5          When Shipping
0025h    High-Speed On-Chip Oscillator Control Register 6            FRA6          When Shipping
0026h
0027h    High-Speed On-Chip Oscillator Control Register 3            FRA3          When shipping
0028h    Voltage Monitor Circuit/Comparator A Control Register       CMPA          00h
0029h    Voltage Monitor Circuit Edge Select Register                VCAC          00h
002Ah
002Bh    Voltage Detect Register 1                                   VCA1          00001000b
002Ch    Voltage Detect Register 2                                   VCA2          00h (4)
002Dh                                                                              00100000b (5)
002Eh                                                                VD1LS
002Fh                                                                              00000111b
0030h                                                                VW0C
0031h                                                                              1100X010b (4)
0032h                                                                VW1C          1100X011b (5)
0033h                                                                              10001010b
0034h

0035h    Voltage Detection 1 Level Select Register
0036h    Voltage Monitor 0 Circuit Control Register
0037h
0038h

0039h Voltage Monitor 1 Circuit Control Register

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. The CWR bit in the RSTFR register is set to 0 after power-on and voltage monitor 0 reset. Hardware reset, software reset, or watchdog timer

            reset does not affect this bit.

      3. The CSPROINI bit in the OFS register is set to 0.
      4. The LVDAS bit in the OFS register is set to 1.
      5. The LVDAS bit in the OFS register is set to 0.

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Table 4.2 SFR Information (2) (1)

Address                                     Register                                    Symbol           After Reset
                                                                               VW2C             10000010b
003Ah Voltage Monitor 2 Circuit Control Register

003Bh

003Ch

003Dh

003Eh

003Fh

0040h

0041h Flash Memory Ready Interrupt Control Register                            FMRDYIC          XXXXX000b

0042h

0043h

0044h

0045h

0046h INT4 Interrupt Control Register                                          INT4IC           XX00X000b
                                                                               TRCIC            XXXXX000b
0047h Timer RC Interrupt Control Register                                      TRD0IC           XXXXX000b
                                                                               TRD1IC           XXXXX000b
0048h Timer RD0 Interrupt Control Register                                     TREIC            XXXXX000b
                                                                               S2TIC            XXXXX000b
0049h Timer RD1 Interrupt Control Register                                     S2RIC            XXXXX000b
                                                                               KUPIC            XXXXX000b
004Ah Timer RE Interrupt Control Register                                      ADIC             XXXXX000b
                                                                               SSUIC / IICIC    XXXXX000b
004Bh UART2 Transmit Interrupt Control Register
                                                                               S0TIC            XXXXX000b
004Ch UART2 Receive Interrupt Control Register                                 S0RIC            XXXXX000b
                                                                               S1TIC            XXXXX000b
004Dh Key Input Interrupt Control Register                                     S1RIC            XXXXX000b
                                                                               INT2IC           XX00X000b
004Eh A/D Conversion Interrupt Control Register                                TRAIC            XXXXX000b

004Fh SSU Interrupt Control Register / IIC bus Interrupt Control Register (2)  TRBIC            XXXXX000b
                                                                               INT1IC           XX00X000b
0050h                                                                          INT3IC           XX00X000b

0051h UART0 Transmit Interrupt Control Register                                INT0IC           XX00X000b
                                                                               U2BCNIC          XXXXX000b
0052h UART0 Receive Interrupt Control Register

0053h UART1 Transmit Interrupt Control Register

0054h UART1 Receive Interrupt Control Register

0055h INT2 Interrupt Control Register

0056h Timer RA Interrupt Control Register

0057h

0058h Timer RB Interrupt Control Register

0059h INT1 Interrupt Control Register

005Ah INT3 Interrupt Control Register

005Bh

005Ch

005Dh INT0 Interrupt Control Register

005Eh UART2 Bus Collision Detection Interrupt Control Register

005Fh

0060h

0061h

0062h

0063h

0064h

0065h

0066h

0067h

0068h

0069h

006Ah

006Bh

006Ch

006Dh

006Eh

006Fh

0070h

0071h

0072h Voltage Monitor 1/Comparator A1 Interrupt Control Register               VCMP1IC          XXXXX000b
                                                                               VCMP2IC          XXXXX000b
0073h Voltage Monitor 2/Comparator A2 Interrupt Control Register

0074h

0075h

0076h

0077h

0078h

0079h

007Ah

007Bh

007Ch

007Dh

007Eh

007Fh

X: Undefined

Notes:
      1. The blank areas are reserved and cannot be accessed by users.
      2. Selectable by the IICSEL bit in the SSUIICSR register.

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Table 4.3 SFR Information (3) (1)

Address                                  Register                                Symbol           After Reset
0080h DTC Activation Control Register                                  DTCTL            00h

0081h

0082h

0083h

0084h

0085h

0086h
0087h

0088h DTC Activation Enable Register 0                                  DTCEN0           00h

0089h DTC Activation Enable Register 1                                  DTCEN1           00h

008Ah DTC Activation Enable Register 2                                  DTCEN2           00h

008Bh DTC Activation Enable Register 3                                  DTCEN3           00h

008Ch DTC Activation Enable Register 4                                  DTCEN4           00h

008Dh  DTC Activation Enable Register 5                                 DTCEN5           00h
008Eh  DTC Activation Enable Register 6
008Fh                                                                   DTCEN6           00h

0090h

0091h

0092h

0093h

0094h

0095h
0096h

0097h

0098h

0099h

009Ah

009Bh

009Ch
009Dh

009Eh

009Fh

00A0h UART0 Transmit/Receive Mode Register                              U0MR             00h
                                                                        U0BRG            XXh
00A1h UART0 Bit Rate Register                                           U0TB             XXh
                                                                                         XXh
00A2h UART0 Transmit Buffer Register                                    U0C0             00001000b
                                                                        U0C1             00000010b
00A3h  UART0 Transmit/Receive Control Register 0                        U0RB             XXh
00A4h                                                                                    XXh
                                                                        U2MR             00h
00A5h UART0 Transmit/Receive Control Register 1                         U2BRG            XXh
                                                                        U2TB             XXh
00A6h UART0 Receive Buffer Register                                                      XXh
                                                                        U2C0             00001000b
00A7h                                                                   U2C1             00000010b
                                                                        U2RB             XXh
00A8h UART2 Transmit/Receive Mode Register                                               XXh
                                                                        URXDF            00h
00A9h UART2 Bit Rate Register

00AAh  UART2 Transmit Buffer Register
00ABh  UART2 Transmit/Receive Control Register 0
00ACh

00ADh UART2 Transmit/Receive Control Register 1

00AEh UART2 Receive Buffer Register

00AFh

00B0h UART2 Digital Filter Function Select Register

00B1h

00B2h
00B3h

00B4h

00B5h

00B6h

00B7h

00B8h

00B9h
00BAh

00BBh UART2 Special Mode Register 5                                     U2SMR5           00h
                                                                        U2SMR4           00h
00BCh UART2 Special Mode Register 4                                     U2SMR3           000X0X0Xb
                                                                        U2SMR2           X0000000b
00BDh UART2 Special Mode Register 3                                     U2SMR            X0000000b

00BEh UART2 Special Mode Register 2

00BFh UART2 Special Mode Register

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

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Table 4.4 SFR Information (4) (1)

Address                              Register                                    Symbol           After Reset
00C0h                                                                  AD0              XXh
00C1h   A/D Register 0                                                 AD1              000000XXb
                                                                        AD2              XXh
00C2h    A/D Register 1                                                 AD3              000000XXb
00C3h                                                                   AD4              XXh
                                                                        AD5              000000XXb
00C4h    A/D Register 2                                                 AD6              XXh
00C5h    A/D Register 3                                                 AD7              000000XXb
00C6h                                                                                    XXh
                                                                                         000000XXb
00C7h    A/D Register 4                                                                  XXh
00C8h                                                                                    000000XXb
                                                                                         XXh
00C9h    A/D Register 5                                                                  000000XXb
00CAh                                                                                    XXh
                                                                                         000000XXb
00CBh    A/D Register 6
00CCh
00CDh

00CEh    A/D Register 7
00CFh

00D0h
00D1h

00D2h    A/D Mode Register                                              ADMOD            00h
00D3h                                                                   ADINSEL          11000000b
00D4h                                                                   ADCON0           00h
                                                                        ADCON1           00h
00D5h A/D Input Select Register                                         DA0              00h
                                                                        DA1              00h
00D6h    A/D Control Register 0
00D7h    A/D Control Register 1                                         DACON            00h

00D8h    D/A0 Register                                                  P0               XXh
00D9h    D/A1 Register                                                  P1               XXh
                                                                        PD0              00h
00DAh                                                                   PD1              00h
00DBh                                                                   P2               XXh
                                                                        P3               XXh
00DCh    D/A Control Register                                           PD2              00h
00DDh                                                                   PD3              00h
00DEh                                                                   P4               XXh
                                                                        P5               XXh
00DFh    Port P0 Register                                               PD4              00h
00E0h                                                                   PD5              00h
                                                                        P6               XXh
00E1h    Port P1 Register
00E2h    Port P0 Direction Register                                     PD6              00h
00E3h    Port P1 Direction Register

00E4h    Port P2 Register
00E5h    Port P3 Register

00E6h    Port P2 Direction Register
00E7h    Port P3 Direction Register

00E8h    Port P4 Register
00E9h    Port P5 Register
00EAh    Port P4 Direction Register

00EBh    Port P5 Direction Register
00ECh    Port P6 Register

00EDh    Port P6 Direction Register
00EEh

00EFh
00F0h
00F1h
00F2h
00F3h

00F4h
00F5h

00F6h
00F7h

00F8h
00F9h
00FAh

00FBh
00FCh

00FDh
00FEh
00FFh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

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R8C/35M Group                                                           4. Special Function Registers (SFRs)

Table 4.5 SFR Information (5) (1)

Address                                                    Register              Symbol           After Reset
0100h   Timer RA Control Register                                      TRACR            00h
0101h   Timer RA I/O Control Register                                  TRAIOC           00h
0102h   Timer RA Mode Register                                         TRAMR            00h
0103h   Timer RA Prescaler Register                                    TRAPRE           FFh
0104h   Timer RA Register                                              TRA              FFh
0105h   LIN Control Register 2                                         LINCR2           00h
0106h   LIN Control Register                                           LINCR            00h
0107h   LIN Status Register                                            LINST            00h
0108h   Timer RB Control Register                                      TRBCR            00h
0109h   Timer RB One-Shot Control Register                             TRBOCR           00h
010Ah   Timer RB I/O Control Register                                  TRBIOC           00h
010Bh   Timer RB Mode Register                                         TRBMR            00h
010Ch   Timer RB Prescaler Register                                    TRBPRE           FFh
010Dh   Timer RB Secondary Register                                    TRBSC            FFh
010Eh   Timer RB Primary Register                                      TRBPR            FFh
010Fh
0110h   Timer RE Second Data Register / Counter Data Register          TRESEC           00h
0111h   Timer RE Minute Data Register / Compare Data Register          TREMIN           00h
0112h   Timer RE Hour Data Register                                    TREHR            00h
0113h   Timer RE Day of Week Data Register                             TREWK            00h
0114h   Timer RE Control Register 1                                    TRECR1           00h
0115h   Timer RE Control Register 2                                    TRECR2           00h
0116h   Timer RE Count Source Select Register                          TRECSR           00001000b
0117h
0118h   Timer RC Mode Register                                         TRCMR            01001000b
0119h   Timer RC Control Register 1                                    TRCCR1           00h
011Ah   Timer RC Interrupt Enable Register                             TRCIER           01110000b
011Bh   Timer RC Status Register                                       TRCSR            01110000b
011Ch   Timer RC I/O Control Register 0                                TRCIOR0          10001000b
011Dh   Timer RC I/O Control Register 1                                TRCIOR1          10001000b
011Eh   Timer RC Counter                                               TRC              00h
011Fh                                                                                   00h
0120h   Timer RC General Register A                                    TRCGRA           FFh
0121h                                                                                   FFh
0122h   Timer RC General Register B                                    TRCGRB           FFh
0123h                                                                                   FFh
0124h   Timer RC General Register C                                    TRCGRC           FFh
0125h                                                                                   FFh
0126h   Timer RC General Register D                                    TRCGRD           FFh
0127h                                                                                   FFh
0128h   Timer RC Control Register 2                                    TRCCR2           00011000b
0129h   Timer RC Digital Filter Function Select Register               TRCDF            00h
012Ah   Timer RC Output Master Enable Register                         TRCOER           01111111b
012Bh   Timer RC Trigger Control Register                              TRCADCR          00h
012Ch
012Dh   Timer RD Control Expansion Register                            TRDECR           00h
012Eh   Timer RD Trigger Control Register                              TRDADCR          00h
012Fh   Timer RD Start Register                                        TRDSTR           11111100b
0130h   Timer RD Mode Register                                         TRDMR            00001110b
0131h   Timer RD PWM Mode Register                                     TRDPMR           10001000b
0132h   Timer RD Function Control Register                             TRDFCR           10000000b
0133h   Timer RD Output Master Enable Register 1                       TRDOER1          FFh
0134h   Timer RD Output Master Enable Register 2                       TRDOER2          01111111b
0135h   Timer RD Output Control Register                               TRDOCR           00h
0136h   Timer RD Digital Filter Function Select Register 0             TRDDF0           00h
0137h   Timer RD Digital Filter Function Select Register 1             TRDDF1           00h
0138h
0139h
013Ah
013Bh
013Ch
013Dh
013Eh
013Fh

Note:
      1. The blank areas are reserved and cannot be accessed by users.

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R8C/35M Group                                                           4. Special Function Registers (SFRs)

Table 4.6 SFR Information (6) (1)

Address                                     Register                             Symbol           After Reset
                                                                        TRDCR0           00h
0140h Timer RD Control Register 0                                       TRDIORA0         10001000b
                                                                        TRDIORC0         10001000b
0141h Timer RD I/O Control Register A0                                  TRDSR0           11100000b
                                                                        TRDIER0          11100000b
0142h Timer RD I/O Control Register C0                                  TRDPOCR0         11111000b
                                                                        TRD0             00h
0143h Timer RD Status Register 0                                                         00h
                                                                        TRDGRA0          FFh
0144h Timer RD Interrupt Enable Register 0                                               FFh
                                                                        TRDGRB0          FFh
0145h Timer RD PWM Mode Output Level Control Register 0                                  FFh
                                                                        TRDGRC0          FFh
0146h Timer RD Counter 0                                                                 FFh
                                                                        TRDGRD0          FFh
0147h                                                                                    FFh
                                                                        TRDCR1           00h
0148h Timer RD General Register A0                                      TRDIORA1         10001000b
                                                                        TRDIORC1         10001000b
0149h                                                                   TRDSR1           11000000b
                                                                        TRDIER1          11100000b
014Ah Timer RD General Register B0                                      TRDPOCR1         11111000b
                                                                        TRD1             00h
014Bh                                                                                    00h
                                                                        TRDGRA1          FFh
014Ch Timer RD General Register C0                                                       FFh
                                                                        TRDGRB1          FFh
014Dh                                                                                    FFh
                                                                        TRDGRC1          FFh
014Eh Timer RD General Register D0                                                       FFh
                                                                        TRDGRD1          FFh
014Fh                                                                                    FFh
                                                                        U1MR             00h
0150h Timer RD Control Register 1                                       U1BRG            XXh
                                                                        U1TB             XXh
0151h Timer RD I/O Control Register A1                                                   XXh
                                                                        U1C0             00001000b
0152h Timer RD I/O Control Register C1                                  U1C1             00000010b
                                                                        U1RB             XXh
0153h Timer RD Status Register 1                                                         XXh

0154h Timer RD Interrupt Enable Register 1

0155h Timer RD PWM Mode Output Level Control Register 1

0156h Timer RD Counter 1

0157h

0158h Timer RD General Register A1

0159h

015Ah Timer RD General Register B1

015Bh

015Ch Timer RD General Register C1

015Dh

015Eh Timer RD General Register D1

015Fh

0160h UART1 Transmit/Receive Mode Register

0161h UART1 Bit Rate Register

0162h UART1 Transmit Buffer Register

0163h

0164h UART1 Transmit/Receive Control Register 0

0165h UART1 Transmit/Receive Control Register 1

0166h UART1 Receive Buffer Register

0167h

0168h

0169h

016Ah

016Bh

016Ch

016Dh

016Eh

016Fh

0170h

0171h

0172h

0173h

0174h

0175h

0176h

0177h

0178h

0179h

017Ah

017Bh

017Ch

017Dh

017Eh

017Fh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

R01DS0021EJ0100 Rev.1.00                                                                 Page 20 of 54
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Table 4.7 SFR Information (7) (1)

Address                                   Register                                  Symbol           After Reset
0180h                                                                     TRASR            00h
0181h   Timer RA Pin Select Register                                      TRBRCSR          00h
0182h   Timer RB/RC Pin Select Register                                   TRCPSR0          00h
0183h   Timer RC Pin Select Register 0                                    TRCPSR1          00h
0184h   Timer RC Pin Select Register 1                                    TRDPSR0          00h
0185h   Timer RD Pin Select Register 0                                    TRDPSR1          00h
0186h   Timer RD Pin Select Register 1                                    TIMSR            00h
0187h   Timer Pin Select Register
0188h                                                                     U0SR             00h
0189h   UART0 Pin Select Register                                         U1SR             00h
018Ah   UART1 Pin Select Register                                         U2SR0            00h
018Bh   UART2 Pin Select Register 0                                       U2SR1            00h
018Ch   UART2 Pin Select Register 1                                       SSUIICSR         00h
018Dh   SSU/IIC Pin Select Register
018Eh                                                                     INTSR            00h
018Fh   INT Interrupt Input Pin Select Register                           PINSR            00h
0190h   I/O Function Pin Select Register
0191h
0192h   SS Bit Counter Register                                           SSBR             11111000b
0193h   SS Transmit Data Register L / IIC bus Transmit Data Register (2)  SSTDR / ICDRT    FFh
0194h   SS Transmit Data Register H (2)                                   SSTDRH           FFh
         SS Receive Data Register L / IIC bus Receive Data Register (2)    SSRDR / ICDRR    FFh
0195h   SS Receive Data Register H (2)                                    SSRDRH           FFh
         SS Control Register H / IIC bus Control Register 1 (2)            SSCRH / ICCR1    00h
0196h   SS Control Register L / IIC bus Control Register 2 (2)            SSCRL / ICCR2    01111101b
         SS Mode Register / IIC bus Mode Register (2)                      SSMR / ICMR      00010000b / 00011000b
0197h   SS Enable Register / IIC bus Interrupt Enable Register (2)        SSER / ICIER     00h
         SS Status Register / IIC bus Status Register (2)                  SSSR / ICSR      00h / 0000X000b
0198h   SS Mode Register 2 / Slave Address Register (2)                   SSMR2 / SAR      00h

0199h   Flash Memory Status Register                                      FST              10000X00b

019Ah   Flash Memory Control Register 0                                   FMR0             00h
         Flash Memory Control Register 1                                   FMR1             00h
019Bh   Flash Memory Control Register 2                                   FMR2             00h

019Ch

019Dh
019Eh
019Fh
01A0h
01A1h
01A2h
01A3h
01A4h
01A5h
01A6h
01A7h
01A8h
01A9h
01AAh
01ABh
01ACh
01ADh
01AEh
01AFh
01B0h
01B1h
01B2h
01B3h
01B4h
01B5h
01B6h
01B7h
01B8h
01B9h
01BAh
01BBh
01BCh
01BDh
01BEh
01BFh

X: Undefined
Notes:

      1. The blank areas are reserved and cannot be accessed by users.
      2. Selectable by the IICSEL bit in the SSUIICSR register.

R01DS0021EJ0100 Rev.1.00                                                                    Page 21 of 54
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Table 4.8 SFR Information (8) (1)

Address                                   Register                               Symbol           After Reset
                                                                        RMAD0            XXh
01C0h Address Match Interrupt Register 0                                                 XXh
                                                                        AIER0            0000XXXXb
01C1h                                                                   RMAD1            00h
                                                                                         XXh
01C2h                                                                   AIER1            XXh
                                                                                         0000XXXXb
01C3h Address Match Interrupt Enable Register 0                                          00h

01C4h Address Match Interrupt Register 1

01C5h

01C6h

01C7h Address Match Interrupt Enable Register 1

01C8h

01C9h

01CAh

01CBh

01CCh

01CDh

01CEh

01CFh

01D0h

01D1h

01D2h

01D3h

01D4h

01D5h

01D6h

01D7h

01D8h

01D9h

01DAh

01DBh

01DCh

01DDh

01DEh

01DFh

01E0h Pull-Up Control Register 0                                        PUR0             00h

01E1h Pull-Up Control Register 1                                        PUR1             00h

01E2h

01E3h

01E4h

01E5h

01E6h

01E7h

01E8h

01E9h

01EAh

01EBh

01ECh

01EDh

01EEh

01EFh

01F0h Port P1 Drive Capacity Control Register                           P1DRR            00h

01F1h Port P2 Drive Capacity Control Register                           P2DRR            00h

01F2h Drive Capacity Control Register 0                                 DRR0             00h

01F3h Drive Capacity Control Register 1                                 DRR1             00h

01F4h

01F5h Input Threshold Control Register 0                                VLT0             00h

01F6h Input Threshold Control Register 1                                VLT1             00h

01F7h

01F8h Comparator B Control Register 0                                   INTCMP           00h

01F9h

01FAh External Input Enable Register 0                                  INTEN            00h

01FBh External Input Enable Register 1                                  INTEN1           00h

01FCh INT Input Filter Select Register 0                                INTF             00h

01FDh INT Input Filter Select Register 1                                INTF1            00h

01FEh Key Input Enable Register 0                                       KIEN             00h

01FFh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

R01DS0021EJ0100 Rev.1.00                                                                      Page 22 of 54
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R8C/35M Group                                                           4. Special Function Registers (SFRs)

Table 4.9 SFR Information (9) (1)

Address                            Register                                      Symbol           After Reset
2C00h                                                                                   XXh
2C01h   DTC Transfer Vector Area                                       DTCD0            XXh
         DTC Transfer Vector Area                                       DTCD1            XXh
                                                                        DTCD2            XXh
2C02h    DTC Transfer Vector Area                                       DTCD3            XXh
2C03h    DTC Transfer Vector Area                                       DTCD4            XXh
                                                                        DTCD5            XXh
2C04h    DTC Transfer Vector Area                                                        XXh
2C05h    DTC Transfer Vector Area                                                        XXh
2C06h    DTC Transfer Vector Area                                                        XXh
                                                                                         XXh
2C07h    DTC Transfer Vector Area                                                        XXh
2C08h    DTC Transfer Vector Area                                                        XXh
                                                                                         XXh
2C09h    DTC Transfer Vector Area                                                        XXh
2C0Ah    DTC Transfer Vector Area                                                        XXh
                                                                                         XXh
    :    DTC Transfer Vector Area                                                        XXh
    :    DTC Transfer Vector Area                                                        XXh
2C3Ah    DTC Transfer Vector Area                                                        XXh
                                                                                         XXh
2C3Bh    DTC Transfer Vector Area                                                        XXh
2C3Ch    DTC Transfer Vector Area                                                        XXh
                                                                                         XXh
2C3Dh    DTC Transfer Vector Area                                                        XXh
2C3Eh    DTC Transfer Vector Area                                                        XXh
                                                                                         XXh
2C3Fh    DTC Transfer Vector Area                                                        XXh
2C40h    DTC Control Data 0                                                              XXh
2C41h                                                                                    XXh
                                                                                         XXh
2C42h                                                                                    XXh
2C43h                                                                                    XXh
                                                                                         XXh
2C44h                                                                                    XXh
2C45h                                                                                    XXh
                                                                                         XXh
2C46h                                                                                    XXh
2C47h                                                                                    XXh
                                                                                         XXh
2C48h    DTC Control Data 1                                                              XXh
2C49h                                                                                    XXh
2C4Ah                                                                                    XXh
                                                                                         XXh
2C4Bh                                                                                    XXh
2C4Ch                                                                                    XXh
                                                                                         XXh
2C4Dh                                                                                    XXh
2C4Eh                                                                                    XXh
2C4Fh                                                                                    XXh
                                                                                         XXh
2C50h    DTC Control Data 2                                                              XXh
2C51h                                                                                    XXh
                                                                                         XXh
2C52h                                                                                    XXh
2C53h                                                                                    XXh
                                                                                         XXh
2C54h                                                                                    XXh
2C55h                                                                                    XXh
2C56h                                                                                    XXh
                                                                                         XXh
2C57h    DTC Control Data 3                                                              XXh
2C58h                                                                                    XXh
                                                                                         XXh
2C59h                                                                                    XXh
2C5Ah                                                                                    XXh
2C5Bh                                                                                    XXh

2C5Ch
2C5Dh

2C5Eh
2C5Fh

2C60h    DTC Control Data 4
2C61h
2C62h
2C63h
2C64h

2C65h
2C66h

2C67h    DTC Control Data 5
2C68h

2C69h
2C6Ah
2C6Bh

2C6Ch
2C6Dh

2C6Eh
2C6Fh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

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R8C/35M Group                                                           4. Special Function Registers (SFRs)

Table 4.10 SFR Information (10) (1)

Address                    Register                                              Symbol           After Reset
                                                                        DTCD6            XXh
2C70h DTC Control Data 6                                                DTCD7            XXh
                                                                        DTCD8            XXh
2C71h                                                                   DTCD9            XXh
                                                                        DTCD10           XXh
2C72h                                                                   DTCD11           XXh
                                                                        DTCD12           XXh
2C73h                                                                   DTCD13           XXh
                                                                                         XXh
2C74h                                                                                    XXh
                                                                                         XXh
2C75h                                                                                    XXh
                                                                                         XXh
2C76h                                                                                    XXh
                                                                                         XXh
2C77h                                                                                    XXh
                                                                                         XXh
2C78h DTC Control Data 7                                                                 XXh
                                                                                         XXh
2C79h                                                                                    XXh
                                                                                         XXh
2C7Ah                                                                                    XXh
                                                                                         XXh
2C7Bh                                                                                    XXh
                                                                                         XXh
2C7Ch                                                                                    XXh
                                                                                         XXh
2C7Dh                                                                                    XXh
                                                                                         XXh
2C7Eh                                                                                    XXh
                                                                                         XXh
2C7Fh                                                                                    XXh
                                                                                         XXh
2C80h DTC Control Data 8                                                                 XXh
                                                                                         XXh
2C81h                                                                                    XXh
                                                                                         XXh
2C82h                                                                                    XXh
                                                                                         XXh
2C83h                                                                                    XXh
                                                                                         XXh
2C84h                                                                                    XXh
                                                                                         XXh
2C85h                                                                                    XXh
                                                                                         XXh
2C86h                                                                                    XXh
                                                                                         XXh
2C87h                                                                                    XXh
                                                                                         XXh
2C88h DTC Control Data 9                                                                 XXh
                                                                                         XXh
2C89h                                                                                    XXh
                                                                                         XXh
2C8Ah                                                                                    XXh
                                                                                         XXh
2C8Bh                                                                                    XXh
                                                                                         XXh
2C8Ch                                                                                    XXh
                                                                                         XXh
2C8Dh                                                                                    XXh
                                                                                         XXh
2C8Eh                                                                                    XXh
                                                                                         XXh
2C8Fh                                                                                    XXh

2C90h DTC Control Data 10

2C91h

2C92h

2C93h

2C94h

2C95h

2C96h

2C97h

2C98h DTC Control Data 11

2C99h

2C9Ah

2C9Bh

2C9Ch

2C9Dh

2C9Eh

2C9Fh

2CA0h DTC Control Data 12

2CA1h

2CA2h

2CA3h

2CA4h

2CA5h

2CA6h

2CA7h

2CA8h DTC Control Data 13

2CA9h

2CAAh

2CABh

2CACh

2CADh

2CAEh

2CAFh

X: Undefined

Note:
      1. The blank areas are reserved and cannot be accessed by users.

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R8C/35M Group                                                           4. Special Function Registers (SFRs)

Table 4.11 SFR Information (11) (1)

Address                    Register                                              Symbol           After Reset
                                                                        DTCD14           XXh
2CB0h DTC Control Data 14                                               DTCD15           XXh
                                                                        DTCD16           XXh
2CB1h                                                                   DTCD17           XXh
                                                                        DTCD18           XXh
2CB2h                                                                   DTCD19           XXh
                                                                        DTCD20           XXh
2CB3h                                                                   DTCD21           XXh
                                                                                         XXh
2CB4h                                                                                    XXh
                                                                                         XXh
2CB5h                                                                                    XXh
                                                                                         XXh
2CB6h                                                                                    XXh
                                                                                         XXh
2CB7h                                                                                    XXh
                                                                                         XXh
2CB8h DTC Control Data 15                                                                XXh
                                                                                         XXh
2CB9h                                                                                    XXh
                                                                                         XXh
2CBAh                                                                                    XXh
                                                                                         XXh
2CBBh                                                                                    XXh
                                                                                         XXh
2CBCh                                                                                    XXh
                                                                                         XXh
2CBDh                                                                                    XXh
                                                                                         XXh
2CBEh                                                                                    XXh
                                                                                         XXh
2CBFh                                                                                    XXh
                                                                                         XXh
2CC0h DTC Control Data 16                                                                XXh
                                                                                         XXh
2CC1h                                                                                    XXh
                                                                                         XXh
2CC2h                                                                                    XXh
                                                                                         XXh
2CC3h                                                                                    XXh
                                                                                         XXh
2CC4h                                                                                    XXh
                                                                                         XXh
2CC5h                                                                                    XXh
                                                                                         XXh
2CC6h                                                                                    XXh
                                                                                         XXh
2CC7h                                                                                    XXh
                                                                                         XXh
2CC8h DTC Control Data 17                                                                XXh
                                                                                         XXh
2CC9h                                                                                    XXh
                                                                                         XXh
2CCAh                                                                                    XXh
                                                                                         XXh
2CCBh                                                                                    XXh
                                                                                         XXh
2CCCh                                                                                    XXh
                                                                                         XXh
2CCDh                                                                                    XXh
                                                                                         XXh
2CCEh                                                                                    XXh
                                                                                         XXh
2CCFh                                                                                    XXh

2CD0h DTC Control Data 18

2CD1h

2CD2h

2CD3h

2CD4h

2CD5h

2CD6h

2CD7h

2CD8h DTC Control Data 19

2CD9h

2CDAh

2CDBh

2CDCh

2CDDh

2CDEh

2CDFh

2CE0h DTC Control Data 20

2CE1h

2CE2h

2CE3h

2CE4h

2CE5h

2CE6h

2CE7h

2CE8h DTC Control Data 21

2CE9h

2CEAh

2CEBh

2CECh

2CEDh

2CEEh

2CEFh

X: Undefined

Note:
      1. The blank areas are reserved and cannot be accessed by users.

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R8C/35M Group                                                           4. Special Function Registers (SFRs)

Table 4.12 SFR Information (12) (1)

Address                    Register                                              Symbol           After Reset
                                                                        DTCD22           XXh
2CF0h DTC Control Data 22                                                                XXh
                                                                        DTCD23           XXh
2CF1h                                                                                    XXh
                                                                                         XXh
2CF2h                                                                                    XXh
                                                                                         XXh
2CF3h                                                                                    XXh
                                                                                         XXh
2CF4h                                                                                    XXh
                                                                                         XXh
2CF5h                                                                                    XXh
                                                                                         XXh
2CF6h                                                                                    XXh
                                                                                         XXh
2CF7h                                                                                    XXh

2CF8h DTC Control Data 23

2CF9h

2CFAh

2CFBh

2CFCh

2CFDh

2CFEh

2CFFh

2D00h

          :

2FFFh

X: Undefined
Note:

      1. The blank areas are reserved and cannot be accessed by users.

Table 4.13 ID Code Areas and Option Function Select Area

Address                                                      Area Name           Symbol           After Reset
     :       Option Function Select Register 2                          OFS2             (Note 1)
             ID1                                                                         (Note 2)
FFDBh        ID2                                                        OFS              (Note 2)
     :       ID3                                                                         (Note 2)
             ID4                                                                         (Note 2)
FFDFh        ID5                                                                         (Note 2)
     :       ID6                                                                         (Note 2)
             ID7                                                                         (Note 2)
FFE3h       Option Function Select Register                                             (Note 1)
     :

FFEBh
     :

FFEFh
     :

FFF3h
     :

FFF7h
     :

FFFBh
     :

FFFFh

Notes:       The option function select area is allocated in the flash memory, not in the SFRs. Set appropriate values as ROM data by a program.
      1.     Do not write additions to the option function select area. If the block including the option function select area is erased, the option function select
             area is set to FFh.
      2.     When blank products are shipped, the option function select area is set to FFh. It is set to the written value after written by the user.
             When factory-programming products are shipped, the value of the option function select area is the value programmed by the user.
             The ID code areas are allocated in the flash memory, not in the SFRs. Set appropriate values as ROM data by a program.
             Do not write additions to the ID code areas. If the block including the ID code areas is erased, the ID code areas are set to FFh.
             When blank products are shipped, the ID code areas are set to FFh. They are set to the written value after written by the user.
             When factory-programming products are shipped, the value of the ID code areas is the value programmed by the user.

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5. Electrical Characteristics

Table 5.1      Absolute Maximum Ratings

     Symbol                      Parameter                    Condition  Rated Value              Unit
VCC/AVCC      Supply voltage                 -40C  Topr  85C
VI            Input voltage                                             -0.3 to 6.5              V
VO            Output voltage
Pd            Power dissipation                                         -0.3 to VCC + 0.3        V
Topr          Operating ambient temperature
                                                                         -0.3 to VCC + 0.3        V
Tstg
                                                                         500                      mW

                                                                         -20 to 85 (N version) /  C

                                                                         -40 to 85 (D version)

               Storage temperature                                       -65 to 150               C

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Table 5.2 Recommended Operating Conditions

Symbol                              Parameter                                  Conditions              Standard
                                                                                                                                   Unit
                                                                         4.0 V  VCC  5.5 V
                                                                         2.7 V  VCC < 4.0 V  Min. Typ. Max.
                                                                         1.8 V  VCC < 2.7 V
VCC/AVCC Supply voltage                                                  4.0 V  VCC  5.5 V   1.8      -               5.5  V
                                                                         2.7 V  VCC < 4.0 V
VSS/AVSS Supply voltage                                                  1.8 V  VCC < 2.7 V  -        0               -    V
                                                                         4.0 V  VCC  5.5 V
VIH        Input "H" voltage  Other than CMOS input                      2.7 V  VCC < 4.0 V  0.8 VCC  -               VCC  V
                                                                         1.8 V  VCC < 2.7 V
                              CMOS   Input level  Input level selection                      0.5 VCC  -               VCC  V
                              input  switching    : 0.35 VCC             4.0 V  VCC  5.5 V
                                     function                            2.7 V  VCC < 4.0 V  0.55 VCC -               VCC  V
                                     (I/O port)   Input level selection  1.8 V  VCC < 2.7 V
                                                  : 0.5 VCC              4.0 V  VCC  5.5 V   0.65 VCC -               VCC  V
                                                                         2.7 V  VCC < 4.0 V
                                                                         1.8 V  VCC < 2.7 V  0.65 VCC -               VCC  V
                                                                         4.0 V  VCC  5.5 V
                                                                         2.7 V  VCC < 4.0 V  0.7 VCC  -               VCC  V
                                                                         1.8 V  VCC < 2.7 V
                                                                                             0.8 VCC  -               VCC  V
                                                                         2.7 V  VCC  5.5 V
                                                  Input level selection  1.8 V  VCC < 2.7 V  0.85 VCC -               VCC  V
                                                  : 0.7 VCC              1.8 V  VCC  5.5 V
                                                                         2.7 V  VCC  5.5 V   0.85 VCC -               VCC  V
                                                                         2.7 V  VCC  5.5 V
                                                                         1.8 V  VCC < 2.7 V  0.85 VCC -               VCC  V
                                                                         2.7 V  VCC  5.5 V
                              External clock input (XOUT)                1.8 V  VCC < 2.7 V  1.2      -               VCC  V
                                                                         2.7 V  VCC  5.5 V
VIL        Input "L" voltage Other than CMOS input                       1.8 V  VCC < 2.7 V  0        -               0.2 VCC V

                              CMOS   Input level  Input level selection                      0        -               0.2 VCC V
                              input  switching    : 0.35 VCC
                                     function                                                0        -               0.2 VCC V
                                     (I/O port)   Input level selection
                                                  : 0.5 VCC                                  0        -               0.2 VCC V

                                                                                             0        -               0.4 VCC V

                                                                                             0        -               0.3 VCC V

                                                                                             0        -               0.2 VCC V

                                                  Input level selection                      0        - 0.55 VCC V
                                                  : 0.7 VCC
                                                                                             0        - 0.45 VCC V

                                                                                             0        - 0.35 VCC V

                              External clock input (XOUT)                                    0        -               0.4  V

IOH(sum)   Peak sum output "H" current Sum of all pins IOH(peak)                             -        -               -160 mA
IOH(sum)
IOH(peak)  Average sum output "H" current Sum of all pins IOH(avg)                           -        -               -80 mA

IOH(avg)   Peak output "H" current   Drive capacity Low                                      -        -               -10 mA

IOL(sum)                             Drive capacity High                                     -        -               -40 mA
IOL(sum)
IOL(peak)  Average output "H" current Drive capacity Low                                     -        -               -5 mA

IOL(avg)                             Drive capacity High                                     -        -               -20 mA

f(XIN)     Peak sum output "L" current Sum of all pins IOL(peak)                             -        -               160 mA

           Average sum output "L" current Sum of all pins IOL(avg)                           -        -               80 mA

           Peak output "L" current   Drive capacity Low                                      -        -               10 mA

                                     Drive capacity High                                     -        -               40 mA

           Average output "L" current Drive capacity Low                                     -        -               5    mA

                                     Drive capacity High                                     -        -               20 mA

           XIN clock input oscillation frequency                                             -        -               20 MHz

                                                                                             -        -               5 MHz

f(XCIN) XCIN clock input oscillation frequency                                               -        32.768 50 kHz
fOCO40M When used as the count source for timer RC or timer RD (3)
fOCO-F fOCO-F frequency                                                                      32       -               40 MHz

                                                                                             -        -               20 MHz

                                                                                             -        -               5 MHz

-          System clock frequency                                                            -        -               20 MHz

                                                                                             -        -               5 MHz

f(BCLK) CPU clock frequency                                                                  -        -               20 MHz

                                                                                             -        -               5 MHz

Notes:
     1. VCC = 1.8 to 5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. The average output current indicates the average value of current measured during 100 ms.
     3. fOCO40M can be used as the count source for timer RC or timer RD in the range of VCC = 2.7 V to 5.5V.

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                          P0

                          P1

                          P2                          30pF

                          P3

                          P4

                          P5

                          P6

Figure 5.1 Ports P0 to P6 Timing Measurement Circuit

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Table 5.3 A/D Converter Characteristics

Symbol                 Parameter                             Conditions                       Standard         Unit
                                                                                                                Bit
                                                                                        Min. Typ. Max.         LSB

-       Resolution                              Vref = AVCC                             -     -         10     LSB

-       Absolute accuracy          10-bit mode  Vref = AVCC = 5.0 V  AN0 to AN7 input,  -     -         3     LSB
                                                                     AN8 to AN11 input
                                                                                                               LSB
                                                Vref = AVCC = 3.3 V  AN0 to AN7 input,  -     -         5
                                                                     AN8 to AN11 input                         LSB

                                                Vref = AVCC = 3.0 V  AN0 to AN7 input,  -     -         5     LSB
                                                                     AN8 to AN11 input
                                                                                                               LSB
                                                Vref = AVCC = 2.2 V  AN0 to AN7 input,  -     -         5
                                                                     AN8 to AN11 input                         LSB

                                   8-bit mode   Vref = AVCC = 5.0 V  AN0 to AN7 input,  -     -         2     MHz
                                                                     AN8 to AN11 input                         MHz
                                                                                                               MHz
                                                Vref = AVCC = 3.3 V  AN0 to AN7 input,  -     -         2     MHz
                                                                     AN8 to AN11 input                          k
                                                                                                                s
                                                Vref = AVCC = 3.0 V  AN0 to AN7 input,  -     -         2      s
                                                                     AN8 to AN11 input                          s
                                                                                                                A
                                                Vref = AVCC = 2.2 V  AN0 to AN7 input,  -     -         2
                                                                     AN8 to AN11 input                           V
                                                                                                                 V
AD      A/D conversion clock                    4.0 V  Vref = AVCC  5.5 V (2)             2     -        20      V
                                                                                          2     -        16
                                                3.2 V  Vref = AVCC  5.5 V (2)             2     -        10
                                                                                          2     -         5
                                                2.7 V  Vref = AVCC  5.5 V (2)             -     3         -
                                                                                        2.2     -         -
                                                2.2 V  Vref = AVCC  5.5 V (2)           2.2     -         -
                                                                                        0.8     -         -
-       Tolerance level impedance                                                         -    45         -
                                                                                        2.2     -       AVCC
tCONV   Conversion time            10-bit mode  Vref = AVCC = 5.0 V, AD = 20 MHz          0     -        Vref
                                                Vref = AVCC = 5.0 V, AD = 20 MHz        1.19  1.34      1.49
                                   8-bit mode   AD = 20 MHz
                                                VCC = 5 V, XIN = f1 = AD = 20 MHz
tSAMP   Sampling time

IVref   Vref current

Vref    Reference voltage

VIA     Analog input voltage (3)

OCVREF On-chip reference voltage                2 MHz  AD  4 MHz

Notes:
     1. VCC/AVCC = Vref = 2.2 to 5.5 V, VSS = 0 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise
          specified.
     2. The A/D conversion result will be undefined in wait mode, stop mode, when the flash memory stops, and in low-current-
          consumption mode. Do not perform A/D conversion in these states or transition to these states during A/D conversion.
     3. When the analog input voltage is over the reference voltage, the A/D conversion result will be 3FFh in 10-bit mode and FFh in
          8-bit mode.

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Table 5.4 D/A Converter Characteristics

   Symbol                            Parameter                           Condition                     Standard
                                                       (Note 2)                                                                  Unit
-              Resolution
-              Absolute accuracy                                                               Min. Typ. Max.
tsu            Setup time
RO             Output resistor                                                                 -         -               8  Bit
IVref          Reference power input current
                                                                                               -         -               2.5 LSB

                                                                                               -         -               3  s

                                                                                               -         6               -  k

                                                                                               -         -               1.5 mA

Notes:
     1. VCC/AVCC = Vref = 2.7 to 5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. This applies when one D/A converter is used and the value of the DAi register (i = 0 or 1) for the unused D/A converter is 00h.
          The resistor ladder of the A/D converter is not included.

Table 5.5 Comparator A Electrical Characteristics

   Symbol              Parameter                       Condition                               Standard                     Unit

                                                                                       Min. Typ.                   Max.

LVREF          External reference voltage input range                                  1.4        -                VCC      V

LVCMP1,        External comparison voltage input                                       -0.3       -      VCC + 0.3          V
LVCMP2         range

-              Offset                                                                     -    50                  200      mV

-              Comparator output delay time (2)        At falling, VI = Vref - 100 mV     -       3                -        s

                                                       At falling, VI = Vref - 1 V or below -  1.5                 -        s

                                                       At rising, VI = Vref + 100 mV      -       2                -        s

                                                       At rising, VI = Vref + 1 V or above -   0.5                 -        s

-              Comparator operating current            VCC = 5.0 V                        -    0.5                 -        A

Notes:
     1. VCC = 2.7 to 5.5 V, Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. When the digital filter is disabled.

Table 5.6 Comparator B Electrical Characteristics

   Symbol                           Parameter                     Condition                    Standard                     Unit

Vref           IVREF1, IVREF3 input reference voltage  VI = Vref 100 mV              Min. Typ.                   Max.
VI             IVCMP1, IVCMP3 input voltage            VCC = 5.0 V
-              Offset                                                                  0       -         VCC - 1.4          V
td             Comparator output delay time (2)
ICMP           Comparator operating current                                            -0.3    -         VCC + 0.3          V

                                                                                       -       5                   100      mV

                                                                                       -       0.1                 -        s

                                                                                       -       17.5                -        A

Notes:
     1. VCC = 2.7 to 5.5 V, Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. When the digital filter is disabled.

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R8C/35M Group                                                                          5. Electrical Characteristics

Table 5.7 Flash Memory (Program ROM) Electrical Characteristics

    Symbol                        Parameter             Conditions                     Standard               Unit

-              Program/erase endurance (2)                            Min.             Typ.      Max.         times
-              Byte program time                                    1,000 (3)                                  s
-              Block erase time                                                        -         -              s
td(SR-SUS)     Time delay from suspend request until                    -                                      ms
               suspend                                                  -              80        500
-              Interval from erase start/restart until                  -                                      s
               following suspend request                                               0.3       -
-              Time from suspend until erase restart                    0
                                                                                       - 5+CPU clock
td(CMDRST-                                                              -                         3 cycles

READY)                                                                                 -         -

-                                                                                      - 30+CPU clock s
-                                                                                                   1 cycle
-
-              Time from when command is forcibly                   -                  - 30+CPU clock s
                                                                                                    1 cycle
               terminated until reading is enabled

               Program, erase voltage                               2.7                -         5.5          V

               Read voltage                                         1.8                -         5.5          V

               Program, erase temperature                           0                  -         60           C

               Data hold time (7)                       Ambient temperature = 55C 20  -         -            year

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = 0 to 60C, unless otherwise specified.
     2. Definition of programming/erasure endurance
          The programming and erasure endurance is defined on a per-block basis.
          If the programming and erasure endurance is n (n = 1,000), each block can be erased n times. For example, if 1,024 1-byte
          writes are performed to different addresses in block A, a 1 Kbyte block, and then the block is erased, the
          programming/erasure endurance still stands at one.
          However, the same address must not be programmed more than once per erase operation (overwriting prohibited).
     3. Endurance to guarantee all electrical characteristics after program and erase. (1 to Min. value can be guaranteed).
     4. In a system that executes multiple programming operations, the actual erasure count can be reduced by writing to sequential
          addresses in turn so that as much of the block as possible is used up before performing an erase operation. For example,
          when programming groups of 16 bytes, the effective number of rewrites can be minimized by programming up to 128 groups
          before erasing them all in one operation. It is also advisable to retain data on the erasure endurance of each block and limit
          the number of erase operations to a certain number.
     5. If an error occurs during block erase, attempt to execute the clear status register command, then execute the block erase
          command at least three times until the erase error does not occur.
     6. Customers desiring program/erase failure rate information should contact their Renesas technical support representative.
     7. The data hold time includes time that the power supply is off or the clock is not supplied.

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Table 5.8 Flash Memory (Data flash Block A to Block D) Electrical Characteristics

    Symbol                         Parameter            Conditions                               Standard            Unit
-
-              Program/erase endurance (2)                                              Min.     Typ.         Max.   times
               Byte program time                                                     10,000 (3)                        s
-              (program/erase endurance  1,000 times)                                            -            -
               Byte program time                                                          -
-              (program/erase endurance > 1,000 times)                                    -      160          1,500
               Block erase time                                                           -
-              (program/erase endurance  1,000 times)                                     -      300          1,500  s
               Block erase time                                                           -
td(SR-SUS)     (program/erase endurance > 1,000 times)                                    0      0.2          1      s
               Time delay from suspend request until
-              suspend                                                                    -      0.3          1      s
               Interval from erase start/restart until
-              following suspend request                                                         - 5+CPU clock ms
               Time from suspend until erase restart                                                       3 cycles
td(CMDRST-
                                                                                                 -            -      s
READY)
                                                                                                 - 30+CPU clock s
-                                                                                                            1 cycle
-
-              Time from when command is forcibly                                    -           - 30+CPU clock s
-              terminated until reading is enabled                                                          1 cycle
               Program, erase voltage
               Read voltage                                                            2.7       -            5.5    V
               Program, erase temperature                                              1.8
                                                                                     -20 (7)     -            5.5    V
               Data hold time (8)                                                      20
                                                                                                 -            85     C

                                                        Ambient temperature = 55 C              -            -      year

Notes:
     1. VCC = 2.7 to 5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. Definition of programming/erasure endurance
          The programming and erasure endurance is defined on a per-block basis.
          If the programming and erasure endurance is n (n = 10,000), each block can be erased n times. For example, if 1,024 1-byte
          writes are performed to different addresses in block A, a 1 Kbyte block, and then the block is erased, the
          programming/erasure endurance still stands at one.
          However, the same address must not be programmed more than once per erase operation (overwriting prohibited).
     3. Endurance to guarantee all electrical characteristics after program and erase. (1 to Min. value can be guaranteed).
     4. In a system that executes multiple programming operations, the actual erasure count can be reduced by writing to sequential
          addresses in turn so that as much of the block as possible is used up before performing an erase operation. For example,
          when programming groups of 16 bytes, the effective number of rewrites can be minimized by programming up to 128 groups
          before erasing them all in one operation. In addition, averaging the erasure endurance between blocks A to D can further
          reduce the actual erasure endurance. It is also advisable to retain data on the erasure endurance of each block and limit the
          number of erase operations to a certain number.
     5. If an error occurs during block erase, attempt to execute the clear status register command, then execute the block erase
          command at least three times until the erase error does not occur.
     6. Customers desiring program/erase failure rate information should contact their Renesas technical support representative.
     7. -40C for D version.
     8. The data hold time includes time that the power supply is off or the clock is not supplied.

            Suspend request
                  (FMR21 bit)

                                 FST7 bit               Fixed time  Clock-dependent
                                 FST6 bit                                   time
                                                                                              Access restart
                     FST6, FST7: Bit in FST register
                     FMR21: Bit in FMR2 register                    td(SR-SUS)

Figure 5.2 Time delay until Suspend

R01DS0021EJ0100 Rev.1.00                                                                                         Page 33 of 54
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Table 5.9 Voltage Detection 0 Circuit Electrical Characteristics

   Symbol                 Parameter                                Condition                               Standard
                                                                                                                                      Unit

                                                                                                   Min. Typ. Max.

Vdet0      Voltage detection level Vdet0_0 (2)                                                     1.80 1.90 2.05  V

           Voltage detection level Vdet0_1 (2)                                                     2.15 2.35 2.50  V

           Voltage detection level Vdet0_2 (2)                                                     2.70 2.85 3.05  V

           Voltage detection level Vdet0_3 (2)                                                     3.55 3.80 4.05  V

-          Voltage detection 0 circuit response time (4)           At the falling of VCC from 5 V  -  6     150 s

                                                                   to (Vdet0_0 - 0.1) V

-          Voltage detection circuit self power consumption VCA25 = 1, VCC = 5.0 V                 -  1.5   -      A

td(E-A)    Waiting time until voltage detection circuit                                            -  -     100 s
           operation starts (3)

Notes:
     1. The measurement condition is VCC = 1.8 V to 5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version).
     2. Select the voltage detection level with bits VDSEL0 and VDSEL1 in the OFS register.
     3. Necessary time until the voltage detection circuit operates when setting to 1 again after setting the VCA25 bit in the VCA2
          register to 0.
     4. Time until the voltage monitor 0 reset is generated after the voltage passes Vdet0.

Table 5.10 Voltage Detection 1 Circuit Electrical Characteristics

  Symbol                               Parameter                              Condition                    Standard
Vdet1                                                                                                                                 Unit
           Voltage detection level Vdet1_0 (2)                     At the falling of VCC
-          Voltage detection level Vdet1_1 (2)                     At the falling of VCC           Min. Typ. Max.
-          Voltage detection level Vdet1_2 (2)                     At the falling of VCC
-          Voltage detection level Vdet1_3 (2)                     At the falling of VCC           2.00 2.20 2.40  V
td(E-A)    Voltage detection level Vdet1_4 (2)                     At the falling of VCC
           Voltage detection level Vdet1_5 (2)                     At the falling of VCC           2.15 2.35 2.55  V
           Voltage detection level Vdet1_6 (2)                     At the falling of VCC
           Voltage detection level Vdet1_7 (2)                     At the falling of VCC           2.30 2.50 2.70  V
           Voltage detection level Vdet1_8 (2)                     At the falling of VCC
           Voltage detection level Vdet1_9 (2)                     At the falling of VCC           2.45 2.65 2.85  V
           Voltage detection level Vdet1_A (2)                     At the falling of VCC
           Voltage detection level Vdet1_B (2)                     At the falling of VCC           2.60 2.80 3.00  V
           Voltage detection level Vdet1_C (2)                     At the falling of VCC
           Voltage detection level Vdet1_D (2)                     At the falling of VCC           2.75 2.95 3.15  V
           Voltage detection level Vdet1_E (2)                     At the falling of VCC
           Voltage detection level Vdet1_F (2)                     At the falling of VCC           2.85 3.10 3.40  V
           Hysteresis width at the rising of Vcc in voltage        Vdet1_0 to Vdet1_5
           detection 1 circuit                                     selected                        3.00 3.25 3.55  V
                                                                   Vdet1_6 to Vdet1_F
           Voltage detection 1 circuit response time (3)           selected                        3.15 3.40 3.70  V
                                                                   At the falling of VCC from
           Voltage detection circuit self power consumption        5 V to (Vdet1_0 - 0.1) V        3.30 3.55 3.85  V
           Waiting time until voltage detection circuit operation  VCA26 = 1, VCC = 5.0 V
           starts (4)                                                                              3.45 3.70 4.00  V

                                                                                                   3.60 3.85 4.15  V

                                                                                                   3.75 4.00 4.30  V

                                                                                                   3.90 4.15 4.45  V

                                                                                                   4.05 4.30 4.60  V

                                                                                                   4.20 4.45 4.75  V

                                                                                                   -  0.07  -      V

                                                                                                   -  0.10  -      V

                                                                                                   -  60 150 s

                                                                                                   -  1.7   -      A

                                                                                                   -  -     100 s

Notes:
     1. The measurement condition is VCC = 1.8 V to 5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version).
     2. Select the voltage detection level with bits VD1S0 to VD1S3 in the VD1LS register.
     3. Time until the voltage monitor 1 interrupt request is generated after the voltage passes Vdet1.
     4. Necessary time until the voltage detection circuit operates when setting to 1 again after setting the VCA26 bit in the VCA2
          register to 0.

R01DS0021EJ0100 Rev.1.00                                                                                    Page 34 of 54
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Table 5.11 Voltage Detection 2 Circuit Electrical Characteristics

   Symbol                 Parameter                                        Condition                                Standard
                                                                                                                                               Unit

                                                                                                            Min. Typ. Max.

Vdet2          Voltage detection level Vdet2_0 (2)                         At the falling of VCC            3.70 4.00 4.30       V

               Voltage detection level Vdet2_EXT (2)                       At the falling of LVCMP2 1.20 1.34 1.48               V

-              Hysteresis width at the rising of Vcc in voltage detection                                   -  0.10       -      V

               2 circuit

-              Voltage detection 2 circuit response time (3)               At the falling of Vcc from -        20 150 s
                                                                           5 V to (Vdet2_0 - 0.1) V

-              Voltage detection circuit self power consumption            VCA27 = 1, VCC = 5.0 V -            1.7        -      A

td(E-A)        Waiting time until voltage detection circuit operation                                       -  -      100 s
               starts (4)

Notes:
     1. The measurement condition is VCC = 1.8 V to 5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version).
     2. The voltage detection level varies with detection targets. Select the level with the VCA24 bit in the VCA2 register.
     3. Time until the voltage monitor 2 interrupt request is generated after the voltage passes Vdet2.
     4. Necessary time until the voltage detection circuit operates after setting to 1 again after setting the VCA27 bit in the VCA2
          register to 0.

Table 5.12 Power-on Reset Circuit (2)

   Symbol                                Parameter                               Condition                  Standard           Unit
trth            External power VCC rise gradient                                                                             mV/ms
                                                                       (1)                        Min. Typ. Max.

                                                                                                         0     - 50,000

Notes:
     1. The measurement condition is Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. To use the power-on reset function, enable voltage monitor 0 reset by setting the LVDAS bit in the OFS register to 0.

     Vdet0 (1)                                                                                                        Vdet0 (1)

   External                      trth                                                              trth
Power VCC       tw(por) (2)
                                                       Voltage detection 0
       0.5 V                                          circuit response time

     Internal
reset signal

                                                       1 32                                                     1 32
                                                    fOCO-S                                                     fOCO-S

   Notes:
      1. Vdet0 indicates the voltage detection level of the voltage detection 0 circuit. Refer to 6. Voltage Detection
           Circuit for details.
      2. tw(por) indicates the duration the external power VCC must be held below the valid voltage (0.5 V) to enable
           a power-on reset. When turning on the power after it falls with voltage monitor 0 reset disabled, maintain
           tw(por) for 1 ms or more.

Figure 5.3 Power-on Reset Circuit Electrical Characteristics

R01DS0021EJ0100 Rev.1.00                                                                                              Page 35 of 54
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Table 5.13 High-speed On-Chip Oscillator Circuit Electrical Characteristics

   Symbol                 Parameter                                Condition                                Standard        Unit
-                                                                                                                           MHz
                                                                                                     Min.      Typ. Max.
-
-              High-speed on-chip oscillator frequency after       VCC = 1.8 V to 5.5 V              39.4      40     40.6
               reset                                               -20C  Topr  85C
                                                                                                     39.4      40     40.6 MHz
               High-speed on-chip oscillator frequency when        VCC = 1.8 V to 5.5 V
               the FRA4 register correction value is written into  -40C  Topr  85C                 39.6      40     40.4 MHz
               the FRA1 register and the FRA5 register
               correction value into the FRA3 register (2)         VCC = 1.8 V to 5.5 V      36.311 36.864 37.417 MHz
                                                                   Topr = 25C
               High-speed on-chip oscillator frequency when                                  36.311 36.864 37.417 MHz
               the FRA6 register correction value is written into  VCC = 1.8 V to 5.5 V
               the FRA1 register and the FRA7 register             -20C  Topr  85C         36.495 36.864 37.233 MHz
               correction value into the FRA3 register
                                                                   VCC = 1.8 V to 5.5 V              31.52     32 32.48 MHz
               Oscillation stability time                          -40C  Topr  85C
               Self power consumption at oscillation                                                 31.52     32 32.48 MHz
                                                                   VCC = 1.8 V to 5.5 V
                                                                   Topr = 25C                       31.68     32 32.32 MHz

                                                                   VCC = 1.8 V to 5.5 V              -         100    450 s
                                                                   -20C  Topr  85C
                                                                                                     -         500    -     A
                                                                   VCC = 1.8 V to 5.5 V
                                                                   -40C  Topr  85C

                                                                   VCC = 1.8 V to 5.5 V
                                                                   Topr = 25C
                                                                   VCC = 5.0 V, Topr = 25C
                                                                   VCC = 5.0 V, Topr = 25C

Notes:
     1. VCC = 1.8 to 5.5 V, Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. This enables the setting errors of bit rates such as 9600 bps and 38400 bps to be 0% when the serial interface is used in
          UART mode.

Table 5.14 Low-speed On-Chip Oscillator Circuit Electrical Characteristics

Symbol                    Parameter                                          Condition                        Standard
                                                                                                                                         Unit
                                                                   VCC = 5.0 V, Topr = 25C
                                                                   VCC = 5.0 V, Topr = 25C          Min. Typ. Max.

fOCO-S         Low-speed on-chip oscillator frequency                                                   60     125 250 kHz
-              Oscillation stability time
-              Self power consumption at oscillation                                                    -      30     100 s
fOCO-WDT       Low-speed on-chip oscillator frequency for the
               watchdog timer                                                                           -      2      -     A
-              Oscillation stability time
-              Self power consumption at oscillation                                                    60     125 250 kHz

                                                                   VCC = 5.0 V, Topr = 25C             -      30     100 s

                                                                   VCC = 5.0 V, Topr = 25C             -      2      -     A

Note:
     1. VCC = 1.8 to 5.5 V, Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.

Table 5.15 Power Supply Circuit Timing Characteristics

Symbol                    Parameter                                Condition                                      Standard
                                                                                                                                           Unit

                                                                                                           Min. Typ. Max.

td(P-R)    Time for internal power supply stabilization during                                              -      - 2,000 s
           power-on (2)

Notes:
     1. The measurement condition is VCC = 1.8 to 5.5 V and Topr = 25C.
     2. Waiting time until the internal power supply generation circuit stabilizes during power-on.

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Table 5.16 Timing Requirements of Synchronous Serial Communication Unit (SSU) (1)

   Symbol      Parameter                        Conditions              Min.     Standard  Max.            Unit
tSUCYC                                                                    4     Typ.         -
tHI            SSCK clock cycle time                                    0.4                               tCYC (2)
tLO                                                                     0.4       -                       tSUCYC
tRISE                                                                     -                               tSUCYC
               SSCK clock "H" width                                       -     -          0.6            tCYC (2)
tFALL                                                                     -
               SSCK clock "L" width                                       -     -          0.6               s
tSU                                                                                                       tCYC (2)
tH             SSCK clock rising        Master                          100     -          1
tLEAD          time                     Slave                             1                                  s
tLAG                                                                            -          1                 ns
tOD                                                                 1tCYC + 50                            tCYC (2)
tSA            SSCK clock falling       Master                                  -          1                 ns
               time                     Slave                       1tCYC + 50
tOR                                                                             -          1                 ns
                                                                          -
               SSO, SSI data input setup time                             -     -          -              tCYC (2)
                                                                          -                                  ns
               SSO, SSI data input hold time                              -     -          -                 ns
                                                                          -                                  ns
               SCS setup time           Slave                                   -          -                 ns

               SCS hold time            Slave                                   -          -

               SSO, SSI data output delay time                                  -          1

               SSI slave access time            2.7 V  VCC  5.5 V               -          1.5tCYC + 100
                                                1.8 V  VCC < 2.7 V
                                                2.7 V  VCC  5.5 V               -          1.5tCYC + 200
                                                1.8 V  VCC < 2.7 V
               SSI slave out open time                                          -          1.5tCYC + 100

                                                                                -          1.5tCYC + 200

Notes:
     1. VCC = 1.8 to 5.5 V, VSS = 0 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. 1tCYC = 1/f1(s)

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4-Wire Bus Communication Mode, Master, CPHS = 1

SCS (output)              VIH or VOH
                             VIL or VOL
                                      tHI                               tFALL                       tRISE

SSCK (output)
   (CPOS = 1)

                                                                  tLO
                                                                   tHI

SSCK (output)
   (CPOS = 0)

                               tLO                                      tSUCYC

SSO (output)

                                                                                  tOD

SSI (input)

                          tSU  tH

4-Wire Bus Communication Mode, Master, CPHS = 0

SCS (output)              VIH or VOH
                             VIL or VOL
                                      tHI                               tFALL                       tRISE

SSCK (output)
   (CPOS = 1)

                                                                  tLO
                                                                   tHI

SSCK (output)
   (CPOS = 0)

                               tLO                                      tSUCYC

SSO (output)

                                                                                               tOD

SSI (input)

                               tSU         tH

                    CPHS, CPOS: Bits in SSMR register

Figure 5.4 I/O Timing of Synchronous Serial Communication Unit (SSU) (Master)

R01DS0021EJ0100 Rev.1.00                                                                                   Page 38 of 54
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4-Wire Bus Communication Mode, Slave, CPHS = 1

               SCS (input)        VIH or VOH
                                     VIL or VOL

                                              tLEAD  tHI                   tFALL         tRISE             tLAG
                                                                                                                 tOR
               SSCK (input)                                   tLO
                (CPOS = 1)                                    tHI                               tLAG
                                                                                                      tOR
               SSCK (input)
                (CPOS = 0)

                                                     tLO             tSUCYC

               SSO (input)

                                              tSU         tH

               SSI (output)

                                         tSA                               tOD

4-Wire Bus Communication Mode, Slave, CPHS = 0

   SCS (input)                    VIH or VOH

SSCK (input)                      VIL or VOL
(CPOS = 1)
                                  tLEAD       tHI             tFALL               tRISE

                                                     tLO
                                                     tHI

SSCK (input)
(CPOS = 0)

                                              tLO                  tSUCYC

SSO (input)

                                              tSU         tH

SSI (output)

                             tSA                                           tOD

                                CPHS, CPOS: Bits in SSMR register

Figure 5.5 I/O Timing of Synchronous Serial Communication Unit (SSU) (Slave)

R01DS0021EJ0100 Rev.1.00                                                                                              Page 39 of 54
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                                                                    tHI  tSUCYC

                               VIH or VOH

               SSCK

                                  VIL or VOL
                                                      tLO

SSO (output)

                                                                                             tOD

SSI (input)

                          tSU  tH

Figure 5.6     I/O Timing of Synchronous Serial Communication Unit (SSU) (Clock Synchronous
               Communication Mode)

R01DS0021EJ0100 Rev.1.00                                                                          Page 40 of 54
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Table 5.17 Timing Requirements of I2C bus Interface (1)

  Symbol                       Parameter                      Condition                  Standard                Unit
                                                                                                   Max.
tSCL      SCL input cycle time                                                Min.         Typ.
tSCLH     SCL input "H" width
tSCLL     SCL input "L" width                                            12tCYC + 600 (2)  -       -                             ns
tsf       SCL, SDA input fall time
tSP       SCL, SDA input spike pulse rejection time                      3tCYC + 300 (2)   -       -                             ns
tBUF      SDA input bus-free time
tSTAH     Start condition input hold time                                5tCYC + 500 (2)   -       -                             ns
tSTAS     Retransmit start condition input setup time
tSTOP     Stop condition input setup time                                     -            -       300                           ns
tSDAS     Data input setup time
tSDAH     Data input hold time                                                -            -       1tCYC (2)                     ns

                                                                              5tCYC (2)    -       -                             ns

                                                                              3tCYC (2)    -       -                             ns

                                                                              3tCYC (2)    -       -                             ns

                                                                              3tCYC (2)    -       -                             ns

                                                                         1tCYC + 40 (2)    -       -                             ns

                                                                              10           -       -                             ns

Notes:
     1. VCC = 1.8 to 5.5 V, VSS = 0 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.
     2. 1tCYC = 1/f1(s)

SDA                              VIH
                                 VIL
                     tBUF         tSTAH

                                         tSCLH                         tSTAS               tSP tSTOP
                                                              Sr(3)
SCL                                                                                                             P(2)
                                                                                         tSDAS
               P(2)        S(1)  tSCLL

                           tsf                 tsr

                                         tSCL          tSDAH

               Notes:
                 1. Start condition
                 2. Stop condition
                 3. Retransmit start condition

Figure 5.7 I/O Timing of I2C bus Interface

R01DS0021EJ0100 Rev.1.00                                                                              Page 41 of 54
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Table 5.18 Electrical Characteristics (1) [4.2 V  Vcc  5.5 V]

Symbol               Parameter                              Condition                      Standard       Unit

                                                                                     Min.  Typ. Max.

VOH      Output "H" Other than XOUT       Drive capacity High VCC = 5 V IOH = -20 mA VCC - 2.0 -     VCC  V

         voltage                          Drive capacity Low VCC = 5 V IOH = -5 mA VCC - 2.0 -       VCC  V

                     XOUT                 VCC = 5 V                    IOH = -200 A 1.0   -         VCC  V

VOL      Output "L" Other than XOUT Drive capacity High VCC = 5 V IOL = 20 mA        -     -         2.0  V

         voltage                          Drive capacity Low VCC = 5 V IOL = 5 mA    -     -         2.0  V

                     XOUT                 VCC = 5 V                    IOL = 200 A  -     -         0.5  V

VT+-VT-  Hysteresis  INT0, INT1, INT2,    VCC = 5.0 V                                0.1   1.2       -    V
                     INT3, INT4,
                     KI0, KI1, KI2, KI3,
                     TRAIO, TRCIOA,
                     TRCIOB, TRCIOC,
                     TRCIOD, TRDIOA0,
                     TRDIOB0, TRDIOC0,
                     TRDIOD0, TRDIOA1,
                     TRDIOB1, TRDIOC1,
                     TRDIOD1, TRCTRG,
                     TRCCLK, ADTRG,
                     RXD0, RXD1, RXD2,
                     CLK0, CLK1, CLK2,
                     SSI, SCL, SDA, SSO

                     RESET                VCC = 5.0 V                                0.1   1.2       -    V

IIH      Input "H" current                VI = 5 V, VCC = 5.0 V                      -     -         5.0 A

IIL      Input "L" current                VI = 0 V, VCC = 5.0 V                      -     -         -5.0 A

RPULLUP Pull-up resistance                VI = 0 V, VCC = 5.0 V                      25    50 100 k

RfXIN    Feedback XIN                                                                -     0.3       -    M
         resistance

RfXCIN   Feedback XCIN                                                               -     8         -    M
         resistance

VRAM RAM hold voltage                     During stop mode                           1.8   -         -    V

Note:
     1. 4.2 V  VCC  5.5 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), f(XIN) = 20 MHz, unless otherwise specified.

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Table 5.19 Electrical Characteristics (2) [3.3 V  Vcc  5.5 V]
                   (Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.)

Symbol  Parameter                                           Condition                                           Standard  Unit
                                                                                                         Min. Typ. Max.

ICC     Power supply          High-speed       XIN = 20 MHz (square wave)                                -  6.5 15 mA

        current               clock mode       High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
        (VCC = 3.3 to 5.5 V)
                                               No division

        Single-chip mode,                      XIN = 16 MHz (square wave)                                -  5.3 12.5 mA
        output pins are                        High-speed on-chip oscillator off
        open, other pins                       Low-speed on-chip oscillator on = 125 kHz
                                               No division

        are VSS                                XIN = 10 MHz (square wave)                                -  3.6     -     mA
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
                                               No division

                                               XIN = 20 MHz (square wave)                                -  3.0     -     mA
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
                                               Divide-by-8

                                               XIN = 16 MHz (square wave)                                -  2.2     -     mA
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
                                               Divide-by-8

                                               XIN = 10 MHz (square wave)                                -  1.5     -     mA
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
                                               Divide-by-8

                              High-speed       XIN clock off                                             -  7.0 15 mA
                              on-chip          High-speed on-chip oscillator on fOCO-F = 20 MHz
                              oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                               No division

                                               XIN clock off                                             -  3.0     -     mA
                                               High-speed on-chip oscillator on fOCO-F = 20 MHz
                                               Low-speed on-chip oscillator on = 125 kHz
                                               Divide-by-8

                                               XIN clock off                                             -  1       -     mA
                                               High-speed on-chip oscillator on fOCO-F = 4 MHz
                                               Low-speed on-chip oscillator on = 125 kHz
                                               Divide-by-16, MSTIIC = MSTTRD = MSTTRC = 1

                              Low-speed        XIN clock off                                             -  90 400 A
                              on-chip          High-speed on-chip oscillator off
                              oscillator mode  Low-speed on-chip oscillator on = 125 kHz
                                               Divide-by-8, FMR27 = 1, VCA20 = 0

                              Low-speed        XIN clock off                                             -  85 400 A
                              clock mode       High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator off
                                               XCIN clock oscillator on = 32 kHz
                                               No division, FMR27 = 1, VCA20 = 0

                                               XIN clock off                                             -  47      -     A
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator off
                                               XCIN clock oscillator on = 32 kHz
                                               No division, Program operation on RAM
                                               Flash memory off, FMSTP = 1, VCA20 = 0

                              Wait mode        XIN clock off                                             -  15 100 A
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
                                               While a WAIT instruction is executed
                                               Peripheral clock operation
                                               VCA27 = VCA26 = VCA25 = 0
                                               VCA20 = 1

                                               XIN clock off                                             -  4       90 A
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator on = 125 kHz
                                               While a WAIT instruction is executed
                                               Peripheral clock off
                                               VCA27 = VCA26 = VCA25 = 0
                                               VCA20 = 1

                                               XIN clock off                                             -  3.5     -     A
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator off
                                               XCIN clock oscillator on = 32 kHz (peripheral clock off)
                                               While a WAIT instruction is executed
                                               VCA27 = VCA26 = VCA25 = 0
                                               VCA20 = 1

                              Stop mode        XIN clock off, Topr = 25C                                -  2.0 5.0 A
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator off
                                               CM10 = 1, Peripheral clock off
                                               VCA27 = VCA26 = VCA25 = 0

                                               XIN clock off, Topr = 85C                                - 5.0 (1) -      A
                                               High-speed on-chip oscillator off
                                               Low-speed on-chip oscillator off                             15 (2)
                                               CM10 = 1, Peripheral clock off
                                               VCA27 = VCA26 = VCA25 = 0

Notes:
     1. Value when the program ROM capacity of the product is 16 Kbytes to 32 Kbytes.
     2. Value when the program ROM capacity of the product is 48 Kbytes to 128 Kbytes.

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Timing Requirements
(Unless Otherwise Specified: VCC = 5 V, VSS = 0 V at Topr = 25C)

Table 5.20 External Clock Input (XOUT, XCIN)

   Symbol                              Parameter                             Standard     Unit

tc(XOUT)                                                                 Min.  Max.
tWH(XOUT)
tWL(XOUT)      XOUT input cycle time                                     50            -  ns
tc(XCIN)       XOUT input "H" width
tWH(XCIN)      XOUT input "L" width                                      24            -  ns
tWL(XCIN)      XCIN input cycle time
               XCIN input "H" width                                      24            -  ns
               XCIN input "L" width
                                                                         14            -  s

                                                                         7             -  s

                                                                         7             -  s

                                                   tC(XOUT), tC(XCIN)                     VCC = 5 V

                                       tWH(XOUT),
                                       tWH(XCIN)

External Clock Input

                                                   tWL(XOUT), tWL(XCIN)

Figure 5.8 External Clock Input Timing Diagram when VCC = 5 V

Table 5.21 TRAIO Input

   Symbol                              Parameter                             Standard     Unit

tc(TRAIO)                                                                Min.  Max.
tWH(TRAIO)
tWL(TRAIO)     TRAIO input cycle time                                    100           -  ns
               TRAIO input "H" width
               TRAIO input "L" width                                     40            -  ns

                                                                         40            -  ns

                                                   tC(TRAIO)                           VCC = 5 V
                                                        tWL(TRAIO)
                                       tWH(TRAIO)

TRAIO input

Figure 5.9 TRAIO Input Timing Diagram when VCC = 5 V

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Table 5.22 Serial Interface

   Symbol                                       Parameter                                            Standard      Unit
                                                             When external clock is selected
tc(CK)                                                                                           Min.        Max.
tW(CKH)                                                      When internal clock is selected
tW(CKL)        CLKi input cycle time                                                             200           -   ns
td(C-Q)        CLKi input "H" width
th(C-Q)        CLKi input "L" width                                                              100           -   ns
tsu(D-C)       TXDi output delay time
th(C-D)        TXDi hold time                                                                    100           -   ns
td(C-Q)        RXDi input setup time
tsu(D-C)       RXDi input hold time                                                              -             90  ns
th(C-D)        TXDi output delay time
               RXDi input setup time                                                             0             -   ns
               RXDi input hold time
                                                                                                 10            -   ns

                                                                                                 90            -   ns

                                                                                                 -             10  ns

                                                                                                 90            -   ns

                                                                                                 90            -   ns

i = 0 to 2
Note:

     1. Vcc = 5 V and Topr = -20 to 85 C (N version)/-40 to 85 C (D version), unless otherwise specified.

                                       tW(CKH)                         tC(CK)                                     VCC = 5 V
                                                                              tW(CKL)
CLKi                                                                                                           th(C-Q)
                                                                                                 th(C-D)
TXDi                                            td(C-Q)                                tsu(D-C)
RXDi

                        i = 0 to 2
Figure 5.10 Serial Interface Timing Diagram when VCC = 5 V

Table 5.23 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

   Symbol                                                   Parameter                                Standard      Unit
tW(INH)
tW(INL)        INTi input "H" width, KIi input "H" width                                         Min.        Max.
               INTi input "L" width, KIi input "L" width
                                                                                                 250 (1)       -   ns

                                                                                                 250 (2)       -   ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
          frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
          frequency 3) or the minimum value of standard, whichever is greater.

                                                                                                               VCC = 5 V

INTi input                             tW(INL)
(i = 0 to 4)
                                                                       tW(INH)
KIi input
(i = 0 to 3)

Figure 5.11 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi when Vcc
                     =5V

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Table 5.24 Electrical Characteristics (3) [2.7 V  Vcc < 4.2 V]

Symbol                     Parameter                          Condition                      Standard       Unit

                                                                                       Min.  Typ. Max.

VOH     Output "H" voltage Other than XOUT Drive capacity High IOH = -5 mA VCC - 0.5         -         VCC  V

                                                 Drive capacity Low IOH = -1 mA VCC - 0.5    -         VCC  V

                            XOUT                                        IOH = -200 A  1.0   -         VCC  V

VOL     Output "L" voltage Other than XOUT Drive capacity High IOL = 5 mA              -     -         0.5  V

                                                 Drive capacity Low IOL = 1 mA         -     -         0.5  V

                            XOUT                                        IOL = 200 A   -     -         0.5  V

VT+-VT- Hysteresis          INT0, INT1, INT2,    VCC = 3.0 V                           0.1   0.4       -    V
                            INT3, INT4,
                            KI0, KI1, KI2, KI3,
                            TRAIO, TRCIOA,
                            TRCIOB, TRCIOC,
                            TRCIOD, TRDIOA0,
                            TRDIOB0,
                            TRDIOC0,
                            TRDIOD0,
                            TRDIOA1,
                            TRDIOB1,
                            TRDIOC1,
                            TRDIOD1,
                            TRCTRG, TRCCLK,
                            ADTRG,
                            RXD0, RXD1,
                            RXD2, CLK0,
                            CLK1, CLK2, SSI,
                            SCL, SDA, SSO

                            RESET                VCC = 3.0 V                           0.1   0.5       -    V

IIH     Input "H" current                        VI = 3 V, VCC = 3.0 V                 -     -         4.0  A

IIL     Input "L" current                        VI = 0 V, VCC = 3.0 V                 -     -         -4.0 A

RPULLUP Pull-up resistance                       VI = 0 V, VCC = 3.0 V                 42    84        168 k

RfXIN Feedback resistance XIN                                                          -     0.3       -    M

RfXCIN Feedback resistance XCIN                                                        -     8         -    M

VRAM RAM hold voltage                            During stop mode                      1.8   -         -    V

Note:
     1. 2.7 V  VCC < 4.2 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), f(XIN) = 10 MHz, unless otherwise specified.

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Table 5.25 Electrical Characteristics (4) [2.7 V  Vcc < 3.3 V]
                   (Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.)

Symbol         Parameter                                       Condition                                   Standard  Unit
                                                                                                     Min. Typ. Max.
                                           XIN = 10 MHz (square wave)
ICC     Power supply current High-speed    High-speed on-chip oscillator off                         - 3.5 10 mA
                                           Low-speed on-chip oscillator on = 125 kHz
        (VCC = 2.7 to 3.3 V) clock mode    No division

        Single-chip mode,                  XIN = 10 MHz (square wave)
                                           High-speed on-chip oscillator off
        output pins are open,              Low-speed on-chip oscillator on = 125 kHz                 - 1.5 7.5 mA
                                           Divide-by-8
        other pins are VSS
                                           XIN clock off
                               High-speed  High-speed on-chip oscillator on fOCO-F = 20 MHz          - 7.0 15 mA
                               on-chip     Low-speed on-chip oscillator on = 125 kHz
                               oscillator  No division                                               - 3.0 - mA
                               mode
                                           XIN clock off
                                           High-speed on-chip oscillator on fOCO-F = 20 MHz          - 4.0 - mA
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8                                               - 1.5 - mA

                                           XIN clock off                                             -  1  - mA
                                           High-speed on-chip oscillator on fOCO-F = 10 MHz
                               Low-speed   Low-speed on-chip oscillator on = 125 kHz                 - 90 390 A
                               on-chip     No division
                               oscillator
                               mode        XIN clock off
                               Low-speed   High-speed on-chip oscillator on fOCO-F = 10 MHz
                               clock mode  Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8
                               Wait mode
                                           XIN clock off
                                           High-speed on-chip oscillator on fOCO-F = 4 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-16
                                           MSTIIC = MSTTRD = MSTTRC = 1

                                           XIN clock off
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8, FMR27 = 1, VCA20 = 0

                                           XIN clock off                                             - 80 400 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           XCIN clock oscillator on = 32 kHz
                                           No division, FMR27 = 1, VCA20 = 0

                                           XIN clock off                                             - 40 - A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           XCIN clock oscillator on = 32 kHz
                                           No division, Program operation on RAM

                                           Flash memory off, FMSTP = 1, VCA20 = 0

                                           XIN clock off                                             - 15 90 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock operation
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                           XIN clock off                                             -  4 80 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                                           XIN clock off                                             - 3.5 - A

                                           High-speed on-chip oscillator off

                                           Low-speed on-chip oscillator off

                                           XCIN clock oscillator on = 32 kHz (peripheral clock off)

                                           While a WAIT instruction is executed

                                           VCA27 = VCA26 = VCA25 = 0, VCA20 = 1

                               Stop mode   XIN clock off, Topr = 25C                                - 2.0 5.0 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

                                           XIN clock off, Topr = 85C                                - 5.0 (1) - A
                                           High-speed on-chip oscillator off                                15 (2)
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

Notes:
     1. Value when the program ROM capacity of the product is 16 Kbytes to 32 Kbytes.
     2. Value when the program ROM capacity of the product is 48 Kbytes to 128 Kbytes.

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Timing Requirements
(Unless Otherwise Specified: VCC = 3 V, VSS = 0 V at Topr = 25C)

Table 5.26 External Clock Input (XOUT, XCIN)

   Symbol                                          Parameter                            Standard     Unit

tc(XOUT)                                                                            Min.  Max.
tWH(XOUT)
tWL(XOUT)      XOUT input cycle time                                                50            -  ns
tc(XCIN)       XOUT input "H" width
tWH(XCIN)      XOUT input "L" width                                                 24            -  ns
tWL(XCIN)      XCIN input cycle time
               XCIN input "H" width                                                 24            -  ns
               XCIN input "L" width
                                                                                    14            -  s

                                                                                    7             -  s

                                                                                    7             -  s

                                                              tC(XOUT), tC(XCIN)                  VCC = 3 V

                                       tWH(XOUT),
                                       tWH(XCIN)

External Clock Input

                                                              tWL(XOUT), tWL(XCIN)

Figure 5.12 External Clock Input Timing Diagram when VCC = 3 V

Table 5.27 TRAIO Input

   Symbol                                          Parameter                            Standard     Unit

tc(TRAIO)                                                                           Min.  Max.
tWH(TRAIO)
tWL(TRAIO)     TRAIO input cycle time                                               300           -  ns
               TRAIO input "H" width
               TRAIO input "L" width                                                120           -  ns

                                                                                    120           -  ns

                                                              tC(TRAIO)                           VCC = 3 V
                                                                   tWL(TRAIO)
                                       tWH(TRAIO)

TRAIO input

Figure 5.13 TRAIO Input Timing Diagram when VCC = 3 V

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Table 5.28 Serial Interface

   Symbol                                       Parameter                                            Standard      Unit
                                                             When external clock is selected
tc(CK)                                                                                           Min.        Max.
tW(CKH)                                                      When internal clock is selected
tW(CKL)        CLKi input cycle time                                                             300           -             ns
td(C-Q)        CLKi input "H" width
th(C-Q)        CLKi Input "L" width                                                              150           -             ns
tsu(D-C)       TXDi output delay time
th(C-D)        TXDi hold time                                                                    150           -             ns
td(C-Q)        RXDi input setup time
tsu(D-C)       RXDi input hold time                                                              -           120             ns
th(C-D)        TXDi output delay time
               RXDi input setup time                                                             0             -             ns
               RXDi input hold time
                                                                                                 30            -             ns

                                                                                                 90            -             ns

                                                                                                 -             30            ns

                                                                                                 120           -             ns

                                                                                                 90            -             ns

i = 0 to 2
Note:

     1. Vcc = 3 V and Topr = -20 to 85 C (N version)/-40 to 85 C (D version), unless otherwise specified.

                                       tW(CKH)                         tC(CK)                                     VCC = 3 V
                                                                              tW(CKL)
CLKi                                                                                                           th(C-Q)
                                                                                                 th(C-D)
TXDi                                            td(C-Q)                                tsu(D-C)
RXDi

               i = 0 to 2

Figure 5.14 Serial Interface Timing Diagram when VCC = 3 V

Table 5.29 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

   Symbol                                                   Parameter                                Standard      Unit
tW(INH)
tW(INL)        INTi input "H" width, KIi input "H" width                                         Min.        Max.
               INTi input "L" width, KIi input "L" width
                                                                                                 380 (1)       -             ns

                                                                                                 380 (2)       -             ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
          frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
          frequency 3) or the minimum value of standard, whichever is greater.

INTi input                                                                                                   VCC = 3 V
(i = 0 to 4)
                                       tW(INL)
KIi input
(i = 0 to 3)                                                           tW(INH)

Figure 5.15 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi when Vcc
                     =3V

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Table 5.30 Electrical Characteristics (5) [1.8 V  Vcc < 2.7 V]

Symbol                     Parameter                          Condition                     Standard       Unit

                                                                                      Min.  Typ. Max.

VOH     Output "H" voltage Other than XOUT       Drive capacity High IOH = -2 mA VCC - 0.5 -          VCC  V

                                                 Drive capacity Low IOH = -1 mA VCC - 0.5 -           VCC  V

                            XOUT                                        IOH = -200 A 1.0   -         VCC  V

VOL     Output "L" voltage Other than XOUT       Drive capacity High IOL = 2 mA       -     -         0.5  V

                                                 Drive capacity Low IOL = 1 mA        -     -         0.5  V

                            XOUT                                        IOL = 200 A  -     -         0.5  V

VT+-VT- Hysteresis          INT0, INT1, INT2,    VCC = 2.2 V                          0.05  0.2       -    V
                            INT3, INT4,
                            KI0, KI1, KI2, KI3,
                            TRAIO, TRCIOA,
                            TRCIOB, TRCIOC,
                            TRCIOD, TRDIOA0,
                            TRDIOB0, TRDIOC0,
                            TRDIOD0, TRDIOA1,
                            TRDIOB1, TRDIOC1,
                            TRDIOD1, TRCTRG,
                            TRCCLK,
                            ADTRG,
                            RXD0, RXD1, RXD2,
                            CLK0, CLK1, CLK2,
                            SSI, SCL, SDA, SSO

                            RESET                VCC = 2.2 V                          0.05  0.20      -    V

IIH     Input "H" current                        VI = 2.2 V, VCC = 2.2 V              -     -         4.0  A

IIL     Input "L" current                        VI = 0 V, VCC = 2.2 V                -     -         -4.0 A

RPULLUP Pull-up resistance                       VI = 0 V, VCC = 2.2 V                70    140 300 k

RfXIN   Feedback            XIN                                                       -     0.3       -    M

        resistance

RfXCIN  Feedback            XCIN                                                      -     8         -    M
        resistance

VRAM RAM hold voltage                            During stop mode                     1.8   -         -    V

Note:
     1. 1.8 V  VCC < 2.7 V and Topr = -20 to 85C (N version) / -40 to 85C (D version), f(XIN) = 5 MHz, unless otherwise specified.

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Table 5.31 Electrical Characteristics (6) [1.8 V  Vcc < 2.7 V]
                   (Topr = -20 to 85C (N version) / -40 to 85C (D version), unless otherwise specified.)

Symbol         Parameter                                  Condition                                        Standard
                                                                                                                                  Unit

                                                                                                     Min. Typ. Max.

ICC     Power supply current High-speed XIN = 5 MHz (square wave)                                    - 2.2 - mA
                                                                                                     - 0.8 - mA
        (VCC = 1.8 to 2.7 V)   clock mode  High-speed on-chip oscillator off
        Single-chip mode,                  Low-speed on-chip oscillator on = 125 kHz
        output pins are open,              No division
        other pins are VSS
                                           XIN = 5 MHz (square wave)
                                           High-speed on-chip oscillator off

                                           Low-speed on-chip oscillator on = 125 kHz

                                           Divide-by-8

                               High-speed  XIN clock off                                             - 2.5 10 mA
                               on-chip     High-speed on-chip oscillator on fOCO-F = 5 MHz           - 1.7 - mA
                               oscillator  Low-speed on-chip oscillator on = 125 kHz
                               mode        No division

                                           XIN clock off
                                           High-speed on-chip oscillator on fOCO-F = 5 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-8

                                           XIN clock off                                             -  1  - mA
                                           High-speed on-chip oscillator on fOCO-F = 4 MHz
                                           Low-speed on-chip oscillator on = 125 kHz
                                           Divide-by-16
                                           MSTIIC = MSTTRD = MSTTRC = 1

                               Low-speed   XIN clock off                                             - 90 300 A
                               on-chip     High-speed on-chip oscillator off
                               oscillator  Low-speed on-chip oscillator on = 125 kHz
                               mode        Divide-by-8, FMR27 = 1, VCA20 = 0

                               Low-speed   XIN clock off                                             - 80 350 A
                               clock mode  High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           XCIN clock oscillator on = 32 kHz
                                           No division, FMR27 = 1, VCA20 = 0

                                           XIN clock off                                             - 40 - A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           XCIN clock oscillator on = 32 kHz
                                           No division, Program operation on RAM
                                           Flash memory off, FMSTP = 1, VCA20 = 0

                               Wait mode   XIN clock off                                             - 15 90 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock operation
                                           VCA27 = VCA26 = VCA25 = 0
                                           VCA20 = 1

                                           XIN clock off                                             -  4 80 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator on = 125 kHz
                                           While a WAIT instruction is executed
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0
                                           VCA20 = 1

                                           XIN clock off                                             - 3.5 - A

                                           High-speed on-chip oscillator off

                                           Low-speed on-chip oscillator off

                                           XCIN clock oscillator on = 32 kHz (peripheral clock off)

                                           While a WAIT instruction is executed

                                           VCA27 = VCA26 = VCA25 = 0

                                           VCA20 = 1

                               Stop mode   XIN clock off, Topr = 25C                                - 2.0 5 A
                                           High-speed on-chip oscillator off
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

                                           XIN clock off, Topr = 85C                                - 5.0 (1) - A
                                           High-speed on-chip oscillator off                                15 (2)
                                           Low-speed on-chip oscillator off
                                           CM10 = 1
                                           Peripheral clock off
                                           VCA27 = VCA26 = VCA25 = 0

Notes:
     1. Value when the program ROM capacity of the product is 16 Kbytes to 32 Kbytes.
     2. Value when the program ROM capacity of the product is 48 Kbytes to 128 Kbytes.

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Timing Requirements
(Unless Otherwise Specified: VCC = 2.2 V, VSS = 0 V at Topr = 25C)

Table 5.32 External Clock Input (XOUT, XCIN)

   Symbol                                         Parameter                            Standard     Unit

tc(XOUT)                                                                           Min.  Max.
tWH(XOUT)
tWL(XOUT)      XOUT input cycle time                                               200           -  ns
tc(XCIN)       XOUT input "H" width
tWH(XCIN)      XOUT input "L" width                                                90            -  ns
tWL(XCIN)      XCIN input cycle time
               XCIN input "H" width                                                90            -  ns
               XCIN input "L" width
                                                                                   14            -  s

                                                                                   7             -  s

                                                                                   7             -  s

                                                             tC(XOUT), tC(XCIN)                  VCC = 2.2 V

                                       tWH(XOUT),
                                       tWH(XCIN)

External Clock Input

                                                             tWL(XOUT), tWL(XCIN)

Figure 5.16 External Clock Input Timing Diagram when VCC = 2.2 V

Table 5.33 TRAIO Input

   Symbol                                         Parameter                            Standard     Unit

tc(TRAIO)                                                                          Min.  Max.
tWH(TRAIO)
tWL(TRAIO)     TRAIO input cycle time                                              500           -  ns
               TRAIO input "H" width
               TRAIO input "L" width                                               200           -  ns

                                                                                   200           -  ns

                                                             tC(TRAIO)                   VCC = 2.2 V
                                                                  tWL(TRAIO)
                                      tWH(TRAIO)

TRAIO input

Figure 5.17 TRAIO Input Timing Diagram when VCC = 2.2 V

R01DS0021EJ0100 Rev.1.00                                                                            Page 52 of 54
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Table 5.34 Serial Interface

   Symbol                                       Parameter                                            Standard        Unit
                                                             When external clock is selected
tc(CK)                                                                                           Min.          Max.
tW(CKH)                                                      When internal clock is selected
tW(CKL)        CLKi input cycle time                                                             800           -     ns
td(C-Q)        CLKi input "H" width
th(C-Q)        CLKi input "L" width                                                              400           -     ns
tsu(D-C)       TXDi output delay time
th(C-D)        TXDi hold time                                                                    400           -     ns
td(C-Q)        RXDi input setup time
tsu(D-C)       RXDi input hold time                                                              -             200   ns
th(C-D)        TXDi output delay time
               RXDi input setup time                                                             0             -     ns
               RXDi input hold time
                                                                                                 150           -     ns

                                                                                                 90            -     ns

                                                                                                 -             200   ns

                                                                                                 150           -     ns

                                                                                                 90            -     ns

i = 0 to 2
Note:

     1. Vcc = 2.2 V and Topr = -20 to 85 C (N version)/-40 to 85 C (D version), unless otherwise specified.

                                       tW(CKH)                         tC(CK)                                   VCC = 2.2 V
                                                                              tW(CKL)
CLKi                                                                                                           th(C-Q)
                                                                                                 th(C-D)
TXDi                                            td(C-Q)                                tsu(D-C)
RXDi

Figure 5.18    i = 0 to 2
               Serial Interface Timing Diagram when VCC = 2.2 V

Table 5.35 External Interrupt INTi (i = 0 to 4) Input, Key Input Interrupt KIi (i = 0 to 3)

   Symbol                                                   Parameter                                Standard        Unit
tW(INH)
tW(INL)        INTi input "H" width, KIi input "H" width                                         Min.          Max.
               INTi input "L" width, KIi input "L" width
                                                                                                 1000 (1)      -     ns

                                                                                                 1000 (2)      -     ns

Notes:
     1. When selecting the digital filter by the INTi input filter select bit, use an INTi input HIGH width of either (1/digital filter clock
          frequency 3) or the minimum value of standard, whichever is greater.
     2. When selecting the digital filter by the INTi input filter select bit, use an INTi input LOW width of either (1/digital filter clock
          frequency 3) or the minimum value of standard, whichever is greater.

INTi input                                                                                                     VCC = 2.2 V
(i = 0 to 4)
                                       tW(INL)
KIi input
(i = 0 to 3)                                                           tW(INH)

Figure 5.19 Input Timing Diagram for External Interrupt INTi and Key Input Interrupt KIi when Vcc
                     = 2.2 V

R01DS0021EJ0100 Rev.1.00                                                                                             Page 53 of 54
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Package Dimensions

  Diagrams showing the latest package dimensions and mounting information are available in the "Packages" section of
  the Renesas Electronics website.

JEITA Package Code                  RENESAS Code                           Previous Code  MASS[Typ.]
P-LQFP52-10x10-0.65                 PLQP0052JA-A                               52P6A-A        0.3g

                           HD
                        *1 D

                 39                     27                                                                                                                         NOTE)
   40                                                  26                                                                                                            1. DIMENSIONS "*1" AND "*2"
                                                                                                                                                                          DO NOT INCLUDE MOLD FLASH.
                                                                                                                   bp                                                2. DIMENSION "*3" DOES NOT
                                                                                                                   b1                                                     INCLUDE TRIM OFFSET.

                                                           ZE                                                Terminal cross section          c1                    Reference Dimension in Millimeters
                                                             *2                                                                                    c
                                                                E                                                                           L                   c   Symbol Min Nom Max
                                                                       HE                                                               L1
   52                                                14                                                            Detail F                                        D 9.9 10.0 10.1
                                        13
                1                                                                                                                                                  E 9.9 10.0 10.1
              ZD                                             F
                                                                                                                                                                   A2      1.4

                        Index mark                                                                                                                                 HD 11.8 12.0 12.2

                                                                                                                                                                   HE 11.8 12.0 12.2

                                                                                                                                                                   A              1.7

                                                                                                         A2                                                        A1 0.05 0.1 0.15

                                                                                                      A                                                            bp 0.27 0.32 0.37

S

                                                                                                                                                                   b1      0.30

                                                                                                         A1                                                        c 0.09 0.145 0.20

                                    yS  *3 bp                                                                                                                      c1      0.125

                     e                                     x                                                                                                           0         8

                                                                                                                                                                   e       0.65

                                                                                                                                                                   x              0.13

                                                                                                                                                                   y              0.10

                                                                                                                                                                   ZD      1.1

                                                                                                                                                                   ZE      1.1

                                                                                                                                                                   L 0.35 0.5 0.65

                                                                                                                                                                   L1      1.0

R01DS0021EJ0100 Rev.1.00                                                                                                                                               Page 54 of 54
Jun 20, 2011
REVISION HISTORY               R8C/35M Group Datasheet

Rev.       Date        Page                                        Description
0.10  Sep 28, 2010       -                                                   Summary
0.20  Feb 15, 2011      35
                        36     First Edition issued
1.00  Jun 20, 2011      42     Table 5.11 revised, Note 2 added
                        50     Table 5.13 and Table 5.14 revised
                               Table 5.18 revised
                    All pages  Table 5.30 revised
                         4     "Preliminary", "Under development" deleted
                        28     Table 1.3 "(D): Under development", "(P): Under planning" deleted
                        35     Table 5.2 revised
                        36     Table 5.11 revised
                        43     Table 5.13 revised
                        44     Table 5.19 revised
                        45     Table 5.20 revised
                        47     Table 5.22 Note 1 revised
                        48     Table 5.25 revised
                        49     Table 5.26 revised
                        51     Table 5.28 Note 1 revised
                        52     Table 5.31 revised
                        53     Table 5.32 revised
                               Table 5.34 Note 1 revised

All trademarks and registered trademarks are the property of their respective owners.
                                                                 C-1
General Precautions in the Handling of MPU/MCU Products

The following usage notes are applicable to all MPU/MCU products from Renesas. For detailed usage notes

on the products covered by this manual, refer to the relevant sections of the manual. If the descriptions under

General Precautions in the Handling of MPU/MCU Products and in the body of the manual differ from each

other, the description in the body of the manual takes precedence.

  1. Handling of Unused Pins
       Handle unused pins in accord with the directions given under Handling of Unused Pins in the
       manual.
        The input pins of CMOS products are generally in the high-impedance state. In operation
            with an unused pin in the open-circuit state, extra electromagnetic noise is induced in the
            vicinity of LSI, an associated shoot-through current flows internally, and malfunctions occur
            due to the false recognition of the pin state as an input signal become possible. Unused
            pins should be handled as described under Handling of Unused Pins in the manual.

  2. Processing at Power-on
       The state of the product is undefined at the moment when power is supplied.
        The states of internal circuits in the LSI are indeterminate and the states of register
            settings and pins are undefined at the moment when power is supplied.
            In a finished product where the reset signal is applied to the external reset pin, the states
            of pins are not guaranteed from the moment when power is supplied until the reset
            process is completed.
            In a similar way, the states of pins in a product that is reset by an on-chip power-on reset
            function are not guaranteed from the moment when power is supplied until the power
            reaches the level at which resetting has been specified.

  3. Prohibition of Access to Reserved Addresses
       Access to reserved addresses is prohibited.
        The reserved addresses are provided for the possible future expansion of functions. Do
            not access these addresses; the correct operation of LSI is not guaranteed if they are
            accessed.

  4. Clock Signals
       After applying a reset, only release the reset line after the operating clock signal has become
       stable. When switching the clock signal during program execution, wait until the target clock
       signal has stabilized.
        When the clock signal is generated with an external resonator (or from an external
            oscillator) during a reset, ensure that the reset line is only released after full stabilization of
            the clock signal. Moreover, when switching to a clock signal produced with an external
            resonator (or by an external oscillator) while program execution is in progress, wait until
            the target clock signal is stable.

  5. Differences between Products
       Before changing from one product to another, i.e. to one with a different part number, confirm
       that the change will not lead to problems.

       The characteristics of MPU/MCU in the same group but having different part numbers may

            differ because of the differences in internal memory capacity and layout pattern. When
            changing to products of different part numbers, implement a system-evaluation test for
            each of the products.
                                                        Notice

1. All information included in this document is current as of the date this document is issued. Such information, however, is subject to change without any prior notice. Before purchasing or using any Renesas
      Electronics products listed herein, please confirm the latest product information with a Renesas Electronics sales office. Also, please pay regular and careful attention to additional and different information to
      be disclosed by Renesas Electronics such as that disclosed through our website.

2. Renesas Electronics does not assume any liability for infringement of patents, copyrights, or other intellectual property rights of third parties by or arising from the use of Renesas Electronics products or
      technical information described in this document. No license, express, implied or otherwise, is granted hereby under any patents, copyrights or other intellectual property rights of Renesas Electronics or
      others.

3. You should not alter, modify, copy, or otherwise misappropriate any Renesas Electronics product, whether in whole or in part.
4. Descriptions of circuits, software and other related information in this document are provided only to illustrate the operation of semiconductor products and application examples. You are fully responsible for

      the incorporation of these circuits, software, and information in the design of your equipment. Renesas Electronics assumes no responsibility for any losses incurred by you or third parties arising from the
      use of these circuits, software, or information.
5. When exporting the products or technology described in this document, you should comply with the applicable export control laws and regulations and follow the procedures required by such laws and
      regulations. You should not use Renesas Electronics products or the technology described in this document for any purpose relating to military applications or use by the military, including but not limited to
      the development of weapons of mass destruction. Renesas Electronics products and technology may not be used for or incorporated into any products or systems whose manufacture, use, or sale is
      prohibited under any applicable domestic or foreign laws or regulations.
6. Renesas Electronics has used reasonable care in preparing the information included in this document, but Renesas Electronics does not warrant that such information is error free. Renesas Electronics
      assumes no liability whatsoever for any damages incurred by you resulting from errors in or omissions from the information included herein.
7. Renesas Electronics products are classified according to the following three quality grades: "Standard", "High Quality", and "Specific". The recommended applications for each Renesas Electronics product
      depends on the product's quality grade, as indicated below. You must check the quality grade of each Renesas Electronics product before using it in a particular application. You may not use any Renesas
      Electronics product for any application categorized as "Specific" without the prior written consent of Renesas Electronics. Further, you may not use any Renesas Electronics product for any application for
      which it is not intended without the prior written consent of Renesas Electronics. Renesas Electronics shall not be in any way liable for any damages or losses incurred by you or third parties arising from the
      use of any Renesas Electronics product for an application categorized as "Specific" or for which the product is not intended where you have failed to obtain the prior written consent of Renesas Electronics.
      The quality grade of each Renesas Electronics product is "Standard" unless otherwise expressly specified in a Renesas Electronics data sheets or data books, etc.
     "Standard": Computers; office equipment; communications equipment; test and measurement equipment; audio and visual equipment; home electronic appliances; machine tools;

                          personal electronic equipment; and industrial robots.
     "High Quality": Transportation equipment (automobiles, trains, ships, etc.); traffic control systems; anti-disaster systems; anti-crime systems; safety equipment; and medical equipment not specifically

                          designed for life support.
     "Specific": Aircraft; aerospace equipment; submersible repeaters; nuclear reactor control systems; medical equipment or systems for life support (e.g. artificial life support devices or systems), surgical

                          implantations, or healthcare intervention (e.g. excision, etc.), and any other applications or purposes that pose a direct threat to human life.
8. You should use the Renesas Electronics products described in this document within the range specified by Renesas Electronics, especially with respect to the maximum rating, operating supply voltage

      range, movement power voltage range, heat radiation characteristics, installation and other product characteristics. Renesas Electronics shall have no liability for malfunctions or damages arising out of the
      use of Renesas Electronics products beyond such specified ranges.
9. Although Renesas Electronics endeavors to improve the quality and reliability of its products, semiconductor products have specific characteristics such as the occurrence of failure at a certain rate and
      malfunctions under certain use conditions. Further, Renesas Electronics products are not subject to radiation resistance design. Please be sure to implement safety measures to guard them against the
      possibility of physical injury, and injury or damage caused by fire in the event of the failure of a Renesas Electronics product, such as safety design for hardware and software including but not limited to
      redundancy, fire control and malfunction prevention, appropriate treatment for aging degradation or any other appropriate measures. Because the evaluation of microcomputer software alone is very difficult,
      please evaluate the safety of the final products or system manufactured by you.
10. Please contact a Renesas Electronics sales office for details as to environmental matters such as the environmental compatibility of each Renesas Electronics product. Please use Renesas Electronics
      products in compliance with all applicable laws and regulations that regulate the inclusion or use of controlled substances, including without limitation, the EU RoHS Directive. Renesas Electronics assumes
      no liability for damages or losses occurring as a result of your noncompliance with applicable laws and regulations.
11. This document may not be reproduced or duplicated, in any form, in whole or in part, without prior written consent of Renesas Electronics.
12. Please contact a Renesas Electronics sales office if you have any questions regarding the information contained in this document or Renesas Electronics products, or if you have any other inquiries.
(Note 1) "Renesas Electronics" as used in this document means Renesas Electronics Corporation and also includes its majority-owned subsidiaries.
(Note 2) "Renesas Electronics product(s)" means any product developed or manufactured by or for Renesas Electronics.

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