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Q-5962D9569302VXC

器件型号:Q-5962D9569302VXC
器件类别:模拟器件
文件大小:443.45KB,共0页
厂商名称:INTERSIL [Intersil Corporation]
厂商官网:http://www.intersil.com/cda/home/
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器件描述

16-CHANNEL, SGL ENDED MULTIPLEXER,

16通道, SGL 终端多路复用器,

参数

Q-5962D9569302VXC功能数量 1
Q-5962D9569302VXC端子数量 28
Q-5962D9569302VXC最大工作温度 125 Cel
Q-5962D9569302VXC最小工作温度 -55 Cel
Q-5962D9569302VXC额定供电电压 15 V
Q-5962D9569302VXC加工封装描述 SIDE BRAZED, CERAMIC, DIP-28
Q-5962D9569302VXC无铅 Yes
Q-5962D9569302VXC欧盟RoHS规范 Yes
Q-5962D9569302VXC状态 ACTIVE
Q-5962D9569302VXC工艺 CMOS
Q-5962D9569302VXC包装形状 RECTANGULAR
Q-5962D9569302VXC包装尺寸 IN-LINE
Q-5962D9569302VXC端子形式 THROUGH-HOLE
Q-5962D9569302VXC端子间距 2.54 mm
Q-5962D9569302VXC端子涂层 MATTE TIN
Q-5962D9569302VXC端子位置 DUAL
Q-5962D9569302VXC包装材料 CERAMIC, METAL-SEALED COFIRED
Q-5962D9569302VXC温度等级 MILITARY
Q-5962D9569302VXC输入数 16
Q-5962D9569302VXC最大接通时间 1000 ns
Q-5962D9569302VXC最大关断时间 1000 ns
Q-5962D9569302VXC模拟IC其它类型 SGL ENDED MULTIPLEXER
Q-5962D9569302VXC关闭状态下的隔离额定值 50 dB
Q-5962D9569302VXC最大限制模拟输入电压 15 V
Q-5962D9569302VXC额定负供电电压 -15 V
Q-5962D9569302VXC正向导通电阻匹配额定值 126 ohm
Q-5962D9569302VXC最大通态电阻 1800 ohm

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Q-5962D9569302VXC器件文档内容

                                                                              HS-0546RH, HS-0547RH

                                 Data Sheet                       March 13, 2006              FN3544.4

Radiation Hardened Single 16/Differential                         Features
8 Channel CMOS Analog Multiplexers with
Active Overvoltage Protection                                     Electrically Screened to SMD # 5962-95693
                                                                   QML Qualified per MIL-PRF-38535 Requirements
The HS-0546RH and HS-0547RH are radiation hardened                Gamma Dose . . . . . . . . . . . . . . . . . . . . . . 1 x 104RAD(Si)
analog multiplexers with Active Overvoltage Protection and         No Latch-Up
guaranteed rON matching. Analog input levels may greatly          No Channel Interaction During Overvoltage
exceed either power supply without damaging the device or          Guaranteed rON Matching
disturbing the signal path of other channels. Active protection    Maximum Power Supply . . . . . . . . . . . . . . . . . . . . . . .44V
circuitry assures that signal fidelity is maintained even under    Break-Before-Make Switch
fault conditions that would destroy other multiplexers. Analog    Analog Signal Range. . . . . . . . . . . . . . . . . . . . . . . . . . . . 15V
inputs can withstand constant 70V peak-to-peak levels with         Access Time. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1.0s
15V supplies and digital inputs will sustain continuous faults
up to 4V greater than either supply. In addition, signal sources  Applications
are protected from short circuiting should multiplexer supply
loss occur: each input presents 1k of resistance under this       Data Acquisition Systems
condition. These features make the HS-0546RH and
HS-0547RH ideal for use in systems where the analog inputs         Control Systems
originate from external equipment or separately powered
circuitry. Both devices are fabricated with 44V dielectrically    Telemetry
isolated CMOS technology. The HS-0546 is a 16 channel
device and the HS-0547 is an 8 channel differential version. If   Ordering Information
input overvoltage protection is not needed, the HS-0506 and
HS-0507 multiplexers are recommended.                             ORDERING        INTERNAL       PART   TEMP.
                                                                   NUMBER       MKT. NUMBER   MARKING  RANGE
Specifications for Rad Hard QML devices are controlled
by the Defense Supply Center in Columbus (DSCC). The                                                     (C)
SMD numbers listed here must be used when ordering.
                                                                  5962D9569301V9A HS0-0546RH-Q Q-5962D9569301V9A 25
Detailed Electrical Specifications for these devices are
contained in SMD 5962-95693. A "hot-link" is provided             5962D9569301VXC HS1B-0546RH-Q Q-5962D9569301VXC -55 to
on our homepage for downloading.                                                                                                                      125
http://www.intersil.com
                                                                  5962D9569302V9A HS0-0547RH-Q Q-5962D9569302V9A 25

                                                                  5962D9569302VXC HS1B-0547RH-Q Q-5962D9569302VXC -55 to
                                                                                                                                                      125

Pinouts                                                           HS-0547RH GDIP1-T28 (CERDIP) OR CDIP2-T28 (SBDIP)
                                                                                                  TOP VIEW
     HS-0546RH GDIP1-T28 (CERDIP) OR CDIP2-T28 (SBDIP)
                                      TOP VIEW

      VSUPPLY 1           28 OUT                                  +VSUPPLY 1                  28 OUT A
               NC 2       27 -VSUPPLY                                  OUT B 2                27 -VSUPPLY
               NC 3       26 IN 8                                           NC 3              26 IN 8A
                          25 IN 7                                       IN 8B 4               25 IN 7A
            IN 16 4       24 IN 6                                       IN 7B 5               24 IN 6A
            IN 15 5       23 IN 5                                       IN 6B 6               23 IN 5A
            IN 14 6       22 IN 4                                       IN 5B 7               22 IN 4A
            IN 13 7       21 IN 3                                       IN 4B 8               21 IN 3A
            IN 12 8       20 IN 2                                       IN 3B 9               20 IN 2A
            IN 11 9       19 IN 1                                       IN 2B 10              19 IN 1A
            IN 10 10      18 ENABLE                                     IN 1B 11              18 ENABLE
                          17 ADDRESS A0                                  GND 12               17 ADDRESS A0
              IN 9 11     16 ADDRESS A1                                  VREF 13              16 ADDRESS A1
            GND 12        15 ADDRESS A2                                     NC 14             15 ADDRESS A2
            VREF 13
ADDRESS A3 14

                       1                                CAUTION: These devices are sensitive to electrostatic discharge; follow proper IC Handling Procedures.

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                                                        HS-0546RH, HS-0547RH

Functional Diagrams                                                                                  HS-0547RH

                                     HS-0546RH

IN1                                                                        OUT  IN1A                                                                        OUT A
IN2  1K                                                                         IN8A  1K
                                                                                 IN1B
IN16  1K                                        DECODER/                         IN8B  1K

                                                DRIVER                                                                         OUT B

      1K                                                                               1K                       DECODER/

                                                                                                                DRIVER

          OVER-   5V                               LEVEL                                   OVER-      5V         LEVEL
       VOLTAGE   REF                                SHIFT                                VOLTAGE     REF         SHIFT
      CLAMP AND                                                                        CLAMP AND
                                                                                                                 
         SIGNAL                                                                           SIGNAL

      ISOLATION                                                                        ISOLATION

          DIGITAL INPUT                                                                    DIGITAL INPUT

            PROTECTION                                                                       PROTECTION

                         VREF A0 A1 A2 A3 EN                                                                 VREF A0 A1 A2 EN

          HS-0546RH TRUTH TABLE                                                            HS-0547RH TRUTH TABLE

                                                           "ON"                                                 "ON" CHANNEL
                                                                                                                        PAIR
A3    A2  A1          A0                        EN      CHANNEL                  A2    A1  A0             EN

X     X   X           X                         L          NONE                  X     X          X       L             NONE

L     L   L           L                         H          1                     L     L          L       H               1

L     L   L           H                         H          2                     L     L          H       H               2

L     L   H           L                         H          3

L     L   H           H                         H          4                     L     H          L       H               3

L     H   L           L                         H          5                     L     H          H       H               4

L     H   L           H                         H          6                     H     L          L       H               5

L     H   H           L                         H          7                     H     L          H       H               6

L     H   H           H                         H          8                     H     H          L       H               7

H     L   L           L                         H          9                     H     H          H       H               8

H     L   L           H                         H          10

H     L   H           L                         H          11

H     L   H           H                         H          12

H     H   L           L                         H          13

H     H   L           H                         H          14

H     H   H           L                         H          15

H     H   H           H                         H          16

                      2                                                                                                        FN3544.4

                                                                                                                             March 13, 2006
                                                  HS-0546RH, HS-0547RH

Switching Waveforms

                                                  A3                                  10V           VA INPUT
                                                                                                     2V/DIV.
       VAH = 4.0 ADDRESS                          A2             IN 1                   10V
                       DRIVE (VA)                                                 VOUT       CH1 ON
                                0V        VA      A1 IN 2 THRU IN 15              10K

50%                         OUTPUT A              A0                                    
+10V             -8V                                                      IN 16
                                                                                                               OUTPUT A
                                    -10V               EN        OUT                                           5V/DIV.
        tA                                        VAH
                                                            GND

                                                                                                                    CH16 ON
                                                                                                               200ns/DIV

                                                  FIGURE 1. ACCESS TIME

       VAH = 4.0

                   ADDRESS                        A3                                 +5V     VA INPUT
                                                                                             2V/DIV.
0V                 DRIVE (VA)                     A2             IN 1             VOUT
                                                                                  1K                                  OUTPUT
                                          VA      A1 IN 2 THRU IN 15                                                  1V/DIV.

                                                  A0                                                       100ns/DIV

       50%         50% OUTPUT                           EN       IN 16
                                                  VAH            OUT
                                                            GND

            tOPEN

                                          FIGURE 2. BREAK-BEFORE-MAKE DELAY (tOPEN)

       VAH = 4.0

50%                                               A3

                                                  A2             IN 1             +10V

                                   0V             A1
                             OUTPUT
                                                  A0 IN 2 THRU IN 16                                           CH1 ON
                               90%
          90%      tOFF                           EN             OUT                                            OUTPUT
       tON(EN)     (EN)                                    GND                                                  4V/DIV.
                                              VA

                                                                                  1K         CH1 OFF

                                                                                                               100ns/DIV

                                          FIGURE 3. ENABLE DELAY tON(EN), tOFF(EN)

                   3                                                                                                           FN3544.4

                                                                                                                             March 13, 2006
                                                                            HS-0546RH, HS-0547RH

Schematic Diagrams

                                                                            V+ TTL REFERENCE CIRCUIT

                                        R10
                             R9
                      Q1

                            Q4

                      D3

                                                                                   LEVEL SHIFTER
                                                                                                                                            V+

                         P                           P                      P      P  P      P            P                                     P      P

                   P     N                           R2                                                                                                         LEVEL
                                                                                                                                                                SHIFTED
OVERVOLTAGE                                                                                       R5      R7                                                    ADDRESS
                                                                                                                                                                TO
PROTECTION                                                                                        R6      R8                                                    DECODE
                                                                                             N                             N
                                                          R3                R4                                                                                  LEVEL
                                                     N                                                          N
               V+                                                                                                                                               SHIFTED
                                                                                                                   V-
   D2                                                                              N  N                                                                N        ADDRESS

ADD R1             N                                                            N                                                                               TO

                                                                                                                                                                DECODE

IN.
          200

   D1

               V-

                                                     FIGURE 4. ADDRESS INPUT BUFFER AND LEVEL SHIFTER

                                                        +V                                   FROM
                                                                                         DECODE
P              P   P        P                                 P                 P
                                                                                                            OVERVOLTAGE PROTECTION
                            N                                 N                 N                                                                                        N

                                                                                                                             V+

                                                                                                                            P
                                                                                                                                           Q5

                   A0 OR A0 N                                                                R11      D6      D7 D4                                D5

                                                                                         IN                                                               N                 OUT

   A1 OR A1                                                                                  1K

                            N                                                                                                                   N

A2 OR A2                                                                                                  Q6
                                                  N

ENABLE                                                                                    FROM                                        V
                                                                                      DECODE                                                                 P
                                                                        V-
TO N-CHANNEL DEVICE OF THE SWITCH PAIR                                                                FIGURE 6. MULTIPLEX SWITCH
TO P-CHANNEL DEVICE OF THE SWITCH PAIR

        FIGURE 5. ADDRESS DECODER

                      4                                                                                                                                                     FN3544.4

                                                                                                                                                                            March 13, 2006
                                           HS-0546RH, HS-0547RH

Burn-In/Life Test Circuits

V1                  1                  R2      V2                 V2                  1               R2      V3
     C1 D1          2          28          D2 C2                       C1 D1          2       28          D2 C2
            R1 3               27                                             R1 3            27
F3                  4          26                 F4                V1                4       26
                    5          25                 F0                                  5       25
                    6          24                 F1                                  6       24
                    7          23                 F2                                  7       23
                    8          22                                                     8       22
                    9          21                                                     9       21
                   10          20                                                    10       20
                   11          19                                                    11       19
                   12          18                                                    12       18
                   13          17                                                    13       17
                   14          16                                                    14       16
                               15                                                             15

                          DYNAMIC AND LIFE TEST                                                           STATIC

NOTES:                                                            NOTES:
1. The Dynamic Test Circuit is utilized for all life testing.     8. V1 = +5V minimum, +6V maximum.
2. V1 = +15V minimum, +16V maximum.                               9. V2 = +15V minimum, +16V maximum.
3. V2 = -15V maximum, -16V minimum.
4. R1, R2 = 10k, 5%, 1/4 or 1/2W (per socket).                  10. V3 = -15V maximum, -16V minimum.
5. C1, C2 = 0.01F minimum (per socket) or 0.1F minimum         11. R1, R2 = 10k, 5%, 1/4 or 1/2W (per socket).
     (per row).                                                   12. C1, C2 = 0.01F minimum (per socket) or 0.1F minimum
6. D1, D2 = 1N4002 or equivalent (per board).
7. F0 = 100kHz, 10%; F1 = F0/2; F2 = F1/2; F3 = F2/2; F4 = F3/2       (per row).
     40% - 60% duty cycle; VIL = 0.8V maximum;                    13. D1, D2 = 1N4002 or equivalent (per board).
     VIH = 4.0V minimum.

Irradiation Circuit

                               +15V        1                      28

                                           2                      27          -15V       10k

                          10k  NC          3                      26

                               +1V         4                      25

                                           5                      24

                                           6                      23

                                           7                      22

                                           8                      21

                                           9                      20

                                           10                     19

                                           11                     18

                                           12                     17
                                                                  16
                                           13

                                           14                     15

                               +5V

                       5                                                                                  FN3544.4

                                                                                                          March 13, 2006
                                             HS-0546RH, HS-0547RH

Die Characteristics                                     ASSEMBLY RELATED INFORMATION:
                                                        Substrate Potential:
DIE DIMENSIONS:
    83.9 mils x 159 mils x 19 mils                          Unbiased (DI)

INTERFACE MATERIALS:                                    ADDITIONAL INFORMATION:
Glassivation:                                           Worst Case Current Density:

    Type: Nitride                                           1.4 x 105 A/cm2
   Thickness: 7k 0.7k
                                                        Transistor Count:
Top Metallization:                                          HS-0546 - 485
    Type: Al                                                HS-0547 - 485
   Thickness: 16k 2k

Substrate:
    CMOS, DI

Metallization Mask Layout

              HS-0546RH                                                HS-0547RH

      EN  A0  A1 A2                 A3 VREF  GND               EN  A0  A1 A2  NC VREF  GND

IN 1                                             IN 9   IN 1A                          IN 1B

IN 2                                             IN 10  IN 2A                          IN 2B

IN 3                                             IN 11  IN 3A                          IN 3B

IN 4                                             IN 12  IN 4A                          IN 4B

IN 5                                             IN 13  IN 5A                          IN 5B

IN 6                                             IN 14  IN 6A                          IN 6B

IN 7                                             IN 15  IN 7A                          IN 7B

IN 8                                             IN 16  IN 8A                          IN 8B

      -V      OUT                   +V       NC                -V      OUT A      +V   OUT B

                   All Intersil U.S. products are manufactured, assembled and tested utilizing ISO9000 quality systems.
                          Intersil Corporation's quality certifications can be viewed at www.intersil.com/design/quality

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                     6                                                                 FN3544.4

                                                                                       March 13, 2006
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