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HEC4014

器件型号:HEC4014
厂商名称:Philips Semiconductors (NXP Semiconductors N.V.)
厂商官网:https://www.nxp.com/
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器件描述

8-bit static shift register

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HEC4014器件文档内容

                              INTEGRATED CIRCUITS

DATA SHEET

   For a complete data sheet, please also download:

    The IC04 LOCMOS HE4000B Logic
      Family Specifications HEF, HEC

    The IC04 LOCMOS HE4000B Logic
      Package Outlines/Information HEF, HEC

HEF4014B                             January 1995
MSI
8-bit static shift register

Product specification
File under Integrated Circuits, IC04
Philips Semiconductors                                           Product specification

  8-bit static shift register                                       HEF4014B
                                                                             MSI

DESCRIPTION                                                      Operation is synchronous and the device is edge-triggered
                                                                 on the LOW to HIGH transition of CP. Each register stage
The HEF4014B is a fully synchronous edge-triggered 8-bit         is of a D-type master-slave flip-flop. When PE is HIGH,
static shift register with eight synchronous parallel inputs     data is loaded into the register from P0 to P7 on the LOW
(P0 to P7), a synchronous serial data input (DS), a              to HIGH transition of CP. When PE is LOW, data is shifted
synchronous parallel enable input (PE), a LOW to HIGH            to the first position from DS, and all the data in the register
edge-triggered clock input (CP) and buffered parallel            is shifted one position to the right on the LOW to HIGH
outputs from the last three stages (O5 to O7).                   transition of CP. Schmitt-trigger action in the clock input
                                                                 makes the circuit highly tolerant to slower clock rise and
                                                                 fall times

                                      Fig.1 Functional diagram.

              Fig.2 Pinning diagram.                              HEF4014BP(N): 16-lead DIL; plastic
                                                                                                (SOT38-1)

                                                                  HEF4014BD(F): 16-lead DIL; ceramic (cerdip)
                                                                                                (SOT74)

                                                                  HEF4014BT(D): 16-lead SO; plastic
                                                                                                (SOT109-1)

                                                                  ( ): Package Designator North America

                                                                 FAMILY DATA, IDD LIMITS category MSI
                                                                 See Family Specifications

January 1995                                                  2
Philips Semiconductors                                  Product specification

  8-bit static shift register                            HEF4014B
                                                                  MSI

                                  Fig.3 Logic diagram.

January 1995                   3
Philips Semiconductors                                                                        Product specification

  8-bit static shift register                                                                  HEF4014B
                                                                                                        MSI

PINNING

PE        parallel enable input

P0 to P7  parallel data inputs
DS        serial data input
CP        clock input (LOW to HIGH edge-triggered)

O5 to O7 buffered parallel outputs from the last three
              stages

FUNCTION TABLES                                            Parallel operation
Serial operation

              INPUTS                 OUTPUTS                               INPUTS                 OUTPUTS

n         CP        DS  PE       O5  O6         O7         n        CP         DS  PE         O5  O6         O7

1                   D1       L   X   X          X          1                   X   H          P5  P6         P7

2                   D2       L   X   X          X                              X   X              no change

3                   D3       L   X   X          X          Notes
                                                           1. H = HIGH state (the more positive voltage)
6                   X        L   D1  X          X
                                                                L = LOW state (the less positive voltage)
7                   X        L   D2  D1         X               X = state is immaterial

8                   X        L   D3  D2         D1                      = positive-going transition

                    X        X       no change                          = negative-going transition
                                                                Dn = either HIGH or LOW
                                                                n = number of clock pulse transitions

AC CHARACTERISTICS
VSS = 0 V; Tamb = 25 C; CL = 50 pF; input transition times  20 ns

                        VDD      TYPICAL FORMULA FOR P (W)
                         V

Dynamic power           5            900 fi +  (foCL) VDD2        where
   dissipation per
   package (P)          10           4 300 fi +  (foCL) VDD2      fi = input freq. (MHz)

                        15       12 000 fi +  (foCL) VDD2         fo = output freq. (MHz)

                                                                    CL = load cap. (pF)

                                                                     (foCL) = sum of outputs

                                                                    VDD = supply voltage (V)

January 1995                                            4
Philips Semiconductors                                                          Product specification

  8-bit static shift register                                                    HEF4014B
                                                                                          MSI

AC CHARACTERISTICS
VSS = 0 V; Tamb = 25 C; CL = 50 pF; input transition times  20 ns

                         VDD  SYMBOL MIN.  TYP.                     MAX.        TYPICAL EXTRAPOLATION
                          V                                                                 FORMULA
                                                                     260
Propagation delays       5                 130                       110   ns       103 ns + (0,55 ns/pF) CL
   CP  On                                                              80  ns        44 ns + (0,23 ns/pF) CL
      HIGH to LOW        10    tPHL           55                     230   ns        32 ns + (0,16 ns/pF) CL
                                                                     100   ns        88 ns + (0,55 ns/pF) CL
      LOW to HIGH        15                   40                       80  ns        39 ns + (0,23 ns/pF) CL
Output transition times                                              120   ns        32 ns + (0,16 ns/pF) CL
                         5                 115                         60  ns        10 ns + (1,0 ns/pF) CL
   HIGH to LOW                                                         40  ns          9 ns + (0,42 ns/pF) CL
                         10    tPLH           50                     120   ns          6 ns + (0,28 ns/pF) CL
   LOW to HIGH                                                         60  ns        10 ns + (1,0 ns/pF) CL
   Set-up times          15                   40                       40  ns          9 ns + (0,42 ns/pF) CL
                                                                           ns          6 ns + (0,28 ns/pF) CL
      PE  CP             5                    60                           ns
                                                                           ns      see also waveforms Fig.4
      DS  CP             10    tTHL           30                           ns
                                                                           ns
      Pn  CP             15                   20                           ns
   Hold times                                                              ns
                         5                    60                           ns
      PE  CP                                                               ns
                         10    tTLH           30                           ns
      DS  CP                                                               ns
                         15                   20                           ns
      Pn  CP                                                               ns
Minimum clock            5            40      10                           ns
                                                                           ns
   pulse width; LOW      10    tsu    25      5                            ns
                                                                           ns
                         15           15      0                            ns
                                                                           ns
                         5            35   -5                              ns
                                                                           ns
                         10    tsu    25      -5                           ns

                         15           25      0                            MHz
                                                                           MHz
                         5            35      -5                           MHz

                         10    tsu    25      -5

                         15           25      0

                         5            25      -5

                         10    thold  20      0

                         15           15      0

                         5            30      15

                         10    thold  20      10

                         15           15      7

                         5            30      15

                         10    thold  20      10

                         15           15      7

                         5            70      35

                         10    tWCPL  30      15

                         15           24      12

Maximum clock            5            6       13
   pulse frequency
                         10    fmax   15      30

                         15           20      40

January 1995                               5
January 1995                                                                                                                                                           Philips Semiconductors

                                                                                                                                                           8-bit static shift register

6

                  Fig.4 Waveforms showing minimum clock pulse width, and set-up and hold times for PE to CP, DS to CP, and P to CP. Set-up and hold times                 Product specification
                            are shown as positive values but may be specified as negative values.
                                                                                                                                                              HEF4014B
              APPLICATION INFORMATION                                                                                                                      MSI
              Some examples of applications for the HEF4014B are:
               Parallel-to-serial converter
               Serial data queueing
               General purpose register
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