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CD74HC595MT

器件型号:CD74HC595MT
器件类别:半导体    逻辑集成电路    计数器移位寄存器   
厂商名称:Texas Instruments
厂商官网:http://www.ti.com/
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器件描述

8-Bit Shift Registers With 3-State Output Registers 16-SOIC -55 to 125

参数

产品属性属性值
3-State OutputYes
ICC @ Nom Voltage(Max)(mA)0.08
F @ Nom Voltage(Max)(Mhz)28
Technology FamilyHC
RatingCatalog
Schmitt TriggerNo
Package GroupPDIP,SO,SOIC,SOIC,SSOP
Operating Temperature Range(C)-55 to 125
tpd @ Nom Voltage(Max)(ns)41
Approx. Price (US$)0.24 | 1ku
VCC(Max)(V)6
VCC(Min)(V)2
Package Sizemm2
Voltage(Nom)(V)6
Output Drive (IOL/IOH)(Max)(mA)7.8/-7.8

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CD74HC595MT器件文档内容

                                                                            CD74HC595
                                                             8BIT SHIFT REGISTERS
                                                WITH 3STATE OUTPUT REGISTERS

                                                                                              SCHS353 - JANUARY 2004

  D 8-Bit Serial-In, Parallel-Out Shift         DW, E, M, NS, OR SM PACKAGE
  D Wide Operating Voltage Range of 2 V to 6 V                (TOP VIEW)
  D High-Current 3-State Outputs Can Drive Up
                                                                                                    QB 1  16 VCC
        To 15 LSTTL Loads                                                                           QC 2  15 QA
                                                                                                    QD 3  14 SER
  D Low Power Consumption, 80-A Max ICC                                                            QE 4  13 OE
  D Typical tpd = 14 ns                                                                             QF 5  12 RCLK
  D 6-mA Output Drive at 5 V                                                                       QG 6  11 SRCLK
  D Low Input Current of 1 A Max                                                                   QH 7  10 SRCLR
  D Shift Register Has Direct Clear                                                               GND 8    9 QH

description/ordering information

The CD74HC595 device contains an 8-bit serial-in, parallel-out shift register that feeds an 8-bit D-type storage
register. The storage register has parallel 3-state outputs. Separate clocks are provided for both the shift and
storage registers. The shift register has a direct overriding clear (SRCLR) input, serial (SER) input, and serial
output for cascading. When the output-enable (OE) input is high, the outputs are in the high-impedance state.

Both the shift register clock (SRCLK) and storage register clock (RCLK) are positive-edge triggered. If both
clocks are connected together, the shift register always is one clock pulse ahead of the storage register.

                         ORDERING INFORMATION

TA                       PACKAGE                 ORDERABLE                                                TOP-SIDE
                                                PART NUMBER                                               MARKING

    PDIP - E             Tube of 25             CD74HC595E                                        CD74HC595E

    SOIC - DW            Tube of 40             CD74HC595DW                                       HC595M
                         Reel of 2000           CD74HC595DWR

-55C to 125C SOIC - M  Tube of 40             CD74HC595M                                        HC595M
                         Reel of 2500           CD74HC595M96
                         Reel of 250            CD74HC595MT

    SOP - NS             Reel of 2000 CD74HC595NSR                                                HC595M

    SSOP - SM            Tube of 80             CD74HC595SM                                       HJ595
                         Reel of 2000           CD74HC595SM96

Package drawings, standard packing quantities, thermal data, symbolization, and PCB design
  guidelines are available at www.ti.com/sc/package.

Please be aware that an important notice concerning availability, standard warranty, and use in critical applications of
Texas Instruments semiconductor products and disclaimers thereto appears at the end of this data sheet.

PRODUCTION DATA information is current as of publication date.                                    Copyright  2004, Texas Instruments Incorporated
Products conform to specifications per the terms of Texas Instruments                                                                                      1
standard warranty. Production processing does not necessarily include
testing of all parameters.

                                                    POST OFFICE BOX 655303 DALLAS, TEXAS 75265
CD74HC595
8BIT SHIFT REGISTERS
WITH 3STATE OUTPUT REGISTERS

SCHS353 - JANUARY 2004

                                 FUNCTION TABLE

           INPUTS

   SER  SRCLK SRCLR  RCLK                                              FUNCTION
     X                  X     OE
     X                  X
     X  X  X            X     H Outputs QA-QH are disabled.
                              L Outputs QA-QH are enabled.
        X  X                  X Shift register is cleared.

        X  L

   L       H         X        X  First stage of the shift register goes low.
                                 Other stages store the data of previous stage, respectively.

   H       H         X        X  First stage of the shift register goes high.
                                 Other stages store the data of previous stage, respectively.

   X    X  X                  X Shift-register data is stored in the storage register.

2                     POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                  CD74HC595
                                                   8BIT SHIFT REGISTERS
                                      WITH 3STATE OUTPUT REGISTERS

                                                                                    SCHS353 - JANUARY 2004

logic diagram (positive logic)  1D                                            3R    15
                                  C1                                            C3          QA
                       13
              OE                R                                             3S     1
          RCLK 12                                                                           QB
                                2S                                            3R
                       10       2R                                              C3   2
        SRCLR                                                                               QC
        SRCLK 11                  C2                                          3S
                                R                                                    3
            SER 14                                                            3R            QD
                                2S                                              C3
                                2R                                                   4
                                                                              3S            QE
                                  C2
                                R                                             3R     5
                                                                                C3          QF
                                2S
                                2R                                            3S     6
                                                                                            QG
                                  C2                                          3R
                                R                                               C3   7
                                                                                            QH
                                2S                                            3S
                                2R                                                   9 QH
                                                                              3R
                                  C2                                            C3
                                R
                                                                              3S
                                2S
                                2R                                            3R
                                                                                C3
                                  C2
                                R                                             3S

                                2S                                            3R
                                2R                                              C3

                                  C2                                          3S
                                R

                                2S
                                2R

                                  C2
                                R

                                 POST OFFICE BOX 655303 DALLAS, TEXAS 75265                    3
CD74HC595
8BIT SHIFT REGISTERS
WITH 3STATE OUTPUT REGISTERS

SCHS353 - JANUARY 2004

timing diagram

SRCLK

   SER

   RCLK

SRCLR

   OE

   QA                                                            
   QB

   QC

   QD

   QE

   QF

   QG

   QH

       QH'implies that the output is in 3-State mode.

    NOTE:

4                   POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                                              CD74HC595
                                                                               8BIT SHIFT REGISTERS
                                                                 WITH 3STATE OUTPUT REGISTERS

                                                                                                                                                                                 SCHS353 - JANUARY 2004

absolute maximum ratings over operating free-air temperature range (unless otherwise noted)

       Supply voltage range, VCC . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -0.5 V to 7 V
       Input clamp current, IIK (VI < 0 or VI > VCC) (see Note 1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20 mA
       Output clamp current, IOK (VO < 0 or VO > VCC) (see Note 1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20 mA
       Continuous output current, IO (VO = 0 to VCC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35 mA
       Continuous current through VCC or GND . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 70 mA
       Package thermal impedance, JA (see Note 2): E package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 67C/W

                                                                       DW package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 57C/W
                                                                       M package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73C/W
                                                                       NS package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64C/W
                                                                       SM package . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82C/W
       Storage temperature range, Tstg . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . -65C to 150C

Stresses beyond those listed under "absolute maximum ratings" may cause permanent damage to the device. These are stress ratings only, and
  functional operation of the device at these or any other conditions beyond those indicated under "recommended operating conditions" is not
  implied. Exposure to absolute-maximum-rated conditions for extended periods may affect device reliability.

NOTES: 1. The input and output voltage ratings may be exceeded if the input and output current ratings are observed.
              2. The package thermal impedance is calculated in accordance with JESD 51-7.

recommended operating conditions (see Note 3)

                                                                                   MIN NOM MAX UNIT

VCC Supply voltage                                                                 2     5  6V

                                               VCC = 2 V                           1.5

VIH High-level input voltage                   VCC = 4.5 V                         3.15           V

                                               VCC = 6 V                           4.2

                                               VCC = 2 V                                    0.5

VIL  Low-level input voltage                   VCC = 4.5 V                                  1.35 V

                                               VCC = 6 V                                    1.8

VI   Input voltage                                                                 0        VCC V

VO   Output voltage                                                                0        VCC V

                                               VCC = 2 V                                    1000

t/v Input transition rise/fall time            VCC = 4.5 V                                  500 ns

                                               VCC = 6 V                                    400

TA   Operating free-air temperature                                                -55      125 C

NOTE 3: All unused inputs of the device must be held at VCC or GND to ensure proper device operation. Refer to the TI application report,
              Implications of Slow or Floating CMOS Inputs, literature number SCBA004.

If this device is used in the threshold region (from VILmax = 0.5 V to VIHmin = 1.5 V), there is a potential to go into the wrong state from induced
  grounding, causing double clocking. Operating with the inputs at tt = 1000 ns and VCC = 2 V does not damage the device; however, functionally,
  the CLK inputs are not ensured while in the shift, count, or toggle operating modes.

                                     POST OFFICE BOX 655303 DALLAS, TEXAS 75265                    5
CD74HC595
8BIT SHIFT REGISTERS
WITH 3STATE OUTPUT REGISTERS

SCHS353 - JANUARY 2004

electrical characteristics over recommended operating free-air temperature range (unless
otherwise noted)

                                                             TA = 25C           TA = -55C TO TA = -40C TO

   PARAMETER  TEST CONDITIONS                        VCC                         125C       85C             UNIT

                                                      2V     MIN TYP MAX MIN MAX MIN MAX                        V
                                                     4.5 V
                                                      6V     1.9 1.998           1.9         1.9                V
                                                                                                               nA
                               IOH = -20 A          4.5 V   4.4 4.499           4.4         4.4               A
                                                                                                               A
                                                      6V     5.9 5.999           5.9         5.9
                                                      2V
   VOH        VI = VIH or VIL  QH, IOH = -4 mA       4.5 V   3.98 4.3            3.7         3.84
                               QA-QH, IOH = -6 mA     6V
   VOL                         QH, IOH = -5.2 mA             3.98 4.3            3.7         3.84
                               QA-QH, IOH = -7.8 mA  4.5 V
   II                                                        5.48 5.8            5.2         5.34
   IOZ                                                6V
   ICC                                                6V     5.48 5.8            5.2         5.34
   Ci                                                 6V
                                                      6V     0.002 0.1                  0.1        0.1
                                                      2V
                               IOL = 20 A           to 6 V  0.001 0.1                  0.1        0.1

                                                             0.001 0.1                  0.1        0.1

              VI = VIH or VIL  QH, IOL = 4 mA                0.17 0.26                  0.4        0.33
                               QA-QH, IOL = 6 mA
              VI = VCC or 0    QH, IOL = 5.2 mA              0.17 0.26                  0.4        0.33
              VO = VCC or 0,   QA-QH, IOL = 7.8 mA
              VI = VCC or 0,                                 0.15 0.26                  0.4        0.33
                               QA-QH
                               IO = 0                        0.15 0.26                  0.4        0.33

                                                             0.1 100                1000        1000

                                                             0.01 0.5                 10        5

                                                                             8          160        80

                                                             3               10         10         10 pF

6                               POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                                              CD74HC595
                                                                               8BIT SHIFT REGISTERS
                                                                  WITH 3STATE OUTPUT REGISTERS

                                                                                                                SCHS353 - JANUARY 2004

timing requirements over recommended operating free-air temperature range (unless otherwise
noted)

                                                                  TA = 25C          TA = -55C TO TA = -40C TO

                                                   VCC                               125C       85C             UNIT

                                                                  MIN MAX MIN MAX MIN MAX

                                                   2V                            6          4.2        5

fclock Clock frequency                             4.5 V                         31         21         25 MHz
                                                    6V
                                                                                 36         25         29

                                                   2V             80                 120         100

                        SRCLK or RCLK high or low  4.5 V          16                 24          20

                                                   6V             14                 20          17

tw   Pulse duration                                2V             80                 120         100              ns

                        SRCLR low                  4.5 V          16                 24          20

                                                   6V             14                 20          17

                                                   2V             100                150         125

                        SER before SRCLK           4.5 V          20                 30          25

                                                   6V             17                 25          21

                                                   2V             75                 113         94

                        SRCLK before RCLK          4.5 V          15                 23          19

                                                   6V             13                 19          16

tsu  Setup time                                    2V             50                 75          65               ns

                        SRCLR low before RCLK      4.5 V          10                 15          13

                                                   6V             9                  13          11

                                                   2V             50                 75          60

                        SRCLR high (inactive) before SRCLK 4.5 V  10                 15          12

                                                   6V             9                  13          11

                                                   2V             0                  0           0

th   Hold time, SER after SRCLK                    4.5 V          0                  0           0                ns

                                                   6V             0                  0           0

This setup time allows the storage register to receive stable data from the shift register. The clocks can be tied together, in which case the shift
  register is one clock pulse ahead of the storage register.

                                    POST OFFICE BOX 655303 DALLAS, TEXAS 75265                                         7
CD74HC595
8BIT SHIFT REGISTERS
WITH 3STATE OUTPUT REGISTERS

SCHS353 - JANUARY 2004

switching characteristics over recommended operating free-air temperature range, CL = 50 pF
(unless otherwise noted) (see Figure 1)

                FROM         TO              TA = 25C                    TA = -55C TO TA = -40C TO
               (INPUT)  (OUTPUT)
   PARAMETER                      VCC                                     125C       85C             UNIT
         fmax  SRCLK        QH                                                                         MHz
         tpd    RCLK     QA-QH     2V    MIN TYP MAX MIN MAX MIN MAX                                    ns
                                  4.5 V                                                                 ns
                            QH     6V    6   26                           4.2         5                 ns
                         QA-QH     2V                                                                   ns
                         QA-QH    4.5 V  31  38                           21          25                ns
                         QA-QH     6V
                                   2V    36  42                           25          29
                            QH    4.5 V
                                   6V        50 160                              240        200
                                   2V
                                  4.5 V      17                       32         48         40
                                   6V
                                   2V        14                       27         41         34
                                  4.5 V
                                   6V        50 150                              225        187
                                   2V
                                  4.5 V      17                       30         45         37
                                   6V
                                   2V        14                       26         38         32
                                  4.5 V
                                   6V        51 175                              261        219
                                   2V
   tPHL        SRCLR              4.5 V      18                       35         52         44
   ten           OE                6V
   tdis          OE                          15                       30         44         37

                                             40 150                              225        187

                                             15                       30         45         37

                                             13                       26         38         32

                                             42 200                              300        250

                                             23                       40         60         50

                                             20                       34         51         43

                                             28                       60         90         75

                                             8                        12         18         15

   tt                                        6                        10         15         13

                                             28                       75         110        95

                                             8                        15         22         19

                                             6                        13         19         16

switching characteristics over recommended operating free-air temperature range, CL = 150 pF
(unless otherwise noted) (see Figure 1)

                FROM         TO              TA = 25C                    TA = -55C TO TA = -40C TO
               (INPUT)  (OUTPUT)
   PARAMETER                      VCC                                     125C       85C             UNIT
         tpd    RCLK     QA-QH                                                                          ns
         ten                       2V    MIN TYP MAX MIN MAX MIN MAX                                    ns
         tt       OE     QA-QH    4.5 V                                                                 ns
                                   6V        60 200                              300        250
                         QA-QH     2V
                                  4.5 V      22                       40         60         50
                                   6V
                                   2V        19                       34         51         43
                                  4.5 V
                                   6V        70 200                              298        250

                                             23                       40         60         50

                                             19                       34         51         43

                                             45 210                              315        265

                                             17                       42         63         53

                                             13                       36         53         45

8                        POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                                                CD74HC595
                                                                                 8BIT SHIFT REGISTERS
                                                                    WITH 3STATE OUTPUT REGISTERS

                                                                                                                  SCHS353 - JANUARY 2004

operating characteristics, TA = 25C                                TEST CONDITIONS  TYP UNIT
                                                                            No load  400 pF
                                                         PARAMETER
  Cpd Power dissipation capacitance

POST OFFICE BOX 655303 DALLAS, TEXAS 75265                                                   9
CD74HC595
8BIT SHIFT REGISTERS
WITH 3STATE OUTPUT REGISTERS

SCHS353 - JANUARY 2004

                                     PARAMETER MEASUREMENT INFORMATION

                                                VCC                  PARAMETER RL                        CL      S1         S2
                                          S1                                                                   Open       Closed
                                    Test                             ten           tPZH      1 k      50 pF   Closed       Open
                                          S2                                                             or               Closed
            From Output Point RL                                                   tPZL                                    Open
                                                                                                      150 pF
              Under Test                                                                                                   Open
                              CL                                     tdis          tPHZ 1 k                         Open
                                                                                   tPLZ               50 pF
                 (see Note A)
                                                                                                                  Closed

                                                                     tpd or tt               --       50 pF   Open
                                                                                                         or
                       LOAD CIRCUIT
                                                                                                      150 pF

                                               VCC                   Reference                        50%                          VCC
                                               0V                           Input                             th
                                               VCC                                                                90%              0V
    High-Level             50%            50%  0V                                            tsu
           Pulse                 tw                                                          90%                                   VCC
                                                                     Data                                                 50%
    Low-Level                                                                                     tr
           Pulse                                                     Input          50%                                    10% 0 V
                                                                                   10%                                          tf

                           50%            50%

                  VOLTAGE WAVEFORMS                                                       VOLTAGE WAVEFORMS
                    PULSE DURATIONS                                  SETUP AND HOLD AND INPUT RISE AND FALL TIMES

     Input        50%                     50%                   VCC          Output                                               VCC
                                             tPHL                           Control
In-Phase                                        90%             0V     (Low-Level            50%                  50%
  Output                                                                 Enabling)                    VCC
                  tPLH                       tPLH               VOH                                   50%                 tPLZ    0V
  Out-of-                                         50%  50%                             tPZL                                       VCC
   Phase                     90%                                             Output                   50%
  Output              50%         tr            10%      10% VOL     Waveform 1                                           10% VOL
                    10%                                      tf      (See Note B)                                         tPHZ
                           50%                                                                                            90% VOH
                  tPHL      10%                         90% VOH                       tPZH
                    90%           tf                            VOL                                                                  0 V
                                                                             Output
                                                             tr      Waveform 2
                                                                     (See Note B)

                            VOLTAGE WAVEFORMS                                              VOLTAGE WAVEFORMS
    PROPAGATION DELAY AND OUTPUT TRANSITION TIMES                    ENABLE AND DISABLE TIMES FOR 3-STATE OUTPUTS

NOTES: A. CL includes probe and test-fixture capacitance.
             B. Waveform 1 is for an output with internal conditions such that the output is low, except when disabled by the output control.
                  Waveform 2 is for an output with internal conditions such that the output is high, except when disabled by the output control.
             C. Phase relationships between waveforms were chosen arbitrarily. All input pulses are supplied by generators having the following
                  characteristics: PRR  1 MHz, ZO = 50 , tr = 6 ns, tf = 6 ns.
             D. For clock inputs, fmax is measured when the input duty cycle is 50%.
             E. The outputs are measured one at a time, with one input transition per measurement.
             F. tPLZ and tPHZ are the same as tdis.
             G. tPZL and tPZH are the same as ten.
             H. tPLH and tPHL are the same as tpd.

                                          Figure 1. Load Circuit and Voltage Waveforms

10                                        POST OFFICE BOX 655303 DALLAS, TEXAS 75265
                                                                                                  PACKAGE OPTION ADDENDUM

www.ti.com                                                                                                                                                10-Jun-2014

PACKAGING INFORMATION

Orderable Device  Status Package Type Package Pins Package Eco Plan             Lead/Ball Finish    MSL Peak Temp Op Temp (C)                                    Device Marking                       Samples
CD74HC595DW
CD74HC595DWR      (1)           Drawing      Qty  (2)                                        (6)                   (3)                                                          (4/5)
   CD74HC595E
CD74HC595EE4     ACTIVE  SOIC  DW 16        40 Green (RoHS                        CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HC595M
  CD74HC595M                                            & no Sb/Br)                CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HC595M
CD74HC595M96                                                                      CU NIPDAU                                                              CD74HC595E
  CD74HC595MT     ACTIVE  SOIC  DW 16 2000 Green (RoHS                             CU NIPDAU       N / A for Pkg Type -55 to 125                          CD74HC595E
CD74HC595MTG4                                                      & no Sb/Br)     CU NIPDAU       N / A for Pkg Type -55 to 125                          HC595M
CD74HC595NSR                                                                      CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HC595M
CD74HC595SM96     ACTIVE  PDIP  N        16  25   Pb-Free                          CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HC595M
                                                  (RoHS)                           CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HC595M
                                                                                   CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HC595M
                  ACTIVE  PDIP  N        16  25   Pb-Free                          CU NIPDAU      Level-1-260C-UNLIM -55 to 125                           HJ595
                                                  (RoHS)                                          Level-1-260C-UNLIM -55 to 125

                  ACTIVE  SOIC  D        16  40 Green (RoHS

                                                  & no Sb/Br)

                  ACTIVE  SOIC  D        16 2500 Green (RoHS

                                                  & no Sb/Br)

                  ACTIVE  SOIC  D        16 250 Green (RoHS

                                                  & no Sb/Br)

                  ACTIVE  SOIC  D        16 250 Green (RoHS

                                                  & no Sb/Br)

                  ACTIVE  SO    NS 16 2000 Green (RoHS
                                                                  & no Sb/Br)

                  ACTIVE  SSOP  DB 16 2000 Green (RoHS
                                                                  & no Sb/Br)

(1) The marketing status values are defined as follows:
ACTIVE: Product device recommended for new designs.
LIFEBUY: TI has announced that the device will be discontinued, and a lifetime-buy period is in effect.
NRND: Not recommended for new designs. Device is in production to support existing customers, but TI does not recommend using this part in a new design.
PREVIEW: Device has been announced but is not in production. Samples may or may not be available.
OBSOLETE: TI has discontinued the production of the device.

(2) Eco Plan - The planned eco-friendly classification: Pb-Free (RoHS), Pb-Free (RoHS Exempt), or Green (RoHS & no Sb/Br) - please check http://www.ti.com/productcontent for the latest availability
information and additional product content details.
TBD: The Pb-Free/Green conversion plan has not been defined.
Pb-Free (RoHS): TI's terms "Lead-Free" or "Pb-Free" mean semiconductor products that are compatible with the current RoHS requirements for all 6 substances, including the requirement that
lead not exceed 0.1% by weight in homogeneous materials. Where designed to be soldered at high temperatures, TI Pb-Free products are suitable for use in specified lead-free processes.
Pb-Free (RoHS Exempt): This component has a RoHS exemption for either 1) lead-based flip-chip solder bumps used between the die and package, or 2) lead-based die adhesive used between
the die and leadframe. The component is otherwise considered Pb-Free (RoHS compatible) as defined above.
Green (RoHS & no Sb/Br): TI defines "Green" to mean Pb-Free (RoHS compatible), and free of Bromine (Br) and Antimony (Sb) based flame retardants (Br or Sb do not exceed 0.1% by weight
in homogeneous material)

                                                  Addendum-Page 1
                             PACKAGE OPTION ADDENDUM

www.ti.com                   10-Jun-2014

(3) MSL, Peak Temp. - The Moisture Sensitivity Level rating according to the JEDEC industry standard classifications, and peak solder temperature.

(4) There may be additional marking, which relates to the logo, the lot trace code information, or the environmental category on the device.

(5) Multiple Device Markings will be inside parentheses. Only one Device Marking contained in parentheses and separated by a "~" will appear on a device. If a line is indented then it is a continuation
of the previous line and the two combined represent the entire Device Marking for that device.

(6) Lead/Ball Finish - Orderable Devices may have multiple material finish options. Finish options are separated by a vertical ruled line. Lead/Ball Finish values may wrap to two lines if the finish
value exceeds the maximum column width.

Important Information and Disclaimer:The information provided on this page represents TI's knowledge and belief as of the date that it is provided. TI bases its knowledge and belief on information
provided by third parties, and makes no representation or warranty as to the accuracy of such information. Efforts are underway to better integrate information from third parties. TI has taken and
continues to take reasonable steps to provide representative and accurate information but may not have conducted destructive testing or chemical analysis on incoming materials and chemicals.
TI and TI suppliers consider certain information to be proprietary, and thus CAS numbers and other limited information may not be available for release.

In no event shall TI's liability arising out of such information exceed the total purchase price of the TI part(s) at issue in this document sold by TI to Customer on an annual basis.

            Addendum-Page 2
www.ti.com                                               PACKAGE MATERIALS INFORMATION

TAPE AND REEL INFORMATION                                                                                                                              26-Jan-2013

*All dimensions are nominal

Device                       Package Package Pins  SPQ   Reel Reel A0 B0 K0 P1 W              Pin1
                               Type Drawing
                                                   2000  Diameter Width (mm) (mm) (mm) (mm) (mm) Quadrant
                                                   2500
                                                   2000  (mm) W1 (mm)
                                                   2000
CD74HC595DWR                 SOIC DW 16                  330.0 16.4 10.75 10.7 2.7 12.0 16.0  Q1
CD74HC595M96
CD74HC595NSR                 SOIC  D  16                 330.0 16.4 6.5 10.3 2.1 8.0 16.0     Q1
CD74HC595SM96
                             SO    NS 16                 330.0 16.4 8.2 10.5 2.5 12.0 16.0    Q1

                             SSOP DB 16                  330.0 16.4 8.2 6.6 2.5 12.0 16.0     Q1

                                                   Pack Materials-Page 1
www.ti.com                                     PACKAGE MATERIALS INFORMATION

                                                                                                                                             26-Jan-2013

*All dimensions are nominal  Package Type  Package Drawing Pins  SPQ   Length (mm)  Width (mm)  Height (mm)
              Device               SOIC                          2000       367.0       367.0        38.0
                                   SOIC    DW  16                2500       333.2       345.9        28.6
      CD74HC595DWR                  SO                           2000       367.0       367.0        38.0
       CD74HC595M96               SSOP     D   16                2000       367.0       367.0        38.0
       CD74HC595NSR
      CD74HC595SM96                        NS  16

                                           DB  16

                                               Pack Materials-Page 2
DB (R-PDSO-G**)                                                                                                  MECHANICAL DATA

28 PINS SHOWN                                                                                   MSSO002E JANUARY 1995 REVISED DECEMBER 2001
                0,65
                 28                                                                                                PLASTIC SMALL-OUTLINE

                 1                                       0,38         0,15 M
                                             A           0,22

                                                              15

                                                                                                           0,25
                                                                                                           0,09

                                                                           5,60 8,20                          Gage Plane  0,25
                                                                           5,00 7,40                   08
                                                                                                                          0,95
                                                             14                                                           0,55

2,00 MAX                                                 0,05 MIN             Seating Plane
                                                                                          0,10

                                                PINS **  14       16  20              24        28     30        38

          DIM

          A MAX                                          6,50 6,50 7,50 8,50 10,50 10,50 12,90

          A MIN                                          5,90 5,90 6,90 7,90 9,90 9,90 12,30

                                                                                                                          4040065 /E 12/01

NOTES: A. All linear dimensions are in millimeters.
             B. This drawing is subject to change without notice.
             C. Body dimensions do not include mold flash or protrusion not to exceed 0,15.
             D. Falls within JEDEC MO-150

                                                          POST OFFICE BOX 655303 DALLAS, TEXAS 75265
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Texas Instruments Incorporated and its subsidiaries (TI) reserve the right to make corrections, enhancements, improvements and other
changes to its semiconductor products and services per JESD46, latest issue, and to discontinue any product or service per JESD48, latest
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complete. All semiconductor products (also referred to herein as "components") are sold subject to TI's terms and conditions of sale
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TI warrants performance of its components to the specifications applicable at the time of sale, in accordance with the warranty in TI's terms
and conditions of sale of semiconductor products. Testing and other quality control techniques are used to the extent TI deems necessary
to support this warranty. Except where mandated by applicable law, testing of all parameters of each component is not necessarily
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TI assumes no liability for applications assistance or the design of Buyers' products. Buyers are responsible for their products and
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TI does not warrant or represent that any license, either express or implied, is granted under any patent right, copyright, mask work right, or
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Buyer acknowledges and agrees that it is solely responsible for compliance with all legal, regulatory and safety-related requirements
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In some cases, TI components may be promoted specifically to facilitate safety-related applications. With such components, TI's goal is to
help enable customers to design and create their own end-product solutions that meet applicable functional safety standards and
requirements. Nonetheless, such components are subject to these terms.

No TI components are authorized for use in FDA Class III (or similar life-critical medical equipment) unless authorized officers of the parties
have executed a special agreement specifically governing such use.

Only those TI components which TI has specifically designated as military grade or "enhanced plastic" are designed and intended for use in
military/aerospace applications or environments. Buyer acknowledges and agrees that any military or aerospace use of TI components
which have not been so designated is solely at the Buyer's risk, and that Buyer is solely responsible for compliance with all legal and
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TI has specifically designated certain components as meeting ISO/TS16949 requirements, mainly for automotive use. In any case of use of
non-designated products, TI will not be responsible for any failure to meet ISO/TS16949.

Products                                       Applications

Audio                  www.ti.com/audio        Automotive and Transportation www.ti.com/automotive

Amplifiers             amplifier.ti.com        Communications and Telecom www.ti.com/communications

Data Converters        dataconverter.ti.com    Computers and Peripherals  www.ti.com/computers

DLP Products          www.dlp.com             Consumer Electronics       www.ti.com/consumer-apps

DSP                    dsp.ti.com              Energy and Lighting        www.ti.com/energy

Clocks and Timers      www.ti.com/clocks       Industrial                 www.ti.com/industrial

Interface              interface.ti.com        Medical                    www.ti.com/medical

Logic                  logic.ti.com            Security                   www.ti.com/security

Power Mgmt             power.ti.com            Space, Avionics and Defense www.ti.com/space-avionics-defense

Microcontrollers       microcontroller.ti.com  Video and Imaging          www.ti.com/video

RFID                   www.ti-rfid.com

OMAP Applications Processors www.ti.com/omap   TI E2E Community           e2e.ti.com

Wireless Connectivity  www.ti.com/wirelessconnectivity

                       Mailing Address: Texas Instruments, Post Office Box 655303, Dallas, Texas 75265
                                            Copyright 2014, Texas Instruments Incorporated

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CD74HC595MT器件购买:

数量 单价(人民币) mouser购买
250 ¥5.07 购买
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