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AS7C1026B-12TI

器件型号:AS7C1026B-12TI
器件类别:存储   
厂商名称:ALSC [Alliance Semiconductor Corporation]
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器件描述

64K X 16 STANDARD SRAM, 10 ns, PDSO44

参数
AS7C1026B-12TI功能数量 1
AS7C1026B-12TI端子数量 44
AS7C1026B-12TI最大工作温度 70 Cel
AS7C1026B-12TI最小工作温度 0.0 Cel
AS7C1026B-12TI最大供电/工作电压 5.5 V
AS7C1026B-12TI最小供电/工作电压 4.5 V
AS7C1026B-12TI额定供电电压 5 V
AS7C1026B-12TI最大存取时间 10 ns
AS7C1026B-12TI加工封装描述 10.20 × 18.40 MM, 铅 FREE, TSOP2-44
AS7C1026B-12TI无铅 Yes
AS7C1026B-12TI欧盟RoHS规范 Yes
AS7C1026B-12TI状态 ACTIVE
AS7C1026B-12TI工艺 CMOS
AS7C1026B-12TI包装形状 矩形的
AS7C1026B-12TI包装尺寸 SMALL OUTLINE, THIN PROFILE
AS7C1026B-12TI表面贴装 Yes
AS7C1026B-12TI端子形式 GULL WING
AS7C1026B-12TI端子间距 0.8000 mm
AS7C1026B-12TI端子涂层 MATTE 锡/锡 BISMUTH
AS7C1026B-12TI端子位置
AS7C1026B-12TI包装材料 塑料/环氧树脂
AS7C1026B-12TI温度等级 COMMERCIAL
AS7C1026B-12TI内存宽度 16
AS7C1026B-12TI组织 64K × 16
AS7C1026B-12TI存储密度 1.05E6 deg
AS7C1026B-12TI操作模式 ASYNCHRONOUS
AS7C1026B-12TI位数 65536 words
AS7C1026B-12TI位数 64K
AS7C1026B-12TI内存IC类型 标准存储器
AS7C1026B-12TI串行并行 并行

文档预览

AS7C1026B-12TI器件文档内容

March 2004                                                                                                                                               AS7C1026B

                                                                          

                                            5 V 64K X 16 CMOS SRAM

Features                                                                  TTL-compatible, three-state I/O
                                                                         JEDEC standard packaging
Industrial and commercial versions
Organization: 65,536 words 16 bits                                     - 44-pin 400 mil SOJ
Center power and ground pins for low noise                               - 44-pin TSOP 2-400
High speed
                                                                         ESD protection  2000 volts
- 10/12/15/20 ns address access time                                     Latch-up current  200 mA
- 5, 6, 7, 8 ns output enable access time
Low power consumption: ACTIVE                                      Pin arrangement

  - 605 mW / max @ 10 ns                                                     44-Pin SOJ (400 mil), TSOP 2

Low power consumption: STANDBY

  - 55 mW / max CMOS I/O

6 T 0.18 u CMOS technology
Easy memory expansion with CE, OE inputs

                                                                                         A4  1                                                  44       A5

Logic block diagram                                                                      A3  2                                                  43       A6

                                                                                         A2  3                                                  42       A7

                                                                                         A1  4                                                  41       OE

                A0                                                                       A0  5                                                  40       UB
                A1
                A2                                                                    CE     6                                                  39       LB
                A3  Row decoder                                 VCC
                A4                                                                    I/O0   7                                                  38       I/O15
                A5                   A864 K 16
                A6                        A9                                          I/O1   8                                                  37       I/O14
                A7                            A10              GND
                                                   A11                                I/O2   9                                                  36       I/O13
                                                        A12Array
                                                             A13                      I/O3   10                                                 35       I/O12
                                                                 A14Control circuit
                                                                      A15             VCC    11                                                 34       GND

                                                                                                                                     AS7C1026BGND1233    VCC

                                                                                      I/O4   13                                                 32       I/O11

                                                                                      I/O5   14                                                 31       I/O10

                                                                                      I/O6   15                                                 30       I/O9

     I/O0I/O7       I/O                                                              I/O7   16                                                 29       I/O8
    I/O8I/O15      buffer
                                                                                      WE     17                                                 28       NC

                                                                                      A15    18                                                 27       A8

                                                                                      A14    19                                                 26       A9

WE                          Column decoder                                            A13    20                                                 25       A10

                                                                                      A12    21                                                 24       A11

                                                                                      NC     22                                                 23       NC

UB
OE
LB
CE

Selection guide                             -10                      -12     -15                                                                    -20         Unit

Maximum address access time                 10                       12               15                                                            20          ns
Maximum output enable access time
Maximum operating current                   5                        6                7                                                             8           ns
Maximum CMOS standby current
                                            110                      100              90                                                            80          mA

                                            10                       10               10                                                            10          mA

3/26/04, v 1.3                     Alliance Semiconductor                                                              P. 1 of 10

                                                                                                 Copyright Alliance Semiconductor. All rights reserved.
                                                                                       AS7C1026B

                                                     

Functional description

The AS7C1026B is a high-performance CMOS 1,048,576-bit Static Random Access Memory (SRAM) device organized as 65,536 words
16 bits. It is designed for memory applications where fast data access, low power, and simple interfacing are desired.

Equal address access and cycle times (tAA, tRC, tWC) of 10/12/15/20 ns with output enable access times (tOE) of 5, 6, 7, 8 ns are ideal for
high-performance applications.

When CE is high, the device enters standby mode. If inputs are still toggling, the device will consume ISB power. If the bus is static, then full
standby power is reached (ISB1). For example, the AS7C1026B is guaranteed not to exceed 55 mW under nominal full standby conditions.
A write cycle is accomplished by asserting write enable (WE) and chip enable (CE). Data on the input pins I/O0 through I/O15 is written on
the rising edge of WE (write cycle 1) or CE (write cycle 2). To avoid bus contention, external devices should drive I/O pins only after
outputs have been disabled with output enable (OE) or write enable (WE).

A read cycle is accomplished by asserting output enable (OE) and chip enable (CE) with write enable (WE) high. The chip drives I/O pins
with the data word referenced by the input address. When either chip enable or output enable is inactive or write enable is active, output
drivers stay in high-impedance mode.

The device provides multiple center power and ground pins, and separate byte enable controls, allowing individual bytes to be written and
read. LB controls the lower bits, I/O0 through I/O7, and UB controls the higher bits, I/O8 through I/O15.

All chip inputs and outputs are TTL-compatible, and operation is from a single 5 V supply. The device is packaged in common industry
standard packages.

    Absolute maximum ratings

                    Parameter                Symbol       Min                Max        Unit

    Voltage on VCC relative to GND           Vt1     0.50                   +7.0       V
                                                     0.50
    Voltage on any pin relative to GND       Vt2                             VCC +0.50  V
                                                      
    Power dissipation                        PD       65                    1.0        W

    Storage temperature (plastic)            Tstg     55                    +150       C

    Ambient temperature with VCC             Tbias                           +125       C
    applied

    DC current into outputs (low)            IOUT                           20         mA

Note: Stresses greater than those listed under Absolute Maximum Ratings may cause permanent damage to the device. This is a stress rating only and func-
tional operation of the device at these or any other conditions outside those indicated in the operational sections of this specification is not implied. Exposure
to absolute maximum rating conditions for extended periods may affect reliability.

Truth table

CE              WE     OE                LB  UB      I/O0I/O7 I/O8I/O15               Mode

H               X      X                 X   X       High Z          High Z             Standby (ISB), ISBI)

L               H      L                 L   H       DOUT            High Z        Read I/O0I/O7 (ICC)

L               H      L                 H   L       High Z          DOUT          Read I/O8I/O15 (ICC)

L               H      L                 L   L       DOUT            DOUT          Read I/O0I/O15 (ICC)

L               L      X                 L   L       DIN             DIN           Write I/O0I/O15 (ICC)

L               L      X                 L   H       DIN             High Z        Write I/O0I/O7 (ICC)

L               L      X                 H   L       High Z          DIN           Write I/O8I/O15 (ICC)

L               H      H                 X   X       High Z          High Z             Output disable (ICC)
                                             H
L               X      X                 H

Key: H = high, L = low, X = don't care.

3/26/04, v 1.3                               Alliance Semiconductor                           P. 2 of 10
                                                                                                    AS7C1026B

                                                                  

Recommended operating conditions

                       Parameter                         Symbol Min Nominal          Max                    Unit

Supply voltage                                           VCC      4.5      5.0       5.5                    V

Input voltage                                            VIH      2.2               VCC + 0.5              V

                                                         VIL      0.5              0.8                    V

                                            commercial      TA    0                 70                     oC
Ambient operating temperature                                                                               oC
                                       industrial           TA    40               85

VIL min = -1.0V for pulse width less than 5ns

VIH max = VCC+2.0V for pulse width less than 5ns.

DC operating characteristics (over the operating range)1

                                                                  -10           -12  -15               -20

Parameter                     Sym      Test conditions            Min Max Min Max Min Max Min Max Unit

Input leakage current         | ILI |      VCC = Max,             1 1 1 - 1 A
                                       VIN = GND to VCC

Output leakage current        | ILO |  VCC = Max, CE = VIH,       1 1 1 - 1 A
                                        VOUT = GND to VCC

Operating power supply                       VCC = Max,
current
                              ICC      CE  VIL, IOUT = 0mA,       110 100 90 - 80 mA

                                               f = fMax

                              ISB          VCC = Max,             50 45 45                            40 mA

                                       CE  VIH , f = fMax

Standby power supply current           VCC = Max, CE  VCC0.2 V,

                              ISB1           VIN  0.2 V or         10 10 10 - 10 mA

                                       VIN  VCC0.2 V, f = 0

Output voltage                VOL      IOL = 8 mA, VCC = Min       0.4 0.4 0.4 - 0.4 V

                              VOH IOH = 4 mA, VCC = Min 2.4 2.4 2.4 2.4 -                                  V

Capacitance (f = 1MHz, Ta = 25 C, VCC = NOMINAL)2

Parameter                              Symbol                     Signals             Test conditions  Max Unit
                                                                                          VIN = 0 V      5 pF
Input capacitance                      CIN               A, CE, WE, OE, LB, UB                           7 pF
I/O capacitance                                                                      VIN = VOUT = 0 V
                                       CI/O                       I/O

3/26/04, v 1.3                               Alliance Semiconductor                                    P. 3 of 10
                                                                                          AS7C1026B

                                                        

Read cycle (over the operating range)3,9

                                                   -10              -12  -15            -20

         Parameter                        Symbol Min Max Min Max Min Max Min Max Unit Notes

Read cycle time                           tRC   10 12 15 20 - ns
Address access time
Chip enable (CE) access time              tAA    10 12 15 - 20 ns                       3
Output enable (OE) access time
Output hold from address change           tACE   10 12 15 - 20 ns                       3
CE low to output in low Z
CE high to output in high Z               tOE    5 6 7 - 8 ns
OE low to output in low Z
Byte select access time                   tOH   3 3 3 3 - ns                           5
Byte select Low to low Z
Byte select High to high Z                tCLZ  3333                                      - ns 4, 5
OE high to output in high Z
Power up time                             tCHZ  456                               -       7 ns 4, 5
Power down time
                                          tOLZ  0000                                      - ns 4, 5

                                          tBA    5 6 7 - 8 ns

                                          tBLZ  0000                                      - ns 4, 5

                                          tBHZ  566                               -       7 ns 4, 5

                                          tOHZ         456                        -       7 ns 4, 5

                                          tPU   0 0 0 0 - ns 4, 5

                                          tPD    10 12 15 - 20 ns 4, 5

Key to switching waveforms                           Falling input                   Undefined output/don't care

                            Rising input

Read waveform 1 (address controlled)3,6,7,9

                                                        tRC

Address

                                 tOH            tAA                                     tOH

DataOUT         Previous data valid                                      Data valid

3/26/04, v 1.3                            Alliance Semiconductor                             P. 4 of 10
                                                                                                                           AS7C1026B

                                                                                 

Read waveform 2 (OE, CE, UB, LB controlled)3,6,8,9

                                                                                           tRC

Address
                                                                  tAA

OE

                                                         tOE                                                     tOH
                                  tOLZ
                                                                                                                     tOHZ
CE                                                                                                                tHZ

                                              tACE                                                                   tBHZ
                                        tLZ

LB, UB

                                  tBLZ                                 tBA

DataIN                                                                                               Data valid

Write cycle (over the operating range) 11

                                                                            -10                 -12  -15         -20

                Parameter               Symbol Min Max Min Max Min Max Min Max Unit                                            Notes

Write cycle time                        tWC 10 12 15 20 -                                                            ns    5
Chip enable (CE) to write end                                                                                                   4, 5
Address setup to write end              tCW 8 9 10 12 -                                                              ns   4, 5
Address setup time
Write pulse width                       tAW 8 9 10 12 -                                                              ns
Write recovery time
Address hold from end of write          tAS                            000 0 -                                         ns
Data valid to write end
Data hold time                          tWP 7 8 9 12 -                                                               ns
Write enable to output in high Z
Output active from write end            tWR 0 0 0 0 -                                                                ns
Byte select low to end of write
                                        tAH 0 0 0 0 -                                                                ns

                                        tDW 5 6 8 10 -                                                               ns

                                        tDH 0 0 0 0 -                                                                ns

                                        tWZ 5 6 7 - 8                                                                ns

                                        tOW 1 1 1 2 -                                                                ns

                                        tBW 7 8 9 9 -                                                                ns

3/26/04, v 1.3                          Alliance Semiconductor                                                             P. 5 of 10
                                                                                                                            AS7C1026B

                                                                                         

Write waveform 1 (WE controlled)11

                                                                                    tWC

Address                        tCW                                                                               tAH
      CE                                                                                                         tWR

LB, UB                        tBW

      WE                  tAS  tAW                                                          tWP

  DataIN                                                                                         tDW             tDH
DataOUT                                                                                              Data valid        tOW

                                                    tWZ                                                          high Z
                          Data undefined

Write waveform 2 (CE controlled)11                                                                        tAH
                                                                                                           tWR
                                                                                    tWC
                                                                                                                tDH
Address              tAS                        tCW                                              Data valid
       CE                                    tAW
                 tCLZ                                                                                             tOW
LB, UB         high Z                           tBW                                                  high Z
      WE                                                   tWP

  DataIN                                                        tDW
DataOUT
                                                 tWZ
                               Data undefined

3/26/04, v 1.3            Alliance Semiconductor                                                                            P. 6 of 10
                                                                                   AS7C1026B

                                                

AC test conditions

       Output load: see Figure B.
       Input pulse level: GND to 3.5 V. See Figure A.
       Input rise and fall times: 2 ns. See Figure A.
       Input and output timing reference levels: 1.5

                                                                                             +5 V

                                                 480                                               Thevenin Equivalent:
                                                 C13
+3.5V           90%        90%         DOUT                                                        DOUT  168   +1.728 V
                                           255

        10%          2 ns  10%                                GND
GND                                    Figure B: 5 V Output load

                Figure A: Input pulse

Notes

1 During VCC power-up, a pull-up resistor to VCC on CE is required to meet ISB specification.
2 This parameter is sampled, but not 100% tested.
3 For test conditions, see AC Test Conditions, Figures A and B.
4 These parameters are specified with CL = 5 pF, as in Figures B. Transition is measured 500 mV from steady-state voltage.
5 This parameter is guaranteed, but not tested.
6 WE is high for read cycle.
7 CE and OE are low for read cycle.
8 Address is valid prior to or coincident with CE transition low.
9 All read cycle timings are referenced from the last valid address to the first transitioning address.
10 N/A.
11 All write cycle timings are referenced from the last valid address to the first transitioning address.
12 Not applicable.
13 C = 30 pF, except all high Z and low Z parameters where C = 5 pF.

3/26/04, v 1.3                         Alliance Semiconductor                                                                 P. 7 of 10
                                                                                                                  AS7C1026B

Package dimensions                                                                               44-pin TSOP 2
                                                                                            c
       44 43 42 41 40 39 38 37 36 35 34 33 32 31 30 29 28 27 26 25 24 23

                                                                                                  Min Max
                                                                                                  (mm) (mm)

                44-pin TSOP 2                                                 E He             A         1.2

                                                                                               A1 0.05 0.15

                                                                                               A2 0.95 1.05

1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22                                       b  0.30   0.45

                          D                                                                    c 0.120 0.21

                                                                                               D 18.31 18.52

A                                              A2                                      l       E 10.06 10.26

                                                                              05

   A1 b            e                                                                           He 11.68 11.94

                                                                                               e  0.80 (typical)

                                                                                               l  0.40   0.60

                                D                                                                 44-pin SOJ
                   e                                                                                400 mil

          44-pin SOJ                                                                              Min (in) Max (in)

                                            E1 E2                                              A 0.128 0.148

                                                                                               A1 0.025  

   Pin 1                                                                                              A2 0.105 0.115

                B                                                                      c

                                                                          A2                          B 0.026 0.032

                                            A                                                  b 0.015 0.020

   A1

                                   Seating                                          E          c 0.007 0.013

                b                  plane

                                                                                               D 1.120 1.130

                                                                                               E  0.370 NOM

                                                                                               E1 0.395 0.405

                                                                                               E2 0.435 0.445

                                                                                               e  0.050 NOM

3/26/04, v 1.3                                     Alliance Semiconductor                                             P. 8 of 10
                                                                                              AS7C1026B

                                                            

Ordering codes

Package \ Access time         Temp                   10 ns  12 ns               15 ns             20 ns

Plastic SOJ, 400 mil          commercial   AS7C1026B-10JC AS7C1026B-12JC AS7C1026B-15JC AS7C1026B-20JC
                               industrial  AS7C1026B-10JI AS7C1026B-12JI AS7C1026B-15JI AS7C1026B-20JI

TSOP 2, 10.2 x 18.4 mm        commercial   AS7C1026B-10TC AS7C1026B-12TC AS7C1026B-15TC AS7C1026B-20TC
                               industrial  AS7C1026B-10TI AS7C1026B-12TI AS7C1026B-15TI AS7C1026B-20TI

Note: Add suffix `N' to the above ordering part number for LEAD FREE PARTS (Ex: AS7C1026B-10JCN)

Part numbering system

AS7C 1026B XX                             X                       X                                           X
                                                                                                  N = LEAD FREE PART
SRAM    Device        Access               Package:         Temperature range:
prefix  number         time
                              J = SOJ 400 mil               C = commercial: 0 C to 70 C

                              T = TSOP 2, 10.2 x 18.4 mm I = industrial: -40 C to 85 C

3/26/04, v 1.3                             Alliance Semiconductor                                 P. 9 of 10
                                                                         AS7C1026B

                                    



Alliance Semiconductor Corporation  Copyright Alliance Semiconductor
2575, Augustine Drive,              All Rights Reserved
Santa Clara, CA 95054               Part Number: AS7C1026B
Tel: 408 - 855 - 4900               Document Version: v 1.3
Fax: 408 - 855 - 4999
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   The data contained herein represents Alliance's best data and/or estimates at the time of issuance. Alliance reserves the right to change or correct this
   data at any time, without notice. If the product described herein is under development, significant changes to these specifications are possible. The
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   or use of any product described herein, and disclaims any express or implied warranties related to the sale and/or use of Alliance products including
   liability or warranties related to fitness for a particular purpose, merchantability, or infringement of any intellectual property rights, except as express
   agreed to in Alliance's Terms and Conditions of Sale (which are available from Alliance). All sales of Alliance products are made exclusively according
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