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74HC151

器件型号:74HC151
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厂商名称:MOTOROLA [Motorola, Inc]
厂商官网:http://www.freescale.com/
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74HC151器件文档内容

MOTOROLA

SEMICONDUCTOR TECHNICAL DATA

8-Input Data                                                                              MC74HC151
Selector/Multiplexer
                                                                                   16                               N SUFFIX
HighPerformance SiliconGate CMOS                                                       1                   PLASTIC PACKAGE

   The MC74HC151 is identical in pinout to the LS151. The device inputs are                                      CASE 64808
compatible with standard CMOS outputs; with pullup resistors, they are
compatible with LSTTL outputs.                                                            16                     D SUFFIX
                                                                                                  1          SOIC PACKAGE
   This device selects one of the eight binary Data Inputs, as determined by                                 CASE 751B05
the Address Inputs. The Strobe pin must be at a low level for the selected
data to appear at the outputs. If Strobe is high, the Y output is forced to a low           ORDERING INFORMATION
level and the Y output is forced to a high level.
                                                                                            MC74HCXXXN          Plastic
   The HC151 is similar in function to the HC251 which has 3state outputs.                 MC74HCXXXD          SOIC

Output Drive Capability: 10 LSTTL Loads                                                            PIN ASSIGNMENT
Outputs Directly Interface to CMOS, NMOS, and TTL
Operating Voltage Range: 2 to 6 V                                                              D3 1        16 VCC
Low Input Current: 1 A                                                                        D2 2        15 D4
High Noise Immunity Characteristic of CMOS Devices                                             D1 3        14 D5
In Compliance with the Requirements Defined by JEDEC Standard                                  D0 4        13 D6
                                                                                                  Y5         12 D7
    No. 7A                                                                                        Y6         11 A0
Chip Complexity: 132 FETs or 33 Equivalent Gates                                        STROBE 7           10 A1
                                                                                              GND 8           9 A2
                       LOGIC DIAGRAM

DATA                  D0 4                    5Y
INPUTS                 D1 3
                       D2 2                                 DATA
                       D3 1                              OUTPUTS                                     FUNCTION TABLE
                       D4 15                   6Y
                       D5 14
                       D6 13                                                                         Inputs          Outputs
                       D7 12
                                                                                   A2 A1 A0 Strobe Y Y

                       A0 11                                                              XXX                H       LH
                       A1 10                                                              LLL
ADDRESS                A2 9                                                               L LH               L  D0 D0
INPUTS                                                                                   LHL
                                                                                          L HH               L  D1 D1
                                                                                          HL L
                                                                                          HLH                L  D2 D2
                                                                                          HH L
                       STROBE 7                                                           HHH                L  D3 D3

                                                                                                             L  D4 D4

                                 PIN 16 = VCC                                                                L  D5 D5
                                 PIN 8 = GND
                                                                                                             L  D6 D6

                                                                                                             L  D7 D7

                                                                                   D0, D1, ..., D7 = the level of the respective
                                                                                   D input.

10/95                                                             1                REV 6

Motorola, Inc. 1995
MC74HC151
MAXIMUM RATINGS*
Symbol
VCCParameter                         Value                  Unit                 This device contains protection
Vin                                                                           circuitry to guard against damage
Vout                                                                          due to high static voltages or electric
Iin                                                                           fields. However, precautions must
Iout                                                                          be taken to avoid applications of any
ICC                                                                           voltage higher than maximum rated
PD                                                                            voltages to this highimpedance cir-
DC Supply Voltage (Referenced to GND)                      0.5 to + 7.0            V                 cuit. For proper operation, Vin and

DC Input Voltage (Referenced to GND)                      1.5 to VCC + 1.5 V                         v v Vout should be constrained to the
DC Output Voltage (Referenced to GND)
DC Input Current, per Pin                                 0.5 to VCC + 0.5 V                         range GND (Vin or Vout) VCC.
                                                                                                         Unused inputs must always be
                                                             20                   mA
                                                                                                      tied to an appropriate logic voltage
DC Output Current, per Pin                                    25                   mA                level (e.g., either GND or VCC).
                                                                                                      Unused outputs must be left open.
DC Supply Current, VCC and GND Pins                           50                   mA

Tstg StorageTemperature
Power Dissipation in Still Air       Plastic DIP             750                    mW

                                     SOIC Package            500

TL Lead Temperature, 1 mm from Case for 10 Seconds          _C
                                                          65 to + 150

                                                                                    _C
(Plastic DIP or SOIC Package)
                                                             260

* Maximum Ratings are those values beyond which damage to the device may occur.

Functional operation should be restricted to the Recommended Operating Conditions.

Derating -- Plastic DIP: 10 mW/_C from 65_ to 125_C
                    SOIC Package: 7 mW/_C from 65_ to 125_C

For high frequency or heavy load considerations, see Chapter 2 of the Motorola HighSpeed CMOS Data Book (DL129/D).
RECOMMENDED OPERATING CONDITIONS
Symbol
VCC DC Supply Voltage (Referenced to GND)
          Parameter                                          Min Max Unit
Vin, Vout DC Input Voltage, Output Voltage (Referenced to GND) 0 VCC V
                                                             2.0 6.0 V
TA
tr, tf Input Rise and Fall Time
(Figure 1)
          Operating Temperature, All Package Types            55 + 125 _C

                                                    VCC = 2.0 V 0    1000 ns
                                                    VCC = 4.5 V 0    500
                                                    VCC = 6.0 V 0    400
DC ELECTRICAL CHARACTERISTICS (Voltages Referenced to GND)
Symbol
                                                                                                      Guaranteed Limit

          Parameter                                 Test Conditions                 VCC   v v 55 to                   125_C Unit
                                                                                      V
                                                                                           25_C
                                                                                                      85_C
VIH
          Minimum HighLevel Input   v Vout = 0.1 V or VCC 0.1 V                  2.0         1.5   1.5               1.5                  V

                                     |Iout| 20 A
Voltage                                           4.5         3.15  3.15              3.15
VIL
                                                                                    6.0         4.2   4.2               4.2

Voltage
          Maximum LowLevel Input    v Vout = 0.1 V or VCC 0.1 V                  2.0         0.3   0.3               0.3                  V

                                     |Iout| 20 A                                   4.5         0.9   0.9               0.9
VOH
                                                                                    6.0         1.2   1.2               1.2

          Minimum HighLevel Output  v Vin = VIH or VIL                             2.0         1.9   1.9               1.9                  V
          Voltage
                                     |Iout| 20 A
Vin = VIH        4.5         4.4   4.4               4.4

                                                                                    6.0         5.9   5.9               5.9

                                                         v |Iout| 4.0 mA            4.5         3.98  3.84              3.70
                                                         v |Iout| 5.2 mA            6.0         5.48  5.34              5.20
VOL
          Maximum LowLevel Output   v Vin = VIH or VIL                             2.0         0.1   0.1               0.1                  V
          Voltage
                                     |Iout| 20 A
v Vin = VIH or VIL |Iout| 4.0 mA                  4.5         0.1   0.1               0.1
v |Iout| 5.2mA
                                                                                    6.0         0.1   0.1               0.1

                                                                                    4.5         0.26  0.33              0.40
                                                                                    6.0         0.26  0.33              0.40
Iin
ICC                                                      0.1       1.0             1.0                A
          Maximum Input Leakage Current Vin = VCC or GND                            6.0
Current (per Package)
          Maximum Quiescent Supply   Vin = VCC or GND                               6.0         8     80                160                  A
                                     Iout = 0 A
NOTE: Information on typical parametric values can be found in Chapter 2 of the Motorola HighSpeed CMOS Data Book (DL129/D).

MOTOROLA                                                  2                                           HighSpeed CMOS Logic Data

                                                                                                                                             DL129 -- Rev 6
AC ELECTRICAL CHARACTERISTICS (CL = 50 pF, Input tr = tf = 6 ns)
                                                                                              MC74HC151

Symbol
tPLH,

       tPHL
                                                                            Guaranteed Limit

                                                                 VCC   v v 55 to
                                                                   V
                                                                        25_C
                                           Parameter              2.0       85_C              125_C Unit
                                                                  4.5
     Maximum Propagation Delay, Input D to Output Y or Y          6.0
        (Figures 1, 3 and 6)
tPLH,2.0185230             280                           ns
tPHL                            4.5
                                                                  6.0  37   46                56

                                                                  2.0  31   39                48
                                                                  4.5
     Maximum Propagation Delay, Input A to Output Y or Y          6.0  205  255               310                           ns
        (Figures 2 and 6)
tPLH,                           2.0  41   51                62
tPHL                            4.5
                                                                  6.0  35   43                53

     Maximum Propagation Delay, Strobe to Output Y or Y           --   125  155               190                           ns
        (Figures 4, 5 and 6)
tTLH,25  31                38
       tTHL
                                                                       21   26                32

Cin
NOTES:
     Maximum Output Transition Time, Any Output                        75   95                110                           ns
        (Figures 1 and 6)
                                                                       15   19                22

                                                                       13   16                19

     Maximum Input Capacitance                                         10   10                10                            pF

1. For propagation delays with loads other than 50 pF, see Chapter 2 of the Motorola HighSpeed CMOS Data Book (DL129/D).

2. Information on typical parametric values can be found in Chapter 2 of the Motorola HighSpeed CMOS Data Book (DL129/D).

                                                                       Typical @ 25C, VCC = 5.0 V

CPD  Power Dissipation Capacitance (Per Package)*                           36                                              pF

* Used to determine the noload dynamic power consumption: PD = CPD VCC2f + ICC VCC. For load considerations, see Chapter 2 of the
Motorola HighSpeed CMOS Data Book (DL129/D).

                                PIN DESCRIPTIONS

INPUTS                                                           Strobe (Pin 7)
                                                                    Strobe. This input pin must be at a low level for the se-
D0, D1, ... , D7 (Pins 4, 3, 2, 1, 15, 14, 13, 12)
   Data inputs. Data on any one of these eight binary inputs     lected data to appear at the outputs. If the Strobe pin is high,
                                                                 the Y output is forced to a low level and the Y output is forced
may be selected to appear on the output.                         to a high level.

CONTROL INPUTS                                                   OUTPUTS

A0, A1, A2 (Pins 11, 10, 9)                                      Y, Y (Pins 5, 6)
   Address inputs. The data on these pins are the binary ad-        Data outputs. The selected data is presented at these pins

dress of the selected input (see the Function Table).            in both true (Y output) and complemented (Y output) forms.

HighSpeed CMOS Logic Data                                    3                                     MOTOROLA

DL129 -- Rev 6
MC74HC151

                                        SWITCHING WAVEFORMS

                tr          90%         tf                    INPUT A               VALID            VALID
  INPUT D                  50%                        VCC                       50%                                        VCC
                          10%                         GND           tPLH
              tPLH                                                                   50%                                   GND
OUTPUT Y                    90%                tPHL           OUTPUT                                     tPHL
                           50%                                 Y OR Y
                          10%                    tTHL

                    tTLH

                          Figure 1.                                                       Figure 2.

                                 tr     tf                                            tf                   tr
                                                    VCC                                              tPHL
                            90%                     GND                   90%                                     VCC
                           50%                                            50%                                     GND
  INPUT D                 10%                tPLH             STROBE       10%
             tPHL                                                                                                 tTHL
                                90%            tTLH                             tPLH
OUTPUT Y                         50%
                                   10%                        Y                            90%
                                                                     tTLH                 50%

                                                                                          10%

          tTHL

                          Figure 3.                                                       Figure 4.

           90%        tf                tr                                      DEVICE             TEST POINT
            50%                                       VCC                       UNDER      OUTPUT
STROBE 10%                tPHL                        GND                        TEST
        Y           90%                                                                                      CL*
                    50%                     tPLH

                      10%                    tTLH
                            tTHL

                          Figure 5.                                   * Includes all probe and jig capacitance
                                                                               Figure 6. Test Circuit

MOTOROLA                                                   4                                         HighSpeed CMOS Logic Data

                                                                                                                  DL129 -- Rev 6
                            EXPANDED LOGIC DIAGRAM     MC74HC151

                D0 4                                5Y
                                                                DATA
                D1 3
                                                    6 Y OUTPUTS
                D2 2

DATA           D3 1
INPUTS          D4 15

                D5 14

                D6 13
                D7 12

                A0 11

ADDRESS         A1 10
INPUTS

                A2 9

STROBE 7

HighSpeed CMOS Logic Data  5                       MOTOROLA

DL129 -- Rev 6
MC74HC151

                                                        OUTLINE DIMENSIONS

              A              9                                         N SUFFIX                 NOTES:
                                                                PLASTIC PACKAGE                  1. DIMENSIONING AND TOLERANCING PER ANSI
                                      B                                                                Y14.5M, 1982.
16                                                                   CASE 64808                  2. CONTROLLING DIMENSION: INCH.
1                             8                                         ISSUE R                   3. DIMENSION L TO CENTER OF LEADS WHEN
                                                                                                       FORMED PARALLEL.
      H                                                                                           4. DIMENSION B DOES NOT INCLUDE MOLD FLASH.
               G                                                                                  5. ROUNDED CORNERS OPTIONAL.

                                                                                                    INCHES        MILLIMETERS

                  F                         C                                                    DIM MIN MAX MIN MAX

                                                                           L                     A 0.740 0.770 18.80 19.55

                              S                                                                  B 0.250 0.270 6.35 6.85

                                                                                                 C 0.145 0.175 3.69 4.44

                                                                                                 D 0.015 0.021 0.39 0.53

                                               T       SEATING                                  F 0.040 0.070 1.02 1.77
                                                       PLANE
                                                                                                 G     0.100 BSC      2.54 BSC

                                            K                                        M           H     0.050 BSC      1.27 BSC

                                                                 J                               J 0.008 0.015 0.21 0.38

                                                                                                 K 0.110 0.130 2.80 3.30

                  D 16 PL                                                                        L 0.295 0.305 7.50 7.74
                     0.25 (0.010) M T A M
                                                                                                 M  0 10        0 10

                                                                                                 S 0.020 0.040 0.51 1.01

                          A                                       D SUFFIX                      NOTES:
                                                       PLASTIC SOIC PACKAGE                      1. DIMENSIONING AND TOLERANCING PER ANSI
                                                                                                       Y14.5M, 1982.
          16                                                   CASE 751B05                       2. CONTROLLING DIMENSION: MILLIMETER.
                                                                    ISSUE J                       3. DIMENSIONS A AND B DO NOT INCLUDE
          1                                                                                            MOLD PROTRUSION.
                                         9                                                        4. MAXIMUM MOLD PROTRUSION 0.15 (0.006)
                                                                                                       PER SIDE.
                                               B P 8 PL                                          5. DIMENSION D DOES NOT INCLUDE DAMBAR
                                                                                                      PROTRUSION. ALLOWABLE DAMBAR
                                                                 0.25 (0.010) M B M                    PROTRUSION SHALL BE 0.127 (0.005) TOTAL
                                         8                                                             IN EXCESS OF THE D DIMENSION AT
                                                                                                       MAXIMUM MATERIAL CONDITION.
           G

                                                                                                       MILLIMETERS    INCHES

                                                                                                    DIM MIN MAX MIN MAX

                                           K                                                  F     A 9.80 10.00 0.386 0.393
                                                                                        J
                                                     C                     R X 45                  B 3.80 4.00 0.150 0.157

                                                                     M                              C 1.35 1.75 0.054 0.068
                  D 16 PL
                                                                                                    D 0.35 0.49 0.014 0.019
                        0.25 (0.010) M T B S A S
                                                                                                    F 0.40 1.25 0.016 0.049

   T                                                                                               G       1.27 BSC  0.050 BSC
SEATING
                                                                                                    J 0.19 0.25 0.008 0.009
  PLANE
                                                                                                    K 0.10 0.25 0.004 0.009

                                                                                                    M       0 7     0        7

                                                                                                    P 5.80 6.20 0.229 0.244

                                                                                                    R 0.25 0.50 0.010 0.019

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MOTOROLA                       CODELINE                                 6               *MC74HC151/D* MC74HC151/D
                                                                                                                      HighSpeed CMOS Logic Data
                                                                                                                                          DL129 -- Rev 6
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