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24C1024

器件型号:24C1024
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厂商名称:ATMEL [ATMEL Corporation]
厂商官网:http://www.atmel.com/
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24C1024器件文档内容

Features                                                                                2-wire Serial
                                                                                        EEPROM
Low-voltage Operation
                                                                                        1M (131,072 x 8)
       2.7 (VCC = 2.7V to 5.5V)
Internally Organized 131,072 x 8
2-wire Serial Interface
Schmitt Triggers, Filtered Inputs for Noise Suppression
Bi-directional Data Transfer Protocol
400 kHz (2.7V) and 1 MHz (5V) Clock Rate
Write Protect Pin for Hardware and Software Data Protection
256-byte Page Write Mode (Partial Page Writes Allowed)
Random and Sequential Read Modes
Self-timed Write Cycle (5 ms Typical)
High Reliability

       Endurance: 100,000 Write Cycles/Page

       Data Retention: 40 Years
8-lead PDIP, 8-lead EIAJ SOIC, 8-lead LAP and 8-ball dBGATM Packages

Description                                                                             AT24C1024

The AT24C1024 provides 1,048,576 bits of serial electrically erasable and program-
mable read only memory (EEPROM) organized as 131,072 words of 8 bits each. The
device's cascadable feature allows up to 2 devices to share a common 2-wire bus. The
device is optimized for use in many industrial and commercial applications where low-
power and low-voltage operation are essential. The devices are available in space-
saving 8-lead PDIP, 8-lead EIAJ SOIC, 8-lead Leadless Array (LAP) and 8-ball dBGA
packages. In addition, the entire family is available in 2.7V (2.7V to 5.5V) versions.

                              8-lead PDIP

Pin Configurations              NC 1   8 VCC
                                 A1 2  7 WP
Pin Name  Function              NC 3   6 SCL
A1        Address Input       GND 4    5 SDA
SDA       Serial Data
SCL       Serial Clock Input  8-lead Leadless Array
WP        Write Protect
NC        No Connect

                              VCC 8    1 NC
                               WP 7    2 A1
                              SCL 6    3 NC
                              SDA 5    4 GND

          8-lead SOIC         Bottom View
                              8-ball dBGA
  NC 1    8 VCC
   A1 2   7 WP                VCC 8    1 NC
  NC 3    6 SCL                WP 7    2 A1
GND 4     5 SDA               SCL 6    3 NC
                              SDA 5    4 GND

                              Bottom View                                               Rev. 1471HSEEPR03/03

                                                                                                                1
Absolute Maximum Ratings*                                                           *NOTICE:  Stresses beyond those listed under "Absolute
                                                                                              Maximum Ratings" may cause permanent dam-
  Operating Temperature.................................. -55C to +125C                     age to the device. This is a stress rating only and
  Storage Temperature ..................................... -65C to +150C                   functional operation of the device at these or any
  Voltage on Any Pin                                                                          other conditions beyond those indicated in the
  with Respect to Ground .....................................-1.0V to +7.0V                  operational sections of this specification is not
  Maximum Operating Voltage .......................................... 6.25V                  implied. Exposure to absolute maximum rating
  DC Output Current........................................................ 5.0 mA            conditions for extended periods may affect device
                                                                                              reliability.
Block Diagram

2 AT24C1024

                                                                                              1471HSEEPR03/03
                 AT24C1024

Pin Description  SERIAL CLOCK (SCL): The SCL input is used to positive edge clock data into each
                 EEPROM device and negative edge clock data out of each device.
Memory
Organization     SERIAL DATA (SDA): The SDA pin is bi-directional for serial data transfer. This pin is open-
                 drain driven and may be wire-ORed with any number of other open-drain or open-collector
                 devices.

                 DEVICE/PAGE ADDRESSES (A1): The A1 pin is a device address input that can be hard-
                 wired or left not connected for hardware compatibility with AT24C128/256/512. When the A1
                 pin is hardwired, as many as two 1024K devices may be addressed on a single bus system
                 (device addressing is discussed in detail under the Device Addressing section). When the pin
                 is not hardwired, the default A1 is zero.

                 WRITE PROTECT (WP): The hardware Write Protect pin is useful for protecting the entire
                 contents of the memory from inadvertent write operations. The write-protect input, when tied to
                 GND, allows normal write operations. When WP is tied high to VCC, all write operations to the
                 memory are inhibited. If left unconnected, WP is internally pulled down to GND. Switching WP
                 to VCC prior to a write operation creates a software write-protect function.

                 AT24C1024, 1024K SERIAL EEPROM: The 1024K is internally organized as 512 pages of
                 256 bytes each. Random word addressing requires a 17-bit data word address.

                                                                                                                                                                  3

1471HSEEPR03/03
Pin Capacitance(1)

Applicable over recommended operating range from TA = 25C, f = 1.0 MHz, VCC = +2.7V.

Symbol Test Condition                                                 Max                    Units       Conditions
                                                                                               pF         VI/O = 0V
CI/O   Input/Output Capacitance (SDA)                                      8                   pF          VIN = 0V

CIN    Input Capacitance (A1, SCL)                                         6

Note: 1. This parameter is characterized and is not 100% tested.

DC Characteristics

Applicable over recommended operating range from: TAI = -40C to +85C, VCC = +2.7V to +5.5V, TAC = 0C to +70C,
VCC = +2.7V to +5.5V (unless otherwise noted).

Symbol Parameter            Test Condition                            Min              Typ          Max  Units

VCC    Supply Voltage                                                 2.7                           5.5  V

ICC    Supply Current       VCC = 5.0V         READ at 400 kHz                                      2.0  mA

ICC    Supply Current       VCC = 5.0V         WRITE at 400 kHz                                     5.0  mA

                            VCC = 2.7V         VIN = VCC or VSS                                     3.0  A

ISB    Standby Current

                            VCC = 5.5V                                                              6.0  A

ILI    Input Leakage Current VIN = VCC or VSS                                          0.10         3.0  A

ILO    Output Leakage       VOUT = VCC or VSS                                          0.05         3.0  A
       Current

VIL    Input Low Level(1)                                                -0.6                VCC x 0.3   V
                                                                      VCC x 0.7
VIH    Input High Level(1)                                                                   VCC + 0.5   V

  VOL  Output Low Level     VCC = 3.0V         IOL = 2.1 mA                                         0.4  V
Note:
       1. VIL min and VIH max are reference only and are not tested.

4 AT24C1024

                                                                                                         1471HSEEPR03/03
                                                                           AT24C1024

AC Characteristics

Applicable over recommended operating range from TA = -40C to +85C, VCC = +2.7V to +5.5V, CL = 100 pF (unless
otherwise noted). Test conditions are listed in Note 2.

Symbol   Parameter                               Test Conditions     Min   Max   Units

fSCL     Clock Frequency, SCL                    4.5V  VCC  5.5V           1000       kHz
                                                 2.7V  VCC  5.5V           400
                                                                                       s
tLOW     Clock Pulse Width Low                   4.5V  VCC  5.5V      0.4  0.55
                                                 2.7V  VCC  5.5V      1.3   0.9        s
                                                                      0.4
tHIGH    Clock Pulse Width High                  4.5V  VCC  5.5V      0.6   0.3        s
                                                 2.7V  VCC  5.5V     0.05  100
                                                                     0.05  300         s
tAA      Clock Low to Data Out Valid             4.5V  VCC  5.5V      0.5
                                                 2.7V  VCC  5.5V      1.3   10         s
                                                                     0.25
tBUF     Time the bus must be free before a new  4.5V  VCC  5.5V      0.6              s
         transmission can start(1)               2.7V  VCC  5.5V     0.25              s
                                                                      0.6              ns
tHD.STA  Start Hold Time                         4.5V  VCC  5.5V       0               s
                                                 2.7V  VCC  5.5V      100              ns

tSU.STA  Start Setup Time                        4.5V  VCC  5.5V     0.25              s
                                                 2.7V  VCC  5.5V      0.6              ns
                                                                      50               ms
tHD.DAT  Data In Hold Time                                                       Write Cycles
                                                                     100K
tSU.DAT  Data In Setup Time

tR       Inputs Rise Time(1)

tF       Inputs Fall Time(1)                     4.5V  VCC  5.5V
                                                 2.7V  VCC  5.5V

tSU.STO  Stop Setup Time                         4.5V  VCC  5.5V
                                                 2.7V  VCC  5.5V

tDH      Data Out Hold Time

tWR      Write Cycle Time

  Endurance(1) 5.0V, 25C, Page Mode

Notes: 1. This parameter is characterized and is not 100% tested.
            2. AC measurement conditions:
                RL (connects to VCC): 1.3 k (2.7V, 5V)
                Input pulse voltages: 0.3 VCC to 0.7 VCC
                Input rise and fall times: 50 ns
                Input and output timing reference voltages: 0.5 VCC

                                                                                                                                                                  5

1471HSEEPR03/03
Device     CLOCK and DATA TRANSITIONS: The SDA pin is normally pulled high with an external
Operation  device. Data on the SDA pin may change only during SCL low time periods (refer to Data
           Validity timing diagram). Data changes during SCL high periods will indicate a start or stop
           condition as defined below.

           START CONDITION: A high-to-low transition of SDA with SCL high is a start condition which
           must precede any other command (refer to Start and Stop Definition timing diagram).

           STOP CONDITION: A low-to-high transition of SDA with SCL high is a stop condition. After a
           read sequence, the Stop command will place the EEPROM in a standby power mode (refer to
           Start and Stop Definition timing diagram).

           ACKNOWLEDGE: All addresses and data words are serially transmitted to and from the
           EEPROM in 8-bit words. The EEPROM sends a zero during the ninth clock cycle to acknowl-
           edge that it has received each word.

           STANDBY MODE: The AT24C1024 features a low-power standby mode which is enabled: a)
           upon power-up and b) after the receipt of the STOP bit and the completion of any internal
           operations.

           MEMORY RESET: After an interruption in protocol, power loss or system reset, any 2-wire
           part can be reset by following these steps:
           1. Clock up to 9 cycles,
           2. Look for SDA high in each cycle while SCL is high.
           3. Create a start condition.

6 AT24C1024

             1471HSEEPR03/03
                                                      AT24C1024

Bus Timing (SCL: Serial Clock, SDA: Serial Data I/O)

Write Cycle Timing (SCL: Serial Clock, SDA: Serial Data I/O)

                                                                                                                      (1)
Note: 1. The write cycle time tWR is the time from a valid stop condition of a write sequence to the end of the internal clear/write cycle.

                                                                                                                                                                  7

1471HSEEPR03/03
Data Validity
Start and Stop Definition
Output Acknowledge

8 AT24C1024

                           1471HSEEPR03/03
Device                                                           AT24C1024
Addressing
            The 1024K EEPROM requires an 8-bit device address word following a start condition to
Write       enable the chip for a read or write operation (refer to Figure 1). The device address word con-
Operations  sists of a mandatory one, zero sequence for the first five most significant bits as shown. This is
            common to all 2-wire EEPROM devices.

            The 1024K uses the one device address bit, A1, to allow up to two devices on the same bus.
            The A1 bit must compare to the corresponding hardwired input pin. The A1 pin uses an inter-
            nal proprietary circuit that biases it to a logic low condition if the pin is allowed to float.

            The seventh bit (P0) of the device address is a memory page address bit. This memory page
            address bit is the most significant bit of the data word address that follows. The eighth bit of
            the device address is the read/write operation select bit. A read operation is initiated if this bit
            is high and a write operation is initiated if this bit is low.

            Upon a compare of the device address, the EEPROM will output a zero. If a compare is not
            made, the device will return to a standby state.

            DATA SECURITY: The AT24C1024 has a hardware data protection scheme that allows the
            user to write-protect the entire memory when the WP pin is at VCC.

            BYTE WRITE: To select a data word in the 1024K memory requires a 17-bit word address.
            The word address field consists of the P0 bit of the device address, then the most significant
            word address followed by the least significant word address (refer to Figure 2)

            A write operation requires the P0 bit and two 8-bit data word addresses following the device
            address word and acknowledgment. Upon receipt of this address, the EEPROM will again
            respond with a zero and then clock in the first 8-bit data word. Following receipt of the 8-bit
            data word, the EEPROM will output a zero. The addressing device, such as a microcontroller,
            then must terminate the write sequence with a stop condition. At this time the EEPROM enters
            an internally timed write cycle, TWR, to the nonvolatile memory. All inputs are disabled during
            this write cycle and the EEPROM will not respond until the write is complete (refer to Figure 2).

            PAGE WRITE: The 1024K EEPROM is capable of 256-byte page writes.

            A page write is initiated the same way as a byte write, but the microcontroller does not send a
            stop condition after the first data word is clocked in. Instead, after the EEPROM acknowledges
            receipt of the first data word, the microcontroller can transmit up to 255 more data words. The
            EEPROM will respond with a zero after each data word received. The microcontroller must ter-
            minate the page write sequence with a stop condition (refer to Figure 3).

            The data word address lower 8 bits are internally incremented following the receipt of each
            data word. The higher data word address bits are not incremented, retaining the memory page
            row location. When the word address, internally generated, reaches the page boundary, the
            following byte is placed at the beginning of the same page. If more than 256 data words are
            transmitted to the EEPROM, the data word address will "roll over" and previous data will be
            overwritten. The address "rollover" during write is from the last byte of the current page to the
            first byte of the same page.

            ACKNOWLEDGE POLLING: Once the internally timed write cycle has started and the
            EEPROM inputs are disabled, acknowledge polling can be initiated. This involves sending a
            start condition followed by the device address word. The read/write bit is representative of the
            operation desired. Only if the internal write cycle has completed will the EEPROM respond
            with a zero, allowing the read or write sequence to continue.

                                                                                                                                                                  9

1471HSEEPR03/03
Read        Read operations are initiated the same way as write operations with the exception that the
Operations  read/write select bit in the device address word is set to one. There are three read operations:
            current address read, random address read and sequential read.

            CURRENT ADDRESS READ: The internal data word address counter maintains the last
            address accessed during the last read or write operation, incremented by one. This address
            stays valid between operations as long as the chip power is maintained. The address "rollover"
            during read is from the last byte of the last memory page, to the first byte of the first page.

            Once the device address with the read/write select bit set to one is clocked in and acknowl-
            edged by the EEPROM, the current address data word is serially clocked out. The
            microcontroller does not respond with an input zero but does generate a following stop condi-
            tion (refer to Figure 4).

            RANDOM READ: A random read requires a "dummy" byte write sequence to load in the data
            word address. Once the device address word and data word address are clocked in and
            acknowledged by the EEPROM, the microcontroller must generate another start condition.
            The microcontroller now initiates a current address read by sending a device address with the
            read/write select bit high. The EEPROM acknowledges the device address and serially clocks
            out the data word. The microcontroller does not respond with a zero but does generate a fol-
            lowing stop condition (refer to Figure 5).

            SEQUENTIAL READ: Sequential reads are initiated by either a current address read or a ran-
            dom address read. After the microcontroller receives a data word, it responds with an
            acknowledge. As long as the EEPROM receives an acknowledge, it will continue to increment
            the data word address and serially clock out sequential data words. When the memory
            address limit is reached, the data word address will "roll over" and the sequential read will con-
            tinue. The sequential read operation is terminated when the microcontroller does not respond
            with a zero, but does generate a following stop condition (refer to Figure 6).

10 AT24C1024

              1471HSEEPR03/03
                                                                                                                                                                                                            AT24C1024

Figure 1. Device Address

                                                                                                                                                                                            0

Figure 2. Byte Write

                                                      MOST                                                                                                                                        LEAST
                                                  SIGNIFICANT                                                                                                                                  SIGNIFICANT

                                P0

Figure 3. Page Write

                                          MOST       LEAST
                                     SIGNIFICANT  SIGNIFICANT

                      P0

Figure 4. Current Address Read

                                                                                                                                                                11

1471HSEEPR03/03
Figure 5. Random Read

                                                                     P0

Figure 6. Sequential Read

                                                                     P0

12 AT24C1024

                                                                         1471HSEEPR03/03
                                                                                AT24C1024

Ordering Information

                    Ordering Code  Package                                      Operation Range

AT24C1024-10CI-2.7                 8CN3                                             Industrial
AT24C1024C1-10CI-2.7               8CN1                                         (-40C to 85C)
AT24C1024-10PI-2.7                  8P3
AT24C1024W-10SI-2.7                 8S2

AT24C1024-10UI-2.7                 8U8

Note: For 2.7V devices used in the 4.5V to 5.5V range, please refer to performance values in the AC and DC Characteristics tables.

8CN3                                                           Package Type
8CN1  8-lead, 0.230" Wide, Leadless Array Package (LAP)
8P3   8-lead, 0.300" Wide, Leadless Array Package (LAP)
8S2   8-lead, 0.300" Wide, Plastic Dual In-line Package (PDIP)
8U8   8-lead, 0.200" Wide, Plastic Gull Wing Small Outline Package (EIAJ SOIC)
      8-ball, die Ball Grid Array Package (dBGA)
-2.7
                                                                    Options
      Low Voltage (2.7V to 5.5V)

                                                                                                                                                                13

1471HSEEPR03/03
Packaging Information

8CN3 LAP

                             Marked Pin1 Indentifier

E

                                D                                          A
                                                                            A1
                         Top View
                                                             Side View
                                                      L1
                                                               Pin1 Corner

0.10 mm       8                                       1
   TYP
                                                                                    COMMON DIMENSIONS
       e                                                                             (Unit of Measure = mm)

              7                                           2

                                                                SYMBOL MIN NOM MAX NOTE

                                                          3                     A   0.94  1.04                   1.14

              6

                                                             b                  A1  0.30  0.34 0.38

                                                                                b   0.36  0.41                   0.46  1

              5                                           4                     D   5.89  5.99                   6.09

                                                                                E   4.83  4.93                   5.03

          e1                                          L                         e         1.27 BSC

                 Bottom View                                                    e1        0.56 REF

                                                                                L   0.62  0.67                   0.72  1

                                                                                L1  0.92  0.97                   1.02  1

Note: 1. Metal Pad Dimensions.

                                                                                                                       11/14/01

                                                      TITLE                                                      DRAWING NO. REV.

   2325 Orchard Parkway                               8CN3, 8-lead, (6 x 5 x 1.04 mm Body), Lead Pitch 1.27 mm,  8CN3     A
R San Jose, CA 95131                                  Leadless Array Package (LAP)

14 AT24C1024

                                                                                                                 1471HSEEPR03/03
                                                                                                AT24C1024

8CN1 LAP

                             Marked Pin1 Indentifier

E

                              D                                            A
                                                                            A1
                         Top View
                                                             Side View
                                                      L1
                                                               Pin1 Corner

0.10 mm         8                                     1
   TYP
                                                                                    COMMON DIMENSIONS
       e                                                                             (Unit of Measure = mm)

                7                                         2

                                                                SYMBOL MIN NOM MAX NOTE

                                                          3                     A   0.94  1.04      1.14

                6

                                                             b                  A1  0.30  0.34 0.38

                                                                                b   0.36  0.41      0.46     1

                5                                         4                     D   7.90  8.00      8.10

                                                                                E   4.90  5.00      5.10

            e1                                        L                         e         1.27 BSC

                   Bottom View                                                  e1        0.60 REF

                                                                                L   0.62  0.67      0.72     1

                                                                                L1  0.92  0.97      1.02     1

Note: 1. Metal Pad Dimensions.

                                                                                                             11/13/01

                                TITLE                                                           DRAWING NO. REV.

   2325 Orchard Parkway         8CN1, 8-lead (8 x 5 x 1.04 mm Body), Lead Pitch 1.27 mm,            8CN1        A
R San Jose, CA 95131            Leadless Array Package (LAP)

                                                                                                                                                                15

1471HSEEPR03/03
8P3 PDIP

                                    1         E

                                              E1

                                   N          c
                                                              eA
                Top View
                                                       End View

                D                                                                   COMMON DIMENSIONS
                                                                                    (Unit of Measure = inches)
                                 e

        D1                              A2 A  SYMBOL                                MIN NOM MAX                      NOTE
                                                  A                                                           0.210   2
                                    b2  L         A2
                                                  b                                 0.115 0.130 0.195                 5
          b3                        b             b2                                0.014 0.018 0.022                 6
                                                  b3                                0.045 0.060 0.070                 6
        4 PLCS                                    c                                 0.030 0.039 0.045
                                                  D                                 0.008 0.010 0.014                 3
                Side View                         D1                                0.355 0.365 0.400                 3
                                                  E                                 0.005                             4
                                                  E1                                0.300 0.310 0.325                 3
                                                  e                                 0.240 0.250 0.280
                                                  eA                                                                  4
                                                  L                                         0.100 BSC                 2
                                                                                            0.300 BSC
                                                                                    0.115 0.130 0.150

Notes:  1. This drawing is for general information only; refer to JEDEC Drawing MS-001, Variation BA for additional information.
        2. Dimensions A and L are measured with the package seated in JEDEC seating plane Gauge GS-3.
        3. D, D1 and E1 dimensions do not include mold Flash or protrusions. Mold Flash or protrusions shall not exceed 0.010 inch.
        4. E and eA measured with the leads constrained to be perpendicular to datum.
        5. Pointed or rounded lead tips are preferred to ease insertion.
        6. b2 and b3 maximum dimensions do not include Dambar protrusions. Dambar protrusions shall not exceed 0.010 (0.25 mm).

                                                                                                                     01/09/02

                                       TITLE                                        DRAWING NO. REV.
                                       8P3, 8-lead, 0.300" Wide Body, Plastic Dual
           2325 Orchard Parkway        In-line Package (PDIP)                       8P3                                              B
        R San Jose, CA 95131

16 AT24C1024

                                                                                    1471HSEEPR03/03
                                                                                    AT24C1024

8S2 EIAJ SOIC

                 1

                              H

                                        N

                 Top View

e                        b

                                           A

                   D                                                                COMMON DIMENSIONS
                                                                                     (Unit of Measure = mm)
                 Side View

A1                                            C  SYMBOL                             MIN NOM            MAX   NOTE
                                                     A                              1.78               2.03
    L                                                A1                             0.05               0.33   5
               E                                     b                              0.35               0.51   5
                                                     C                              0.18               0.25   2, 3
          End View                                   D                              5.13               5.38
                                                     E                              5.13               5.41   4
                                                     H                              7.62               8.38
                                                     L                              0.51               0.89
                                                     e
                                                                                             1.27 BSC

Notes: 1. This drawing is for general information only; refer to EIAJ Drawing EDR-7320 for additional information.
          2. Mismatch of the upper and lower dies and resin burrs aren't included.
          3. It is recommended that upper and lower cavities be equal. If they are different, the larger dimension shall be regarded.
          4. Determines the true geometric position.
          5. Values b,C apply to pb/Sn solder plated terminal. The standard thickness of the solder layer shall be 0.010 +0.010/-0.005 mm.

                                                                                                                                                                   5/2/02

                                           TITLE                                    DRAWING NO. REV.
                                           8S2, 8-lead, 0.209" Body, Plastic Small
   2325 Orchard Parkway                    Outline Package (EIAJ)                                      8S2          B
R San Jose, CA 95131

                                                                                                                                                                17

1471HSEEPR03/03
8U8 dBGA

                                            E

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    D        this corner

       Top View

                                                  - Z-

                81                             #                                            COMMON DIMENSIONS
                                                                                             (Unit of Measure = mm)
                72                             b#               SYMBOL                                                     NOTE
                                                                     D                      MIN NOM MAX
                 63                              0 . 1 5MZXY#        D1                                               3.84
                                                 0 . 0 8MZ           E
d                                             #                     E1                                  0.80 TYP
                                                    A2               e                                                2.85
                 54                                     A            d
                                                         A1          A                                   1.05 TYP
D1                                                                   A1                                  0.75 TYP
                                                      Side View      A2                                  0.75 TYP
E1                      e                                            b                                  0.90 REF
                                                                                            0.49 0.52 0.55
Bottom View                                                                                 0.35 0.38 0.41
                                                                                            0.47 0.50 0.53

Notes: 1. This drawing is for general information only. No JEDEC Drawing to refer to for additional information.            01/09/02
         2. Dimension is measured at the maximum solder ball diameter, parallel to primary datum Z.

                                               TITLE                                                              DRAWING NO. REV.
                                               8U8, 8-ball 0.75 pitch, Die Ball Grid Array
  2325 Orchard Parkway                         Package (dBGA) AT24C1024 (AT35520)                                 8U8             A
R San Jose, CA 95131

18 AT24C1024

                                                                                                                  1471HSEEPR03/03
Atmel Corporation             Atmel Operations                       RF/Automotive
                                                                       Theresienstrasse 2
  2325 Orchard Parkway        Memory                                   Postfach 3535
  San Jose, CA 95131            2325 Orchard Parkway                   74025 Heilbronn, Germany
  Tel: 1(408) 441-0311          San Jose, CA 95131                     Tel: (49) 71-31-67-0
  Fax: 1(408) 487-2600          Tel: 1(408) 441-0311                   Fax: (49) 71-31-67-2340
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Regional Headquarters                                                  Colorado Springs, CO 80906
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Europe                          2325 Orchard Parkway                   Fax: 1(719) 540-1759
  Atmel Sarl                    San Jose, CA 95131
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  Switzerland                   La Chantrerie                          Avenue de Rochepleine
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Asia                            Fax: (33) 2-40-18-19-60                Fax: (33) 4-76-58-34-80
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